KR200156564Y1 - 직렬 통신장치 - Google Patents

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KR200156564Y1
KR200156564Y1 KR2019960045978U KR19960045978U KR200156564Y1 KR 200156564 Y1 KR200156564 Y1 KR 200156564Y1 KR 2019960045978 U KR2019960045978 U KR 2019960045978U KR 19960045978 U KR19960045978 U KR 19960045978U KR 200156564 Y1 KR200156564 Y1 KR 200156564Y1
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서평원
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Abstract

본 고안은 여러가지 통신 규약에 따른 직렬 통신을 구한함으로써 통신 규약이 다른 직렬 통신 종속 디바이스를 사용하는데 있어서의 호환성을 향상시키도록 한 직렬 통신장치에 관한 것이다.
종래의 직렬 통신장치는 직렬 통신 디바이스의 통신 규약이 다르기 때문에 각각에 맞는 제어기를 별도로 사용해야 하기 때문에 호환성이 결여되는 문제점이 있었다.
이것을 해결하기 위해, 본 고안은 직렬 통신 규약에 따라 데이터를 송수신하기 위한 제어신호를 전송하는 프로세서와, 프로세서로부터 전송된 제어신호에 따라 제어신호를 출력하는 제어 신호 발생기와, 제어 신호 발생기로부터 전송된 제어신호에 따라 상기 프로세서로부터 전송된 직렬 통신 규약에 따른 데이터의 송수신을 결성하기 위한 제 1∼n 양방향 버퍼와, 제 1∼n 양방향 버퍼로부터 전송된 송수신 데이터에 따라 데이터를 송수신하기 위한 송수신된 클럭과 제어 데이터에 따라 그에 해당하는 동작을 수행하는 제 1∼n 직렬 통신 종속 디바이스로 구성된 것이다.

Description

직렬 통신장치
본 고안은 직렬 통신장치에 관한 것으로, 특히 여러 가지 통신 규약에 따른 직렬 통신을 구현함으로써 통신 규약이 다른 직렬 통신 종속 디바이스를 사용하는데 있어서의 호환성을 향상시키도록 한 직렬 통신장치에 관한 것이다.
종래의 직렬 통신장치는 제1도 에 도시된 바와같이, 직렬 클럭과 제어 데이터의 송수신을 제어하는 직렬 통신 제어기(1)와, 상기 직렬 통신 제어기(1)로부터 송수신 된 클럭과 제어 데이터에 따라 동작하는 직렬 통신 종속 디바이스(2)로 구성되어져 있다.
이와 같이 구성된 종래 직렬 통신장치의 동작을 설명하면 다음과 같다.
먼저, 직렬 통신 제어기(1)는 직렬 통신을 하기 위하여 직렬 클럭을 전송하게 되고, 아울러 데이터 송수신을 위한 제어 데이터를 전송하게 된다.
그러면, 직렬 통신 종속 디바이스(2)는 상기 직렬 통신 제어기(1)로부터 송수신 된 클럭과 제어 데이터를 검색하여 그에 해당하는 동작을 수행하게 된다.
즉, 직렬 통신 종속 디바이스(2)는 상기 검색 결과 수신 제어신호라면 상기 제어 데이터 다음에 연속되는 데이터를 수신하게 되고, 송신 제어 데이터라면 요구되는 데이터를 송신하게 된다.
여기서, 풀업 저항(R1)은 상기 직렬 통신 제어기(1)로부터 전송된 제어 데이터의 데이터 선로를 보상하기 위한 것이다.
그러나 이러한 종래의 직렬 통신장치는 직렬 통신 디바이스의 통신 규약이 다르기 때문에 각각에 맞는 제어기를 별도로 사용해야 하기 때문에 호환성이 결여되는 문제점이 있었다.
따라서 본 고안은 여러 가지 통신 규약에 따른 직렬 통신을 구현함으로써 통신 규약이 다른 직렬 통신 종속 디바이스를 사용하는데 있어서의 호환성을 향상시키도록 한 직렬 통신장치를 제공하는데 그 목적이 있다.
제1도는 종래의 직렬 통신장치의 블럭 구성도.
제2도는 본 고안에 의한 직렬 통신장치의 블럭 구성도.
* 도면의 주요부분에 대한 부호의 설명
101 : 프로세서 102 : 제어 신호 발생기
103-1∼103-n : 제 1∼ n 양방향 버퍼
104-1∼104-n : 직렬 통신 종속 디바이스
이하, 본 고안을 첨부한 도면에 의거하여 상세히 설명하면 다음과 같다.
제2도는 본 고안에 의한 직렬 통신장치의 블럭 구성도를 니타낸 것으로서, 직렬 통신 규약에 따라 데이티를 송수신하기 위한 제어신호를 전송하는 프로세서(101)와, 상기 프로세서(101)의 출력단에 연결되어 프로세서(101)로부터 전송된 제어신호에 따라 제어신호를 출력하는 제어신호발생기(102)와, 상기 제어신호발생기(102)의 출력단에 연결되어 제어신호발생기(102)로부터 전송된 제어신호에 따라 상기 프로세서(101)로부터 전송된 직렬 통신 규약에 따른 데이터의 송수신을 결정하기 위한 제1∼n 양방향 버퍼(103-1∼103-n)와, 상기 제 1∼n 양방향 버퍼(103-1∼103-n)의 출력단에 연결되어 제 1∼n양방향 버퍼(103-1∼103-n)로부터 전송된 송수신 데이터에 따라 데이터를 송수신하기 위한 송수신된 클럭과 제어 데이터에 따라 그에 해당하는 동작을 수행하는 제 1∼n 직렬 통신 종속 디바이스(104-1∼104-n)로 구성되어져 있다.
이와 같이 구성된 본 고안의 동작 및 작용효과를 설명하면 다음과 같다.
먼저 프로세서(101)가 직렬 통신 종속 디바이스(104-1)에 데이터를 송수신하고자 할 때 프로세서(101)는 직렬 통신 종속 디바이스(104-1)을 위한 일련의 제어신호(어드레스 버스, 쓰기 신호, 읽기 신호 등)을 출력한다. 이러한 신호들은 제어신호발생기(102)로 입력되고 제어신호 발생기는 이 신호들을 사용하여 양방향 버퍼(103-1∼103-n) 들은 동작하지 않도록 한다.
직렬 통신 종속 디바이스(104-1)와 양방향 버퍼(103-1)사이의 클럭과 데이터 선로는 프로세서(101)의 데이터 버스를 사용하여 프로세서(101)가 다양한 신호 규약을 제어할 수 있게 한다.
즉 프로세서(101)가 비트 연산을 통해 클럭의 속도와 데이터의 양식을 직렬 통신 종속 디바이스(104-)에 맞게 변환함으로써 직렬 통신 종속 디바이스(104-1)와의 데이터 송수신이 가능한 것이다.
위의 설명은 프로세서(101)가 직렬 통신 종속 디바이스(104-1)와 데이터를 송수신할때의 동작을 설명한 것이다.
직렬 통신 종속 디바이스(104-1)와 나머지 직렬 통신 종속 디바이스(104-2 ∼104-n)들과는 서로신호 규약(클럭의 속도 및 데이터의 양식)이 다르기 때문에 프로세서(101)가 비트 연산을 통해 이들을 제어한다.
상기와 같이 제어신호발생기(102)가 각각의 제 1∼n 양방향 버퍼(103-1∼103-n)를 제어하게 되므로 여러개의 다양한 제 1∼n 직렬 통신 종속 디바이스(104-1∼104-n)를 함께 사용할 수가 있다.
이렇게 함으로써 I2C(Inti1-Integated Circuit)버스를 통한 직렬 통신이나 FPGA(Field Programmale Gate Array) 등의 직렬 다운로드가 가능하게 된다.
이상에서 설명한 바와같이 본 고안은 이러 가지 통신 규약에 따른 직렬 통신을 구현함으로써 통신 규약이 다른 직렬 통신 종속 디바이스를 사용하는데 있어서 호환성을 향상시킬 수 있는 효과가 있다.

Claims (1)

  1. 직렬 통신 규약에 따라 데이타를 송수신하기 위한 제어신호를 전송하는 프로세서(101)와, 상기 프로세서(101)의 출력단에 언결되어 프로세서(101)로부터 신송된 제어신호에 따라 제어신호를 출력하는 제어신호발생기(102)와, 상기 제어신호발생기(102)의 출력단에 연결되어 제어신호발생기(102)로부터 전송된 제어신호에 따라 상기 프로세서(101)로부터 진송된 직렬 통신 규약에 따른 데이터의 송수신을 결정하기 위한 제 1∼n 양방향 버퍼(103-1∼103-n)와, 상기 제 1∼n 양방향 버퍼(103-1∼103-n)의 출력단에 연결되어 제 1∼n양방향 버퍼 (103-1∼103-n)로부터 전송된 송수신 데이터에 따라 데이터를 송수신하기 위한 송수신된 클럭과 제어 데이터에 따라 그에 해당하는 동작을 수행하는 제 1∼n 직렬통신 종속 디바이스(104-1∼104-n)를 포함하여 구성된 것을 특징으로 하는 직렬 통신장치.
KR2019960045978U 1996-12-06 1996-12-06 직렬 통신장치 KR200156564Y1 (ko)

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