KR20010087707A - 에이티엠 셀 다중화 및 역다중화 장치 - Google Patents

에이티엠 셀 다중화 및 역다중화 장치 Download PDF

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Abstract

본 발명은 ATM(Asynchronous Transfer Mode) 셀(Cell) 다중화 및 역다중화 장치에 관한 것으로, 특히 물리계층 보드(Physical Layer Board)로부터 입력된 ATM 셀을 다중화하여 라우팅(Routing) 정보를 추가시켜 스위치 망(Switching Network)에 전송하며, 해당 스위치 망으로부터 수신한 ATM 셀을 역다중화하도록 한 ATM 셀 다중화 및 역다중화 장치에 관한 것이다.
본 발명은 시스템 클럭을 수신해 각 구성 블록에 분배하며, 선로 장치에서 사용할 클럭을 생성하는 클럭부와; 가입자 정합 모듈의 각종 OAM 기능과 연결 관리 기능을 수행하며, 내부 메시지를 통해 상위 제어 모듈과 통신을 수행하는 제어부와; 각각의 선로 장치로부터 수신되는 ATM 셀을 라운드 로빈 방식으로 다중화시켜 주며, ATM 셀을 역다중화하여 해당 선로 장치로 출력하는 물리계층 인터페이스부와; 수신한 내부 셀을 블록 코딩하고 직렬 데이터로 변환시켜 스위치 망으로 전송하며, 해당 스위치 망으로부터 수신한 내부 셀을 블록 코딩하고 직렬 데이터로 변환시켜 스위치 망으로 전송하며, 해당 스위치 망으로부터 수신한 직렬 데이터를 병렬 데이터로 변환하고 블록 코딩된 데이터를 디코딩시켜 주는 스위치 링크 정합부와; 상기 물리계층 인터페이스부로부터 수신한 ATM 셀을 구분하여 상기 스위치 링크 정합부 또는 제어부로 인가하며, 상기 스위치 링크 정합부 또는 제어부로부터 수신한 데이터를 ATM 셀로 변환시켜 상기 물리계층 인터페이스부로 인가하는 ATM계층 처리부를 포함하여 이루어진 것을 특징으로 한다.

Description

에이티엠 셀 다중화 및 역다중화 장치 {a ATM Cell Multiplying and Demultiplying Apparatus}
본 발명은 ATM 셀 다중화 및 역다중화 장치에 관한 것으로, 특히 물리계층 보드(Physical Layer Board)로부터 입력된 ATM 셀을 다중화하여 라우팅(Routing) 정보를 추가시켜 스위치 망(Switching Network)에 전송하며, 해당 스위치 망으로부터 수신한 ATM 셀을 역다중화하도록 한 ATM 셀 다중화 및 역다중화 장치에 관한 것이다.
종래의 ATM 셀 다중화 및 역다중화 지원 기능은 DS1(즉, T1)/E1 급 64 링크(Link)를 지원하고 스위치 망에서 수신된 ATM 셀을 가입자에게 전송하고 가입자로부터 수신된 셀을 스위치 망으로 전송하는 기능을 수행하였는데, DS1/E1 급 지원 물리계층 장치의 연결과 상위 프로세서와의 상태 관리 등을 담당하였다. 그러나, 트래픽 제어(Traffic Control)를 UPC(User Parameter Control)만 지원하였고스페이싱(Spacing) 기능과 UBR(Unspecified Baud Rate) 연결은 지원하지 못 했으며, 또한 CC(Continuity Check)와 PM(Performance Monitoring)에 관련된 여러 OAM(Operation Administration and Maintenance) 기능의 구현이 미비하였다.
다시 말해서, 종래의 ATM 셀 다중화 및 역다중화 장치는 트래픽 제어 시에 지원되는 서비스가 CBR(Constant Bit Rate), VBR(Variable Bit Rae) 및 UBR(Unspecified Bit Rate)로 제한되는 단점이 있었고 ATM 망 이외의 망과 ATM 망과의 인터페이스를 위한 장치가 각각 존재하기 때문에 시스템 비용의 고가화와 관리의 어려움이 있었다.
그리고, 종래의 ATM 셀 다중화 및 역다중화 장치는 시그널링 셀(Signaling Cell)의 경우에 1 셀 단위로 처리될 수밖에 없는 구조적인 한계가 있기 때문에, 2 셀 이상으로 처리하게 되어 트래픽의 폭주가 발생하는 경우에는 시그널링 셀이 타임아웃(Time Out)되는 경우가 많아지게 되고 이로 인해 재전송 요구가 빈번하게 발생하여 호 처리 성능이 현저하게 저하되는 현상이 발생하는 문제점이 있었다. 또한, IPC(Inter Processor Communication) 셀 처리의 경우에도 1 셀 처리 제약으로 인한 IPC 셀의 다량 발생은 시스템의 성능에 큰 영향을 미치는 문제점이 있었다.
전술한 바와 같은 단점 내지는 문제점을 해결하기 위한 것으로, 본 발명은 ATM 가입자 셀 다중화 및 역다중화 처리 장치에서 DS1/E1 급 64 링크, DS3 급 3 링크의 ATM 망 이외의 망의 FR(Frame Relay), CE(Circuit Emulation) 및 ATM 전송을혼합 수용하여 관리하며, DS1/E1 급 72 링크의 가입자 인터페이스를 제공하는 물리계층 보드로부터 입력된 ATM 셀을 다중화하여 라우팅 정보를 추가시켜 스위치 망에 전송하며, 해당 스위치 망으로부터 수신한 ATM 셀을 역다중화하도록 하는데 그 목적이 있다.
도 1은 본 발명의 실시 예에 따른 ATM(Asynchronous Transfer Mode) 셀 다중화 및 역다중화 장치를 나타낸 구성 블록도.
도 2는 도 1에 있어 제어부를 나타낸 구성 블록도.
도 3은 도 1에 있어 물리계층 셀 버스상의 셀 형식을 나타낸 도면.
도 4는 도 1에 있어 물리계층 인터페이스부에 의해 다중화된 셀의 출력 형식을 나타낸 도면.
* 도면의 주요 부분에 대한 부호의 설명 *
10 : 물리계층 인터페이스부 20 : ATM 계층 처리부
30 : 스위치 링크 정합부 40 : 클럭부
50 : 제어부 51 : RS232C 수신부
52 : 이더넷 수신부 53 : OSC(Oscillator)
54 : CPU(Central Processing Unit)
55 : 플래쉬(Flash) ROM(Read Only Memory)
56 : SRAM(Static Random Access Memory)
57 : DRAM(Dynamic RAM)
58 : PBA(Printed Board Assembly) 상태 감지부
59 : EPLD
상술한 바와 같은 목적을 달성하기 위한 본 발명은 시스템 클럭을 수신해 각 구성 블록에 분배하며, 선로 장치에서 사용할 클럭을 생성하는 클럭부와; 가입자 정합 모듈의 각종 OAM 기능과 연결 관리 기능을 수행하며, 내부 메시지를 통해 상위 제어 모듈과 통신을 수행하는 제어부와; 각각의 선로 장치로부터 수신되는 ATM 셀을 라운드 로빈 방식으로 다중화시켜 주며, ATM 셀을 역다중화하여 해당 선로 장치로 출력하는 물리계층 인터페이스부와; 수신한 내부 셀을 블록 코딩하고 직렬 데이터로 변환시켜 스위치 망으로 전송하며, 해당 스위치 망으로부터 수신한 내부 셀을 블록 코딩하고 직렬 데이터로 변환시켜 스위치 망으로 전송하며, 해당 스위치 망으로부터 수신한 직렬 데이터를 병렬 데이터로 변환하고 블록 코딩된 데이터를 디코딩시켜 주는 스위치 링크 정합부와; 상기 물리계층 인터페이스부로부터 수신한 ATM 셀을 구분하여 상기 스위치 링크 정합부 또는 제어부로 인가하며, 상기 스위치 링크 정합부 또는 제어부로부터 수신한 데이터를 ATM 셀로 변환시켜 상기 물리계층 인터페이스부로 인가하는 ATM 계층 처리부를 포함하여 이루어진 것을 특징으로 한다.
여기서, 상기 ATM 계층 처리부는 상기 물리계층 인터페이스부로부터 수신되는 ATM 셀을 UPC를 통해 감시하여 트래픽을 위반하지 않은 ATM 셀에 대해 라우팅 정보를 부가하고 헤더 변환을 수행한 후에 상기 스위치 링크 정합부로 인가하는 수신 ATM 계층 처리부와; 상기 스위치 링크 정합부로부터 수신한 내부 셀을 ATM 셀로 변환하고 PBA 비트 맵과 출력 선로 번호를 부가해 주며, 상기 제어부로부터 수신한 신호 처리용 셀이나 OAM 셀을 ATM 셀로 변환시켜 상기 물리계층 인터페이스부로 인가하는 송신 ATM 계층 처리부를 포함하여 이루어진 것을 특징으로 한다.
그리고, 상기 수신 ATM 계층 처리부는 상기 물리계층 인터페이스부로부터 수신한 셀의 헤더로부터 VPI와 VCI를 분석해 VPC용인지 또는 VCC용인지를 확인하며, VP 인덱스와 VCI를 이용해 연결 관리 테이블을 검색하여 연결 식별자를 추출하며, 연결 식별자, 셀 동기 신호 및 유효 셀 신호를 SPLI로 출력해 사용자 파라메터를 위반한 셀을 각 모드에 따라 폐기하거나 태깅하며, 사용자 선택에 의해 스페이싱을 수행한 후에 헤더 변환을 수행하고 라우팅 택을 부가해 56 바이트 셀을 출력하며, 각 연결 별로 입력된 셀 수 및 사용자 파라메터 위반/폐기된 셀의 수를 계수하며, 연속성 검사가 등록된 연결의 경우에 설정된 시간 동안에 셀이 입력되지 않으면 해당 연결 식별자를 알려주고 성능 감시가 등록된 연결의 경우에 성능 감시 기능을 수행하며, 수신 셀이 신호 처리용 셀이거나 OAM 셀인 경우에 상기 제어부로 인가해 주는 것을 특징으로 한다. 또한, 상기 송신 ATM 계층 처리부는 상기 스위치 링크 정합부로부터 수신되는 사용자 셀과 관리 셀을 다중화하고 해당 다중화된 셀의 헤더로부터 VPI와 VCI를 분석하여 VPC용인지 또는 VCC용인지를 확인하며, VP 인덱스또는 멀티캐스팅 인덱스와 VCI를 이용해 연결 관리 테이블을 검색하여 연결 식별자와 다중화된 셀을 출력하며, 수신 셀이 없는 경우에 OAM 셀 전송 요구가 있는지를 확인하여 연결 식별자를 판독해 OAM 셀 전송 요구와 연결 식별자를 출력하며, 셀을 SPLI로 입력시켜 각 모드에 따라 폴리싱 및 스페이싱된 셀을 입력받으며, 수신 셀이 사용자 셀인 경우에 셀을 계수하고 성능 감시를 수행하여 그 결과를 성능 감시 테이블에 기록하며, 해당 사용자 셀이 전송될 셀인지 또는 루프백될 셀인지를 판단하여 처리하며, 운용자가 설정한 성능 감시 블록 셀의 수만큼 셀이 전송된 경우나 해당 전송된 셀의 연속성 검사를 수행해 연속성을 위반한 경우에 연결 식별자를 기록하는 것을 특징으로 한다.
본 발명은 ATM 시스템에서 DS1/E1 급 가입자를 망에 접속 서비스할 수 있도록 하는 처리 장치에 있어서, DS1/E1 급 가입자 72 링크를 다중화 및 역다중화하여 ATM 시스템에서 제공하는 여러 서비스를 가능하도록 하는데, 즉 DS1, DS1E(즉, E1), FR DS1, FR DS1E, FR DS3, CE DS1, CE DS1E, CE DS3 등의 여러 종류의 물리계층 인터페이스를 망에 접속 서비스할 수 있도록 처리함으로써 여러 종류의 가입자를 다중화 및 역다중화하여 ATM 시스템에서 제공하는 여러 서비스를 가능하게 해 준다. 또한, 본 발명은 사용자 트래픽의 ABR(Available Bit Rate) 서비스를 선택 지원 가능하도록 하여 사용자 트래픽의 계약 위반을 감시하며, OAM 기능을 처리하도록 해 준다. 이하, 본 발명의 실시 예를 첨부한 도면을 참조하여 상세하게 설명하면 다음과 같다.
본 발명의 실시 예에 따른 ATM 셀 다중화 및 역다중화 장치는 도 1에 도시한 바와 같이, 물리계층 인터페이스부(10)와, ATM 계층 처리부(20)와, 스위치 링크 정합부(30)와, 클럭부(40)와, 제어부(50)를 포함하여 이루어진다.
상기 물리계층 인터페이스부(10)는 각각의 물리계층 PBA로부터 16 비트 버스를 통해 셀 전송 요구 신호를 수신한 경우에 해당 물리계층 PBA로 판독 신호를 송출시켜 ATM 셀을 수신하여 상기 ATM 계층 처리부(20)로 인가하며, 상기 ATM 계층 처리부(20)로부터 수신한 ATM 셀을 해당 물리계층 PBA로 인가해 준다. 여기서, 해당 물리계층 PBA는 DS1, DS1E, FR DS1, FR DS1E, FR DS3, CE DS1, CE DS1E, CE DS3 등의 여러 종류의 프레임 신호를 수신하여 프레임의 오버헤드에 포함된 각종 유지 보수 신호를 처리하는 장치이다.
상기 ATM 계층 처리부(20)는 상기 물리계층 인터페이스부(10)로부터 수신한 ATM 셀이 사용자 셀인 경우에 라우팅 정보가 부가된 내부 셀을 상기 스위치 링크 정합부(30)로 인가해 주며, 상기 스위치 링크 정합부(30)로부터 수신한 내부 셀을 ATM 셀로 변환시켜 상기 물리계층 인터페이스부(10)로 인가해 주며, 상기 물리계층 인터페이스부(10)로부터 수신한 ATM 셀이 신호 처리용 셀이거나 OAM 셀인 경우에 상기 제어부(50)로 인가해 해당 신호 처리용 셀이나 OAM 셀이 상기 제어부(50)에서 처리되도록 해 주며, 상기 제어부(50)로부터 수신한 신호 처리용 셀이나 OAM 셀을 ATM 셀로 변환시켜 상기 물리계층 인터페이스부(10)로 인가해 준다. 그리고, 상기 ATM 계층 처리부(20)는 UPC를 수행한 후에 트래픽을 위반하지 않은 셀에 대해 라우팅 정보를 부가하고 헤더 변환을 수행한 후에 상기 스위치 링크 정합부(30)로 인가하는 수신 ATM 계층 처리부(21)와, 상기 스위치 링크 정합부(30)로 수신한 내부 셀을 ATM 셀로 변환하고 PBA 비트 맵과 출력 선로 번호를 부가하여 상기 물리계층 인터페이스부(10)로 인가하는 송신 ATM 계층 처리부(22)를 포함하여 이루어진다.
상기 스위치 링크 정합부(30)는 상기 ATM 계층 처리부(20)로부터 수신한 내부 셀에 대해 블록 코딩(Block Coding)을 수행하고 직렬 데이터로 변환시켜 스위치 링크를 통해 스위치 망으로 전송해 주며, 해당 스위치 망으로부터 수신한 직렬 데이터를 병렬 데이터로 변환하고 블록 코딩된 데이터를 디코딩하여 상기 ATM 계층 처리부(20)로 인가해 주며, 상기 제어부(50)로부터 인가된 메시지 셀을 사용자 셀과 다중화시켜 스위치 망으로 전송해 주며, 해당 스위치 망으로부터 수신한 셀 중에서 내부 메시지 셀을 상기 제어부(50)로 전달해 준다.
상기 클럭부(40)는 로컬 클럭 분배부로부터 시스템 클럭(즉, 46.94(MHz))을 수신하여 236(MHz) 및 46.94(MHz) 클럭을 생성시켜 상기 물리계층 인터페이스부(10), ATM 계층 처리부(20) 및 스위치 링크 정합부(30)로 분배해 주며, ECL(Emitter coupled Logic) 버퍼(Buffer)와 ECL에서 TTL(Transistor-transistor Logic Circuit)로의 변환 소자를 이용하여 선로 장치에서 사용 가능한 클럭을 생성시켜 전달해 준다.
상기 제어부(50)는 가입자 정합 모듈의 각종 OAM 기능과 연결 관리 기능을 수행하며, 내부 메시지를 통해 상위 제어 모듈과 통신을 수행한다. 그리고, 상기 제어부(50)는 도 2에 도시된 바와 같이, RS232C 수신부(51)와, 이더넷 수신부(52)와, OSC(53)와, 'MC860SAR'의 CPU(54)와, 플래쉬 ROM(55)과, SRAM(56)과, DRAM(57)과, PBA 상태 감지부(58)와, 어드레스 디코더로 사용되는 EPLD(59)를 포함하여 이루어진다.
본 발명의 실시 예에 따른 ATM 셀 다중화 및 역다중화 장치의 동작을 설명하면 다음과 같다.
먼저, 8 개의 물리계층 링크 인터페이스를 제공하는 LPLA에서 물리 계층의 프레임을 처리한 후에 추출된 53 바이트 ATM 셀에 LPLA PBA 구분자 및 링크 번호를 추가한 56 바이트 셀을 16 비트 단위로 FIFO(First in First out)에 기록한 후, 물리계층 인터페이스부(10)에게 물리계층으로 전송할 셀이 존재함으로 알리는 셀 전송 요구 신호를 생성한다.
그리고, 상기 셀 전송 요구 신호가 16 비트 버스를 통해 상기 물리계층 인터페이스부(10)에 수신되는 경우, 상기 물리계층 인터페이스부(10)는 해당 LPLA로 셀 판독 신호를 송출시켜 해당 LPLA로부터 ATM 셀을 수신하는데, 각 링크 가입자를 라운드 로빈(Round Robin) 방식으로 다중화하여 ATM 계층 처리부(20)로 전달해 준다. 이때, 물리계층 셀 버스상의 셀 형식은 도 3에 도시된 바와 같으며, 해당 물리계층 인터페이스부(10)를 거쳐 다중화된 셀의 출력 형식은 도 4에 도시된 바와 같다.
다시 말해서, 상기 물리계층 인터페이스부(10)는 최대 9 매의 LPLA에서 입력된 셀 전송 요구 신호에 대해 라운드 로빈 방식으로 우선 순위를 두고 해당 셀 전송 요구 신호에 대한 셀 판독 신호를 생성시켜 해당 LPLA로 송출하여 해당 LPLA로부터 56 바이트의 셀을 16 비트의 단위로 판독한 후에 8 비트로 변환시켜 준다.
이에, 상기 ATM 계층 처리부(20)는 상기 물리계층 인터페이스부(10)로부터 수신한 ATM 셀을 UPC를 통하여 감시하며, 트래픽 계약을 위반하지 않은 셀에 대해 라우팅 정보를 부가하며, 헤더 변환을 수행한 후에 스위치 링크 정합부(30)로 전달해 준다. 이때, 해당 UPC는 SPLI에서 제공하는 가상 스케쥴링 알고리즘(Virtual Scheduling Algorithm)을 사용하며, 라우팅 처리 및 각종 OAM 처리를 위하여 FPGA(Field Programmable Gate Array), FIFO, DPRAM 등을 가진다.
다시 말해서, 상기 ATM 계층 처리부(20) 내의 수신 ATM 계층 처리부(21)는 셀의 헤더로부터 VPI와 VCI를 분석하여 해당 셀이 VPC용인지 또는 VCC용인지를 확인하며, 해당 VP 인덱스와 VCI를 이용하여 연결 관리 테이블을 검색하여 연결 식별자를 추출한다.
그리고, 해당 연결 식별자와 셀 동기 신호, 유효 셀 신호 등을 SPLI로 출력하여 사용자 파라메터를 위반한 셀을 각 모드에 따라 폐기하거나 태깅(Tagging)하며, 사용자 선택에 의해 스페이싱(Spacing)을 수행한 다음에 헤더 변환 및 라우팅 택 3 바이트를 부가하여 56 바이트 셀을 출력한다. 또한, 입력 셀에 대한 각 연결 별로 입력된 셀 수, 사용자 파라메터 위반/폐기된 셀의 수 등을 계수한다.
그리고, 연속성 검사가 등록된 연결에 대해서는 설정된 시간 동안에 셀이 입력되지 않으면 해당 연결 식별자를 제어기로 알려주는 기능, 성능 감시가 등록된 연결에 대해서는 성능 감시 기능 등을 수행하며, 상기 물리계층 인터페이스부(10)로부터 수신한 ATM 셀이 신호 처리용 셀이거나 OAM 셀인 경우에 FIFO를 통해서 제어부(50)로 전달해 줌으로써 해당 신호 처리용 셀이나 OAM 셀은 해당 제어부(50)에서 처리되도록 해 준다.
이에 따라, 상기 ATM 계층 처리부(20)에서 라우팅 정보를 부가한 56 바이트의 셀을 셀 버퍼에 저장하여 놓으면, 상기 스위치 링크 정합부(30)는 해당 셀을 판독하여 64 바이트의 내부 셀 형식으로 변환시켜 주는데, 즉 해당 수신한 내부 셀에 대해 블록 코딩을 수행하고 직렬 데이터로 변환시켜 스위치 링크를 통해 스위치 망으로 전송해 준다.
이 때, 상기 스위치 망으로 전달되는 셀은 상기 직렬 데이터(즉, 사용자 셀)뿐만 아니라 상기 제어부(50)로부터 인가된 관리 셀, 상기 제어부(50)에서 다음 노드로 전달하는 OAM 셀 등이 있는데, 해당 사용자 셀과 관리 셀은 다중화시켜 스위치 망으로 전송해 주며, 해당 관리 셀의 경우에 셀 형태가 내부 메시지용 셀이면 페이로드에 대한 CRC-32를 계산하여 해당 계산된 CRC-32를 삽입하고 내부 메시지용 셀이 아닌 경우에는 OAM 셀로 간주하여 CRC-10을 계산하여 삽입해 준다.
반면에, 스위치 망으로부터 64 바이트의 직렬 데이터가 수신되는 경우, 상기 스위치 링크 정합부(30)는 해당 직렬 데이터를 병렬 데이터로 변환하고 블록 코딩된 데이터를 디코딩하여 56 바이트의 셀 형식으로 상기 ATM 계층 처리부(20)로 인가해 주며, 해당 스위치 망으로부터 수신한 셀 중에서 내부 메시지 셀을 상기 제어부(50)로 전달해 준다.
다시 말해서, 스위치 망으로부터 셀을 수신하면, 상기 스위치 링크 정합부(30)는 내부 메시지용 셀과 사용자 셀로 구분하는데, 해당 내부 메시지용 셀인 경우에는 CRC-32 검사를 수행하여 56 바이트로 셀을 구성하여 상기 제어부(50)로 전달하며, 사용자 셀인 경우에는 점대점 연결 셀인지 아니면 점대다중점 연결 셀인지를 구분한다.
이에, 해당 점대점 연결 셀인 경우에는 해당 셀을 그대로 상기 ATM 계층 처리부(20)로 전달하며, 해당 점대다중점 연결 셀인 경우에 다중점 연결 인덱스를 찾아 셀의 전단에 붙여 54 바이트의 셀을 상기 ATM 계층 처리부(20)로 전달해 준다. 이때, 해당 점대점 연결 셀인 경우에 다중점 연결 인덱스는 '0'이 된다.
그러면, 상기 ATM 계층 처리부(20) 내의 송신 ATM 계층 처리부(22)에서는 상기 스위치 링크 정합부(30)로부터 수신한 내부 셀을 ATM 셀로 변환하고 PBA 비트 맵과 출력 선로 번호를 부가하여 상기 물리계층 인터페이스부(10)로 인가해 주거나 상기 제어부(50)로부터 수신한 신호 처리용 셀이나 OAM 셀을 ATM 셀로 변환시켜 상기 물리계층 인터페이스부(10)로 인가해 준다.
다시 말해서, 상기 송신 ATM 계층 처리부(22)는 사용자 셀 버퍼와 관리 셀 버퍼를 다중화하고 다중화된 셀의 헤더로부터 VPI와 VCI를 분석하여 셀이 VPC용 셀인지 아니면 VCC용 셀인지를 검사한다. 해당 VP 인덱스 또는 멀티캐스팅 인덱스와 VCI를 이용하여 연결 관리 테이블을 검색하여 연결 식별자와 다중화된 셀을 출력한다.
그리고, 해당 사용자 셀 버퍼와 관리 셀 버퍼에 입력 셀이 없는 경우에는 OAM 셀 전송 요구 버퍼를 검색하여 OAM 셀 전송 요구가 있으면 연결 식별자를 OAM 셀 전송 요구 버퍼로부터 판독하여 해당하는 OAM 셀 전송 요구와 연결 식별자를 출력하는 기능을 수행하며, SPLI로 셀을 입력시켜 각 모드에 따라 폴리싱 및 스페이싱된 셀을 입력받는다.
또한, 전송되는 셀이 사용자 셀인 경우에는 셀을 계수하고 성능 감시를 수행하며, 해당 사용자 셀이 물리계층으로 전달되어 가입자로 전송되어야 하는 셀인지 아니면 루프백시켜 다시 상기 수신 ATM 계층 처리부(21)로 돌려보낼 것인지를 판단하여 물리계층에 있는 버퍼에 기록하거나 루프백 버퍼에 기록해 준다.
그리고, 성능 감시를 수행한 결과를 성능 감시 테이블에 기록하며, 운용자가 설정한 성능 감시 블록 셀의 수만큼 셀이 전송된 경우에는 해당 연결 식별자를 연결 식별자 버퍼에 기록해 둔다. 한편, 송신되는 셀의 연속성 검사를 수행하여 연속성을 위반한 경우에도 해당 연결 식별자를 연결 식별자 버퍼에 기록해 둔다.
마지막으로, 상기 물리계층 인터페이스부(10)는 상기 ATM 계층 처리부(20)로부터 수신한 ATM 셀을 LPLA로 전달해 주는데, 물리계층으로 전송되어야 할 ATM 셀을 LPLA PBA 구분자와 링크 구분자를 부가한 56 바이트 셀을 16 비트의 단위로 변환하여 LPLA로 전달해 준다.
이상과 같이, 본 발명에 의해 DS-1/E1 급 물리계층 인터페이스를 72 링크로 수용할 수 있으므로 ATM 시스템에서 여러 가입자를 대상으로 ATM 서비스를 가능하게 해 준다.
다시 말해서, 본 발명에 의해 여러 종류의 물리계층 인터페이스를 가능하도록 함으로써 여러 종류의 가입자를 ATM 시스템에 부착하고자 할 경우에 자원과 관리가 용이하고 비용 면에서 탁월한 효과를 볼 수 있으며, 종래의 ATM 가입자 셀 다중화 및 역다중화 장치에서 지원하지 못 하는 ABR 서비스를 위한 자녀 보드(Daughter Board)로 TCBA(Transaction Control Application Part)를 이용하여 해당 ABR 서비스를 옵션으로 선택 지원할 수 있으며, 신호 처리용 셀과 내부 관리를 위한 메시지의 AAL(ATM Adaptation Layer) 5 형태의 처리로 시스템 내부 트래픽의 현저한 감소로 인하여 시스템의 성능 향상에 크게 기여할 수 있다.

Claims (4)

  1. 시스템 클럭을 수신해 각 구성 블록에 분배하며, 선로 장치에서 사용할 클럭을 생성하는 클럭부와;
    가입자 정합 모듈의 각종 OAM 기능과 연결 관리 기능을 수행하며, 내부 메시지를 통해 상위 제어 모듈과 통신을 수행하는 제어부와;
    각각의 선로 장치로부터 수신되는 ATM 셀을 라운드 로빈 방식으로 다중화시켜 주며, ATM 셀을 역다중화하여 해당 선로 장치로 출력하는 물리계층 인터페이스부와;
    수신한 내부 셀을 블록 코딩하고 직렬 데이터로 변환시켜 스위치 망으로 전송하며, 해당 스위치 망으로부터 수신한 내부 셀을 블록 코딩하고 직렬 데이터로 변환시켜 스위치 망으로 전송하며, 해당 스위치 망으로부터 수신한 직렬 데이터를 병렬 데이터로 변환하고 블록 코딩된 데이터를 디코딩시켜 주는 스위치 링크 정합부와;
    상기 물리계층 인터페이스부로부터 수신한 ATM 셀을 구분하여 상기 스위치 링크 정합부 또는 제어부로 인가하며, 상기 스위치 링크 정합부 또는 제어부로부터 수신한 데이터를 ATM 셀로 변환시켜 상기 물리계층 인터페이스부로 인가하는 ATM 계층 처리부를 포함하여 이루어진 것을 특징으로 하는 에이티엠 셀 다중화 및 역다중화 장치.
  2. 제1항에 있어서,
    상기 ATM 계층 처리부는 상기 물리계층 인터페이스부로부터 수신되는 ATM 셀을 UPC를 통해 감시하여 트래픽을 위반하지 않은 ATM 셀에 대해 라우팅 정보를 부가하고 헤더 변환을 수행한 후에 상기 스위치 링크 정합부로 인가하는 수신 ATM 계층 처리부와;
    상기 스위치 링크 정합부로부터 수신한 내부 셀을 ATM 셀로 변환하고 PBA 비트 맵과 출력 선로 번호를 부가해 주며, 상기 제어부로부터 수신한 신호 처리용 셀이나 OAM 셀을 ATM 셀로 변환시켜 상기 물리계층 인터페이스부로 인가하는 송신 ATM 계층 처리부를 포함하여 이루어진 것을 특징으로 하는 에이티엠 셀 다중화 및 역다중화 장치.
  3. 제2항에 있어서,
    상기 수신 ATM 계층 처리부는 상기 물리계층 인터페이스부로부터 수신한 셀의 헤더로부터 VPI와 VCI를 분석해 VPC용인지 또는 VCC용인지를 확인하며, VP 인덱스와 VCI를 이용해 연결 관리 테이블을 검색하여 연결 식별자를 추출하며, 연결 식별자, 셀 동기 신호 및 유효 셀 신호를 SPLI로 출력해 사용자 파라메터를 위반한 셀을 각 모드에 따라 폐기하거나 태깅하며, 사용자 선택에 의해 스페이싱을 수행한 후에 헤더 변환을 수행하고 라우팅 택을 부가해 56 바이트 셀을 출력하며, 각 연결별로 입력된 셀 수 및 사용자 파라메터 위반/폐기된 셀의 수를 계수하며, 연속성 검사가 등록된 연결의 경우에 설정된 시간 동안에 셀이 입력되지 않으면 해당 연결 식별자를 알려주고 성능 감시가 등록된 연결의 경우에 성능 감시 기능을 수행하며, 수신 셀이 신호 처리용 셀이거나 OAM 셀인 경우에 상기 제어부로 인가해 주는 것을 특징으로 하는 에이티엠 셀 다중화 및 역다중화 장치.
  4. 제2항에 있어서,
    상기 송신 ATM 계층 처리부는 상기 스위치 링크 정합부로부터 수신되는 사용자 셀과 관리 셀을 다중화하고 해당 다중화된 셀의 헤더로부터 VPI와 VCI를 분석하여 VPC용인지 또는 VCC용인지를 확인하며, VP 인덱스 또는 멀티캐스팅 인덱스와 VCI를 이용해 연결 관리 테이블을 검색하여 연결 식별자와 다중화된 셀을 출력하며, 수신 셀이 없는 경우에 OAM 셀 전송 요구가 있는지를 확인하여 연결 식별자를 판독해 OAM 셀 전송 요구와 연결 식별자를 출력하며, 셀을 SPLI로 입력시켜 각 모드에 따라 폴리싱 및 스페이싱된 셀을 입력받으며, 수신 셀이 사용자 셀인 경우에 셀을 계수하고 성능 감시를 수행하여 그 결과를 성능 감시 테이블에 기록하며, 해당 사용자 셀이 전송될 셀인지 또는 루프백될 셀인지를 판단하여 처리하며, 운용자가 설정한 성능 감시 블록 셀의 수만큼 셀이 전송된 경우나 해당 전송된 셀의 연속성 검사를 수행해 연속성을 위반한 경우에 연결 식별자를 기록하는 것을 특징으로 하는 에이티엠 셀 다중화 및 역다중화 장치.
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* Cited by examiner, † Cited by third party
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KR20030096715A (ko) * 2002-06-17 2003-12-31 한국전자통신연구원 Ａｔｍ 계층 처리 장치 및 그 방법
KR100713755B1 (ko) * 2005-10-13 2007-05-07 엘지노텔 주식회사 고속 데이터 전송 보드 장치 및 데이터 전송 포맷

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