KR20000056356A - 데이터/클럭 복원 회로 - Google Patents

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Abstract

본 발명은 광통신 시스템에서 클럭/데이터의 복원과 데이터 결정(Data decision)을 동시에 수행할 수 있도록한 데이터/클럭 복원 회로에 관한 것으로, 왜곡된 데이터를 포함하는 수신 데이터를 복원하는 데이터 신호 복원부와,복원된 데이터를 받아 피드백 입력되는 복원 클럭에 의해 재생(retime)된 데이터를 출력하는 D F/F과,상기 D F/F과 데이터 신호 복원부의 출력 신호를 받아 위상을 검출하는 위상 검출부와,상기 위상 검출 신호를 저대역 통과 필터링하는 로우 패스 필터와,저대역 통과 필터링이된 위상 검출 신호를 이용하여 주파수를 발진하는 제 1 전압 제어 오실레이터와,상기 제 1 전압 제어 오실레이터에서 출력되는 발진 주파수와 피드백되는 복원 클럭 신호를 받아 위상 주파수를 검출하는 위상 주파수 검출부와,상기 위상 주파수 검출부에서 출력되는 up/down의 제어 신호에 의해 전하를 펌핑하는 전하 펌프 블록과,상기 전하 펌프 블록에 출력되는 신호를 필터링하는 루프 필터와,상기 루프 필터에 의해 필터링된 신호에 의해 복원 클럭을 출력하는 제 2 전압 제어 오실레이터를 포함하여 구성된다.

Description

데이터/클럭 복원 회로{Data/clock recovery circuit}
본 발명은 광통신 시스템에 관한 것으로, 특히 클럭/데이터의 복원과 데이터 결정(Data decision)을 동시에 수행할 수 있도록한 데이터/클럭 복원 회로에 관한 것이다.
이하, 첨부된 도면을 참고하여 종래 기술의 데이터/클럭 복원 회로에 관하여 설명하면 다음과 같다.
도 1은 종래 기술의 데이터/클럭 복원 회로의 구성 블록도이다.
종래 기술의 데이터/클럭 복원 회로는 155.52Mbps의 속도로 전송되는 데이터 전송 과정에서 왜곡된 데이터 신호를 복구하기 위한 데이터 신호 복원부(1)와, 복구된 데이터 신호와 피드백되는 발진 주파수 신호를 받아 위상 비교를 하는 제 1 위상 비교부(2)와, 제 1 위상 비교 신호에 의해 전하 펌핑 동작을 하는 제 1 전하 펌프 블록(3)과, 19.44MHz로 입력되는 클럭 신호와 피드백되어 1/4 주파수 분주 블록(8)에 의해 1/4 분주된 주파수의 위상을 비교하는 제 2 위상 비교부(9)와, 제 2 위상 비교 신호에 의해 전하 펌핑 동작을 하는 제 2 전하 펌프 블록(10)과, 데이터 신호 복원부(1)에서 복구된 데이터 신호를 모니터링하여 입력 데이터의 유무를 판단하여 루프1 또는 루프2를 선택하는 데이터 신호 모니터(11)와, 데이터 신호 모니터(11)에 의해 루프1 또는 루프2를 선택하는 스위칭 블록(4)과, 상기 스위칭 블록(4)에 의해 선택 출력되는 데이터 신호를 저대역 필터링하는 로우 패스 필터(5)와, 저대역 필터링된 신호에 의해 발진 주파수 신호를 출력하는 전압 제어 오실레이터(6)와, 전압 제어 오실레이터(6)의 출력 신호와 데이터 신호 복원부(1)에서 복원된 데이터 신호를 받아 155.52Mbps의 데이터와 155.52MHz의 클럭을 동기시켜 출력하는 데이터/클럭 동기부(7)를 포함하여 구성된다.
여기서, 제 1 위상 비교부(2),제 1 전하 펌프 블록(3) 그리고 로우 패스 필터(5),전압 제어 오실레이터(6)로 연결되는 루프를 루프1, 제 2 위상 비교부(9),제 2 전하 펌프 블록(10) 그리고 로우 패스 필터(5),전압 제어 오실레이터(6)로 연결되는 루프를 루프2라 한다.
이와 같이 구성된 종래 기술의 데이터/클럭 복원 회로는 입력 데이터가 없는 경우 다음과 같이 동작한다.
입력 데이터가 없는 경우 데이터 신호 모니터(11)에 의해 스위칭 블록(4)에서 루프2로 이루어진 전하 펌프 PLL에 연결되어 레퍼런스 클럭인 19.44Mhz신호와 동기되어 전압제어 오실레이터(6)은 77.76Mhz 클럭 신호를 출력하게 된다.
만약, 데이터가 입력되는 경우에는 전송선에 의해 왜곡된 데이터 신호는 데이터 신호 복원부(1)에 의해 정상적인 데이터 신호로 복구되고 이 신호는 데이터 신호 모니터(11)와 루프1으로 이루어진 전하 펌프 PLL에 동시에 인가된다.
데이터 신호 모니터(11)에 의해 스위칭 블록(4)은 루프1으로 연결되어 155.52Mbps 데이터 신호와 77.76MHz 클럭 신호와 동기를 이루게 된다.
그러므로 입력 데이터 신호만을 입력받아 데이터 신호를 정상적으로 복구하게될뿐만 아니라 입력 데이터와 동기된 클럭 신호를 출력하게 되므로 데이터/클럭 복원 회로의 기능을 한다.
그리고 155.52Mbps의 데이터와 77.76MHz의 클럭 신호를 데이터/클럭 동기부(7)에서 인가된 데이터와 클럭 신호의 동기 및 정확한 데이터를 결정하기 위해 155.52MHz의 클럭 신호를 출력한다.
이와 같은 종래 기술의 데이터/클럭 복원 회로는 다음과 같은 문제가 있다.
155.52Mbps의 데이터와 77.76MHz의 클럭 신호를 동기시키므로 클럭 신호를 재발생(regeneration)시켜야 하는 문제가 있다.
데이터를 정확히 결정(decision)하기 위해서는 클럭 신호를 155.52Mhz로 변환하고 데이터와 클럭을 동기시키기 위한 데이터/클럭 동기 블록이 필요하여 구성이 복잡하다.
본 발명은 이와 같은 종래 기술의 데이터/클럭 복원 회로의 문제를 해결하기 위하여 안출한 것으로, 클럭/데이터의 복원과 데이터 결정(Data decision)을 동시에 수행할 수 있도록한 데이터/클럭 복원 회로를 제공하는데 그 목적이 있다.
도 1은 종래 기술의 데이터/클럭 복원 회로의 구성 블록도
도 2는 본 발명에 따른 데이터/클럭 복원 회로의 구성 블록도
도면의 주요 부분에 대한 부호의 설명
21. 데이터 신호 복원부 22. D F/F
23. 위상 검출부 24. 로우 패스 필터
25. 제 1 전압 제어 오실레이터 26. 위상 주파수 검출부
27. 전하 펌프 블록 28. 루프 필터
29. 제 2 전압 제어 오실레이터
이와 같은 목적을 달성하기 위한 본 발명에 따른 데이터/클럭 복원 회로는 왜곡된 데이터를 포함하는 수신 데이터를 복원하는 데이터 신호 복원부와,복원된 데이터를 받아 피드백 입력되는 복원 클럭에 의해 재생(retime)된 데이터를 출력하는 D F/F과,상기 D F/F과 데이터 신호 복원부의 출력 신호를 받아 위상을 검출하는 위상 검출부와,상기 위상 검출 신호를 저대역 통과 필터링하는 로우 패스 필터와,저대역 통과 필터링이된 위상 검출 신호를 이용하여 주파수를 발진하는 제 1 전압 제어 오실레이터와,상기 제 1 전압 제어 오실레이터에서 출력되는 발진 주파수와 피드백되는 복원 클럭 신호를 받아 위상 주파수를 검출하는 위상 주파수 검출부와,상기 위상 주파수 검출부에서 출력되는 up/down의 제어 신호에 의해 전하를 펌핑하는 전하 펌프 블록과,상기 전하 펌프 블록에 출력되는 신호를 필터링하는 루프 필터와,상기 루프 필터에 의해 필터링된 신호에 의해 복원 클럭을 출력하는 제 2 전압 제어 오실레이터를 포함하여 이루어지는 것을 특징으로 한다.
이하, 첨부된 도면을 참고하여 본 발명에 따른 데이터/클럭 복원 회로에 관하여 상세히 설명하면 다음과 같다.
도 2는 본 발명에 따른 데이터/클럭 복원 회로의 구성 블록도이다.
본 발명은 전송선을 통하여 전달되면서 왜곡된 데이터를 정상적인 파형으로 복구하기 위한 데이터 신호 복원부(21)와 클럭 신호에 의해 재생(retime)된 데이터를 출력하기 위한 D F/F(22) 블록이 포함되어 있다.
그 구성은 왜곡된 데이터를 포함하고 155.52Mbps의 속도로 입력되는 데이터를 정상적으로 복원하는 데이터 신호 복원부(21)와, 피드백 입력되는 복원 클럭에 의해 동작하여 retime된 데이터를 출력하는 D F/F(22)과, 상기 D F/F(22)과 데이터 신호 복원부(21)의 출력 신호를 받아 위상을 검출하는 위상 검출부(23)와, 상기 위상 검출부(23)의 출력 신호를 저대역 통과 필터링을 하는 로우 패스 필터(24)와, 저대역 통과 필터링이된 위상 검출 신호를 이용하여 주파수를 발진하는 제 1 전압 제어 오실레이터(25)와, 제 1 전압 제어 오실레이터(25)에서 출력되는 발진 주파수와 피드백되는 155.52MHz의 클럭 신호를 받아 위상 주파수를 검출하는 위상 주파수 검출부(26)와, 상기 위상 주파수 검출부(26)에서 출력되는 up/down의 제어 신호에 의해 전하를 펌핑하는 전하 펌프 블록(27)과, 상기 전하 펌프 블록(27)에 출력되는 신호를 필터링하는 루프 필터(28)와, 상기 루프 필터(28)에 의해 필터링된 신호에 의해 155.52MHz의 주파수를 발진하는 제 2 전압 제어 오실레이터(29)를 포함하여 구성된다.
이와 같이 구성된 본 발명에 따른 데이터/클럭 복원 회로는 다음과 같이 데이터/클럭 복원 동작을 한다.
데이터 신호 복원부(21)에서 복구된 데이터ⓐ와 D F/F(22)에서 재생(retime)된 데이터ⓑ의 주파수 동기를 위해 루프1이 위상 검출부(23),로우 패스 필터(24),제 1 전압 제어 오실레이터(25)로 구성된다.
그리고 실제 클럭 신호인 제 2 전압 제어 오실레이터(29)의 출력과 입력 데이터에 의해 주파수 동기된 제 1 전압 제어 오실레이터(29)의 출력이 위상 동기를 이루도록 루프2를 따라 전하 펌프 PLL이 구성된다.
전하 펌프 PLL은 위상 주파수 검출부(26),전하 펌프 블록(27),루프 필터(28)와 제 2 전압 제어 오실레이터(29)로 구성된다.
데이터 신호 복원부(21)에서 복원된 데이터는 D F/F(22)의 위상을 검출하고 위상 검출부(23)에서 검출된 위상 신호는 저대역 통과 필터링 과정을 거치게 된다.
로우 패스 필터(24)에서 필터링된 신호는 입력 데이터와 전압 제어 오실레이터에서 출력되는 클럭 신호를 비교하여 데이터 신호와 클럭 신호를 동기시키는 것이 아니고, 입력 데이터와 클럭 신호에 의해 재생(retime)된 데이터 신호를 비교하여 동기시키는 것이다.
즉, 입력된 데이터는 송신부의 클럭 정보를 가진 데이터이고 수신부에서의 retimed data는 수신부의 클럭 정보를 가진 데이터이므로 두 데이터의 동기는 송신부의 클럭 신호와 수신부의 클럭 신호를 동기시키는 것을 의미한다.
초기 데이터가 전송될때 preamble time 동안에 `1' `0'상태로 주기적으로 변하는 데이터의 신호가 전송되며 이 신호에 의해 제 1 전압 제어 오실레이터(25)와 제 2 전압 제어 오실레이터(29)는 루프1과 루프2에 의해 155.52MHz의 클럭 신호를 발생하게 된다.
이후 랜덤한 데이터가 입력될 경우 루프1의 위상 검출부(23)는 XOR 타입의 입력 데이터와 클럭 신호에 의해 재생(retime)된 데이터의 듀티를 비교하여 듀티 에러값을 출력한다.
이는 로우 패스 필터(24)에 의해 평균값으로 바뀌어 제 1 전압 제어 오실레이터(25)의 컨트롤 전압이 되며 제 1 전압 제어 오실레이터(25)의 출력을 조정한다.
제 1 전압 제어 오실레이터(25)의 출력 신호ⓓ는 루프2를 따라 구성된 전하 펌프 블록(27)을 포함하는 PLL에 인가되어 위상 주파수 검출부(26)에서 제 1 전압 제어 오실레이터(25)의 출력과 제 2 전압 제어 오실레이터(29)에서의 출력ⓒ의 에지를 비교한다.
이때 검출된 위상차는 전하 펌프 블록(27)과 루프 필터(28)에 의해 제 2 전압 제어 오실레이터(29)의 제어 신호로 바뀌고 제 1 전압 제어 오실레이터(25)와 제 2 전압 제어 오실레이터(29)는 위상 동기를 이루며 D F/F(22)에 안정된 클럭 신호를 제공한다.
이때 입력 데이터와 D F/F(22)에 의해 재생된 데이터는 90°위상차를 이루며 동기되므로 클럭 신호는 데이터 신호를 정확히 재생할 수 있도록 데이터 비트의 중간에 인가된다.
입력 데이터와 재생(retime)된 데이터를 동기시키는 구조이므로 클럭 복원,데이터 복원 데이터 결정을 동시에 수행할 수 있다.
이와 같은 본 발명의 데이터/클럭 복원 회로는 데이터 복원시에 입력 데이터와 재생된 데이터를 동기시켜 데이터 복원의 정확성이 높다.
데이터 신호와 클럭 신호를 비교하여 동기를 이루는 구조를 사용하지만 입력된 데이터와 클럭에 의해 재생된 데이터를 동기시키기 위해 D F/F를 사용한다.
본 발명은 아날로그 PLL과 차지 펌프 PLL을 공유하는 구조이다.
여기서, 아날로그 PLL을 구성하는 이유는 입력된 데이터와 재생된 데이터가 90°위상차를 가진 상태로 주파수 동기를 이루기 위함이다.
이와 같은 본 발명에 따른 데이터/클럭 복원 회로는 다음과 같은 효과가 있다.
입력 데이터와 재생된 데이터를 동기시키는 구조이므로 클럭 복원,데이터 복원 그리고 데이터 결정(data decision)을 동시에 수행하여 데이터/클럭 복원 동작이 효율적으로 이루어진다.
또한, 실제 클럭 신호와 입력 데이터에 의해 동기된 제 1 전압 제어 오실레이터의 출력을 전하 펌프 PLL을 이용하여 동기시키므로 속도가 빠르고 안정적인 클럭을 공급할 수 있다.

Claims (5)

  1. 왜곡된 데이터를 포함하는 수신 데이터를 복원하는 데이터 신호 복원부와,
    복원된 데이터를 받아 피드백 입력되는 복원 클럭에 의해 재생된 데이터를 출력하는 D F/F과,
    상기 D F/F과 데이터 신호 복원부의 출력 신호를 받아 위상을 검출하는 위상 검출부와,
    상기 위상 검출 신호를 저대역 통과 필터링하는 로우 패스 필터와,
    저대역 통과 필터링이된 위상 검출 신호를 이용하여 주파수를 발진하는 제 1 전압 제어 오실레이터와,
    상기 제 1 전압 제어 오실레이터에서 출력되는 발진 주파수와 피드백되는 복원 클럭 신호를 받아 위상 주파수를 검출하는 위상 주파수 검출부와,
    상기 위상 주파수 검출부에서 출력되는 up/down의 제어 신호에 의해 전하를 펌핑하는 전하 펌프 블록과,
    상기 전하 펌프 블록에 출력되는 신호를 필터링하는 루프 필터와,
    상기 루프 필터에 의해 필터링된 신호에 의해 복원 클럭을 출력하는 제 2 전압 제어 오실레이터를 포함하여 구성되는 것을 특징으로 하는 데이터/클럭 복원 회로.
  2. 제 1 항에 있어서, 위상 주파수 검출부는 제 1 전압 제어 오실레이터의 출력과 제 2 전압 제어 오실레이터에서의 출력의 에지를 비교하여 두 출력의 위상차를 검출하는 것을 특징으로 하는 데이터/클럭 복원 회로.
  3. 제 1 항에 있어서, 데이터 신호 복원부에 입출력되는 데이터는 155.52Mbps의 속도로 입력되고 데이터 복원되어 출력되는 속도는 155.52Mbps인것을 특징으로 하는 데이터/클럭 복원 회로.
  4. 제 1 항에 있어서, 제 2 전압 제어 오실레이터에서 출력되는 복원 클럭은 155.52MHz인것을 특징으로 하는 데이터/클럭 복원 회로.
  5. 제 1 항에 있어서, 입력 데이터와 D F/F에 의해 재생된 데이터는 90°위상차를 이루며 동기되는 것을 특징으로 하는 데이터/클럭 복원 회로.
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