KR102491625B1 - 표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법 - Google Patents

표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법 Download PDF

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Abstract

본 발명은 표시 패널의 일측 가장자리 영역과 타측 가장자리 영역에 각각 배치되는 전원 공급 라인의 선폭을 다르게 하여 표시 패널의 내의 전압 강하를 동일하게 할 수 있는 표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법에 관한 것이다. 본 발명은 표시 패널의 일측 가장자리 영역과 타측 가장자리 영역에 각각 배치되는 전원 공급 라인의 선폭을 백색(W) 및 청색(B) 서브 화소의 전류량에 따라 조절하는 것을 기술적 특징으로 한다. 본 발명에 의하면 표시 패널의 내의 전압 강하를 동일하게 할 수 있어 종래 기술에 비해 표시 패널의 휘도 편차를 최소화 할 수 있고, 이로 인해 표시 패널의 구동 성능을 향상시킬 수 있다.

Description

표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법{DISPLAY PANEL AND DISPLAY PANEL INCLUDING THE SAME AND DRIVING METHOD THEREOF}
본 발명은 표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법에 관한 것이다.
반도체 기술의 급격한 진보에 힘입어 전자 기기의 소형화, 박형화 및 경량화 추세가 이어지면서, 이와 같은 새로운 전자 기기에서 처리되는 정보를 사용자가 육안으로 확인하기 위한 인터페이스 역할을 하는 표시 장치의 발전이 이루어져 왔다. 근래에는 액정 표시 장치(Liquid Crystal Display Device), 플라즈마 표시 장치(Plasma Display Device), 유기 발광 다이오드 표시 장치(Organic Light-Emitting Diode Display Device)와 같은 여러 가지 표시 장치가 사용되고 있다.
종래 유기 발광 표시 장치는 게이트 라인들과 데이터 라인들의 교차영역마다 화소가 형성되어 있는 표시 패널, 표시 패널에 형성되어 있는 게이트 라인들에 순차적으로 스캔 신호를 공급하기 위한 게이트 드라이버, 표시 패널에 형성되어 있는 데이터 라인들로 데이터 전압을 공급하기 위한 데이터 드라이버 및 게이트 드라이버와 데이터 드라이버의 기능을 제어하기 위한 타이밍 컨트롤러를 포함한다.
여기서, 표시 패널에는 복수의 게이트 라인들과 데이터 라인들이 교차하는 영역마다 화소가 형성되어 있으며, 각 픽셀은 광을 출력하는 유기 발광 다이오드(OLED) 및 유기 발광 다이오드(OLED)를 구동하기 위한 구동부를 포함한다.
이때, 구동부는 데이터 라인과 게이트 라인에 접속되어 유기 발광 다이오드(OLED)의 구동을 제어하기 위해 구동 트랜지스터, 스위칭 트랜지스터 및 스토리지 커패시터를 포함하여 구성될 수 있다.
또한, 구동부는 게이트 라인에 스캔 신호가 공급될 때 데이터 라인으로 공급되는 데이터 전압에 따라 유기 발광 다이오드(OLED)로 공급되는 전류량을 제어한다.
한편, 유기 발광 표시 장치는 적색(R), 백색(W), 청색(B), 녹색(G)와 같은 4개의 단위 서브 화소를 갖는 구조에서는 배선의 개수를 줄이기 위해 복수의 서브 화소가 전원 공급 라인(EVDD)과 기준 전압 공급 라인(Vref)을 공유하여 기준 전압 공급 라인(Vref)은 단위 화소의 중심에 배치되고, 전원 공급 라인(EVDD)은 단위 화소의 경계에 배치된다.
이에 따라 하나의 전원 공급 라인(EVDD)이 4개의 서브 화소에 전원을 공급하여 단위 화소의 전압 강하(Drop)를 감당하고 있다. 이때, 전원 공급 라인(EVDD)은 유기 발광 다이오드(OLED)에 전류를 공급하고, 표시 패널의 모든 전원 공급 라인(VDD)의 선폭은 동일하게 설계된다.
그러나, 표시 패널의 좌우 가장자리 영역에 배치된 전원 공급 라인 2개의 서브 화소에 전원을 공급하고, 표시 패널의 내부의 전원 공급 라인에 연결된 서브 화소의 개수보다 표시 패널의 좌우 가장자리 영역에 배치된 전원 공급 라인에 연결된 화소의 개수가 적다. 이에 따라, 표시 패널의 좌우 가장자리 영역에 배치된 전원 공급 라인에서 전압 강하가 작아진다.
본 발명은 표시 패널의 일측 가장자리 영역과 타측 가장자리 영역에 각각 배치되는 전원 공급 라인의 선폭을 다르게 하여 표시 패널의 내의 전압 강하를 동일하게 할 수 있는 표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법을 제공하는 것을 일 목적으로 한다.
본 발명은 표시 패널의 일측 가장자리 영역과 타측 가장자리 영역에 각각 배치되는 전원 공급 라인에 흐르는 백색(W) 및 청색(B) 서브 화소의 전류량을 조절할 수 있는 표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법을 제공하는 것을 다른 목적으로 한다.
본 발명은 표시 패널의 휘도 편차를 최소화 할 수 있는 표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법을 제공하는 것을 다른 목적으로 한다.
본 발명은 표시 패널의 구동 성능을 향상시킬 수 있는 표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법을 제공하는 것을 다른 목적으로 한다.
전술한 바와 같은 목적을 달성하기 위하여 본 발명은 표시 패널의 일측 가장자리 영역과 타측 가장자리 영역에 각각 배치되는 전원 공급 라인의 선폭을 다르게 하여 표시 패널의 내의 전압 강하를 동일하게 할 수 있는 표시 패널과 이를 포함하는 표시 장치 및 표시 장치의 구동 방법을 제공한다.
보다 구체적으로, 본 발명에서는 표시 패널의 일측 가장자리 영역과 타측 가장자리 영역에 각각 배치되는 전원 공급 라인의 선폭을 백색(W) 및 청색(B) 서브 화소의 전류량에 따라 조절한다. 이에 따라 표시 패널의 내의 전압 강하를 동일하게 할 수 있어 표시 패널의 휘도 편차를 최소화 한다.
본 발명에 의하면, 표시 패널의 일측 가장자리 영역과 타측 가장자리 영역에 각각 배치되는 전원 공급 라인의 선폭을 다르게 하여 표시 패널의 내의 전압 강하를 동일하게 할 수 있는 효과가 있다.
또한, 본 발명에 의하면, 표시 패널의 일측 가장자리 영역과 타측 가장자리 영역에 각각 배치되는 전원 공급 라인에 흐르는 백색(W) 및 청색(B) 서브 화소의 전류량을 조절하여 표시 패널의 휘도 편차를 최소화 할 수 있는 효과가 있다.
마지막으로, 본 발명에 의하면, 표시 패널의 일측 가장자리 영역과 타측 가장자리 영역에 각각 배치되는 전원 공급 라인에 흐르는 백색(W) 및 청색(B) 화소의 전류량을 조절하여 표시 패널의 구동 성능을 향상시킬 수 있는 효과가 있다.
도 1은 본 발명의 일 실시예에 따른 유기 발광 표시 장치의 구성도이다.
도 2는 도 1의 화소의 구성도이다.
도 3은 본 발명의 일 실시예에 따른 어레이 기판에 형성된 화소 구조를 나타내는 도면이다.
전술한 목적, 특징 및 장점은 첨부된 도면을 참조하여 상세하게 후술되며, 이에 따라 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 본 발명의 기술적 사상을 용이하게 실시할 수 있을 것이다. 본 발명을 설명함에 있어서 본 발명과 관련된 공지 기술에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우에는 상세한 설명을 생략한다. 이하, 첨부된 도면을 참조하여 본 발명에 따른 바람직한 실시예를 상세히 설명하기로 한다. 도면에서 동일한 참조부호는 동일 또는 유사한 구성요소를 가리키는 것으로 사용된다.
도 1은 본 발명의 일 실시예에 따른 유기 발광 표시 장치의 구성도이다.
도 1을 참조하면, 유기 발광 표시 장치는 게이트 라인들(GL1 ~GLg)과 데이터 라인들(DL1 ~ DLd)의 교차영역마다 픽셀(P)(110)이 형성되어 있는 표시 패널(100), 표시 패널(100)에 형성되어 있는 상기 게이트 라인들(GL1 ~ GLg)에 순차적으로 스캔 신호를 공급하기 위한 게이트 드라이버(200), 표시 패널(100)에 형성되어 있는 데이터 라인들(DL1 ~ DLd)로 데이터 전압을 공급하기 위한 데이터 드라이버(300) 및 게이트 드라이버(200)와 데이터 드라이버(300)의 기능을 제어하기 위한 타이밍 컨트롤러(400)를 포함한다.
표시 패널(100)에는 복수의 게이트 라인(GL1 ~ GLg)과 데이터 라인(DL1 ~ DLd)이 교차하는 영역마다 서브 화소(P)(110)이 형성되어 있다. 각 픽셀(110)은 광을 출력하는 유기발광다이오드 및 유기 발광 다이오드를 구동하기 위한 구동부를 포함한다. 여기서, 유기 발광 다이오드는, 유기 발광 다이오드에서 발생된 빛이 상부기판을 통해 외부로 방출되는 탑 에미션(Top Emission) 방식으로 구성될 수도 있고, 유기 발광 다이오드에서 발생된 빛이 하부기판으로 방출되는 바텀 에미션(Bottom Emission) 방식으로 구성될 수도 있다.
구동부는 데이터 라인(DL)과 게이트 라인(GL)에 접속되어 유기 발광 다이오드(OLED)의 구동을 제어하기 위해, 구동 트랜지스터, 스위칭 트랜지스터 및 스토리지 커패시터를 포함하여 구성될 수 있다.
유기발광다이오드(OLED)의 애노드는 제 1 전원에 접속되고, 캐소드는 제2전원에 접속된다. 유기 발광 다이오드(OLED)는, 구동 트랜지스터로부터 공급되는 전류에 대응되어 소정 휘도의 광을 출력한다.
또한, 구동부는 게이트 라인(GL)에 스캔 신호가 공급될 때, 데이터 라인(DL)으로 공급되는 데이터전압에 따라, 유기 발광 다이오드(OLED)로 공급되는 전류량을 제어한다.
이를 위해 구동 트랜지스터는 제 1 전원과 상기 유기발광다이오드 사이에 접속되며, 스위칭 트랜지스터는 구동 트랜지스터와 데이터 라인(DL)과 게이트 라인(GL) 사이에 접속된다.
타이밍 컨트롤러(400)는 외부 시스템(미도시)으로부터 공급되는 수직 동기신호, 수평 동기신호 및 클럭을 이용하여, 게이트 드라이버(200)를 제어하기 위한 게이트 제어신호(GCS)와, 데이터 드라이버(300)를 제어하기 위한 데이터 제어신호(DCS)를 출력한다.
타이밍 컨트롤러(400)는 외부 시스템으로부터 입력되는 입력 영상 데이터를 샘플링한 후에 이를 재정렬하여, 재정렬된 디지털 영상데이터를 상기 데이터 드라이버(300)에 공급한다.
즉, 타이밍 컨트롤러(400)는 외부 시스템으로부터 공급된 입력 영상 데이터를 재정렬하여, 재정렬된 디지털 영상 데이터를 데이터 드라이버(300)로 전송하고, 외부 시스템으로부터 공급된 클럭과, 수평 동기신호와, 수직 동기신호(클럭과 신호들은 간단히 타이밍 신호라 함) 및 데이터 인에이블 신호를 이용해서, 게이트 드라이버(200)를 제어하기 위한 게이트 제어신호(GCS)와 데이터 드라이버(300)를 제어하기 위한 데이터 제어신호(DCS)를 생성하여 게이트 드라이버(200) 및 데이터 드라이버(300)로 전송한다.
전술한 바와 같은 목적을 달성하기 위해 타이밍 컨트롤러(400)는 외부 시스템으로부터 입력 영상 데이터와 상기한 바와 같은 각종 신호들을 수신하는 수신부, 수신부로부터 수신된 신호들 중 입력 영상 데이터들을 표시 패널에 맞게 재정렬하여 재정렬된 디지털 영상 데이터들을 생성하기 위한 영상 데이터 처리부, 수신부로부터 수신된 신호들을 이용하여 게이트 드라이버(200)와 데이터 드라이버(300)를 제어하기 위한 게이트 제어신호(GCS)와 데이터 제어신호(DCS)들을 생성하기 위한 제어 신호 생성부 및 영상 데이터 처리부에서 생성된 영상 데이터와 제어 신호들을 데이터 구동부(300) 또는 게이트 구동부(200)로 출력하기 위한 송신부를 포함하여 구성될 수 있다.
다음, 데이터 드라이버(300)는 타이밍 컨트롤러(400)로부터 입력된 영상 데이터를 아날로그 데이터 전압으로 변환하여, 게이트 라인에 스캔 신호가 공급되는 1수평기간마다 1수평 라인분의 데이터 전압을 상기 데이터 라인들에 공급한다. 즉, 상기 데이터 드라이버(300)는 감마전압 발생부(도시하지 않음)로부터 공급되는 감마전압들을 이용하여, 영상 데이터를 데이터 전압으로 변환시킨 후 상기 데이터라 인들로 출력시킨다.
여기서, 데이터 드라이버(300)는 타이밍 컨트롤러(400)로부터의 소스 스타트 펄스(Source Start Pulse; SSP)를 소스 쉬프트 클럭(Source Shift Clock; SSC)에 따라 쉬프트시켜 샘플링 신호를 발생한다. 그리고, 데이터 드라이버(300)는 소스 쉬프트 클럭(SSC)에 따라 입력되는 영상 데이터를 샘플링 신호에 따라 래치하여, 데이터 전압으로 변경한 후, 소스 출력 인에이블(Source Output Enable; SOE) 신호에 응답하여 수평 라인 단위로 데이터 전압을 데이터 라인들에 공급한다.
이를 위해, 데이터 드라이버(300)는 쉬프트 레지스터부, 래치부, 디지털 아날로그 변환부 및 출력버퍼 등을 포함하여 구성될 수 있다.
먼저 쉬프트 레지스터부는 타이밍 컨트롤러(400)로부터 수신된 데이터 제어 신호들을 이용하여 샘플링 신호를 출력한다.
그 다음, 래치부는 타이밍 컨트롤러(400)로부터 순차적으로 수신된 디지털 영상 데이터를 래치하여 디지털 아날로그 변환부로 동시에 출력하는 기능을 수행한다.
이어서, 디지털 아날로그 변환부는 래치부로부터 전송되어온 영상 데이터들을 데이터 전압으로 변환하여 출력한다. 즉, 디지털 아날로그 변환부는, 감마전압 발생부(도시하지 않음)로부터 공급되는 감마전압을 이용하여 영상 데이터들을 데이터 전압으로 변환하여 데이터 라인들로 출력한다.
출력버퍼는 디지털 아날로그 변환부로부터 전송되어온 데이터 전압을 타이밍 컨트롤러(400)로부터 전송되어온 소스출력 인에이블신호(SOE)에 따라 표시 패널(100)의 데이터 라인(DL)들로 출력한다.
마지막으로, 게이트 드라이버(200)는 타이밍 컨트롤러(400)로부터 입력되는 게이트 제어신호에 응답하여 표시 패널(100)의 게이트 라인들(GL1~GLg)에 스캔 신호를 순차적으로 공급한다. 이에 따라, 스캔 신호가 입력되는 해당 수평라인의 각각의 픽셀에 형성되어 있는 스위칭 트랜지스터들이 턴온되어 각 픽셀(110)로 영상이 출력될 수 있다.
게이트 드라이버(200)는 표시 패널(100)과 독립되게 형성되어, 다양한 방식으로 표시 패널(100)과 전기적으로 연결될 수 있는 형태로 구성될 수 있으나, 표시 패널(100) 내에 실장되어 있는 게이트 인 패널(Gate In Panel: GIP) 방식으로 구성될 수도 있다. 이 경우, 게이트 드라이버(200)를 제어하기 위한 게이트 제어 신호로는 스타트 신호(VST) 및 게이트 클럭(GCLK)이 될 수 있다.
이를 위해, 데이터 드라이버(300)는 쉬프트 레지스터부, 래치부, 디지털 아날로그 변환부 및 출력버퍼 등을 포함하여 구성될 수 있다.
먼저 쉬프트 레지스터부는 타이밍 컨트롤러(400)로부터 수신된 데이터 제어 신호들을 이용하여 샘플링 신호를 출력한다.
그 다음, 래치부는 타이밍 컨트롤러(400)로부터 순차적으로 수신된 디지털 영상 데이터를 래치하여 디지털 아날로그 변환부로 동시에 출력하는 기능을 수행한다.
이어서, 디지털 아날로그 변환부는 래치부로부터 전송되어온 영상 데이터들을 데이터 전압으로 변환하여 출력한다. 즉, 디지털 아날로그 변환부는, 감마전압 발생부(도시하지 않음)로부터 공급되는 감마전압을 이용하여 영상 데이터들을 데이터 전압으로 변환하여 데이터 라인들로 출력한다.
출력버퍼는 디지털 아날로그 변환부로부터 전송되어온 데이터 전압을 타이밍 컨트롤러(400)로부터 전송되어온 소스출력 인에이블신호(SOE)에 따라 표시 패널(100)의 데이터 라인(DL)들로 출력한다.
마지막으로, 게이트 드라이버(200)는 타이밍 컨트롤러(400)로부터 입력되는 게이트 제어신호에 응답하여 표시 패널(100)의 게이트 라인들(GL1~GLg)에 스캔 신호를 순차적으로 공급한다. 이에 따라, 스캔 신호가 입력되는 해당 수평라인의 각각의 픽셀에 형성되어 있는 스위칭 트랜지스터들이 턴온되어 각 픽셀(110)로 영상이 출력될 수 있다.
게이트 드라이버(200)는 표시 패널(100)과 독립되게 형성되어, 다양한 방식으로 표시 패널(100)과 전기적으로 연결될 수 있는 형태로 구성될 수 있으나, 표시 패널(100) 내에 실장되어 있는 게이트 인 패널(Gate In Panel: GIP) 방식으로 구성될 수도 있다. 이 경우, 게이트 드라이버(200)를 제어하기 위한 게이트 제어 신호로는 스타트 신호(VST) 및 게이트 클럭(GCLK)이 될 수 있다.
또한, 데이터 드라이버(300), 게이트 드라이버(200) 및 타이밍 컨트롤러(400)가 독립적으로 구성된 것으로 설명되었으나, 데이터 드라이버(300) 또는 게이트 드라이버(200)들 중 적어도 어느 하나는 타이밍 컨트롤러(400)에 일체로 구성될 수도 있다.
도 2는 도 1의 서브 화소의 구성도이다.
도 2를 참조하면, 본 발명의 서브 화소는 VDD 공급 라인, VSS 공급 라인, 기준 전압 공급 라인(Vref) 및 제1 및 제2 게이트 라인(S1, S2)에 접속된다. 각 서브 화소는 구동 TFT(T11), 제1 내지 제2 TFT(T12~T13), 커패시터(C) 및 OLED를 구비한다.
구동 TFT(T11)는 VDD 공급 라인과 제1 노드(N1)에 접속되어 VDD가 인가되는 소스 전극과, 제1 노드(N1)에 접속된 드레인 전극, 제2 노드(N2)에 접속된 게이트 전극을 구비한다. 이러한 구동 TFT(T11)는 제1 노드(N1)의 전압 상태에 따라 제2 노드(N2)에 구동 전류를 공급한다.
제1 TFT(T12)는 제1 게이트 라인(S1)으로부터 제공되는 게이트 신호에 응답하여 데이터 라인(Vdata)와 제2 노드(N2) 간을 서로 스위칭 한다. 여기서, 제2 노드는 구동 TFT(T11)의 게이트 전극에 접속된 노드이다.
제2 TFT(T13)는 제2 게이트 라인(S2)으로부터 제공되는 게이트 신호에 응답하여 센싱 라인과 제1 노드(N1) 간을 서로 스위칭 한다. 여기서, 센싱 라인은 기준 전압 공급 라인(Vref)이다. 그리고, 제1 노드(N1)는 구동 TFT(T11)의 드레인 전극에 접속된 노드이다.
OLED는 VDD 공급 라인과, VSS 공급 라인 사이에 구동 TFT(T11)와 직렬로 접속된다. 구체적으로, OLED는 구동 TFT(T11)에 접속된 애노드와, VSS 공급 라인에 접속된 캐소드와, 애노드 및 캐소드 사이의 발광층을 구비한다.
발광층은 캐소드와 애노드 사이에 순차 적층된 전자 주입층, 전자 수송층, 유기 발광층, 정공 수송층, 정공 주입층을 구비한다.
이러한 OLED는 애노드와 캐소드 사이에 포지티브 바이어스가 인가되면 캐소드로부터의 전자가 전자 주입층 및 전자 수송층을 경유하여 유기 발광층으로 공급되고, 애노드로부터 정공이 정공 주입층 및 정공 수송층을 경유하여 유기 발광층으로 공급된다.
이에 따라, 유기 발광층에서 공급된 전자 및 정공의 재결합으로 형광 또는 인광 물질을 발광시킴으로써 전류 밀도에 비례하는 휘도를 발생한다.
커패시터(C)는 제1 및 제2 노드(N1, N2) 사이에 접속된다. 이러한 커패시터(C)는 제1 노드(N1)에 인가된 전압, 예를 들어 데이터 전압(Vdata)이나 센싱 전압(Vref)을 저장한다.
도 3은 본 발명의 일 실시예에 따른 어레이 기판에 형성된 화소 구조를 나타내는 도면이다.
도 3을 참조하면, 본 발명의 일 실시예에 따른 각 화소는 적색(R), 백색(W), 청색(B), 녹색(G)의 4색으로 발광하고, 적색(R), 백색(W), 청색(B), 녹색(G)의 서브 화소가 행 방향으로 배열되어 있다. 제2 내지 제N전원 공급 라인(EVDD_2 내지 EVDD_N)은 녹색(G) 서브 화소 열과 적색(R) 서브 화소 열 사이에 배치되고, 제1 내지 제N기준 전압 공급 라인(Vref_1 내지 Vref_N)은 백색(W) 서브 화소 열과 청색(B) 서브 화소 열 사이에 배치되어 있다.
자세하게 설명하면, 제1 화소(P1)의 적색(R) 및 백색(W) 서브 화소는 제1 전원 공급 라인(EVDD_1)을 공유하고, 청색(B) 및 녹색(G) 서브 화소는 제2 전원 공급 라인(EVDD_2)을 공유하고 있다. 또한, 제1 화소(P1)의 적색(R), 백색(W), 청색(B), 녹색(G)는 제1 기준 전압 공급 라인(Vref_1)을 공유하고 있다.
제2 화소(P2)의 적색(R) 및 백색(W) 서브 화소는 제2 전원 공급 라인(EVDD_2)을 공유하고, 청색(B) 및 녹색(G) 서브 화소는 제3 전원 공급 라인(EVDD_3)을 공유하고 있다. 또한, 제2 화소(P2)의 적색(R), 백색(W), 청색(B), 녹색(G)는 제2 기준 전압 공급 라인(Vref_2)을 공유하고 있다.
제(N-1) 화소(P(N-1))의 적색(R) 및 백색(W) 서브 화소는 제(N-1) 전원 공급 라인(EVDD_(N-1))을 공유하고, 청색(B) 및 녹색(G) 서브 화소는 제N 전원 공급 라인(EVDD_N)을 공유하고 있다. 또한, 제(N-1) 화소(P2)의 적색(R), 백색(W), 청색(B), 녹색(G)는 제(N-1) 기준 전압 공급 라인(V적색(R)ef(N-1))을 공유하고 있다.
제N 화소(P(N))의 적색(R) 및 백색(W) 서브 화소는 제N 전원 공급 라인(EVDD_N)을 공유하고, 청색(B) 및 녹색(G) 서브 화소는 제(N+1) 전원 공급 라인(EVDD_(N+1))을 공유하고 있다. 또한, 제N 화소(P(N))의 적색(R), 백색(W), 청색(B), 녹색(G)는 제N 기준 전압 공급 라인(EVDD_N)을 공유하고 있다.
여기서, 표시 패널(100)의 일측 가장자리 영역(A)에 형성된 제1 전원 공급 라인(EVDD_1)은 청색(B), 녹색(G), 적색(R), 백색(W) 서브 화소에 전원을 공급하는 것이 아니라 적색(R) 및 백색(W) 서브 화소에만 전원을 공급하므로, 제1 전원 공급 라인(EVDD_1)에는 실제 전원의 반만 공급된다.
또한, 표시 패널의 타측 가장자리 영역(B)에 형성된 제(N +1) 전원 공급 라인(EVDD_(N+1))은 청색(B), 녹색(G), 적색(R), 백색(W) 서브 화소에 전원을 공급하는 것이 아니라 청색(B), 녹색(G) 서브화소에만 전원을 공급하므로, 제(N+1) 전원 공급 라인(EVDD_(N+1))에는 실제 전원의 반만 공급된다.
이때, 휘도가 가장 높아서 휘도 편차가 가장 잘 인지되는 백색(White) 표시시에는 백색(W) 및 청색(B) 서브 화소를 사용하고 각각 다른 전류가 필요한데 제1 전원 공급 라인(EVDD_1)은 백색(W) 서브 화소에만 전류를 공급하고 제(N+1) 전원 공급 라인(EVDD_(N+1))은 청색(B) 서브 화소에만 전류를 공급하고 제2 내지 제N 전원 공급 라인(EVDD_2 내지 EVDD_N)은 백색(W) 및 청색(B) 서브 화소에 전류를 공급한다. 따라서, 표시 패널의 일측 및 타측 가장자리 영역(A, B)에서 일어나는 전압 강하가 달라지게 되어 표시 패널에 휘도 편차가 발생하게 된다.
본 발명의 일 실시예에서는 표시 패널의 휘도 편차를 최소화 하기 위해 표시 패널(100)의 일측 가장자리 영역(A)에 배치된 제1 전원 공급 라인(EVDD_1)과 타측 가장자리 영역(B)에 배치된 제(N+1) 전원 공급 라인(EVDD_(N+1))의 선폭을 백색(W) 및 청색(B) 화소의 전류량에 따라 조절한다.
여기서, 휘도 편차가 가장 잘 인지되는 백색(W) 화소가 제1 전원 공급 라인(EVDD_1)에 연결되어 있으므로 표시 패널(100)의 타측 가장자리 영역(B)에 형성된 제(N+1) 전원 공급 라인(EVDD_(N+1))의 전압 강하 보다 표시 패널(100)의 일측 가장자리 영역(A)에 형성된 제1 전원 공급 라인(EVDD_1)의 전압 강하를 더 크게 할 수 있다.
예를 들면, 수평라인이 2160개 있는 패널에서 화이트(W)를 표시하는 경우, 백색(W) 및 청색(B) 서브 화소를 사용하므로, 백색(W) 서브 화소에 1.09μA, 청색(B) 서브 화소에 0.89μA의 전류가 흐른다면 제1 전원 공급 라인(EVDD_1)에는 2.345mA, 제(N+1) 전원 공급 라인(EVDD_(N+1))에는 1.922mA, 제2 전원 공급 라인(EVDD_2) 내지 제N 전원 공급 라인(EVDD_N)에는 각각 4.277mA의 전류가 흐를 수 있다.
따라서, 제2 전원 공급 라인(EVDD_2) 내지 제N 전원 공급 라인(EVDD_N)의 선폭이 20μm이라고 한다면, 제1 전원 공급 라인(EVDD_1)의 선폭을 11.3μm, 제(N+1) 전원 공급 라인(EVDD_(N+1))의 선폭을 8.7μm로 설정할 수 있다.
이에 따라 표시 패널(100) 내에는 백색(W), 청색(B), 백색(W) 및 청색(B)에 해당하는 3 종류의 전압이 흐르게 되어 표시 패널(100) 내의 전압 강하가 다르게 일어난다.
따라서, 본 발명에서는 표시 패널(100)의 일측 가장자리 영역(A)에 배치된 제1 전원 공급 라인(EVDD_1)과 타측 가장자리 영역(에 배치된 제(N+1) 전원 공급 라인(EVDD_(N+1))의 선폭을 백색(W) 및 청색(B) 화소의 전류량에 따라 조절할 수 있다.
또한, 표시 패널(100)의 타측 가장자리 영역(B)에 형성된 제N 전원 공급 라인(EVDD_N)의 선폭보다 표시 패널(100)의 일측 가장자리 영역(A)에 형성된 제1 전원 공급 라인(EVDD_1)의 선폭을 더 크게 하여 제N 전원 공급 라인(EVDD_N)에서 일어나는 전압 강하보다 제1 전원 공급 라인(EVDD_1)의 전압 강하를 더 크게 할 수 있다.
이에 따라 표시 패널(100) 전체의 전압 강하를 동일하게 할 수 있고, 이로 인해 표시 패널(100)의 휘도 편차를 최소화 할 수 있다. 또한, 표시 패널의 구동 성능을 향상시킬 수 있다.
전술한 본 발명은, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에게 있어 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하므로 전술한 실시예 및 첨부된 도면에 의해 한정되는 것이 아니다.
100: 표시 패널 200: 게이트 드라이버
300: 데이터 드라이버 400: 타이밍 컨트롤러

Claims (9)

  1. 기판 상에 형성된 다수의 게이트 라인;
    상기 게이트 라인과 교차하여 배치된 복수의 데이터 라인;
    상기 각 게이트 라인과 상기 각 데이터 라인에 의해 정의된 복수의 서브 화소 영역; 및
    상기 복수의 서브 화소에 전원을 공급하는 제1 내지 제(N+1) 전원 공급 라인을 포함하고,
    상기 서브 화소 영역은 적색(R), 백색(W), 청색(B), 녹색(G) 서브 화소를 포함하며,
    상기 기판의 일측 가장자리 영역에 형성된 상기 제1 전원 공급 라인의 선폭은 상기 기판의 타측 가장자리 영역에 형성된 상기 제(N+1) 전원 공급 라인의 선폭 보다 더 크고, 상기 제2 전원 공급 라인 내지 상기 제N 전원 공급 라인의 선폭은 상기 제1 전원 공급 라인의 선폭 보다 더 크며,
    상기 제2 전원 공급 라인 내지 상기 제N 전원 공급 라인에는 가장 많은 전류가 흐르고, 상기 제(N+1) 전원 공급 라인에는 가장 적은 전류가 흐르는 표시 패널.
  2. 제1항에 있어서,
    상기 제2 전원 공급 라인 내지 상기 제N 전원 공급 라인은 녹색(G) 서브 화소와 적색(R) 서브 화소 열 사이에 배치되는 표시 패널.
  3. 제1항에 있어서,
    상기 화소에 기준 전압을 공급하는 기준 전압 공급 라인을 포함하는 표시 패널.
  4. 제3항에 있어서,
    상기 기준 전압 공급 라인은 상기 백색(W) 서브 화소 열과 청색(B) 서브 화소 열 사이에 배치되는 표시 패널.
  5. 기판 상에 형성된 다수의 게이트 라인, 상기 게이트 라인과 교차하여 배치된 복수의 데이터 라인 및 상기 각 게이트 라인과 상기 각 데이터 라인에 의해 정의된 복수의 서브 화소 영역을 포함하고, 상기 서브 화소 영역은 적색(R), 백색(W), 청색(B), 녹색(G)의 서브 화소를 포함하며,
    상기 서브 화소에 전원을 공급하는 제1 내지 제(N+1) 전원 공급 라인 및
    상기 기판의 일측 가장자리 영역에 형성된 상기 제1 전원 공급 라인의 선폭은 상기 기판의 타측 가장자리 영역에 형성된 상기 제(N+1) 전원 공급 라인의 선폭 보다 더 크고, 상기 제2 전원 공급 라인 내지 상기 제N 전원 공급 라인의 선폭은 상기 제1 전원 공급 라인의 선폭 보다 더 큰 표시 패널;
    상기 게이트 라인으로 게이트 신호를 공급하는 게이트 구동부; 및
    상기 데이터 라인으로 데이터 신호를 공급하는 데이터 구동부를 포함하고,
    상기 제2 전원 공급 라인 내지 상기 제N 전원 공급 라인에는 가장 많은 전류가 흐르고, 상기 제(N+1) 전원 공급 라인에는 가장 적은 전류가 흐르는 표시 장치.
  6. 제5항에 있어서,
    상기 전원 공급 라인은 녹색(G) 서브 화소와 적색(R) 서브 화소 열 사이에 배치되는 표시 장치.
  7. 제5항에 있어서,
    상기 화소에 기준 전압을 공급하는 기준 전압 공급 라인을 포함하는 표시 장치.
  8. 제7항에 있어서,
    상기 기준 전압 공급 라인은 상기 백색(W) 서브 화소 열과 청색(B) 서브 화소 열 사이에 배치되는 표시 장치.
  9. 기판 상에 형성된 다수의 게이트 라인, 상기 게이트 라인과 교차하여 배치된 복수의 데이터 라인 및 상기 각 게이트 라인과 상기 각 데이터 라인에 의해 정의된 복수의 서브 화소 영역을 포함하고, 상기 서브 화소 영역은 적색(R), 백색(W), 청색(B), 녹색(G)의 서브 화소를 포함하며, 상기 서브 화소에 전원을 공급하는 제1 내지 제(N+1) 전원 공급 라인 및 상기 기판의 일측 가장자리 영역에 형성된 상기 제1 전원 공급 라인의 선폭이 상기 기판의 타측 가장자리 영역에 형성된 상기 제(N+1) 전원 공급 라인의 선폭 보다 더 크고, 상기 제2 전원 공급 라인 내지 상기 제N 전원 공급 라인의 선폭은 상기 제1 전원 공급 라인의 선폭 보다 더 큰 표시 패널, 상기 게이트 라인으로 게이트 신호를 공급하는 게이트 구동부 및 상기 데이터 라인으로 데이터 신호를 공급하는 데이터 구동부를 포함하는 표시 장치에 있어서,
    상기 게이트 신호에 응답하여 하나의 게이트 라인을 스캔하는 단계;
    상기 데이터 신호에 응답하여 상기 복수의 화소 영역 중 하나의 게이트 라인을 공유하는 화소 영역들로 이루어진 블록 영역을 표시하는 단계; 및
    상기 게이트 라인을 스캔하는 단계와 상기 블록 영역을 표시하는 단계를 반복적으로 수행하는 단계를 포함하고,
    상기 제2 전원 공급 라인 내지 상기 제N 전원 공급 라인에는 가장 많은 전류가 흐르고, 상기 제1 전원 공급 라인에는 상기 제(N+1) 전원 공급 라인 보다 더 많은 전류가 흐르고, 상기 제(N+1) 전원 공급 라인에는 가장 적은 전류가 흐르는 표시 장치의 구동 방법.
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