KR102428998B1 - 디스플레이 구동 장치의 디지털 아날로그 컨버터 - Google Patents

디스플레이 구동 장치의 디지털 아날로그 컨버터 Download PDF

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Abstract

본 발명은 디스플레이 구동 장치의 디지털 아날로그 컨버터를 개시한다. 디지털 아날로그 컨버터는, 데이터 신호들에 따라서 접지전압과 하프 전원전압 사이의 복수의 제1 감마전압들 중 하나를 제1 노드에 전달하거나 상기 하프 전원전압과 전원전압 사이의 복수의 제2 감마전압들 중 하나를 제2 노드에 전달하는 스위치 회로; 및 상기 제1 노드의 전압이 상기 하프 전원전압보다 높은 경우 상기 제1 노드를 상기 하프 전원전압의 레벨로 방전시키고, 상기 제2 노드의 전압이 상기 하프 전원전압보다 낮은 경우 상기 제2 노드를 상기 하프 전원전압의 레벨로 충전시키는 제어 회로;를 포함한다.

Description

디스플레이 구동 장치의 디지털 아날로그 컨버터{DIGITAL TO ANALOG CONVERTER IN DISPLAY DRIVING DEVICE}
본 발명은 디스플레이 장치에 관한 것으로, 더 상세하게는 디스플레이 구동 장치의 디지털 아날로그 컨버터에 관한 것이다.
디스플레이 장치는 디스플레이 패널, 디스플레이 구동 장치 및 타이밍 컨트롤러를 포함한다. 디스플레이 구동 장치는 타이밍 컨트롤러로부터 제공되는 디지털 영상 데이터를 소스 구동 신호로 변환하고, 이를 디스플레이 패널에 제공한다.
디스플레이 구동 장치는 디지털 영상 데이터를 소스 구동 신호로 변환하는 디지털 아날로그 컨버터, 소스 구동 신호를 디스플레이 패널의 데이터 라인에 출력하는 출력 회로를 포함할 수 있다. 이러한 디스플레이 구동 장치의 디지털 아날로그 컨버터는 디지털 영상 데이터에 따라서 감마전압들 중 하나를 소스 구동 신호로 출력한다.
그런데, 종래 기술에 따른 디지털 아날로그 컨버터는 디지털 영상 데이터에 대응하는 데이터 신호들의 미스 매치에 의해 높은 레벨의 감마전압과 낮은 레벨의 감마전압이 전달되는 경로들이 순간적으로 쇼트 될 수 있다. 이러한 순간적인 쇼트로 인해 디지털 아날로그 컨버터 내의 트랜지스터들과 같은 내부 소자들이 손상될 수 있다.
따라서, 디스플레이 구동 장치의 디지털 아날로그 컨버터 내에서 순간적인 쇼트 경로로 인해 내부 소자들이 손상되는 것을 방지할 수 있는 기술이 요구되고 있다.
본 발명이 해결하고자 하는 기술적 과제는 순간적인 쇼트로부터 내부 소자들의 손상을 방지하고 동작 속도를 향상시킬 수 있는 디스플레이 구동 장치의 디지털 아날로그 컨버터를 제공하는데 있다.
본 발명의 일 실시예에 따른 디스플레이 구동 장치의 디지털 아날로그 컨버터는, 데이터 신호들에 따라서 접지전압과 하프 전원전압 사이의 복수의 제1 감마전압들 중 하나를 제1 노드에 전달하거나 상기 하프 전원전압과 전원전압 사이의 복수의 제2 감마전압들 중 하나를 제2 노드에 전달하는 스위치 회로; 및 상기 제1 노드의 전압이 상기 하프 전원전압보다 높은 경우 상기 제1 노드를 상기 하프 전원전압의 레벨로 방전시키고, 상기 제2 노드의 전압이 상기 하프 전원전압보다 낮은 경우 상기 제2 노드를 상기 하프 전원전압의 레벨로 충전시키는 제어 회로;를 포함한다.
본 발명의 일 실시예에 따른 디스플레이 구동 장치의 디지털 아날로그 컨버터는, 데이터 신호들에 따라서 접지전압과 하프 전원전압 사이의 복수의 제1 감마전압들 중 하나를 제1 노드에 전달하는 제1 스위치 회로; 상기 데이터 신호들에 따라서 상기 하프 전원전압과 전원전압 사이의 복수의제2 감마전압들 중 하나를 제2 노드에 전달하는 제2 스위치 회로; 상기 제1 노드의 전압 레벨이 상기 하프 전원전압보다 높아지는 경우 상기 제1 노드를 상기 하프 전원전압의 레벨로 방전시키는 제1 제어 회로; 및 상기 제2 노드의 전압 레벨이 상기 하프 전원전압보다 낮아지는 경우 상기 제2 노드를 상기 하프 전원전압의 레벨로 충전시키는 제2 제어 회로;를 포함한다.
상술한 바와 같이, 본 발명은 높은 레벨의 감마전압과 낮은 레벨의 감마전압이 전달되는 경로들 간에 순간적인 쇼트가 발생하는 경우, 낮은 레벨의 감마 전압이 전달되는 제1 노드를 하프 전원전압의 레벨로 방전시키고, 높은 레벨의 감마전압이 전달되는 제2 노드를 하프 전원전압의 레벨로 충전시킴으로써, 트랜지스터와 같은 내부 소자들이 손상되는 것을 방지할 수 있다.
또한, 본 발명은 제어 회로의 동작에 따라서 낮은 레벨의 감마 전압이 전달되는 제1 노드 및 높은 레벨의 감마 전압이 전달되는 제2 노드를 하프 전원전압의 레벨로 방전 및 충전시키므로, 디지털 아날로크 컨버터의 동작 속도를 향상시킬 수 있다.
도 1은 본 발명의 일 실시예에 따른 디스플레이 구동 장치의 디지털 아날로그 컨버터를 도시한다.
도 2는 도 1의 디지털 아날로그 컨버터의 회로도이다.
이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예를 상세하게 설명한다. 본 명세서 및 특허청구범위에 사용된 용어는 통상적이거나 사전적 의미로 한정되어 해석되지 아니하며, 본 발명의 기술적 사항에 부합하는 의미와 개념으로 해석되어야 한다.
본 명세서에 기재된 실시예와 도면에 도시된 구성은 본 발명의 바람직한 실시예이며, 본 발명의 기술적 사상을 모두 대변하는 것이 아니므로, 본 출원 시점에서 이들을 대체할 수 있는 다양한 균등물과 변형예들이 있을 수 있다.
도 1은 본 발명의 일 실시예에 따른 디스플레이 구동 장치의 디지털 아날로그 컨버터(100)를 도시한다. 도 1은 설명의 편의를 위해 3비트의 데이터 신호들에 따라서 8개의 감마 전압들 중 하나를 선택하는 것을 예시한다. 본 발명은 이에 한정되는 것은 아니며, 디스플레이 패널의 해상도에 따라서 데이터 신호들의 비트 수와 감마전압들의 레벨이 결정될 수 있다.
도 1을 참고하면, 디스플레이 구동 장치의 디지털 아날로그 컨버터(100)는 데이터 신호들(D<0>, D<1>, D<2>)에 따라서 제1 내지 제8 감마전압들(GMA1 ~ GMA8) 중 하나를 소스 구동 신호(Sn)로 출력한다. 이러한 디지털 아날로그 컨버터(100)는 스위치 회로(10) 및 제어 회로(20)를 포함한다.
스위치 회로(10)는 데이터 신호들(D<0>, D<1>, D<2>)에 따라서 제1 내지 제4 감마전압들(GMA1 ~ GMA4) 중 하나를 제1 노드(N1)에 전달하거나 제5 내지 제8 감마전압들(GMA5 ~ GMA8) 중 하나를 제2 노드(N2)에 전달한다. 여기서, 제1 내지 제4 감마전압들(GMA1 ~ GMA4)은 접지전압과 하프 전원전압 사이의 레벨을 가지고, 제5 내지 제8 감마전압들(GMA5 ~ GMA8)은 하프 전원전압과 전원전압 사이의 레벨을 가지며, 하프 전원전압은 전원전압의 1/2 레벨을 가진다. 스위치 회로(10)의 내부 구성은 도 2에서 설명한다.
제어 회로(20)는 접지전압과 하프 전원전압 사이의 레벨을 가지는 제1 내지 제4 감마전압들(GMA1 ~ GMA4) 중 하나가 전달되는 제1 노드(N1)의 전압 레벨이 하프 전원전압보다 높아지는 경우 제1 노드(N1)를 하프 전원전압의 레벨로 방전시킨다.
그리고, 제어 회로(20)는 하프 전원전압과 전원전압 사이의 레벨을 가지는 제5 내지 제8 감마전압들(GMA5 ~ GMA8) 중 하나가 전달되는 제2 노드(N2)의 전압 레벨이 하프 전원전압보다 낮아지는 경우 제2 노드(N2)를 하프 전원전압의 레벨로 충전시킨다.
이러한 제어 회로(20)는 제1 노드(N1)와 하프 전원전압(HVDD)의 단자(T1) 사이에 연결되는 제1 다이오드(D1)와 하프 전원전압(HVDD)의 단자(T1)와 제2 노드(N2) 사이에 연결되는 제2 다이오드(D2)를 포함한다.
제1 다이오드(D1)는 제1 노드(N1)의 전압 레벨이 하프 전원전압(HVDD)보다 높아지는 경우 제1 노드(N1)에서 하프 전원전압(HVDD)의 단자(T1)까지 방전 경로를 형성하므로 제1 노드(N1)의 전압이 하프 전원전압(HVDD)의 레벨로 방전된다.
그리고, 제2 다이오드(D2)는 제2 노드(N2)의 전압 레벨이 하프 전원전압(HVDD)보다 낮아지는 경우 하프 전원전압(HVDD)의 단자(T1)에서 제2 노드(N2)까지 충전 경로를 형성하므로 제2 노드(N2)의 전압이 하프 전원전압(HVDD)의 레벨로 충전된다.
그리고 제어 회로(20)는 제1 노드(N1)와 출력단(N3) 사이에 연결되는 제1 스위치(HV_N3)와 제2 노드(N2)와 출력단(N3) 사이에 연결되는 제2 스위치(HV_P3)를 포함한다.
제1 스위치(HV_N3)는 데이터 신호들의 최상위 비트(Db<2>)에 따라서 스위치 회로(12)로부터 제1 노드(N1)에 전달되는 제1 내지 제4 감마전압들(GMA1 ~ GMA4) 중 하나를 출력단(N3)에 전달하고, 제2 스위치(HV_P3)는 데이터 신호들의 최상위 비트(Db<2>)에 따라서 스위치 회로(14)로부터 제2 노드(N2)에 전달되는 제5 내지 제8 감마전압들(GMA5 ~ GMA8) 중 하나를 출력단(N3)에 전달한다. 여기서, 제1 스위치(HV_N3) 및 제2 스위치(HV_P3)는 데이터 신호들의 하위 비트들(D<0>, D<1>)에 따라서 동작하는 스위치 회로(10) 내의 스위치들보다 상대적으로 높은 전압 범위에서 구동하는 NMOS 트랜지스터와 PMOS 트랜지스터로 구성할 수 있다. 일례로, 하위 비트들(D<0>, D<1>)에 따라서 동작하는 스위치 회로(10)의 스위치들은 접지 전압에서 하프 전원전압의 전압 범위 또는 하프 전원전압에서 전원전압의 전압 범위에서 구동하고, 제1 스위치(HV_N3) 및 제2 스위치(HV_P3)는 접지전압과 전원전압 사이의 전압 범위에서 구동할 수 있다.
한편, 도 1에 도시하지 않았지만, 디스플레이 구동 장치는 디지털 영상 데이터에 대응하는 데이터 신호들(D<0>, D<1>, D<2>)을 래치하고 이를 디지털 아날로그 컨버터(100)에 제공하는 래치부를 포함할 수 있고, 디지털 아날로그 컨버터(100)로부터 출력되는 소스 구동 신호(Sn)를 버퍼링하여 디스플레이 패널(도시되지 않음)에 출력하는 출력 회로(도시되지 않음)를 포함할 수 있다. 출력 회로는 증폭기를 포함할 수 있으며, 디지털 아날로그 컨버터(100)의 동작 속도에 따라서 증폭기의 출력 슬루율이 개선될 수 있다.
도 2는 도 1의 디지털 아날로그 컨버터(100)의 회로도이다. 도 2을 참고하면, 디스플레이 구동 장치의 디지털 아날로그 컨버터(100)는 스위치 회로(10) 및 제어 회로(20)를 포함한다.
스위치 회로(10)는 제1 스위치 회로(12) 및 제2 스위치 회로(14)를 포함한다. 제1 스위치 회로(12)는 데이터 신호들(D<0>, Db<0>, D<1>, Db<1>, D<2> Db<2>)에 따라서 제1 내지 제4 감마전압들(GMA1 ~ GMA4) 중 하나를 제1 노드(N1)에 전달하고, 제2 스위치 회로(14)는 데이터 신호들(D<0>, D<1>, D<2>)에 따라서 제5 내지 제8 감마전압들(GMA5 ~ GMA8) 중 하나를 제2 노드(N2)에 전달한다. 여기서, 데이터 신호들(Db<0>, Db<1>, Db<2>)은 데이터 신호들(D<0>, D<1>, D<2>)의 반전 신호이다. 도 2에 도시하지 않았지만 디지털 아날로그 컨버터(100)는 데이터 신호들(D<0>, D<1>, D<2>)을 반전시키기 위한 인버터들을 포함할 수 있다.
제1 스위치 회로(12)는 하위 비트들의 데이터 신호들(D<0>, Db<0>, D<1>, Db<1>)에 따라서 제1 내지 제4 감마전압들(GMA1 ~ GMA4) 중 하나를 전달하는 제1 NMOS 트랜지스터들(MV_N1)을 포함하고, 최상위 비트(Db<2>)에 따라서 제1 NMOS 트랜지스터들(MV_N1)에 의해 전달되는 제1 내지 제4 감마전압들(GMA1 ~ GMA4) 중 하나를 제1 노드(N1)에 전달하는 제2 NMOS 트랜지스터(HV_N2)를 포함한다. 여기서, 제2 NMOS 트랜지스터(HV_N2)는 높은 저항 역할을 할 수 있도록 제1 NMOS 트랜지스터들(MV_N1)보다 상대적으로 높은 전압 범위에서 구동하는 트랜지스터로 구성할 수 있다. 일례로, 제1 NMOS 트랜지스터들(MV_N1)은 접지전압과 하프 전원전압 사이의 전압 범위에서 구동하고, 제2 NMOS 트랜지스터(HV_N2)는 접지전압과 전원전압 사이의 전압 범위에서 구동하는 것으로 구성할 수 있다.
제2 스위치 회로(14)는 하위 비트들의 데이터 신호들(D<0>, Db<0>, D<1>, Db<1>)에 따라서 제5 내지 제8 감마전압들(GMA5 ~ GMA8) 중 하나를 전달하는 제1 PMOS 트랜지스터들(MV_P1)을 포함하고, 최상위 비트(Db<2>)에 따라서 제1 PMOS 트랜지스터들(MV_P1)에 의해 전달되는 제5 내지 제8 감마전압들(GMA5 ~ GMA8) 중 하나를 제2 노드(N2)에 전달하는 제2 PMOS 트랜지스터(HV_P2)를 포함한다. 여기서, 제2 PMOS 트랜지스터(HV_P2)는 높은 저항 역할을 할 수 있도록 제1 PMOS 트랜지스터들(MV_P1)보다 상대적으로 높은 전압 범위에서 구동하는 트랜지스터로 구성할 수 있다. 일례로, 제1 PMOS 트랜지스터들(MV_P1)은 하프 전원전압과 전원전압 사이의 전압 범위에서 구동하고, 제2 NMOS 트랜지스터(HV_N2)는 접지전압과 전원전압 사이의 전압 범위에서 구동하는 것으로 구성할 수 있다.
한편, 스위치 회로(10)의 동작에서 데이터 신호들(D<0>, Db<0>, D<1>, Db<1>, D<2> Db<2>)의 미스 매치에 의해 높은 레벨의 감마전압과 낮은 레벨의 감마전압이 전달되는 경로들 간에 순간적인 쇼트 경로가 발생할 수 있다. 여기서, 높은 레벨의 감마전압은 하프 전원전압과 전원전압 사이의 레벨을 가지는 감마전압들이 예시될 수 있으며, 낮은 레벨의 감마전압은 접지전압과 하프 전원전압 사이의 레벨을 가지는 감마전압들이 예시될 수 있다.
제어 회로(20)는 순간적인 쇼트 경로로부터 스위치 회로(10)의 트랜지스터들과 같은 내부 소자들이 손상되는 것을 방지하기 위해 접지전압과 하프 전원전압 사이의 레벨을 가지는 제1 내지 제4 감마전압들(GMA1 ~ GMA4) 중 하나가 전달되는 제1 노드(N1)의 전압 레벨이 하프 전원전압보다 높아지는 경우 제1 노드(N1)를 하프 전원전압의 레벨로 방전시키고, 하프 전원전압과 전원전압 사이의 레벨을 가지는 제5 내지 제8 감마전압들(GMA5 ~ GMA8) 중 하나가 전달되는 제2 노드(N2)의 전압 레벨이 하프 전원전압보다 낮아지는 경우 제2 노드(N2)를 하프 전원전압의 레벨로 충전시킨다.
제어 회로(20)는 제1 노드(N1)와 출력단(N3) 사이에 연결되고 제2 NMOS 트랜지스터(HV_N2)와 직렬 연결되는 제3 NMOS 트랜지스터(HV_N3)를 포함하고, 제2 노드(N2)와 출력단(N3) 사이에 연결되고 제2 PMOS 트랜지스터(HV_P2)와 직렬 연결되는 제3 PMOS 트랜지스터(HV_P3)를 포함한다. 제3 NMOS 트랜지스터(HV_N3)는 최상위 비트(Db<2>)에 따라서 제1 스위치 회로(12)에 의해 전달되는 제1 내지 제4 감마전압들(GMA1 ~ GMA4) 중 하나를 출력단(N3)에 전달하고, 제3 PMOS 트랜지스터(HV_P3)는 최상위 비트(Db<2>)에 따라서 제2 스위치 회로에 의해 전달되는 제5 내지 제8 감마전압들(GMA5 ~ GMA8) 중 하나를 출력단(N3)에 전달한다. 여기서, 제3 NMOS 트랜지스터(HV_N3) 및 제3 PMOS 트랜지스터(HV_P3)는 높은 전압 범위에서 구동하는 것으로 구성할 수 있으며, 일례로, 접지전압에서 전원전압 사이의 전압 범위에서 구동하는 것으로 구성할 수 있다.
제어 회로(20)는 접지전압과 하프 전원전압 사이의 레벨을 가지는 제1 내지 제4 감마전압들(GMA1 ~ GMA4) 중 하나가 전달되는 제1 노드(N1)의 전압 레벨이 하프 전원전압보다 높아지는 경우 제1 다이오드(D1)에 의해 형성되는 방전 경로를 통해서 제1 노드(N1)를 하프 전원전압의 레벨로 방전시키고, 하프 전원전압과 전원전압 사이의 레벨을 가지는 제5 내지 제8 감마전압들(GMA5 ~ GMA8) 중 하나가 전달되는 제2 노드(N2)의 전압 레벨이 하프 전원전압보다 낮아지는 경우 제2 다이오드(D2)에 의해 형성되는 충전 경로를 통해서 제2 노드(N2)를 하프 전원전압의 레벨로 충전시킨다.
그리고, 제어 회로(20)는 스위치 회로(10)에 의해 전달되는 제1 내지 제8 감마전압들(GMA1 ~ GMA8) 중 하나를 제3 NMOS 트랜지스터(HV_N3) 또는 제3 PMOS 트랜지스터(HV_P3)를 통해서 출력단(N3)에 전달한다. 출력단(N3)에 전달되는 제1 내지 제8 감마전압들(GMA1 ~ GMA8) 중 하나는 소스 구동 신호(Sn)로 출력 회로(도시되지 않음)에 제공된다. 출력 회로는 증폭기를 포함할 수 있으며, 소스 구동 신호(Sn)를 디스플레이 패널에 제공한다.
이와 같이, 본 발명은 높은 레벨의 감마전압과 낮은 레벨의 감마전압이 전달되는 경로들 간에 순간적인 쇼트가 발생하는 경우, 낮은 레벨의 감마 전압이 전달되는 제1 노드(N1)를 하프 전원전압의 레벨로 방전시키고, 높은 레벨의 감마전압이 전달되는 제2 노드(N2)를 하프 전원전압의 레벨로 충전시킴으로써, 트랜지스터들과 같은 내부 소자들이 손상되는 것을 방지할 수 있다.
또한, 본 발명은 제어 회로(20)의 동작에 따라서 낮은 레벨의 감마 전압이 전달되는 제1 노드(N1) 및 높은 레벨의 감마 전압이 전달되는 제2 노드(N2)를 하프 전원전압의 레벨로 방전 및 충전시키므로, 디지털 아날로그 컨버터의 동작 속도를 향상시킬 수 있다. 디지털 아날로그 컨버터의 동작 속도 향상으로 증폭기를 포함하는 출력 회로의 출력 슬루율이 향상될 수 있다.

Claims (15)

  1. 데이터 신호들에 따라서 접지전압과 하프 전원전압 사이의 복수의 제1 감마전압들 중 하나를 제1 노드에 전달하거나 상기 하프 전원전압과 전원전압 사이의 복수의 제2 감마전압들 중 하나를 제2 노드에 전달하는 스위치 회로; 및
    상기 제1 노드의 전압이 상기 하프 전원전압보다 높은 경우 상기 제1 노드를 상기 하프 전원전압의 레벨로 방전시키고, 상기 제2 노드의 전압이 상기 하프 전원전압보다 낮은 경우 상기 제2 노드를 상기 하프 전원전압의 레벨로 충전시키는 제어 회로;
    를 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  2. 제 1 항에 있어서, 상기 제어 회로는,
    상기 제1 노드와 상기 하프 전원전압의 단자 사이에 연결되고, 상기 제1 노드를 상기 하프 전원전압의 레벨로 방전시키는 제1 다이오드; 및
    상기 하프 전원전압의 상기 단자와 상기 제2 노드 사이에 연결되며, 상기 제2 노드를 상기 하프 전원전압의 레벨로 충전시키는 제2 다이오드;
    를 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  3. 제 2 항에 있어서, 상기 제어 회로는,
    상기 제1 노드와 출력단 사이에 연결되고, 상기 제1 노드에 전달되는 상기 복수의 제1 감마전압들 중 하나를 상기 데이터 신호들의 최상위 비트에 따라서 상기 출력단에 전달하는 제1 스위치; 및
    상기 제2 노드와 상기 출력단 사이에 연결되며, 상기 제2 노드에 전달되는 상기 복수의 제2 감마전압들 중 하나를 상기 최상위 비트에 따라서 상기 출력단에 전달하는 제2 스위치;
    를 더 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  4. 제 3 항에 있어서, 상기 제1 및 제2 스위치는,
    상기 데이터 신호들의 하위 비트들에 따라서 동작하는 상기 스위치 회로의 스위치들보다 상대적으로 높은 전압 범위에서 구동하며,
    상기 하위 비트들에 따라서 동작하는 상기 스위치 회로의 스위치들은 접지전압과 하프 전원전압 사이의 전압 범위 또는 하프 전원전압과 전원전압 사이의 전압 범위에서 구동하고,
    상기 제1 및 제2 스위치는 상기 접지전압과 상기 전원전압 사이의 전압 범위에서 구동하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  5. 제 1 항에 있어서, 상기 스위치 회로는,
    상기 데이터 신호들의 하위 비트들에 따라서 상기 복수의 제1 감마전압들 중 하나를 전달하는 제1 NMOS 트랜지스터들;
    상기 제1 NMOS 트랜지스터들에 의해 전달되는 상기 복수의 제1 감마전압들 중 하나를 상기 데이터 신호들의 최상위 비트에 따라서 상기 제1 노드에 전달하는 제2 NMOS 트랜지스터;
    상기 하위 비트들에 따라서 상기 복수의 제2 감마전압들 중 하나를 전달하는 제1 PMOS 트랜지스터들; 및
    상기 제1 PMOS 트랜지스터들에 의해 전달되는 상기 복수의 제2 감마전압들 중 하나를 상기 최상위 비트에 따라서 상기 제2 노드에 전달하는 제2 PMOS 트랜지스터;를 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  6. 제 5 항에 있어서, 상기 최상위 비트에 따라서 동작하는 상기 제2 NMOS 트랜지스터 및 상기 제2 PMOS 트랜지스터는,
    상기 하위 비트들에 따라서 동작하는 상기 제1 NMOS 트랜지스터들 및 상기 제1 PMOS 트랜지스터들 보다 상대적으로 높은 전압 범위에서 구동하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  7. 제 1 항에 있어서, 상기 제어 회로는,
    상기 데이터 신호들의 최상위 비트에 따라서 상기 제1 노드의 전압을 출력단에 전달하는 제3 NMOS 트랜지스터;
    상기 최상위 비트에 따라서 상기 제2 노드의 전압을 상기 출력단에 전달하는 제3 PMOS 트랜지스터;
    상기 제1 노드의 전압 레벨이 상기 하프 전원전압보다 높아지는 경우 상기 제1 노드를 상기 하프 전원전압의 레벨로 방전시키는 제1 다이오드; 및
    상기 제2 노드의 전압 레벨이 상기 하프 전원전압보다 낮아지는 경우 상기 제2 노드를 상기 하프 전원전압의 레벨로 충전시키는 제2 다이오드;
    를 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  8. 삭제
  9. 데이터 신호들에 따라서 접지전압과 하프 전원전압 사이의 복수의 제1 감마전압들 중 하나를 제1 노드에 전달하는 제1 스위치 회로;
    상기 데이터 신호들에 따라서 상기 하프 전원전압과 전원전압 사이의 복수의제2 감마전압들 중 하나를 제2 노드에 전달하는 제2 스위치 회로;
    상기 제1 노드의 전압 레벨이 상기 하프 전원전압보다 높아지는 경우 상기 제1 노드를 상기 하프 전원전압의 레벨로 방전시키는 제1 제어 회로; 및
    상기 제2 노드의 전압 레벨이 상기 하프 전원전압보다 낮아지는 경우 상기 제2 노드를 상기 하프 전원전압의 레벨로 충전시키는 제2 제어 회로;
    를 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  10. 제 9 항에 있어서, 상기 제1 제어 회로는,
    상기 제1 노드와 상기 하프 전원전압의 단자 사이에 연결되고, 상기 제1 노드의 전압 레벨이 상기 하프 전원전압보다 높아지는 경우 상기 제1 노드에서 상기 하프 전원전압 단자까지 방전 경로를 형성하는 제1 다이오드를 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  11. 제 9 항에 있어서, 상기 제2 제어 회로는,
    상기 하프 전원전압의 단자와 상기 제2 노드 사이에 연결되며, 상기 제2 노드의 전압 레벨이 상기 하프 전원전압보다 낮아지는 경우 상기 하프 전원전압의 상기 단자에서 상기 제2 노드까지 충전 경로를 형성하는 제2 다이오드를 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  12. 제 9 항에 있어서,
    상기 제1 스위치 회로는,
    상기 데이터 신호들의 하위 비트들에 따라서 상기 복수개의 제1 감마전압들 중 하나를 전달하는 제1 NMOS 트랜지스터들; 및
    상기 제1 NMOS 트랜지스터들에 의해 전달되는 상기 복수개의 제1 감마전압들 중 하나를 상기 데이터 신호들의 최상위 비트에 따라서 상기 제1 노드에 전달하는 제2 NMOS 트랜지스터;를 포함하고,
    상기 제2 스위치 회로는,
    상기 하위 비트들에 따라서 상기 복수개의 제2 감마전압들 중 하나를 전달하는 제1 PMOS 트랜지스터들; 및
    상기 제1 PMOS 트랜지스터들에 의해 전달되는 상기 복수개의 제2 감마전압들 중 하나를 상기 최상위 비트에 따라서 상기 제2 노드에 전달하는 제2 PMOS 트랜지스터;를 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  13. 제 12 항에 있어서,
    상기 제2 NMOS 트랜지스터 및 상기 제2 PMOS 트랜지스터는, 상기 하위 비트들에 따라서 동작하는 상기 제1 NMOS 트랜지스터들 및 상기 제1 PMOS 트랜지스터들 보다 상대적으로 높은 전압 범위에서 구동하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  14. 제 9 항에 있어서,
    상기 제1 노드에 전달되는 상기 복수개의 제1 감마전압들 중 하나를 상기 데이터 신호들의 최상위 비트에 따라서 출력단에 전달하는 제3 NMOS 트랜지스터; 및
    상기 제2 노드에 전달되는 상기 복수개의 제2 감마전압들 중 하나를 상기 최상위 비트에 따라서 상기 출력단에 전달하는 제3 PMOS 트랜지스터;
    를 더 포함하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
  15. 제 14 항에 있어서,
    상기 제3 NMOS 트랜지스터 및 제3 PMOS 트랜지스터는, 상기 제1 및 제2 스위치 회로에서 상기 데이터 신호들의 하위 비트들에 따라서 동작하는 제1 NMOS 트랜지스터들 및 제1 PMOS 트랜지스터들 보다 상대적으로 높은 전압 범위에서 구동하는 디스플레이 구동 장치의 디지털 아날로그 컨버터.
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