KR102355944B1 - 계통연계 인버터의 전력 제어 장치 및 방법 - Google Patents

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노정욱
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이창현
박도일
정희성
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국민대학교산학협력단
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Abstract

계통연계 인버터의 전력 제어 장치가 제공된다. 전력 제어 장치는 그리드 교류 전압으로부터 센싱된 시간 간격에 기반하여 상기 그리드 교류 전압의 주기 TL을 계산하는 단계, 상기 그리드 교류 전압의 주기 TL, 상기 그리드 교류 전압의 진폭 |Vgrid| 및 듀티 사이클 신호 생성부에 연결되는 기준 전류의 크기 |Iinj.ref|를 이용하여 상기 계통연계 인버터에 포함되는 복수의 스위칭 소자들을 제어하기 위한 기준 신호의 위상 φ을 계산하는 단계, 상기 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 전력 사용량 Pgrid를 계산하는 단계, 상기 계산된 그리드 전력 사용량 Pgrid과 미리 설정된 기준 전력량의 차이값에 기반하여 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 생성하는 단계 및 상기 프로세서가, 상기 기준 신호의 위상 φ, 상기 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 이용하여 듀티 사이클 제어 신호를 생성하는 단계를 수행할 수 있다.

Description

계통연계 인버터의 전력 제어 장치 및 방법{POWER CONTROLLING APPARATUS AND METHOD FOR GRID CONNECTED INVERTER}
이하의 설명은 계통연계 인버터의 전력 제어 장치 및 방법에 관한 것이다. 보다 구체적으로, 그리드 소비 전력과 기준 전력의 비교를 통해 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 리셋 주기와 범위를 결정함으로써 주입 전력을 보다 효율적으로 제어하는 계통연계 인버터의 전력 제어 장치 및 방법에 관한 것이다.
대한민국의 전기요금 체계는 누진세 방식으로서 전력 사용량이 높은 구간에 속하게 되면 더 높은 전력 당 요금을 적용 받는 방식이다. 최근 정부에서는 가정에서 측정된 전력 사용량을 계절과 시간대별로 분류해 전기료를 다르게 부과하는 새로운 요금 체계를 도입할 계획을 발표했다. 같은 양의 전기를 쓰더라도 주간, 야간, 계절에 따라 요금이 달라지므로 저렴한 시간대에 맞춰 소비자 스스로 전기를 합리적으로 이용하도록 유도하는 방식이다.
위와 같은 요금 체계 내에서는 에너지 저장 장치(ESS: energy storage system)로부터 계통으로 전류를 주입시키는 과정에서, 가정 내의 전력 사용 패턴과 선택된 요금 체계에 따라 효과적으로 전류 주입량을 조절할 필요성이 존재한다.
일본 등록특허 제6662096호(2020.02.17) 대한민국 등록특허 제10-2067550호(2020.01.13)
일 측면에 따르면, 계통연계 인버터의 전력 제어 장치가 제공된다. 상기 계통연계 인버터의 전력 제어 장치는 상기 계통연계 인버터로부터 전류가 주입되는 부하에서 측정되는 그리드 교류 전압의 영점들을 센싱하고, 상기 센싱된 영점들의 시간 간격에 기반하여 상기 그리드 교류 전압의 주기 TL을 계산하는 주기 계산부, 상기 그리드 교류 전압의 주기 TL, 상기 그리드 교류 전압의 진폭 |Vgrid| 및 듀티 사이클 신호 생성부로 입력되는 기준 전류의 크기 |Iinv.ref|에 기초하여 상기 계통연계 인버터에 포함되는 복수의 스위칭 소자들을 제어하기 위한 기준 신호의 위상 φ을 계산하고, 상기 기준 신호의 위상 φ을 이용하여 듀티 사이클 제어 신호를 생성하는 듀티 사이클 신호 생성부, 상기 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 소비 전력 Pgrid를 계산하는 소비 전력 계산부 및 상기 계산된 그리드 소비 전력 Pgrid과 미리 설정된 기준 전력의 차이에 기반하여 상기 듀티 사이클 제어 신호를 생성하기 위한 카운트 인덱스의 리셋 주기와 상기 카운트 인덱스의 범위를 결정하고, 상기 카운트 인덱스의 리셋 주기 및 상기 카운트 인덱스의 범위에 기초하여 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel을 상기 듀티 사이클 신호 생성부로 출력하는 전력 제어부를 포함할 수 있다.
일 실시 예에 따르면, 상기 듀티 사이클 신호 생성부는 상기 전력 제어부로부터 전달되는 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel에 기반하여 상기 듀티 사이클 제어 신호를 생성할 수 있다.
다른 일 실시 예에 따르면, 상기 전력 제어부는 상기 주기 계산부로부터 상기 그리드 교류 전압의 주기 TL가 새롭게 출력되는 경우, 상기 듀티 사이클 제어 신호를 생성하기 위한 카운트 인덱스의 크기를 소정 크기만큼 증가시킬 수 있다.
또 다른 일 실시 예에 따르면, 상기 전력 제어부는 상기 증가된 카운트 인덱스가 상기 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 범위 내에 존재하는 경우에, 상기 듀티 사이클 제어 신호를 생성하도록 하는 전류 주입신호 Ienable를 상기 듀티 사이클 신호 생성부로 출력할 수 있다.
또 다른 일 실시 예에 따르면, 상기 전력 제어부는 상기 증가된 카운트 인덱스가 상기 리셋 주기에 대응되는 경우, 상기 카운트 인덱스를 초기값으로 재설정하고, 상기 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 범위에 대응하는 전류 주입량 조절 신호 Plevel를 상기 듀티 사이클 신호 생성부로 출력할 수 있다.
또 다른 일 실시 예에 따르면, 상기 계통연계 인버터의 전력 제어 장치는 상기 그리드 교류 전압의 진폭 |Vgrid| 및 상기 그리드 교류 전압의 주기 TL에 따라 소정 시간 구간 동안 지정된 전압 레벨로 샘플링된 복수의 룩업 테이블을 저장하는 메모리부를 더 포함하고, 상기 메모리부는 상기 그리드 교류 전압의 진폭 |Vgrid|, 상기 그리드 교류 전압의 주기 TL 및 상기 전류 주입량 조절 신호 Plevel에 따라 제1 룩업 테이블을 출력할 수 있다.
또 다른 일 실시 예에 따르면, 상기 복수의 룩업 테이블 각각은 상기 소정 시간 동안의 그리드 교류 전압의 평균값을 상기 소정 시간에 대응하는 전압 레벨로 가지며, 계단함수(step function) 형태로서 시간과 전압 레벨로 정의되는 그래프일 수 있다.
또 다른 일 실시 예에 따르면, 상기 듀티 사이클 신호 생성부는 상기 출력된 제1 룩업 테이블의 전압 레벨을 상기 기준 신호의 위상 φ에 따라 시프팅하고, 상기 시프팅된 전압 레벨과 미리 지정된 톱니파(ramp wave)의 크기를 비교함으로써, 상기 시프팅된 전압 레벨이 상기 톱니파보다 큰 시간 구간에 대응하는 듀티 사이클 제어 신호를 생성할 수 있다.
또 다른 일 실시 예에 따르면, 상기 계통연계 인버터의 전력 제어 장치는 상기 그리드 교류 전압의 피크값 |Vgrid|max을 센싱하고, 상기 센싱된 상기 그리드 교류 전압의 피크값 |Vgrid|max에 따라 상기 계통연계 인버터로 입력되는 직류 전압 VDC의 크기를 제어하는 입력 전압 제어부를 더 포함할 수 있다.
또 다른 일 실시 예에 따르면, 상기 듀티 사이클 신호 생성부는 수학식 6에 기반하여 상기 기준 신호의 위상 φ를 계산할 수 있다. 상기 수학식 6은
Figure 112021099409480-pat00001
이고, L은 상기 계통연계 인버터의 출력 인덕턴스의 크기를 나타낼 수 있다.
다른 일 측면에 따르면, 적어도 하나의 프로세서에 의해 수행되는 계통연계 인버터의 전력 제어 방법이 제공된다. 상기 계통연계 인버터의 전력 제어 방법은 상기 프로세서가, 그리드 교류 전압으로부터 센싱된 시간 간격에 기반하여 상기 그리드 교류 전압의 주기 TL을 계산하는 단계, 상기 프로세서가, 상기 그리드 교류 전압의 주기 TL, 상기 그리드 교류 전압의 진폭 |Vgrid| 및 듀티 사이클 신호 생성부로 입력되는 기준 전류의 크기 |Iinv.ref|에 기초하여 상기 계통연계 인버터에 포함되는 복수의 스위칭 소자들을 제어하기 위한 기준 신호의 위상 φ을 계산하는 단계, 상기 프로세서가, 상기 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 소비 전력 Pgrid를 계산하는 단계, 상기 프로세서가, 상기 계산된 그리드 소비 전력 Pgrid과 미리 설정된 기준 전력의 차이에 기반하여 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 생성하는 단계 및 상기 프로세서가, 상기 기준 신호의 위상 φ, 상기 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 이용하여 듀티 사이클 제어 신호를 생성하는 단계를 포함할 수 있다.
일 실시 예에 따르면, 상기 계통연계 인버터의 전력 제어 방법은 상기 그리드 교류 전압의 주기 TL가 새롭게 계산되는 경우, 상기 듀티 사이클 제어 신호를 생성하기 위한 카운트 인덱스의 크기를 소정 크기만큼 증가시키는 단계를 더 포함할 수 있다.
다른 일 실시 예에 따르면, 상기 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 생성하는 단계는, 상기 증가된 카운트 인덱스가 상기 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 범위 내에 존재하는 경우에, 상기 듀티 사이클 제어 신호를 생성하도록 하는 전류 주입신호 Ienable를 생성하는 단계를 포함할 수 있다.
또 다른 일 실시 예에 따르면, 상기 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 생성하는 단계는, 상기 증가된 카운트 인덱스가 상기 리셋 주기에 대응되는 경우, 상기 카운트 인덱스를 초기값으로 재설정하고, 상기 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 범위에 대응하는 전류 주입량 조절 신호 Plevel를 생성하는 단계를 포함할 수 있다.
또 다른 일 실시 예에 따르면, 상기 계통연계 인버터의 전력 제어 방법은 상기 프로세서에 연결된 메모리부가, 상기 그리드 교류 전압의 진폭 |Vgrid|, 상기 그리드 교류 전압의 주기 TL 및 상기 전류 주입량 조절 신호 Plevel에 따라 미리 저장된 룩업 테이블을 출력하는 단계를 더 포함할 수 있다.
또 다른 일 측면에 따르면, 컴퓨터 장치로 하여금, 그리드 교류 전압으로부터 센싱된 시간 간격에 기반하여 상기 그리드 교류 전압의 주기 TL을 계산하는 단계, 상기 그리드 교류 전압의 주기 TL, 상기 그리드 교류 전압의 진폭 |Vgrid| 및 듀티 사이클 신호 생성부에 연결되는 기준 전류의 크기 |Iinv.ref|를 이용하여 상기 계통연계 인버터에 포함되는 복수의 스위칭 소자들을 제어하기 위한 기준 신호의 위상 φ을 계산하는 단계, 상기 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 전력 사용량 Pgrid를 계산하는 단계, 상기 계산된 그리드 전력 사용량 Pgrid과 미리 설정된 기준 전력량의 차이값에 기반하여 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 생성하는 단계 및 상기 프로세서가, 상기 기준 신호의 위상 φ, 상기 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 이용하여 듀티 사이클 제어 신호를 생성하는 단계를 수행하도록 구현된 명령어(instructions)를 포함하는, 매체에 기록된 컴퓨터 프로그램이 제공된다.
본 실시 예에 따른 계통연계 인버터는 부하의 전력 사용 패턴과 필요 전력량을 고려하여 미리 설정된 주기 내에서만 계통연계 인버터가 전류를 주입할 수 있도록 듀티 사이클 제어 신호를 생성함으로써 저사양의 프로세서를 통해 작은 계산량만으로도 고효율의 전류 제어를 구현하는 효과를 제공할 수 있다.
또한, 계통연계 인버터의 입력 직류 전압을 가변형 직류 링크와 연결함으로써 감지된 그리드 교류 전압의 피크값에 따라 입력 직류 전압이 동적 제어되도록 하여 전류 크기 제어와 위상 제어를 동시에 진행함으로써 불필요한 피드백 연산에 소요되는 시간을 감소시키는 효과를 기대할 수 있다.
본 발명의 실시 예의 설명에 이용되기 위하여 첨부된 아래 도면들은 본 발명의 실시 예들 중 단지 일부일 뿐이며, 본 발명의 기술분야에서 통상의 지식을 가진 사람(이하 "통상의 기술자"라 함)에게 있어서는 발명에 이르는 추가 노력 없이 이 도면들에 기초하여 다른 도면들이 얻어질 수 있다.
도 1은 일 실시 예에 따른 계통연계 인버터의 전력 제어 장치를 설명하는 블록도이다.
도 2는 다른 일 실시 예에 따른 계통연계 인버터의 전력 제어 장치를 설명하는 회로도이다.
도 3a 내지 도 3c는 도 2에서 설명된 계통연계 인버터의 전력 제어 장치가 생성하는 듀티 사이클 제어 신호의 시간에 따른 파형이다.
도 4는 도 2에서 설명된 계통연계 인버터의 전력 제어 장치에 이용되는 주요 신호들의 시간에 따른 파형이다.
도 5는 또 다른 일 실시 예에 따른 계통연계 인버터의 동작 과정을 설명하기 위해 모델링된 회로도이다.
도 6은 일 실시 예에 따른 주기 계산부의 동작 과정을 설명하는 주요 신호들의 그래프이다.
도 7은 일 실시 예에 따라 메모리부에 저장된 룩업 테이블의 예시도이다.
도 8은 일 실시 예에 따라 계통연계 인버터에 연결된 펄스 폭 변조 회로의 출력 신호를 설명하는 그래프이다.
도 9는 또 다른 일 실시 예에 따른 계통연계 인버터의 전력 제어 장치의 시뮬레이션 결과를 나타내는 그래프이다.
후술하는 본 발명에 대한 상세한 설명은, 본 발명의 목적들, 기술적 해법들 및 장점들을 분명하게 하기 위하여 본 발명이 실시될 수 있는 특정 실시 예를 예시로서 도시하는 첨부 도면을 참조한다. 이들 실시 예는 통상의 기술자가 본 발명을 실시할 수 있도록 상세히 설명된다.
본 발명의 상세한 설명 및 청구항들에 걸쳐, '포함하다'라는 단어 및 그 변형은 다른 기술적 특징들, 부가물들, 구성요소들 또는 단계들을 제외하는 것으로 의도된 것이 아니다. 또한, '하나' 또는 '한'은 하나 이상의 의미로 쓰인 것이며, '또 다른'은 적어도 두 번째 이상으로 한정된다.
또한, 본 발명의 '제1', '제2' 등의 용어는 하나의 구성요소를 다른 구성요소로부터 구별하기 위한 것으로서, 순서를 나타내는 것으로 이해되지 않는 한 이들 용어들에 의하여 권리범위가 한정되어서는 아니 된다. 예를 들어, 제1 구성요소는 제2 구성요소로 명명될 수 있고, 이와 유사하게 제2 구성요소도 제1 구성요소로 명명될 수 있다.
어떤 구성요소가 다른 구성요소에 "연결되어" 있다고 언급된 때에는 그 다른 구성요소에 직접 연결될 수도 있지만 중간에 다른 구성요소가 개재할 수도 있다고 이해되어야 할 것이다. 반면에 어떤 구성요소가 다른 구성요소에 "직접 연결되어" 있다고 언급된 때에는 중간에 다른 구성요소가 존재하지 않는 것으로 이해되어야 할 것이다. 한편, 구성요소들 간의 관계를 설명하는 다른 표현들, 즉, "~사이에"와 "바로 ~사이에" 또는 "~에 이웃하는"과 "~에 직접 이웃하는" 등도 마찬가지로 해석되어야 한다.
각 단계들에 있어서 식별부호(예를 들어, a, b, c 등)는 설명의 편의를 위하여 사용된 것으로 식별부호는 논리상 필연적으로 귀결되지 않는 한 각 단계들의 순서를 설명하는 것이 아니며, 각 단계들은 명기된 순서와 다르게 일어날 수 있다. 즉, 각 단계들은 명기된 순서와 동일하게 일어날 수도 있고 실질적으로 동시에 수행될 수도 있으며, 반대의 순서로 수행될 수도 있다.
통상의 기술자에게 본 발명의 다른 목적들, 장점들 및 특성들이 일부는 본 설명서로부터, 그리고 일부는 본 발명의 실시로부터 드러날 것이다. 아래의 예시 및 도면은 실례로서 제공되며, 본 발명을 한정하는 것으로 의도된 것이 아니다. 따라서, 특정 구조나 기능에 관하여 본 명세서에 개시된 상세 사항들은 한정하는 의미로 해석되어서는 아니되고, 단지 통상의 기술자가 실질적으로 적합한 임의의 상세 구조들로써 본 발명을 다양하게 실시하도록 지침을 제공하는 대표적인 기초 자료로 해석되어야 할 것이다.
더욱이 본 발명은 본 명세서에 표시된 실시 예들의 모든 가능한 조합들을 망라한다. 본 발명의 다양한 실시 예는 서로 다르지만 상호 배타적일 필요는 없음이 이해되어야 한다. 예를 들어, 여기에 기재되어 있는 특정 형상, 구조 및 특성은 일 실시 예에 관련하여 본 발명의 사상 및 범위를 벗어나지 않으면서 다른 실시 예로 구현될 수 있다. 또한, 각각의 개시된 실시 예 내의 개별 구성요소의 위치 또는 배치는 본 발명의 사상 및 범위를 벗어나지 않으면서 변경될 수 있음이 이해되어야 한다. 따라서, 후술하는 상세한 설명은 한정적인 의미로서 취하려는 것이 아니며, 본 발명의 범위는, 적절하게 설명된다면, 그 청구항들이 주장하는 것과 균등한 모든 범위와 더불어 첨부된 청구항에 의해서만 한정된다. 도면에서 유사한 참조부호는 여러 측면에 걸쳐서 동일하거나 유사한 기능을 지칭한다.
본 명세서에서 달리 표시되거나 분명히 문맥에 모순되지 않는 한, 단수로 지칭된 항목은, 그 문맥에서 달리 요구되지 않는 한, 복수의 것을 아우른다. 또한, 본 발명을 설명함에 있어, 관련된 공지 구성 또는 기능에 대한 구체적인 설명이 본 발명의 요지를 흐릴 수 있다고 판단되는 경우에는 그 상세한 설명은 생략한다.
이하, 통상의 기술자가 본 발명을 용이하게 실시할 수 있도록 하기 위하여, 본 발명의 바람직한 실시 예들에 관하여 첨부된 도면을 참조하여 상세히 설명하기로 한다.
도 1은 일 실시 예에 따른 계통연계 인버터의 전력 제어 장치를 설명하는 블록도이다. 도 1을 참조하면, 계통연계 인버터의 전력 제어 장치(100)는 주기 계산부(110), 듀티 사이클 신호 생성부(120), 소비 전력 계산부(130) 및 전력 제어부(140)를 포함할 수 있다. 주기 계산부(110)는 계통연계 인버터로부터 전류가 주입되는 부하에서 측정되는 그리드 교류 전압의 영점들을 센싱할 수 있다. 또한, 주기 계산부(110)는 센싱된 영점들의 시간 간격에 기반하여 그리드 교류 전압의 주기 TL을 계산할 수 있다.
듀티 사이클 신호 생성부(120)는 그리드 교류 전압의 주기 TL, 그리드 교류 전압의 진폭 |Vgrid| 및 듀티 사이클 신호 생성부로 입력되는 기준 전류의 크기 |Iinj.ref|를 이용하여 기준 신호의 위상 φ을 계산할 수 있다. 또한, 듀티 사이클 신호 생성부(120)는 기준 신호를 이용하여 계통연계 인버터에 포함되는 복수의 스위치 소자들을 제어할 수 있다. 보다 구체적으로, 듀티 사이클 신호 생성부(120)는 기준 신호의 위상 φ을 이용하여 듀티 사이클 제어 신호를 생성할 수 있다.
소비 전력 계산부(130)는 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 소비 전력 Pgrid를 계산할 수 있다.
전력 제어부(140)는 소비 전력 계산부(130)로부터 계산된 그리드 소비 전력 Pgrid과 미리 설정된 기준 전력의 차이에 기반하여 상기 듀티 사이클 제어 신호를 생성하기 위한 카운트 인덱스의 리셋 주기와 상기 카운트 인덱스의 범위를 결정할 수 있다. 또한, 전력 제어부(140)는 카운트 인덱스의 리셋 주기 및 상기 카운트 인덱스의 범위에 기초하여 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel을 듀티 사이클 신호 생성부(120)로 출력할 수 있다. 듀티 사이클 신호 생성부(120)가 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel에 기반하여 듀티 사이클 제어 신호를 생성하는 과정에서 대해서는 이하에서 추가될 도면과 함께 보다 상세히 설명될 것이다.
도 2는 다른 일 실시 예에 따른 계통연계 인버터의 전력 제어 장치를 설명하는 회로도이다. 도 2를 참조하면, 복수의 스위칭 소자를 포함하는 계통연계 인버터(210)의 출력 전압 Vinv는 아래의 수학식 1과 같이 정리될 수 있다.
Figure 112021099409480-pat00002
설명의 편의를 위해, 계통연계 인버터의 전류 주입 과정을 간소화한 도 5와 함께 설명한다. 도 5는 또 다른 일 실시 예에 따른 계통연계 인버터의 동작 과정을 설명하기 위해 모델링된 회로도이다. 도 5을 참조하면, 계통연계 인버터를 통해 주입되는 전류 Iinv는 그리드 교류 전압 Vgrid이 인가되고 있는 부하로 전달된다. 도 5에서, L은 계통연계 인버터의 출력 인덕턴스의 크기를 나타낸다.
도 5의 회로에서, 키르히호프의 전류 법칙(KCL: Kirchhoff's current law)에 기반하여 계통연계 인버터를 통해 출력되는 전류
Figure 112021099409480-pat00003
를 정리하면 아래의 수학식 2와 같이 정리될 수 있다.
Figure 112021099409480-pat00004
상기 수학식 2에서 ωL은 그리드 교류 전압 Vgrid의 각 주파수로서 2π/TL로 정의된다. 이 경우에,
Figure 112021099409480-pat00005
을
Figure 112021099409480-pat00006
에 관한 식으로 정리하면 아래의 수학식 3과 같다.
Figure 112021099409480-pat00007
이 경우에, 시간 도메인에서 Vgrid(t)는 |Vgrid|cos(ωL×t)로 정의될 수 있다. 또한, 계통부하에 기준 전류의 크기인 |Iinv.ref|를 주입하는 경우에, Iinv(t)의 위상도 Vgrid(t)와 동일해야 할 것이다. 따라서, Iinv(t)는 시간 도메인에서 아래의 수학식 4와 같이 전개될 수 있다.
Figure 112021099409480-pat00008
상기 수학식 3, 4를 참조하면,
Figure 112021099409480-pat00009
를 시간 도메인에서 전개하면 아래의 수학식 5와 같이 정리될 수 있다.
Figure 112021099409480-pat00010
상기 수학식 5에서 L은 계통연계 인버터의 출력 인덕턴스의 크기를 나타낸다. 다시 도 2로 돌아오면, 듀티 사이클 신호 생성부(230)는 위와 같은 연산에 기반하여 기준 신호가 되는 Vinv(t)의 위상 φ를 수학식 6과 같이 계산할 수 있다.
Figure 112021099409480-pat00011
상기 수학식 6에서 |Vgrid|, ωL, L 및 |Iinv.ref|이 상수(constant)인 경우로 가정한다면, |Vinv|와 위상 φ 역시 상수라는 것이 증명된다. 예시적으로, |Vgrid|=220
Figure 112021099409480-pat00012
, ωL =2π×60Hz, L=10mH 및 |Iinv.ref|=5A라는 동작 조건에서 계통연계 인버터가 동작하는 경우에, |Vinv|=311.697V 및 위상 φ = 3.467°로 상수로서 계산됨으로써 계통연계 인버터의 위상 동기 장치의 빠른 동기화가 가능하다는 것이 수식적으로 입증된다.
이 경우에, 계통연계 인버터(210)에 포함되는 복수의 스위치 소자들이 풀 브릿지 회로 토폴로지로 연결되는 경우에 Vinv(t)는 아래의 수학식 7과 같이 정의될 수 있다.
Figure 112021099409480-pat00013
상기 수학식 5와 상기 수학식 7에 기반하여 D(t)가 정리되는 경우, D(t)는 아래의 수학식 8과 같이 정의될 수 있다.
Figure 112021099409480-pat00014
또한, 다른 일 실시예로서 계통연계 인버터(210)에 포함되는 복수의 스위치 소자들이 바이폴라 PWM 스위칭(bipolar PWM switching) 토폴로지로 연결되는 경우, 펄스 폭 변조 회로의 출력 신호 d(t)는 아래의 수학식 9와 같이 정의될 수 있다.
Figure 112021099409480-pat00015
위와 같은 수학식 8, 9와 같이, 계통연계 인버터의 출력 인덕터의 인덕턴스 L, 그리드 교류 전압의 주기 TL, 상기 그리드 교류 전압의 진폭 |Vgrid| 및 듀티 사이클 제어부에 연결되는 기준 전류의 크기 |Iinj.ref|가 측정될 수 있는 경우에 듀티 사이클 신호 생성부(230)에서 위상 동기화를 위한 출력 신호 D(t)를 생성할 수 있다는 것이 수식적으로 증명된다.
도 3a 내지 도 3c는 도 2에서 설명된 계통연계 인버터의 전력 제어 장치가 생성하는 듀티 사이클 제어 신호의 시간에 따른 파형이다. 도 2를 참조하면, 주기 계산부(220)는 부하에서 측정되는 그리드 교류 전압 Vgrid의 영점들을 센싱할 수 있다. 또한, 주기 계산부(220)는 센싱된 영점들의 시간 간격에 기반하여 상기 그리드 교류 전압의 주기 TL을 계산할 수 있다. 소비 전력 계산부(240)는 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 소비 전력 Pgrid를 계산할 수 있다.
도 3a를 참조하면, 그리드 소비 전력 Pgrid이 1kW이고 기준 전력이 0.5kW인 경우에 듀티 사이클 신호 생성부(230)가 생성하는 듀티 사이클 제어 신호 D(t)가 도시된다. 전력 제어부(250)는 그리드 소비 전력 Pgrid과 기준 전력의 차이인 0.5kW에 기반하여 듀티 사이클 제어 신호 D(t)를 생성하기 위한 카운트 인덱스의 리셋 주기를 4로 설정하고, 듀티 사이클 제어 신호 D(t)를 생성하는 카운트 인덱스의 범위를 초기값인 0으로 결정할 수 있다. 이 경우에, 전력 제어부(250)는 전체 네 번의 생성 주기에서 한 번의 주기동안만 듀티 사이클 제어 신호 D(t)가 출력되도록 하는 크기에 대응하는 전류 주입량 조절 신호 Plevel를 듀티 사이클 신호 생성부(230)로 출력할 수 있다.
전력 제어부(250)는 주기 계산부(220)로부터 그리드 교류 전압의 주기 TL가 새롭게 출력되는 경우, 듀티 사이클 제어 신호 D(t)를 생성하기 위한 카운트 인덱스 i의 크기를 소정 크기만큼 증가시킬 수 있다. 이 경우에, 전력 제어부(250)는 증가된 카운트 인덱스가 듀티 사이클 제어 신호 D(t)를 생성하는 카운트 인덱스 i의 범위 내에 존재하는 경우에, 듀티 사이클 제어 신호 D(t)를 생성하도록 하는 전류 주입신호 Ienable를 듀티 사이클 신호 생성부(230)로 출력할 수 있다. 도 3a의 실시 예에서는, 전체의 생성 주기 내에서 첫 번째 주기를 나타내는 i=0(카운트 인덱스의 초기값)인 경우에만 전력 제어부(250)가 전류 주입신호 Ienable를 듀티 사이클 신호 생성부(230)로 출력할 수 있다.
그리드 교류 전압의 주기 TL가 새롭게 출력되는 경우, 전력 제어부(250) 내에서 관리되는 카운트 인덱스 i는 0 -> 1 -> 2 -> 3-> 0-> 1-> 2-> 3 -> ... 과 같은 방식으로 반복된다. 카운트 인덱스 i=3으로 리셋 주기에 도달하게 된 이후에 그리드 교류 전압의 주기 TL가 새롭게 출력되면, 전력 제어부(250)는 카운트 인덱스 i를 0인 초기값으로 재설정하고, 듀티 사이클 제어 신호 D(t)를 생성하는 카운트 인덱스의 범위를 나타내는 전류 주입량 조절 신호 Plevel를 새롭게 듀티 사이클 신호 생성부(230)로 출력할 수 있다.
도 3b를 참조하면, 그리드 소비 전력 Pgrid이 2.5kW이고 기준 전력이 0.5kW인 경우에 듀티 사이클 신호 생성부(230)가 생성하는 듀티 사이클 제어 신호 D(t)가 도시된다. 전력 제어부(250)는 그리드 소비 전력 Pgrid과 기준 전력의 차이인 2.0kW에 기반하여 듀티 사이클 제어 신호 D(t)를 생성하기 위한 카운트 인덱스의 리셋 주기를 4로 설정하고, 듀티 사이클 제어 신호 D(t)를 생성하는 카운트 인덱스의 범위를 0에서 3까지로 결정할 수 있다. 이 경우에, 전력 제어부(250)는 전체 네 번의 생성 주기 내에서 카운트 인덱스의 초기값인 i=0인 경우에 듀티 사이클 제어 신호 D(t)가 출력되도록 하는 크기에 대응하는 전류 주입량 조절 신호 Plevel를 듀티 사이클 신호 생성부(230)로 출력할 수 있다.
도 3b의 실시 예에서는, 전체의 생성 주기 내에서 모든 주기에 대응하는 i=0(카운트 인덱스의 초기값) 이상 i=3 이하 구간 전부에서 전력 제어부(250)가 전류 주입신호 Ienable를 듀티 사이클 신호 생성부(230)로 출력할 수 있다.
도 3c를 참조하면, 그리드 소비 전력 Pgrid이 1.5kW이고 기준 전력이 0.5kW인 경우에 듀티 사이클 신호 생성부(230)가 생성하는 듀티 사이클 제어 신호 D(t)가 도시된다. 전력 제어부(250)는 그리드 소비 전력 Pgrid과 기준 전력의 차이인 1.0kW에 기반하여 듀티 사이클 제어 신호 D(t)를 생성하기 위한 카운트 인덱스의 리셋 주기를 5로 설정하고, 듀티 사이클 제어 신호 D(t)를 생성하는 카운트 인덱스의 범위를 0에서 1까지로 결정할 수 있다. 이전 실시 예와는 상이하게 본 실시 예에서는 전체 5 번의 그리드 교류 전압의 주기 TL가 새롭게 출력되는 주기 내에서 카운트 인덱스의 초기값인 i=0인 경우에 듀티 사이클 제어 신호 D(t)가 출력되도록 하는 크기에 대응하는 전류 주입량 조절 신호 Plevel를 듀티 사이클 신호 생성부(230)로 출력할 수 있다.
도 3c의 실시 예에서는, 전체의 생성 주기 내에서 첫 번째, 두 번째 주기 각각에 대응하는 i=0(카운트 인덱스의 초기값) 이상 i=1 이하 구간에서 전력 제어부(250)가 전류 주입신호 Ienable를 듀티 사이클 신호 생성부(230)로 출력할 수 있다.
본 실시 예에 따른 전력 제어부(250)의 동작에 따라 듀티 사이클 신호 생성부(230)가 필요한 주기 내에서만 계통연계 인버터가 전류를 주입하도록 제어함으로써, 저사양의 프로세서를 통해서 고효율의 전류 제어를 구현하는 효과를 제공할 수 있다.
도 4는 도 2에서 설명된 계통연계 인버터의 전력 제어 장치에 이용되는 주요 신호들의 시간에 따른 파형이다. 도 4를 참조하면, 센싱된 그리드 교류 전압 VGRID,SEN의 시간에 따른 그래프가 도시된다. 입력 전압 제어부(260)의 피크 검출부는 기저장된 피크값의 크기 보다 오차 범위를 초과하는 제1 피크값(410)을 감지할 수 있다. 이 경우에, 입력 전압 제어부(260)는 제1 피크값(240)과 직류 전압 VDC의 차이가 소정의 기준치 이상이 되는 것을 계산할 수 있다. 입력 전압 제어부(260)는 계통연계 인버터로 입력되는 직류 전압 VDC의 크기를 증가시키기 위해 펄스 폭 변조(PWM: pulse width modulation) 회로의 동작 모드를 변경하기 위한 트리거 신호를 생성할 수 있다. 일 실시 예로서, 상기 트리거 신호에 응답하여, 도 2b의 PWMB가 출력하는 DB(t) 신호의 듀티 간격이 증가됨으로써, 제1 시점(420)에서 제2 시점(440)까지 직류 전압 VDC의 크기가 증가되도록 제어한다.
추가로, 입력 전압 제어부(260)의 피크 검출부는 감소된 제2 피크값(430)를 감지할 수 있다. 이 경우에, 입력 전압 제어부(260)가 계통연계 인버터로 입력되는 직류 전압 VDC의 크기를 감소시키기 위한 트리거 신호를 생성할 수 있다는 것은 통상의 기술자에게는 자명한 사실일 것이다. 다만, 상기 트리거 신호가 펄스 폭 변조 회로로 입력되어 직류 전압 VDC의 크기를 제어하는 것은 이해를 돕기 위한 예시적 기재일 뿐, 다른 실시 예를 한정하거나 제한하는 것은 아니다. 이를 테면, 펄스 주파수 변조(PFM: pulse frequency modulation), current mode control, constant on time control 등 직류 전압 VDC의 크기를 제어할 수 있는 다양한 수단에 트리거 신호가 입력될 수 있음은 통상의 기술자에게는 자명한 사실일 것이다.
도 4에서, 제3 시점(450)에서 주기 계산부(220)에 연결된 제로 크로싱 검출부는 그리드 교류 전압의 주기 TL가 기저장된 주기보다 증가한 것을 감지할 수 있다. 도 4에서는 설명의 편의를 위해 주기 계산부와 제로 크로싱 검출부를 별도의 유닛으로 설명하나, 구현 과정에서 주기 계산부에 제로 크로싱 검출부가 포함되어 하나의 유닛으로 구현 가능하다는 것은 통상의 기술자에게는 자명한 사실일 것이다. 주기 계산부의 상세한 동작 과정에 대해서는 이하에서 추가될 도면과 함께 보다 자세히 설명된다.
도 6은 일 실시 예에 따른 주기 계산부의 동작 과정을 설명하는 주요 신호들의 그래프이다. 도 6를 참조하면, 주기 계산부에 포함된 제로 크로싱 검출부는 그리드 교류 전압의 영점들을 센싱할 수 있다. 또한, 주기 계산부는 센싱된 영점들의 시간 간격에 기반하여 상기 그리드 교류 전압의 주기 TL을 계산할 수 있다. 보다 구체적으로, 도 6에서 설명된 주기 계산부(220)는 2 회 연속으로 측정된 영점들의 간격으로 정의되는 그리드 교류 전압의 주기 TL가 미리 저장된 그리드 교류 전압의 주기 TL '와 상이한 경우에 새로운 듀티 사이클 생성을 위한 트리거 신호를 듀티 사이클 신호 생성부(230)로 출력할 수 있다. 듀티 사이클 신호 생성부(230)는 입력되는 트리거 신호에 응답하여 듀티 사이클 제어 신호를 생성할 수 있다.
도 7은 일 실시 예에 따라 메모리부에 저장된 룩업 테이블의 예시도이다. 도 1에 도시되지는 않았지만, 계통연계 인버터의 전력 제어 장치는 메모리부를 더 포함할 수 있다. 메모리부는 그리드 교류 전압의 진폭 |Vgrid| 및 상기 그리드 교류 전압의 주기 TL에 따라 소정 시간 구간 동안 지정된 전압 레벨로 샘플링된 복수의 룩업 테이블을 저장, 유지 및 관리할 수 있다. 또한 또한, 메모리부는 그리드 교류 전압의 대응 스펙에 따라 복수의 룩업 테이블 중 하나를 출력할 수 있다. 구체적으로, 메모리부는 그리드 교류 전압의 진폭 |Vgrid|, 그리드 교류 전압의 주기 TL에 및 전류 주입량 조절 신호 Plevel에 따라 하나의 룩업 테이블을 출력할 수 있다.
도 7을 참조하면, 전력 제어부에 저장된 카운트 인덱스 i=0, |Vgrid|가 1.5V이고 1/TL 가 60Hz인 경우에 이용 가능한 제1 룩업 테이블(700)이 도시된다. 구체적으로, 제1 룩업 테이블(700)은 그리드 교류 전압의 하나의 주기(TL = 1/60sec)를 20 개의 시간 구간으로 나누고, 각각의 시간 구간에 대응하는 샘플링된 전압 레벨을 저장하는 계단함수 형태로 구현될 수 있다. 상기 계단함수는 단위 계단함수의 합으로 정의되어 시간과 전압 레벨로 정의된다. 예시적으로, 제1 룩업 테이블은 하나의 주기동안 미리 샘플링된 전압 레벨 {1.5(V), 1.8(V), 2.1(V), 2.4(V), 2.7(V), 3(V), 2.7(V), 2.4(V), 2.1(V), 1.8(V), 1.5(V), 1.2(V), 0.9(V), 0.6(V), 0.3(V), 0(V), 0.3(V), 0.6(V), 0.9(V), 1.2(V)}을 각각의 시간 구간에 대응하여 저장할 수 있다. 본 실시 예에 따른 계통연계 인버터의 위상 동기 장치는 룩업 테이블 방식으로 간단히 동작 가능하기 때문에 8 비트와 같은 저사양 프로세서를 통해서도 간단히 동작이 가능하며, 원가 저감이 가능하다.
도 8은 일 실시 예에 따라 계통연계 인버터에 연결된 펄스 폭 변조 회로의 출력 신호를 설명하는 그래프이다. 도 8을 참조하면, 메모리부로부터 출력된 룩업 테이블의 신호(810)가 도시된다. 일 실시 예로서, 듀티 사이클 신호 생성부는 출력된 제1 룩업 테이블의 전압 레벨을 기준 신호의 위상 φ에 따라 시프팅할 수 있다. 또한, 듀티 사이클 제어부는 시프팅된 전압 레벨과 미리 지정된 톱니파(ramp wave)(820)의 크기를 비교함으로써, 시프팅된 전압 레벨이 톱니파(820)보다 큰 시간 구간에 대응하는 듀티 사이클 제어 신호 d(t)(830)를 생성할 수 있다. 듀티 사이클 제어 신호 d(t)에 따라 계통연계 인버터에 포함되는 스위칭 소자들이 턴 온 되거나 턴 오프 되도록 제어됨으로써, 계통연계 인버터로부터 주입되는 전류의 위상이 동기화될 수 있다.
도 9는 또 다른 일 실시 예에 따른 계통연계 인버터의 전력 제어 장치의 시뮬레이션 결과를 나타내는 그래프이다. 도 9는 전체 주기를 기준으로 1.2kW 급의 가변 직류 링크 인버터를 이용하고, 계통 전압이 220Vrms인 경우의 실험 결과를 도시한다. 전력 제어부의 동작에 따라 미리 설정된 주기(실제 1/4주기로 턴 온 되므로, 공급 전력을 300W에 대응됨)에 대해서만 주기적으로 주입 전류가 인가되어 계통으로 에너지를 전달할 수 있다는 것이 실험적으로 잘 드러난다.
이상, 본 발명의 기술적 사상을 바람직한 실시예를 들어 상세하게 설명하였으나, 본 발명의 기술적 사상은 상기 실시 예들에 한정되지 않고, 본 발명의 기술적 사상은 상기 실시 예들에 한정되지 않고, 본 발명의 기술적 사상의 범위 내에서 기술 분야의 통상의 지식을 가진 자에 의하여 여러 가지 변혼 및 변경이 가능하다.

Claims (15)

  1. 계통연계 인버터의 전력 제어 장치에 있어서,
    그리드 교류 전압의 주기 TL, 상기 그리드 교류 전압의 진폭 |Vgrid| 및 듀티 사이클 신호 생성부로 입력되는 기준 전류의 크기 |Iinv.ref|에 기초하여 상기 계통연계 인버터에 포함되는 복수의 스위칭 소자들을 제어하기 위한 기준 신호의 위상 φ을 계산하고, 상기 기준 신호의 위상 φ을 이용하여 듀티 사이클 제어 신호를 생성하는 듀티 사이클 신호 생성부;
    상기 계통연계 인버터로부터 전류가 주입되는 부하에서 측정되는 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 소비 전력 Pgrid를 계산하는 소비 전력 계산부; 및
    상기 계산된 그리드 소비 전력 Pgrid과 미리 설정된 기준 전력의 차이에 기반하여 상기 듀티 사이클 제어 신호를 생성하기 위한 카운트 인덱스의 리셋 주기와 상기 카운트 인덱스의 범위를 결정하고, 상기 카운트 인덱스의 리셋 주기 및 상기 카운트 인덱스의 범위에 기초하여 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel을 상기 듀티 사이클 신호 생성부로 출력하는 전력 제어부
    를 포함하고,
    상기 듀티 사이클 신호 생성부는 상기 전력 제어부로부터 전달되는 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel에 기반하여 상기 듀티 사이클 제어 신호를 생성하는 계통연계 인버터의 전력 제어 장치.
  2. 제1항에 있어서,
    상기 전력 제어부는,
    상기 카운트 인덱스가 상기 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 범위 내에 존재하는 경우에 상기 전류 주입량 조절 신호 Plevel을 상기 듀티 사이클 신호 생성부로 출력하는 것을 특징으로 하는 계통연계 인버터의 전력 제어 장치.
  3. 제1항에 있어서,
    상기 전력 제어부는,
    상기 그리드 교류 전압의 주기 TL가 새롭게 계산되는 경우, 상기 듀티 사이클 제어 신호를 생성하기 위한 카운트 인덱스의 크기를 소정 크기만큼 증가시키는 계통연계 인버터의 전력 제어 장치.
  4. 제3항에 있어서,
    상기 전력 제어부는,
    상기 증가된 카운트 인덱스가 상기 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 범위 내에 존재하는 경우에, 상기 듀티 사이클 제어 신호를 생성하도록 하는 전류 주입신호 Ienable를 상기 듀티 사이클 신호 생성부로 출력하는 계통연계 인버터의 전력 제어 장치.
  5. 제3항에 있어서,
    상기 전력 제어부는,
    상기 증가된 카운트 인덱스가 상기 리셋 주기에 대응되는 경우, 상기 카운트 인덱스를 초기값으로 재설정하고, 상기 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 범위에 대응하는 전류 주입량 조절 신호 Plevel를 상기 듀티 사이클 신호 생성부로 출력하는 계통연계 인버터의 전력 제어 장치.
  6. 제1항에 있어서,
    상기 그리드 교류 전압의 진폭 |Vgrid| 및 상기 그리드 교류 전압의 주기 TL에 따라 소정 시간 구간 동안 지정된 전압 레벨로 샘플링된 복수의 룩업 테이블을 저장하는 메모리부
    를 더 포함하고,
    상기 메모리부는,
    상기 그리드 교류 전압의 진폭 |Vgrid|, 상기 그리드 교류 전압의 주기 TL 및 상기 전류 주입량 조절 신호 Plevel에 따라 제1 룩업 테이블을 출력하는 계통연계 인버터의 전력 제어 장치.
  7. 제6항에 있어서,
    상기 복수의 룩업 테이블 각각은,
    상기 소정 시간 동안의 그리드 교류 전압의 평균값을 상기 소정 시간에 대응하는 전압 레벨로 가지며, 계단함수(step function) 형태로서 시간과 전압 레벨로 정의되는 그래프인 것을 특징으로 하는 계통연계 인버터의 전력 제어 장치.
  8. 제6항에 있어서,
    상기 듀티 사이클 신호 생성부는,
    상기 출력된 제1 룩업 테이블의 전압 레벨을 상기 기준 신호의 위상 φ에 따라 시프팅하고, 상기 시프팅된 전압 레벨과 미리 지정된 톱니파(ramp wave)의 크기를 비교함으로써, 상기 시프팅된 전압 레벨이 상기 톱니파보다 큰 시간 구간에 대응하는 듀티 사이클 제어 신호를 생성하는 계통연계 인버터의 전력 제어 장치.
  9. 계통연계 인버터의 전력 제어 장치에 있어서,
    상기 계통연계 인버터로부터 전류가 주입되는 부하에서 측정되는 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 소비 전력 Pgrid을 계산하는 소비 전력 계산부;
    상기 계산된 그리드 소비 전력 Pgrid과 미리 설정된 기준 전력의 차이에 기반하여 듀티 사이클 제어 신호를 생성하기 위한 카운트 인덱스의 리셋 주기와 상기 카운트 인덱스의 범위를 결정하고, 상기 카운트 인덱스의 리셋 주기 및 상기 카운트 인덱스의 범위에 기초하여 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel을 출력하는 전력 제어부; 및
    상기 그리드 교류 전압의 진폭 |Vgrid| 및 상기 계통연계 인버터로부터 전류가 주입되는 부하에서 측정되는 그리드 교류 전압의 주기 TL에 따라 소정 시간 구간 동안 지정된 전압 레벨로 샘플링된 복수의 룩업 테이블을 저장하는 메모리부
    를 포함하고,
    상기 메모리부는,
    상기 그리드 교류 전압의 진폭 |Vgrid|, 상기 그리드 교류 전압의 주기 TL 및 상기 전류 주입량 조절 신호 Plevel에 따라 제1 룩업 테이블을 출력하는 계통연계 인버터의 전력 제어 장치.
  10. 적어도 하나의 프로세서에 의해 수행되는 계통연계 인버터의 전력 제어 방법에 있어서,
    상기 프로세서가, 상기 계통연계 인버터로부터 전류가 주입되는 부하에서 측정되는 그리드 교류 전압의 주기 TL, 상기 그리드 교류 전압의 진폭 |Vgrid| 및 듀티 사이클 신호 생성부로 입력되는 기준 전류의 크기 |Iinj.ref|에 기초하여 상기 계통연계 인버터에 포함되는 복수의 스위칭 소자들을 제어하기 위한 기준 신호의 위상 φ을 계산하는 단계;
    상기 프로세서가, 상기 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 소비 전력 Pgrid를 계산하는 단계;
    상기 프로세서가, 상기 계산된 그리드 소비 전력 Pgrid과 미리 설정된 기준 전력의 차이에 기반하여 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 생성하는 단계; 및
    상기 프로세서가, 상기 기준 신호의 위상 φ, 상기 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 이용하여 듀티 사이클 제어 신호를 생성하는 단계;
    를 포함하는 계통연계 인버터의 전력 제어 방법.
  11. 제10항에 있어서,
    상기 그리드 교류 전압의 주기 TL가 새롭게 계산되는 경우, 상기 듀티 사이클 제어 신호를 생성하기 위한 카운트 인덱스의 크기를 소정 크기만큼 증가시키는 단계
    를 더 포함하는 계통연계 인버터의 전력 제어 방법.
  12. 제11항에 있어서,
    상기 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 생성하는 단계는,
    상기 증가된 카운트 인덱스가 상기 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 범위 내에 존재하는 경우에, 상기 듀티 사이클 제어 신호를 생성하도록 하는 전류 주입신호 Ienable를 생성하는 단계
    를 포함하는 계통연계 인버터의 전력 제어 방법.
  13. 제11항에 있어서,
    상기 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 생성하는 단계는,
    상기 증가된 카운트 인덱스가 리셋 주기에 대응되는 경우, 상기 카운트 인덱스를 초기값으로 재설정하고, 상기 듀티 사이클 제어 신호를 생성하는 카운트 인덱스의 범위에 대응하는 전류 주입량 조절 신호 Plevel를 생성하는 단계
    를 포함하는 계통연계 인버터의 전력 제어 방법.
  14. 제13항에 있어서,
    상기 프로세서에 연결된 메모리부가, 상기 그리드 교류 전압의 진폭 |Vgrid|, 상기 그리드 교류 전압의 주기 TL 및 상기 전류 주입량 조절 신호 Plevel에 따라 미리 저장된 룩업 테이블을 출력하는 단계
    를 더 포함하는 계통연계 인버터의 전력 제어 방법.
  15. 컴퓨터 장치로 하여금, 그리드 교류 전압의 주기 TL, 상기 그리드 교류 전압의 진폭 |Vgrid| 및 듀티 사이클 신호 생성부에 연결되는 기준 전류의 크기 |Iinj.ref|를 이용하여 계통연계 인버터에 포함되는 복수의 스위칭 소자들을 제어하기 위한 기준 신호의 위상 φ을 계산하는 단계, 상기 그리드 교류 전압의 진폭 |Vgrid|을 이용하여 그리드 전력 사용량 Pgrid를 계산하는 단계, 상기 계산된 그리드 전력 사용량 Pgrid과 미리 설정된 기준 전력량의 차이값에 기반하여 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 생성하는 단계 및 상기 기준 신호의 위상 φ, 상기 전류 주입신호 Ienable 및 전류 주입량 조절 신호 Plevel를 이용하여 듀티 사이클 제어 신호를 생성하는 단계를 수행하도록 구현된 명령어(instructions)를 포함하는, 매체에 기록된 컴퓨터 프로그램.
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