KR102282886B1 - Electronic devices and connectors - Google Patents
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Abstract
전자 장치는, 밀봉부(90)와, 상기 밀봉부(90)로부터 외방으로 돌출되는 제 1 주단자(11)와, 상기 밀봉부(90)로부터 외방으로 돌출되는 제 2 주단자(12)와, 상기 제 1 주단자(11)에 표면이 전기적으로 접속되고, 상기 제 2 주단자(12)에 이면이 전기적으로 접속되어, 상기 밀봉부(90) 내에 마련된 전자 소자(95)와, 상기 전자 소자(95)의 표면에 접속되는 헤드부(40)와, 상기 밀봉부(90)로부터 외부로 돌출되어, 센싱을 위해 이용되는 표면측 센싱 단자(13)와, 상기 헤드부(40)와 일체로 형성되어, 상기 표면측 센싱 단자(13)에 전기적으로 접속되는 접속부(35)를 가지고 있다. 상기 표면측 센싱 단자(13) 및 상기 접속부(35) 내를 흐르는 전류의 센싱 전류 경로는, 상기 제 2 주단자(12), 상기 전자 소자(95) 및 상기 제 1 주단자(11)를 흐르는 주전류 경로와 중복되지 않는다.The electronic device includes a sealing portion (90), a first main terminal (11) protruding outwardly from the sealing portion (90), and a second main terminal (12) projecting outwardly from the sealing portion (90); , an electronic element 95 provided in the sealing portion 90 with a front surface electrically connected to the first main terminal 11 and a rear surface electrically connected to the second main terminal 12; The head part 40 connected to the surface of the element 95, the surface-side sensing terminal 13 protruding outward from the sealing part 90 and used for sensing, and the head part 40 are integral with each other It has a connection part 35 electrically connected to the surface-side sensing terminal 13 . The sensing current path of the current flowing in the surface-side sensing terminal 13 and the connection part 35 flows through the second main terminal 12 , the electronic device 95 and the first main terminal 11 . It does not overlap with the main current path.
Description
본 발명은, 전자 장치 및 접속체에 관한 것이다.The present invention relates to an electronic device and a connector.
종래부터, 반도체 소자를 기판의 도체층 위에 얹어 놓고, 당해 반도체 소자의 표면과 단자를 땜납을 통하여 와이어나 접속자에 의해 접속하는 것이 알려져 있다. 또한, 반도체 소자에 있어서의 전압을 검출할 목적으로 센싱 단자가 이용되는 경우가 있다(일본공개특허 특개평7-245401호). 이와 같은 센싱 단자는 접속자의 기단부에 접속된 도체층에 접속되어 있던 점에서, 반도체 소자의 전압을 측정하기 위한 센싱 전류 경로와 반도체 소자를 흐르는 전류 경로가 일부에서 중복되어버려 있으며, 접속자의 배선 저항분의 전압 강하가 센싱 단자에 의해 검출되는 전압에 영향을 끼치고 있었다.BACKGROUND ART Conventionally, it is known that a semiconductor element is placed on a conductor layer of a substrate, and the surface of the semiconductor element is connected to a terminal by a wire or a connector via solder. In addition, a sensing terminal is sometimes used for the purpose of detecting a voltage in a semiconductor element (Japanese Patent Application Laid-Open No. 7-245401). Since such a sensing terminal is connected to the conductor layer connected to the base end of the connector, the sensing current path for measuring the voltage of the semiconductor element and the current path flowing through the semiconductor element partially overlap, and the wiring resistance of the connector The voltage drop of one minute was affecting the voltage detected by the sensing terminal.
이와 같은 점을 감안하여, 본 발명은, 배선 저항에 의한 영향을 극력 받지 않아, 전자 소자의 정확한 전압을 검출할 수 있는 전자 장치 및 접속체를 제공한다.In view of the foregoing, the present invention provides an electronic device and a connector capable of accurately detecting the voltage of an electronic element without being affected by wiring resistance as much as possible.
본 발명의 일례에 의한 전자 장치는,An electronic device according to an example of the present invention,
밀봉부와,seal and
상기 밀봉부로부터 외방으로 돌출되는 제 1 주(主)단자와,a first main terminal protruding outward from the sealing part;
상기 밀봉부로부터 외방으로 돌출되는 제 2 주단자와,a second main terminal protruding outwardly from the sealing part;
상기 제 1 주단자에 표면이 전기적으로 접속되고, 상기 제 2 주단자에 이면이 전기적으로 접속되어, 상기 밀봉부 내에 마련된 전자 소자와,an electronic element having a front surface electrically connected to the first main terminal and a rear surface electrically connected to the second main terminal, provided in the sealing portion;
상기 전자 소자의 표면에 접속되는 헤드부와,a head part connected to the surface of the electronic device;
상기 밀봉부로부터 외부로 돌출되어, 센싱을 위해 이용되는 센싱 단자와,a sensing terminal protruding from the sealing part to the outside and used for sensing;
상기 헤드부와 일체로 형성되어, 상기 센싱 단자에 전기적으로 접속되는 접속부를 구비하고,It is formed integrally with the head part and has a connection part electrically connected to the sensing terminal,
센싱 전류 경로 중 상기 센싱 단자 및 상기 접속부 내를 흐르는 전류는, 상기 제 2 주단자, 상기 전자 소자 및 상기 제 1 주단자를 흐르는 주전류 경로와 중복되지 않는다.A current flowing in the sensing terminal and the connection part among the sensing current paths does not overlap with a main current path flowing through the second main terminal, the electronic device, and the first main terminal.
본 발명의 일례에 의한 전자 장치에 있어서,In the electronic device according to an example of the present invention,
상기 센싱 단자 및 상기 접속부와 상기 헤드부가 일체로 형성되어도 된다.The sensing terminal and the connection portion and the head portion may be integrally formed.
본 발명의 일례에 의한 전자 장치에 있어서,In the electronic device according to an example of the present invention,
상기 제 1 주단자와 상기 헤드부가 일체로 형성되어도 된다.The first main terminal and the head portion may be integrally formed.
본 발명의 일례에 의한 전자 장치는,An electronic device according to an example of the present invention,
상기 헤드부와 일체로 형성되며, 상기 밀봉부 내에서 도체층에 접속되는 기단부를 더 구비해도 된다.It is formed integrally with the said head part, and you may further provide the base end connected to the conductor layer in the said sealing part.
본 발명의 일례에 의한 전자 장치는,An electronic device according to an example of the present invention,
상기 전자 소자는 내압 구조를 가지고,The electronic device has a withstand voltage structure,
상기 헤드부와 일체로 형성되며, 상기 내압 구조와의 접촉을 회피하기 위한 회피부를 더 구비해도 된다.It is formed integrally with the said head part, and you may further provide the avoidance part for avoiding contact with the said pressure-resistant structure.
본 발명의 일례에 의한 접속체는,A connector according to an example of the present invention comprises:
밀봉부와, 상기 밀봉부로부터 외방으로 돌출되는 제 1 주단자와, 상기 밀봉부로부터 외방으로 돌출되는 제 2 주단자와, 상기 제 1 주단자에 표면이 전기적으로 접속되고, 상기 제 2 주단자에 이면이 전기적으로 접속되어, 상기 밀봉부 내에 마련된 전자 소자를 가지는 전자 장치에 이용되는 접속체로서,A sealing portion, a first main terminal protruding outward from the sealing portion, a second main terminal projecting outwardly from the sealing portion, and a surface electrically connected to the first main terminal, the second main terminal A connector for use in an electronic device having an electronic element provided in the sealing portion, the back surface of which is electrically connected to the
상기 전자 소자의 표면에 접속되는 헤드부와,a head part connected to the surface of the electronic device;
상기 밀봉부로부터 외부로 돌출되어 센싱을 위해 이용되는 센싱 단자에 전기적으로 접속되며, 상기 헤드부와 일체로 형성되는 접속부를 구비하고,It protrudes from the sealing part to the outside and is electrically connected to a sensing terminal used for sensing, and includes a connection part integrally formed with the head part,
센싱 전류 경로 중 상기 접속부 내를 흐르는 전류의 센싱 전류 경로는, 상기 제 2 주단자, 상기 전자 소자 및 상기 제 1 주단자를 흐르는 주전류 경로와 중복되지 않는다.Among the sensing current paths, a sensing current path of a current flowing in the connection unit does not overlap with a main current path flowing through the second main terminal, the electronic device, and the first main terminal.
본 발명에서는, 헤드부와 접속부가 일체로 형성되는 점에서 배선 저항에 의한 영향을 극력 방지할 수 있고, 센싱 전류 경로 중 접속부 내를 흐르는 전류가 제 1 주단자, 전자 소자 및 제 2 주단자를 흐르는 주전류 경로와 중복되지 않도록 되어 있는 점에서, 주전류 경로에 기인하는 배선 저항에 의한 영향도 방지할 수 있다. 이 때문에, 전자 소자의 전압을 보다 정확하게 검출할 수 있다.In the present invention, since the head part and the connection part are integrally formed, the influence of the wiring resistance can be prevented as much as possible, and the current flowing in the connection part in the sensing current path causes the first main terminal, the electronic device, and the second main terminal to be separated. Since the main current path is not overlapped with the flowing main current path, the influence of the wiring resistance due to the main current path can also be prevented. For this reason, the voltage of an electronic element can be detected more accurately.
도 1은, 본 발명의 제 1 실시 형태에 의한 반도체 장치의 사시도이다.
도 2는, 본 발명의 제 1 실시 형태에 의한 반도체 장치에 있어서, 밀봉부를 제거한 양태를 나타낸 사시도이다.
도 3은, 도 2에 나타낸 양태를 측방에서 본 측방도이다.
도 4는, 도 3을 확대한 측방도이다.
도 5는, 도 2에 나타낸 양태를 확대한 사시도이다.
도 6은, 본 발명의 제 1 실시 형태에서 이용되는 헤드부, 회피부 등의 관계를 나타낸 저면도이다.
도 7은, 본 발명의 제 1 실시 형태에 있어서, 지그를 이용하여 접속체를 설치하는 양태를 나타낸 측방도이다.
도 8은, 접속부와 표면측 센싱 단자가 별도로 되어 있는 양태를 나타낸 측방도이다.
도 9는, 본 발명의 제 2 실시 형태에서 이용되는 접속체를 나타낸 사시도이다.1 is a perspective view of a semiconductor device according to a first embodiment of the present invention.
Fig. 2 is a perspective view showing a state in which the sealing portion is removed in the semiconductor device according to the first embodiment of the present invention.
3 : is the side view which looked at the aspect shown in FIG. 2 from the side.
Fig. 4 is an enlarged side view of Fig. 3;
Fig. 5 is an enlarged perspective view of the aspect shown in Fig. 2;
Fig. 6 is a bottom view showing the relationship between the head portion, the avoidance portion, and the like used in the first embodiment of the present invention.
Fig. 7 is a side view showing a mode in which a connection body is installed using a jig in the first embodiment of the present invention.
Fig. 8 is a side view showing a state in which a connection portion and a surface-side sensing terminal are separate.
Fig. 9 is a perspective view showing a connector used in the second embodiment of the present invention.
제 1 실시 형태first embodiment
《구성》"Configuration"
본 실시 형태의 전자 장치의 일례인 반도체 장치는, 도 1에 나타내는 바와 같이, 밀봉 수지 등으로 이루어지는 밀봉부(90)와, 밀봉부(90)로부터 외방으로 돌출되는 제 1 주단자(11)와, 밀봉부(90)로부터 외방으로 돌출되는 제 2 주단자(12)를 가지고 있다. 반도체 장치는, 도 2에 나타내는 바와 같이, 제 1 주단자(11)에 표면이 전기적으로 접속되고, 제 2 주단자(12)에 이면이 전기적으로 접속되어, 밀봉부(90) 내에 마련된 반도체 소자(95)와, 반도체 소자(95)의 표면에 접속되는 헤드부(40)와, 밀봉부(90)로부터 외부로 돌출되어, 소스측의 센싱을 위해 이용되는 표면측의 센싱 단자(13)(이하 「표면측 센싱 단자(13)」라고 한다.)와, 헤드부(40)와 일체로 형성되어, 표면측 센싱 단자(13)에 전기적으로 접속되는 접속부(35)를 가지고 있다. 센싱 전류 경로 중, 표면측 센싱 단자(13) 및 접속부(35) 내를 흐르는 전류의 경로는, 제 2 주단자(12), 반도체 소자(95) 및 제 1 주단자(11)를 흐르는 주전류 경로와 중복되지 않도록 되어 있다(도 5 참조). 본 실시 형태에서는, 제 1 단자로서 주전류가 흐르는 제 1 주단자(11)를 이용하여 설명하고, 제 2 단자로서 주전류가 흐르는 표면측 센싱 단자(13)를 이용하여 설명하지만, 이에 한정되는 것은 아니다. 제 1 단자에 주전류가 흐르지 않는 양태를 채용할 수도 있고, 제 2 단자가 센싱을 위해 이용되지 않는 양태를 이용할 수도 있다.As shown in FIG. 1 , a semiconductor device as an example of the electronic device of the present embodiment includes a sealing
본 실시 형태에서는, 전자 장치로서 반도체 장치를 이용하여, 전자 소자로서 반도체 소자(95)를 이용하여 설명하지만, 이에 한정되는 것은 아니고, 특히 「반도체」일 필요는 없다.Although this embodiment demonstrates using the semiconductor device as an electronic device and using the
도 2에 나타내는 바와 같이, 반도체 장치는, 예를 들면 절연성 재료로 이루어지는 기판(5)과, 기판(5) 상에 마련되어, 구리 등으로 이루어지는 도체층(70)을 가져도 된다. 도 4에 나타내는 바와 같이, 기판(5)의 이면에는, 구리 등으로 이루어지는 방열판(79)이 마련되어도 된다.As shown in FIG. 2, a semiconductor device may have the board|
도 2에 나타내는 양태에서는, 도체층(70)에 제 2 주단자(12)가 접속되고, 제 2 주단자(12)는 반도체 소자(95)의 이면과 도체층(70)을 개재하여 접속되어 있다. 제 2 주단자(12)의 도체층(70)과의 접속 개소의 주연에는, 땜납 등의 도전성 접착제가 흘러 나오는 것을 방지하기 위한 레지스트(도시 생략)가 마련되어도 된다. 반도체 소자(95)의 이면과 도체층(70)은, 땜납 등의 도전성 접착제를 개재하여 접속되어도 된다. 헤드부(40)와 반도체 소자(95)의 표면도, 땜납 등의 도전성 접착제(75)를 개재하여 접속되어도 된다(도 4 참조).In the embodiment shown in FIG. 2 , the second
반도체 소자(95)는 가드링 등의 내압 구조를 가져도 된다. 이와 같은 내압 구조를 반도체 소자(95)가 가지고 있는 경우에는, 도 3에 나타내는 바와 같이, 헤드부(40)와 일체로 형성되어, 내압 구조와의 접촉을 회피하기 위한 회피부(31, 32)가 마련되어도 된다. 이와 같은 회피부(31, 32)는, 반도체 소자(95)의 내압 구조에 대응하여 마련되고, 가드링 등의 내압 구조의 배치 위치, 평면 방향의 굵기 등에 의거하여, 미리 설계되게 된다.The
회피부(31, 32)는, 제 1 주단자(11) 및 헤드부(40)의 사이에 마련된 제 1 회피부(31)와, 표면측 센싱 단자(13) 및 헤드부(40)의 사이에 마련된 제 2 회피부(32)를 가져도 된다. 제 1 회피부(31)는 반도체 소자(95)로부터 이간하도록 움푹 들어간 제 1 오목부(31a)여도 되고, 제 2 회피부(32)는 반도체 소자(95)로부터 이간하도록 움푹 들어간 제 2 오목부(32a)여도 된다. 또한, 도 7에서는, 오목부가 이용되고 있지 않은 양태가 나타나 있다.The avoiding
제 1 주단자(11) 및 제 2 주단자(12)는, 대용량의 전류가 흐르는 파워 단자여도 된다. 그리고, 주전류 경로는, 제 2 주단자(12), 도체층(70), 반도체 소자(95)의 이면 및 표면, 헤드부(40), 제 1 회피부(31) 및 제 1 주단자(11)를 통과하도록 하여 형성되어 있다(도 2 참조). 한편, 센싱 전류 경로는, 반도체 소자(95)의 표면, 헤드부(40), 제 2 회피부(32), 접속부(35) 및 표면측 센싱 단자(13)를 통과하도록 하여 형성되어 있다. 그리고, 반도체 소자(95)의 표면으로부터 헤드부(40)로 흐른 전류는, 일방에서는, 주전류 경로를 따라 제 1 회피부(31) 및 제 1 주단자(11)를 통과하고, 타방에서는, 센싱 전류 경로를 따라 제 2 회피부(32), 접속부(35) 및 표면측 센싱 단자(13)를 통과한다.The first
도 2에서 나타내는 바와 같이, 표면측 센싱 단자(13) 및 접속부(35)와 헤드부(40)는 일체로 형성되어도 된다. 이에 한정되지는 않고, 예를 들면, 도 8에 나타내는 바와 같이, 접속부(35)와 헤드부(40)는 일체로 형성되지만, 접속부(35)와 표면측 센싱 단자(13)는 별도가 되어도 된다. 일례로서는, 접속부(35)의 이면이 표면측 센싱 단자(13)의 표면과 도전성 접착제 등을 개재하여 전기적으로 접속되어도 된다.As shown in FIG. 2 , the
도 2에서 나타내는 바와 같이, 제 1 주단자(11)와 헤드부(40)는 일체로 형성되어도 된다. 제 1 주단자(11)와 헤드부(40)가 일체로 형성되는 경우에는, 도 3 및 도 4에 나타내는 바와 같이, 제 1 주단자(11)는 도체층(70)에 접속되어 있지 않고, 도체층(70)으로부터 격리되어 마련되어도 된다. 또한, 이 양태에서는, 제 1 주단자(11)의 하방에는 도체층(70)이 마련되어 있지 않아도 되고, 제 1 회피부(31)의 도중에 제 1 회피부(31)가 밀봉부(90)의 측면으로부터 외부로 노출되어도 되며, 제 1 회피부(31)의 직후에 제 1 주단자(11)가 밀봉부(90)의 측면으로부터 외부로 노출되어도 된다.As shown in FIG. 2, the 1st
제 1 주단자(11)와 헤드부(40)가 일체로 형성되어 있으며, 표면측 센싱 단자(13), 접속부(35) 및 헤드부(40)가 일체로 형성되어 있는 경우에는, 도 3 및 도 7에 나타내는 바와 같이, 제 1 주단자(11)의 이면측 높이와 표면측 센싱 단자(13)의 이면측 높이는 대응하고 있어도 된다. 여기서 높이가 대응한다는 것은, 제 1 주단자(11) 및 표면측 센싱 단자(13) 중 두께가 두꺼운 것의 단자의 두께에 대하여 10%의 범위에서 합치하고 있는 것을 의미한다. 제 1 주단자(11) 및 표면측 센싱 단자(13)의 두께 T0이 동일한 경우에는, 제 1 주단자(11)의 이면측 높이와 제 2 주단자(12)의 이면측 높이의 차이는, 당해 두께 T0의 10% 이내에 들어가 있으며, 0.1T0 이하의 범위에 들어가 있는 것을 의미한다. 제 1 주단자(11) 및 표면측 센싱 단자(13)의 두께가 상이한 경우에는, 두께가 두꺼운 것의 두께 T1의 10% 이내에 들어가 있으며, 0.1T1 이하의 범위에 들어가 있는 것을 의미한다. 제 1 주단자(11)의 이면측 높이와 표면측 센싱 단자(13)의 이면측 높이는 합치하고 있어도 된다. 합치하는 경우에는, 제 1 주단자(11)의 이면측 높이와 표면측 센싱 단자(13)의 이면측 높이의 차이는 제조 오차의 범위에 들어가 있는 것을 의미한다.In the case where the first
또한, 제 1 주단자(11)와 헤드부(40)가 일체로 형성되어 있으며, 접속부(35)와 헤드부(40)가 일체로 형성되어 있는 경우에는, 제 1 주단자(11)의 이면측 높이와 접속부(35)에 연결된 표면측 센싱 단자(13)의 이면측 높이는 대응하고 있어도 된다(도 8 참조). 여기서 높이가 대응한다는 것은, 상기 서술한 양태와 마찬가지로, 제 1 주단자(11) 및 표면측 센싱 단자(13) 중 두께가 두꺼운 것의 단자의 두께에 대하여 10%의 범위로 합치하고 있는 것을 의미한다. 제 1 주단자(11)의 이면측 높이와 표면측 센싱 단자(13)의 이면측 높이는 합치하고 있어도 된다. 합치하는 경우에는, 제 1 주단자(11)의 이면측 높이와 표면측 센싱 단자(13)의 이면측 높이의 차이는 제조 오차의 범위에 들어가 있는 것을 의미한다. 또한, 본 실시 형태에 있어서 「연결」에는 「일체」로 되어 있는 양태도 포함되어 있다.In addition, when the first
도 2 및 도 3에 나타내는 바와 같이, 표면측 센싱 단자(13) 및 접속부(35)와 제 1 주단자(11)는, 헤드부(40)로부터 역방향으로 연장되어 마련되어도 된다. 이 경우에는, 제 1 주단자(11)와 표면측 센싱 단자(13)를 지그(99)를 수용하기 위한 지그받이로서 이용해도 된다(도 7). 단, 표면측 센싱 단자(13) 및 접속부(35)와 제 1 주단자(11)는, 헤드부(40)에서 볼 때, 상이한 방향으로 연장되어 있으면 되고, 이에 한정되는 것은 아니다. 예를 들면, 표면측 센싱 단자(13) 및 접속부(35)와 제 1 주단자(11)는, 90도 또는 90도보다 큰 각도(둔각)를 형성하도록 하여 연장되어도 된다.As shown in FIGS. 2 and 3 , the front
도 6에 나타내는 바와 같이, 헤드부(40)는, 반도체 소자(95)측으로 돌출된 제 2 볼록부(42)와, 제 2 볼록부(42)로부터 반도체 소자(95)측으로 돌출되는 제 1 볼록부(41)를 가져도 된다.As shown in FIG. 6 , the
도 2에 나타내는 양태에서는, 일례로서, 표면측 센싱 단자(13) 및 접속부(35)의 폭보다 제 1 회피부(31), 헤드부(40) 및 제 2 회피부(32)의 폭이 크게 되어 있으며, 제 1 회피부(31), 헤드부(40) 및 제 2 회피부(32)의 폭보다 제 1 주단자(11) 및 제 2 주단자(12)의 폭이 크게 되어 있다.In the aspect shown in FIG. 2, as an example, the width|variety of the
센싱 전류 경로에 관해서는 대용량의 전류를 흘려 보낼 필요가 없기 때문에, 제 2 회피부(32), 접속부(35) 및 표면측 센싱 단자(13)의 폭이 좁게 되어 있어도 된다. 일례로서는, 제 2 회피부(32), 접속부(35) 및 표면측 센싱 단자(13)의 각각의 폭이 좁게 되어 있으며, 헤드부(40)의 폭의 3분의 1 이하 또는 5분의 1 이하가 되어도 된다. 또한, 도 2에 나타내는 양태에서는, 제 2 회피부(32)의 헤드부측의 폭은 크게 되어 있지만, 이와 같은 양태로 되어 있을 필요는 없다. 단, 도 2와 같이 제 2 회피부(32)의 헤드부측의 폭은 크게 하여, 헤드부측의 폭을 헤드부(40)의 폭에 대응시킴으로써, 제 2 회피부(32)의 평면 형상 헤드부(40)의 폭을 확실하게 확보할 수 있다. 즉, 헤드부(40), 제 2 회피부(32) 등을 형성할 때에는 동판 등의 도전성 부재를 구멍을 뚫는 것이 생각되지만, 헤드부(40)의 폭을 확실하게 확보하는 관점에서는, 헤드부(40)에 인접하는 제 2 회피부(32)의 폭을 헤드부(40)의 폭과 동일한 정도로 하는 것이 바람직하다. 한편, 헤드부(40)의 폭을 조금이라도 희생으로 하는 경우에는, 제 2 회피부(32)의 폭을 전체에 걸쳐 좁게 하는 것도 생각할 수 있다.Since it is not necessary to pass a large-capacity current in the sensing current path, the widths of the second avoiding
도 1에 나타내는 양태에서는, 밀봉부(90)의 일방측의 측면으로부터, 제 2 주단자(12), 표면측 센싱 단자(13), 이면측 센싱 단자(14) 및 제어 단자(15)가 외방으로부터 돌출되고, 밀봉부(90)의 타방측의 측면으로부터 제 1 주단자(11)가 외방으로 돌출되어 있다. 제 1 주단자(11), 제 2 주단자(12), 표면측 센싱 단자(13), 이면측 센싱 단자(14) 및 제어 단자(15)는 표면측으로 구부려져, 표면측에 마련된 제어 기판(도시 생략)과 접속되도록 되어 있다. 이 제어 기판은, 반도체 소자(95)를 제어하기 위해 이용되는 것이다.In the aspect shown in FIG. 1, the 2nd
반도체 장치의 밀봉부(90) 내의 구조는 선대칭으로 되어 있어도 된다. 일례로서는, 제 1 주단자(11), 제 2 주단자(12), 표면측 센싱 단자(13), 이면측 센싱 단자(14), 제어 단자(15) 및 도체층(70)의 각각이 임의의 직선에 대하여 선대칭이 되도록 하여 배치되어도 된다. 또한, 도 2에는 와이어(19)도 나타나 있다.The structure in the sealing
《작용·효과》《Action and Effect》
이어서, 상기 서술한 구성으로 이루어지는 본 실시 형태에 의한 작용·효과에 대하여 설명한다.Next, the effect|action and effect by this embodiment which consists of the structure mentioned above are demonstrated.
본 실시 형태에 의하면, 헤드부(40)와 접속부(35)가 일체로 형성되는 점에서 배선 저항에 의한 영향을 극력 방지할 수 있다. 또한, 센싱 전류 경로 중 표면측 센싱 단자(13) 및 접속부(35) 내를 흐르는 전류가, 제 1 주단자(11), 반도체 소자(95) 및 제 2 주단자(12)를 흐르는 주전류 경로와 중복되지 않도록 되어 있는 점에서(도 5 참조), 주전류 경로에 기인하는 배선 저항에 의한 영향도 방지할 수 있다. 이 때문에, 반도체 소자(95)의 전압을 보다 정확하게 검출할 수 있다.According to this embodiment, since the
종래의 구성에서는 반도체 소자(95)에 있어서의 전압을 검출하는 표면측 센싱 단자(13)는 접속자의 기단부에 접속된 도체층(70)에 접속되어 있던 점에서, 반도체 소자(95)의 전압을 측정하기 위한 센싱 전류 경로와 반도체 소자(95)를 흐르는 전류 경로가 적어도 동일한 접속자를 통과하도록 되어 있으며, 접속자의 배선 저항분의 전압 강하가 표면측 센싱 단자(13)에 의해 검출되는 전압에 영향을 끼치고 있었다. 이에 비하여, 본 실시 형태에 의하면, 반도체 소자(95)의 표면으로부터 헤드부(40)로 흐른 전류는, 일방에서는, 주전류 경로를 따라 제 1 회피부(31) 및 제 1 주단자(11)를 통과하고, 타방에서는, 센싱 전류 경로를 따라 제 2 회피부(32), 접속부(35) 및 표면측 센싱 단자(13)를 통과한다. 이 때문에, 표면측 센싱 단자(13)에 의해 검출되는 반도체 소자(95)의 전압은, 보다 정확한 값으로서 검출되게 된다.In the conventional configuration, the surface-
또한, 제 1 주단자(11) 및 제 2 주단자(12)에 대용량의 전류(예를 들면 200A~300A 이상)이 흐르는 경우에는, 배선 저항에 의한 전압 강하의 영향이 커진다. 이 때문에, 이와 같이 용량의 전류가 흐르는 경우에, 본 실시 형태의 양태를 채용하는 것은, 매우 유익하다.Moreover, when a large-capacity current (for example, 200 A to 300 A or more) flows through the first
도 2 등에 나타내는 바와 같이, 표면측 센싱 단자(13) 및 접속부(35)와 헤드부(40)가 일체로 형성되어 있는 양태를 채용한 경우에는, 표면측 센싱 단자(13) 및 접속부(35)와 헤드부(40)를 동일한 재료로 일체 형성할 수 있는 점에서, 표면측 센싱 단자(13) 및 접속부(35)와 헤드부(40)가 별도가 된 경우와 같이 접속 양태에 의해 검출되는 전압이 영향을 받지 않는다. 이 때문에, 표면측 센싱 단자(13)에 의한 전압의 검지를 보다 정확하게 행할 수 있는 점에서 유익하다.As shown in FIG. 2 or the like, in the case of adopting an aspect in which the front
도 8에 나타내는 바와 같이, 헤드부(40)와 접속부(35)가 일체로 형성되고, 접속부(35)와 표면측 센싱 단자(13)가 별도로 형성되는 경우에도, 접속부(35)와 표면측 센싱 단자(13)가 도체층(70)을 개재하지 않고 접속될 때에는, 접속부(35)와 도체층(70) 및 표면측 센싱 단자(13)와 도체층(70)과의 사이의 접속 양태에 의해 검출되는 전압이 영향을 받지 않는다. 이 때문에, 표면측 센싱 단자(13)에 의한 전압의 검지를 정확하게 행할 수 있는 점에서 유익하다.As shown in FIG. 8 , even when the
제 1 주단자(11)와 헤드부(40)가 일체로 형성되는 경우에는, 제 1 주단자(11)에 접속하기 위한 도체층(70)이 필요 없어져, 제 1 주단자(11)의 이면측에는 도체층(70)이 마련되어 있지 않아도 된다. 이와 같이 도체층(70)을 마련하지 않는 경우에는, 제조 비용을 낮출 수 있다. 또한, 제 1 주단자(11)와 헤드부(40)를 일체로 형성하는 경우에는, 도체층(70)을 개재하지 않고 단자를 밀봉부(90)의 측면으로부터 외방으로 노출시킬 수 있으므로, 도체층(70)을 마련하지 않는 만큼, 면내 방향에 있어서의 크기를 작게 하는 것도 기대할 수 있다. 또한, 종래의 구성에서는, 반도체 소자(95)에 있어서의 전압을 검출하는 표면측 센싱 단자(13)가 접속자의 기단부에 접속된 도체층(70)에 접속되어 있던 점에서, 이와 같은 도체층(70)을 마련할 필요가 있었다.When the first
내압 구조를 반도체 소자(95)가 가지고 있는 경우에, 헤드부(40)와 일체로 형성되어, 내압 구조와의 접촉을 회피하기 위한 회피부(31, 32)가 마련되어 있는 경우에는(도 4 등 참조), 반도체 소자(95)의 내압 구조와 접속체(50)가 전기적으로 접촉해버리는 것을 미연에 방지할 수 있다. 또한, 이 양태에 있어서, 도 2 등에 나타내는 바와 같이, 접속부(35)가, 표면측 센싱 단자(13), 제 2 회피부(32) 및 헤드부(40)와 일체로 형성되어 있는 양태를 채용한 경우에는, 헤드부(40)로부터 표면측 센싱 단자(13)까지의 사이의 부재를 일체로 형성할 수 있고, 이들 중 어느 하나가 별도가 된 경우와 같이 접속 양태에 의해 흐르는 전류가 변경되지 않는다. 이 때문에, 표면측 센싱 단자(13)에 의한 전압 또는 전류의 검지를 보다 정확하게 행할 수 있다.In the case where the
제 2 실시 형태second embodiment
이어서, 본 발명의 제 2 실시 형태에 대하여 설명한다.Next, a second embodiment of the present invention will be described.
제 1 실시 형태에서는, 헤드부(40)와 제 1 주단자(11)가 일체로 형성되어 있는 양태를 이용하여 설명했지만, 제 2 실시 형태의 접속체(50a)는, 도 9에 나타내는 바와 같이, 제 1 주단자(11)와 헤드부(40)는 별도로 되어 있다. 본 실시 형태에서는, 헤드부(40)와 일체로 형성되어, 밀봉부(90) 내에서 도체층(70)에 접속되는 기단부(45)가 마련되어 있다.In the first embodiment, the
그 밖의 구성은, 제 1 실시 형태와 마찬가지이다. 제 2 실시 형태에 있어서, 제 1 실시 형태와 동일 또는 마찬가지의 부재 등에 대해서는 동일한 부호를 부여하고, 그 설명을 생략한다. 본 실시 형태에서는, 헤드부(40)와 제 1 주단자(11)가 일체로 형성되어 있는 경우의 효과 이외에 관해서는, 제 1 실시 형태에 의해 실현되는 효과와 마찬가지의 효과를 얻을 수 있다.Other configurations are the same as those of the first embodiment. In 2nd Embodiment, the same code|symbol is attached|subjected to the member same or the same as 1st Embodiment, and the description is abbreviate|omitted. In this embodiment, the same effect as the effect realized by the first embodiment can be obtained except for the effect in the case where the
마지막으로, 상기 서술한 각 실시 형태의 기재, 변형예의 기재 및 도면의 개시는, 청구범위에 기재된 발명을 설명하기 위한 일례에 지나지 않고, 상기 서술한 실시 형태의 기재 또는 도면의 개시에 의해 청구범위에 기재된 발명이 한정되는 것은 아니다. 또한, 출원 당초의 청구항의 기재는 어디까지나 일례이며, 명세서, 도면 등의 기재에 의거하여, 청구항의 기재를 적절히 변경할 수도 있다.Finally, the description of each embodiment described above, description of modifications, and disclosure of drawings are only examples for explaining the invention described in the claims, and are claimed by the description of the above-described embodiments or disclosure of drawings. The invention described in is not limited. Note that the description of the claim at the beginning of the application is merely an example, and the description of the claim may be appropriately changed based on the description of the specification and drawings.
11 제 1 주단자
12 제 2 주단자
13 표면측 센싱 단자
31 제 1 회피부
32 제 2 회피부
35 접속부
40 헤드부
50, 50a 접속체
70 도체층
75 도전성 접착제
90 밀봉부
95 반도체 소자(전자 소자)11 1st main terminal
12 2nd main terminal
13 Surface side sensing terminal
31 1st avoidance part
32 Second avoidance part
35 connection
40 head
50, 50a connector
70 conductor layer
75 conductive adhesive
90 seal
95 Semiconductor devices (electronic devices)
Claims (6)
상기 기판 상에 마련된 도체층과,
상기 도체층 상에 마련된 전자 소자와,
상기 전자 소자의 표면에 도전성 접착제를 개재하여 접속되는 접속체와,
상기 접속체를 개재하여 상기 전자 소자의 표면에 전기적으로 접속되는 제 1 주단자와,
상기 도체층에 접속되는 제 2 주단자와,
상기 전자 소자의 표면측의 전압을 검출하기 위한 센싱 단자와,
상기 도체층, 상기 전자 소자 및 상기 접속체를 내부에 밀봉하는 밀봉부를 구비하고,
상기 접속체는, 상기 전자 소자의 표면에 접속되는 헤드부와, 상기 센싱 단자와 접속되는 접속부를 가지고,
상기 제 2 주단자, 상기 도체층, 상기 전자 소자, 상기 헤드부 및 상기 제 1 주단자를 흐르는 주전류 경로와,
상기 전자 소자의 표면, 상기 헤드부, 상기 접속부 및 상기 센싱 단자를 흐르는 센싱 전류 경로를 가지는 전자 장치.board and
a conductor layer provided on the substrate;
an electronic device provided on the conductor layer;
a connector connected to the surface of the electronic element via a conductive adhesive;
a first main terminal electrically connected to the surface of the electronic element via the connecting body;
a second main terminal connected to the conductor layer;
a sensing terminal for detecting a voltage on the surface side of the electronic element;
and a sealing part for sealing the conductor layer, the electronic element, and the connection body therein;
The connection body has a head part connected to the surface of the electronic element, and a connection part connected to the sensing terminal,
a main current path flowing through the second main terminal, the conductor layer, the electronic element, the head unit, and the first main terminal;
An electronic device having a sensing current path flowing through a surface of the electronic device, the head unit, the connection unit, and the sensing terminal.
상기 제 1 주단자는 상기 접속체와 연결되어 있으며, 상기 제 1 주단자 및 상기 접속체가 일체로 형성되어 있는 전자 장치.The method of claim 1,
The first main terminal is connected to the connecting body, and the first main terminal and the connecting body are integrally formed.
상기 도체층은, 상기 기판 상에 마련된 제 1 도체층과, 상기 기판 상에 마련된 제 2 도체층을 가지고,
상기 전자 소자는, 상기 제 1 도체층 상에 마련되며,
상기 제 1 주단자는, 상기 제 2 도체층에 접속되고,
상기 접속체는, 상기 제 2 도체층에 접속되는 기단부를 가지는 전자 장치.The method of claim 1,
The conductor layer has a first conductor layer provided on the substrate and a second conductor layer provided on the substrate,
The electronic device is provided on the first conductor layer,
The first main terminal is connected to the second conductor layer,
The connection body has a base end connected to the second conductor layer.
상기 센싱 단자는 상기 접속부와 연결되어 있으며, 상기 센싱 단자 및 상기 접속체가 일체로 형성되어 있는 전자 장치.4. The method according to any one of claims 1 to 3,
The sensing terminal is connected to the connection part, and the sensing terminal and the connection body are integrally formed with each other.
상기 전자 소자는 내압 구조를 가지고,
상기 접속체는, 상기 헤드부와 일체로 형성되며, 상기 내압 구조와의 접촉을 회피하기 위한 회피부를 가지는 전자 장치.4. The method according to any one of claims 1 to 3,
The electronic device has a withstand voltage structure,
The connection body is formed integrally with the head part, and has an avoidance part for avoiding contact with the pressure resistant structure.
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