KR102097227B1 - 어레이 기판 및 터치 스크린 - Google Patents

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Abstract

어레이 기판 및 터치 스크린에 있어서, 어레이 기판은 픽셀 전극층(31), 제1 터치 전극층(32) 및 제1 터치 전극층(32)에 순차적으로 설치되는 절연층(33), 제2 터치 전극층(34)을 포함하고; 여기서 픽셀 전극층(31)은 제1 터치 전극층(32), 제2 터치 전극층(34) 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 픽셀 전극층(31)의 수직 투사 영역에 절연층(33)이 제공되지 않는다. 이러한 방식을 통해, 터치 전극 간의 기생 커패시턴스를 감소할 수 있는 동시에, 액정 커패시터와 스토리지 커패시터의 크기에 영향을 미치지 않는다.

Description

어레이 기판 및 터치 스크린
본 발명은 터치 기술분야에 관한 것으로서, 특히는 어레이 기판 및 터치 스크린에 관한 것이다.
전자 기술의 지속적인 발전과 더불어, 터치 스크린은 이미 사람들의 생활에 깊이 침투되었다. 터치 스크린은 견고하고 내구성이 좋으며, 반응 속도가 빠르고 공간을 절약하며 용이한 교류 등 장점을 구비하는 바, 터치 스크린을 이용하면 사용자는 단지 손가락만으로 스크린의 아이콘을 터치하여 본체에 대한 조작을 실현할 수 있기에, 인간-기계 인터페이스가 더욱 간편하게 된다.
터치 스크린은 온셀 터치 스크린(On-cell Touch Panel) 및 인셀 터치 스크린(In-cell Touch Panel)을 포함한다. 여기서, 인셀 터치 스크린은 터치 센싱 기능을 야금 픽셀에 삽입한 것으로서, 이는 패널을 더욱 슬림하고 가볍게 만들었으며 제조상들에게 큰 환영을 받았다.
도 1에 도시된 바와 같이, 도 1은 선행기술의 한가지 액정 패널의 구조도이다. 액정 패널은 상부 기판(11), 하부 기판(12) 및 상부 기판(11)과 하부 기판(12) 사이에 위치하는 액정층(13)을 포함한다. 하부 기판(12)에 박막 트랜지스터 TFT의 소스/드레인 금속층(121), 유기 절연층(122), 공통 전극층(123), 패시베이션층(124) 및 픽셀 전극층(125)이 형성되어 있다.
도 2에 도시된 바와 같이, 도 2는 선행기술의 한가지 인셀 터치 스크린의 구조도이다. 기존의 인셀 터치 스크린에 있어서, 통상적으로는 하부 기판(12)에 터치 전극층(21) 및 절연층(22)을 증가한 것이다. 터치 전극층(21)과 공통 전극층(123)은 감지 전극으로서 터치 스크린의 터치 감지 기능을 실현한다. 여기서, 절연층(22)은 공통 전극층(123)을 커버하고, 터치 전극층(21)은 부분적인 절연층(22)에 위치하며, 패시베이션층(124)은 터치 전극층(21) 및 절연층(22)을 커버한다. 픽셀 전극층(125)은 패시베이션층(124)에 위치한다. 터치 전극층(21)과 공통 전극층(123) 사이에 기생 커패시턴스가 산생되기에, 따라서 선행기술에서는 기생 커패시턴스가 지나치게 커지는 것을 방지하기 위해, 통상적으로 비교적 두꺼운 절연층(22)을 형성하여, 터치 전극층(21)과 공통 전극층(123) 사이의 기생 커패시턴스를 감소한다.
그러나, 도 2에 도시된 바와 같이, 절연층(22)의 두께가 픽셀 전극층(125)과 상부 기판(11) 사이의 간격, 및 픽셀 전극층(125)과 공통 전극층(123) 사이의 거리를 개변시키기에, 절연층(22)의 두께를 증가하여 터치 전극의 기생 커패시턴스를 감소하려고 할 경우, 액정 커패시터와 스토리지 커패시터의 크기도 영향을 받게 되어, 디스플레이 화질을 감소시킨다.
본 발명이 주요하게 해결하고자 하는 기술적 과제는 어레이 기판 및 터치 스크린을 제공하여, 터치 전극 간의 기생 커패시턴스를 감소할 수 있는 동시에, 액정 커패시터와 스토리지 커패시터의 크기에 영향을 미치지 않는 것이다.
상기 기술적 과제를 해결하기 위해, 본 발명에서 사용하는 하나의 기술적 해결수단은, 터치 스크린에 사용하기 위한 어레이 기판을 제공하는 것인 바, 픽셀 전극층, 제1 터치 전극층 및 상기 제1 터치 전극층에 순차적으로 적층 설치되는 절연층, 제2 터치 전극층을 포함하고; 여기서 상기 픽셀 전극층은 상기 제1 터치 전극층, 상기 제2 터치 전극층 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 상기 픽셀 전극층의 수직 투사 영역에 상기 절연층이 제공되지 않고; 상기 제1 터치 전극층은 공통 전극층이며, 상기 제2 터치 전극층은 블랙 매트릭스의 수직 투사 영역 내부에 위치한다.
여기서, 패시베이션층을 더 포함하고; 상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층에 간격을 두고 배열되는 다수의 절연층을 포함하며, 상기 제2 터치 전극층은 그 중 하나의 상기 절연층에 위치하고, 상기 패시베이션층은 상기 제2 터치 전극층 및 절연층 사이의 제1 터치 전극층에 설치되며, 상기 다수의 픽셀 전극봉은 절연층 사이의 상기 패시베이션층에 각각 설치되고, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역에 상기 절연층이 제공되지 않는다.
여기서, 패시베이션층을 더 포함하고; 상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층을 부분적으로 커버하며, 상기 패시베이션층은 상기 제2 터치 전극층 및 상기 절연층에 커버되지 않은 상기 제1 터치 전극층에 설치되고, 상기 다수의 픽셀 전극봉은 상기 패시베이션층에 설치되며, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역 및 픽셀 전극봉 사이에 상기 절연층이 제공되지 않는다.
상기 기술적 과제를 해결하기 위해, 본 발명에서 사용하는 다른 하나의 기술적 해결수단은, 터치 스크린에 사용하기 위한 어레이 기판을 제공하는 것인 바, 픽셀 전극층, 제1 터치 전극층 및 상기 제1 터치 전극층에 순차적으로 적층 설치되는 절연층, 제2 터치 전극층을 포함하고; 여기서 상기 픽셀 전극층은 상기 제1 터치 전극층, 상기 제2 터치 전극층 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 상기 픽셀 전극층의 수직 투사 영역에 상기 절연층이 제공되지 않는다.
여기서, 패시베이션층을 더 포함하고; 상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층에 간격을 두고 배열되는 다수의 절연층을 포함하며, 상기 제2 터치 전극층은 그 중 하나의 상기 절연층에 위치하고, 상기 패시베이션층은 상기 제2 터치 전극층 및 절연층 사이의 제1 터치 전극층에 설치되며, 상기 다수의 픽셀 전극봉은 절연층 사이의 상기 패시베이션층에 각각 설치되고, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역에 상기 절연층이 제공되지 않는다.
여기서, 패시베이션층을 더 포함하고; 상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층을 부분적으로 커버하며, 상기 패시베이션층은 상기 제2 터치 전극층 및 상기 절연층에 커버되지 않은 상기 제1 터치 전극층에 설치되고, 상기 다수의 픽셀 전극봉은 상기 패시베이션층에 설치되며, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역 및 픽셀 전극봉 사이에 상기 절연층이 제공되지 않는다.
여기서, 상기 제1 터치 전극층은 공통 전극층이다.
여기서, 상기 제2 터치 전극층은 블랙 매트릭스의 수직 투사 영역 내부에 위치한다.
상기 기술적 과제를 해결하기 위해, 본 발명에서 사용하는 다른 하나의 기술적 해결수단은, 터치 스크린을 제공하는 것인 바, 어레이 기판, 컬러 필터 기판 및 상기 어레이 기판과 상기 컬러 필터 기판 사이에 위치하는 액정층을 포함하고, 상기 어레이 기판 픽셀 전극층, 제1 터치 전극층 및 상기 제1 터치 전극층에 순차적으로 적층 설치되는 절연층, 제2 터치 전극층을 포함하고; 여기서 상기 픽셀 전극층은 상기 제1 터치 전극층, 상기 제2 터치 전극층 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 상기 픽셀 전극층의 수직 투사 영역에 상기 절연층이 제공되지 않는다.
여기서, 상기 어레이 기판 패시베이션층을 더 포함하고; 상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층에 간격을 두고 배열되는 다수의 절연층을 포함하며, 상기 제2 터치 전극층은 그 중 하나의 상기 절연층에 위치하고, 상기 패시베이션층은 상기 제2 터치 전극층 및 절연층 사이의 제1 터치 전극층에 설치되며, 상기 다수의 픽셀 전극봉은 절연층 사이의 상기 패시베이션층에 각각 설치되고, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역에 상기 절연층이 제공되지 않는다.
여기서, 상기 어레이 기판 패시베이션층을 더 포함하고; 상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층을 부분적으로 커버하며, 상기 패시베이션층은 상기 제2 터치 전극층 및 상기 절연층에 커버되지 않은 상기 제1 터치 전극층에 설치되고, 상기 다수의 픽셀 전극봉은 상기 패시베이션층에 설치되며, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역 및 픽셀 전극봉 사이에 상기 절연층이 제공되지 않는다.
여기서, 상기 제1 터치 전극층은 공통 전극층이다.
여기서, 상기 컬러 필터 기판은 블랙 매트릭스를 포함하고, 상기 제2 터치 전극층은 상기 블랙 매트릭스의 수직 투사 영역 내부에 위치한다.
본 발명의 유익한 효과는 하기와 같다. 선행기술의 상황과 구별되게, 본 발명은 제1 터치 전극층과 제2 터치 전극층 사이에 절연층이 설치되어 있고, 픽셀 전극층의 수직 투사 영역에 상기 절연층이 설치되어 있지 않으며, 즉 제1 터치 전극층과 제2 터치 전극층 사이의 절연층은 픽셀 전극층의 수직 투사 영역 내부에 형성되어 있지 않기에, 따라서 제1 터치 전극층과 제2 터치 전극층 사이에 형성되는 절연층의 두께는 픽셀 전극과 다른 한 기판의 공통 전극 사이의 간격에 영향을 일으키지 않으며, 픽셀 전극과 어레이 기판의 공통 전극 사이의 간격에도 영향을 일으키지 않기에, 따라서 제1 터치 전극층과 제2 터치 전극층 사이의 절연층의 두께는 터치 전극층 사이의 기생 커패시턴스를 감소할 경우, 액정 커패시터와 스토리지 커패시터에 대한 영향을 방지할 수 있다.
도 1은 선행기술의 한가지 액정 패널의 구조도이다.
도 2는 선행기술의 한가지 인셀 터치 스크린의 구조도이다.
도 3은 본 발명의 터치 스크린에 사용하기 위한 어레이 기판의 일 실시예의 구조도이다.
도 4는 본 발명의 터치 스크린에 사용하기 위한 어레이 기판의 다른 실시예의 구조도이다.
도 5는 본 발명의 터치 스크린의 일 실시예의 구조도이다.
이하 도면과 실시예를 결부하여 본 발명을 상세하게 설명하도록 한다.
본 발명을 설명하기에 앞서, 우선 본 발명에 적용되는 어레이 기판의 액정 패널에 대해 설명해야 한다. 어레이 기판과 컬러 필터 기판은 서로 접합되고, 다음 어레이 기판과 컬러 필터 기판 사이에 액정을 넣어 액정 패널을 획득한다. 여기서, 어레이 기판상의 픽셀 전극과 컬러 필터 기판상의 공통 전극에 의해 형성되는 평행판 커패시터는 액정 커패시터이고, 어레이 기판상의 픽셀 전극과 어레이 기판상의 공통 전극에 의해 형성되는 평행판 커패시터는 스토리지 커패시터이다.
도 3을 참조하면, 본 발명의 어레이 기판의 일 실시예에 있어서, 어레이 기판은 픽셀 전극층(31), 제1 터치 전극층(32) 및 제1 터치 전극층(32)에 순차적으로 설치되는 절연층(33), 제2 터치 전극층(34)을 포함하고, 즉 절연층(33)은 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이에 위치한다.
여기서, 터치 기능을 수행할 시, 제1 터치 전극층(32)은 전극을 구동할 수 있고, 제2 터치 전극층(34)은 감지 전극일 수 있으며, 양자는 서로 매칭되어 터치 검출을 실현한다.
픽셀 전극층(31)과 제2 터치 전극층(34)은 중첩되지 않고, 또한 픽셀 전극층(31)의 수직 투사 영역에는 절연층(33)이 설치되어 있지 않으며, 즉 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이에 형성되는 절연층(33)은, 픽셀 전극층(31)의 수직 투사 영역 내부에 형성되지 않는다. 따라서, 어레이 기판과 다른 하나의 컬러 필터 기판이 서로 접합할 시, 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이에 형성되는 절연층(33)의 두께는 픽셀 전극층(31)과 컬러 필터 기판상의 공통 전극층 사이의 간격에 영향을 일으키지 않으며, 픽셀 전극층(31)과 어레이 기판상의 공통 전극층 사이의 간격에도 영향을 일으키지 않고, 이로써 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이의 절연층(33)의 두께를 증가시켜 터치 전극층(32, 34) 사이의 기생 커패시턴스를 감소해야 할 경우, 액정 커패시터와 스토리지 커패시터의 크기에 대한 영향을 방지할 수 있어, 디스플레이 화질을 보장할 수 있다.
또한, 본 발명의 실시예에 있어서, 어레이 기판은 패시베이션층(35)을 더 포함한다. 제1 터치 전극층(32)은 어레이 기판의 공통 전극층이다. 여기서, 픽셀 전극층(31)과 제2 터치 전극층(34)은 중첩되지 않는다. 픽셀 전극층(31)은 제1 터치 전극층(32)과 부분적으로 중첩되고, 제1 터치 전극층(32)에 위치한다. 절연층(33)은 제1 터치 전극층(32)에 간격을 두고 배열되는 다수의 절연층(33)을 포함하고, 제2 터치 전극층(34)은 그 중 하나의 절연층(33)에 위치하고, 절연층(33) 사이의 제1 터치 전극층(32)에 절연층(33)이 제공되지 않는다.
여기서, 패시베이션층(35)은 제2 터치 전극층(34), 절연층(33) 사이의 제1 터치 전극층(32) 및 제2 터치 전극층(34)에 커버되지 않은 절연층(33)에 형성된다. 픽셀 전극층(31)은 다수의 픽셀 전극봉(311)을 포함하고, 다수의 픽셀 전극봉(311)은 절연층(33) 사이의 패시베이션층(35)에 각각 위치하고, 즉 다수의 픽셀 전극봉(311)은 제1 터치 전극층(32)에 직접 커버되는 패시베이션층(35)에 위치하며, 픽셀 전극봉(311)은 패시베이션층(35)과 직접 접촉함으로써, 픽셀 전극봉(311)의 수직 투사 영역 내부에 절연층(33)이 제공되지 않도록 한다.
따라서, 본 실시예에 있어서, 픽셀 전극봉(311) 사이에 절연층(33)이 설치되어 있고, 픽셀 전극봉(311) 사이의 절연층(33)에도 패시베이션층(35)이 제공되지 않는다.
여기서, 어레이 기판은 베이스(36) 및 베이스(36)에 순차적으로 형성되는 게이트 절연층(37), ILD(Insulator layer, 절연층)층(38), 소스/드레인 금속층(39) 및 유기 절연층(40)을 더 포함한다. 제1 터치 전극층(31)은 유기 절연층(40)에 형성된다.
따라서, 본 실시예의 어레이 기판은, 하기의 방법 단계를 통해 형성된다.
단계S41: 베이스(36)를 제공한다.
단계S42: 베이스(36)에 게이트 절연층(37), ILD층(38), 소스/드레인 금속층(39) 및 유기 절연층(40)을 순차적으로 형성한다.
단계S43: 유기 절연층(40)에 제1 터치 전극층(32)을 형성한다.
단계S44: 제1 터치 전극층(32)에 절연층(33)을 형성하고, 절연층(33)은 제1 터치 전극층(32)을 커버한다.
단계S45: 부분적인 절연층(33)을 제거하여 제1 터치 전극층(32)에 간격을 두고 배열되는 다수의 절연층(33)을 형성하며, 절연층(33) 사이의 제1 터치 전극층(32)을 노출시킨다.
단계S46: 그 중 하나의 절연층(33)에 제2 터치 전극층(34)을 형성한다.
단계S47: 제2 터치 전극층(34), 절연층(33) 사이에 위치하는 제1 터치 전극층(32) 및 제2 터치 전극층(34)에 커버되지 않은 절연층(33)에 패시베이션층(35)을 형성한다.
단계S48: 절연층(33) 사이의 패시베이션층(35)에 픽셀 전극봉(311)을 형성한다.
단계S45와 단계S46에 있어서, 제1 터치 전극층(32)에 절연층(33)을 형성한 후, 절연층(33)에 우선 제2 터치 전극층(34)을 형성할 수도 있고, 다음 제2 터치 전극층(34)을 셀프-정렬 마스크로서 제2 터치 전극층(34)에 의해 부분적으로 커버되지 않은 절연층(33)을 제어하여, 제1 터치 전극층(32)에 간격을 두고 배열되는 다수의 절연층(33)을 형성하고, 절연층(33) 사이의 제1 터치 전극층(32)을 노출한다.
상기 방식을 통해, 픽셀 전극봉(311)의 수직 투사 영역 내부에 절연층(33)이 제공되지 않도록 함으로써, 절연층(33) 또는 상이한 두께의 절연층(33)을 설치하여 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이의 기생 커패시턴스를 감소해야 할 시, 절연층(33)이 액정 커패시터와 스토리지 커패시터의 크기에 대한 영향을 방지할 수 있다. 또한, 픽셀 전극봉(311)을 절연층(33) 사이에 형성시키는 것을 통해, 절연층(33)의 높이를 참조하여 각각의 픽셀 전극봉(311)을 형성할 수 있으며, 각각의 픽셀 전극봉(311)의 평탄성을 보장하는데 유리하고, 상기 평탄성은 각각의 픽셀 전극봉의 높이의 일치성을 가리킨다.
도 4를 참조하면, 본 발명의 어레이 기판의 다른 실시예에 있어서, 도 3에 도시된 실시예와 주요하게 상이한 점은, 제2 터치 전극층(34)과 대응되는 위치에 절연층(33)이 형성되어 있는 외에도, 제1 터치 전극층(32)의 기타 위치에 절연층(33)이 형성되어 있지 않는 바, 즉 픽셀 전극봉(311) 사이에 절연층(33)이 설치되어 있지 않다.
따라서, 본 실시예의 어레이 기판을 형성하는 단계에 있어서, 제1 터치 전극층(32)을 형성한 후, 제1 터치 전극층(32)에 절연층(33)을 형성하고, 다음 절연층(33)에 제2 터치 전극층(34)을 형성하며, 그 후 제2 터치 전극층(34)을 셀프-정렬 마스크로 하여 절연층(33)을 노출시켜, 제2 터치 전극층(34)에 커버되는 절연층(33) 이 외의 기타 절연층을 제거할 수 있다. 다음, 제2 터치 전극층(34) 및 노출되는 제1 터치 전극층(32)에 패시베이션층(35)을 형성하고, 다음 제1 터치 전극층(32)과 직접적으로 접촉하는 패시베이션층(35)에 다수의 픽셀 전극봉(311)을 형성하며, 여기서 다수의 픽셀 전극봉(311)은 제2 터치 전극층(34)과 중첩되지 않고, 이로써 픽셀 전극봉(311)의 수직 투사 영역에 절연층(33)이 제공되지 않도록 하며, 절연층(33)은 단지 제1 터치 전극층(32)과 제2 터치 전극층(33) 사이에 위치한다.
본 실시예의 어레이 기판은, 제2 터치 전극층(34)에 커버되는 절연층(33) 이외의 기타 절연층을 제거하는 것을 통해, 공정의 과정을 간소화한다.
여기서, 본 발명의 어레이 기판의 실시예에 있어서, 제2 터치 전극층(34)은 블랙 매트릭스에 대응되는 수직 투사 영역 내부에 위치하는 바, 즉 제2 터치 전극층(34)은 픽셀 유닛 사이에 위치하고, 상기 블랙 매트릭스는 컬러 필터 기판에 위치하며, 하나의 상기 픽셀 유닛과 컬러 필터 기판상의 하나의 적색 포토레지스트층(R) 또는 하나의 녹색 포토레지스트층(G) 또는 하나의 남색 포토레지스트층(B)은 서로 대응된다.
여기서, 다른 실시예에 있어서, 제1 터치 전극층(32)은 어레이 기판에 별도로 증가되어 터치 센싱을 실현하는 터치 전극층일 수도 있으며, 이때 픽셀 전극층(31)은 제1 터치 전극층(32, 34)과 모두 중첩되지 않는다.
도 5를 참조하면, 본 발명의 터치 스크린의 일 실시예에 있어서, 터치 스크린은 터치 기능을 구비하는 액정 스크린이다. 여기서, 터치 스크린은 어레이 기판(51), 컬러 필터 기판(52) 및 어레이 기판과 컬러 필터 기판(52) 사이에 위치하는 액정층(53)을 포함한다.
여기서, 어레이 기판(51)은 상기 임의의 하나의 실시예에 따른 상기 어레이 기판이다. 여기서, 도 3에 도시된 어레이 기판을 예로 들어 설명한다. 본 실시예의 터치 스크린에 있어서, 액정층(53)에 스페이서(531)가 설치되어 액정 간격을 보장한다. 어레이 기판(51)은 픽셀 전극층(31), 제1 터치 전극층(32) 및 제1 터치 전극층(32)에 순차적으로 설치되는 절연층(33), 제2 터치 전극층(34)을 포함하는 바, 즉 절연층(33)은 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이에 위치한다.
여기서, 픽셀 전극층(31)과 제2 터치 전극층(34)은 중첩되지 않고, 또한 픽셀 전극층(31)의 수직 투사 영역에 절연층(33)이 설치되어 있지 않으며, 즉 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이에 형성되는 절연층(33)은, 픽셀 전극층(31)의 수직 투사 영역 내부에 형성되지 않는다. 따라서, 어레이 기판(51)과 컬러 필터 기판(52)이 서로 접합할 시, 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이에 형성되는 절연층(33)의 두께는 픽셀 전극층(31)과 컬러 필터 기판(52)상의 공통 전극층 사이의 간격에 대해 영향을 일으키지 않고, 픽셀 전극층(31)과 어레이 기판(51)상의 공통 전극층 사이의 간격에 대해 영향을 일으키지 않으며, 이로써 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이의 절연층(33)의 두께를 증가시켜 터치 전극층(32, 34) 사이의 기생 커패시턴스를 감소해야 할 경우, 액정 커패시터와 스토리지 커패시터의 크기에 대한 영향을 방지하여, 디스플레이 화질을 보장할 수 있다.
또한, 어레이 기판(51)은 패시베이션층(35)을 더 포함한다. 제1 터치 전극층(32)은 어레이 기판(51)의 공통 전극층이다. 여기서, 픽셀 전극층(31)은 제2 터치 전극층(34)과 중첩되지 않는다. 픽셀 전극층(31)은 제1 터치 전극층(32)과 부분적으로 중첩되고, 제1 터치 전극층(32)에 위치한다. 절연층(33)은 제1 터치 전극층(32)에 간격을 두고 배열되는 다수의 절연층(33)을 포함하고, 제2 터치 전극층(34)은 그 중 하나의 절연층(33)에 위치하고, 절연층(33) 사이의 제1 터치 전극층(32)에 절연층(33)이 제공되지 않는다.
여기서, 패시베이션층(35)은 제2 터치 전극층(34), 절연층(33) 사이의 제1 터치 전극층(32) 및 제2 터치 전극층(34)에 커버되지 않은 절연층(33)에 형성된다. 픽셀 전극층(31)은 다수의 픽셀 전극봉(311)을 포함하고, 다수의 픽셀 전극봉(311)은 절연층(33) 사이의 패시베이션층(35)에 각각 위치하고, 즉 다수의 픽셀 전극봉(311)은 제1 터치 전극층(32)에 직접 커버되는 패시베이션층(35)에 위치하며, 픽셀 전극봉(311)은 패시베이션층(35)과 직접 접촉함으로써, 픽셀 전극봉(311)의 수직 투사 영역 내부에 절연층(33)이 제공되지 않도록 한다.
여기서, 어레이 기판(51)은 베이스(36) 및 베이스(36)에 순차적으로 형성되는 게이트 절연층(37), ILD(Insulator layer, 절연층)층(38), 소스/드레인 금속층(39)및 유기 절연층(40)을 더 포함한다. 제1 터치 전극층(31)은 유기 절연층(40)에 형성된다.
여기서, 컬러 필터 기판(52)은 유리 베이스(521), 유리 베이스에 형성되는 포토레지스트층을 포함하고, 상기 포토레지스트층은 적색 포토레지스트층, 녹색 포토레지스트층, 남색 포토레지스트층을 포함하며, 매 하나의 포토레지스트층은 어레이 기판(51)의 하나의 픽셀 유닛에 대응되고, 여기서 도면에서는 적색 포토레지스트층(523)과 녹색 포토레지스트층(524)만 도시한다. 컬러 필터 기판(52)은 포토레지스트층 사이에 위치하는 블랙 매트릭스(522) 및 평탄층(525)을 더 포함한다. 평탄층(525)은 투명 평탄층이다. 여기서, 컬러 필터 기판(52)에 공통 전극층(미도시)이 더 설치되어 있다.
여기서, 스페이서(531)는 블랙 매트릭스(522)의 수직 투사 영역의 액정층(53)에 위치한다.
여기서, 어레이 기판(51)의 제2 터치 전극층(34)은 블랙 매트릭스(522)의 수직 투사 영역에 위치한다.
본 실시예의 터치 스크린은, 픽셀 전극층의 수직 투사 영역에 절연층(33)을 설치하지 않는 것을 통해, 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이에 절연층(33)을 설치하거나 또는 상이한 두께의 절연층(33)을 설치하여, 제1 터치 전극층(32)과 제2 터치 전극층(34) 사이의 기생 커패시턴스를 감소해야 할 경우, 절연층(33)이 액정 커패시터와 스토리지 커패시터의 크기에 대한 영향을 방지할 수 있다.
상기 내용은 단지 본 발명의 실시예로서, 본 발명의 특허범위를 한정하기 위한 것이 아니며, 본 발명의 명세서 및 도면의 내용을 이용한 동등한 구조 또는 동등 또는 기타 관련 기술분야에서의 직접적이거나 간접적인 응용은 모두 본 발명의 특허호보범위에 속한다.

Claims (13)

  1. 삭제
  2. 터치 스크린에 사용하기 위한 어레이 기판에 있어서,
    이는 픽셀 전극층, 제1 터치 전극층 및 상기 제1 터치 전극층에 순차적으로 적층 설치되는 절연층, 제2 터치 전극층을 포함하고;
    상기 픽셀 전극층은 상기 제1 터치 전극층, 상기 제2 터치 전극층 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 상기 픽셀 전극층의 수직 투사 영역에 상기 절연층이 제공되지 않고;
    상기 제1 터치 전극층은 공통 전극층이며, 상기 제2 터치 전극층은 블랙 매트릭스의 수직 투사 영역 내에 위치하고,
    패시베이션층을 더 포함하고;
    상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층에 간격을 두고 배열되는 다수의 절연층을 포함하며, 상기 제2 터치 전극층은 그 중 하나의 상기 절연층에 위치하고, 상기 패시베이션층은 상기 제2 터치 전극층 및 절연층 사이의 제1 터치 전극층에 설치되며, 상기 다수의 픽셀 전극봉은 절연층 사이의 상기 패시베이션층에 각각 설치되고, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역에 상기 절연층이 제공되지 않는 것을 특징으로 하는 터치 스크린에 사용하기 위한 어레이 기판.
  3. 터치 스크린에 사용하기 위한 어레이 기판에 있어서,
    이는 픽셀 전극층, 제1 터치 전극층 및 상기 제1 터치 전극층에 순차적으로 적층 설치되는 절연층, 제2 터치 전극층을 포함하고;
    상기 픽셀 전극층은 상기 제1 터치 전극층, 상기 제2 터치 전극층 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 상기 픽셀 전극층의 수직 투사 영역에 상기 절연층이 제공되지 않고;
    상기 제1 터치 전극층은 공통 전극층이며, 상기 제2 터치 전극층은 블랙 매트릭스의 수직 투사 영역 내에 위치하고,
    패시베이션층을 더 포함하고;
    상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층을 부분적으로 커버하며, 상기 패시베이션층은 상기 제2 터치 전극층 및 상기 절연층에 커버되지 않은 상기 제1 터치 전극층에 설치되고, 상기 다수의 픽셀 전극봉은 상기 패시베이션층에 설치되며, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역 및 픽셀 전극봉 사이에 상기 절연층이 제공되지 않는 것을 특징으로 하는 터치 스크린에 사용하기 위한 어레이 기판.
  4. 삭제
  5. 터치 스크린에 사용하기 위한 어레이 기판에 있어서,
    이는 픽셀 전극층, 제1 터치 전극층 및 상기 제1 터치 전극층에 순차적으로 적층 설치되는 절연층, 제2 터치 전극층을 포함하고;
    상기 픽셀 전극층은 상기 제1 터치 전극층, 상기 제2 터치 전극층 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 상기 픽셀 전극층의 수직 투사 영역에 상기 절연층이 제공되지 않고,
    패시베이션층을 더 포함하고;
    상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층에 간격을 두고 배열되는 다수의 절연층을 포함하며, 상기 제2 터치 전극층은 그 중 하나의 상기 절연층에 위치하고, 상기 패시베이션층은 상기 제2 터치 전극층 및 절연층 사이의 제1 터치 전극층에 설치되며, 상기 다수의 픽셀 전극봉은 절연층 사이의 상기 패시베이션층에 각각 설치되고, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역에 상기 절연층이 제공되지 않는 것을 특징으로 하는 터치 스크린에 사용하기 위한 어레이 기판.
  6. 터치 스크린에 사용하기 위한 어레이 기판에 있어서,
    이는 픽셀 전극층, 제1 터치 전극층 및 상기 제1 터치 전극층에 순차적으로 적층 설치되는 절연층, 제2 터치 전극층을 포함하고;
    상기 픽셀 전극층은 상기 제1 터치 전극층, 상기 제2 터치 전극층 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 상기 픽셀 전극층의 수직 투사 영역에 상기 절연층이 제공되지 않고,
    패시베이션층을 더 포함하고;
    상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층을 부분적으로 커버하며, 상기 패시베이션층은 상기 제2 터치 전극층 및 상기 절연층에 커버되지 않은 상기 제1 터치 전극층에 설치되고, 상기 다수의 픽셀 전극봉은 상기 패시베이션층에 설치되며, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역 및 픽셀 전극봉 사이에 상기 절연층이 제공되지 않는 것을 특징으로 하는 터치 스크린에 사용하기 위한 어레이 기판.
  7. 제 5항 또는 제 6항에 있어서,
    상기 제1 터치 전극층은 공통 전극층인 것을 특징으로 하는 터치 스크린에 사용하기 위한 어레이 기판.
  8. 제 5항 또는 제 6항에 있어서,
    상기 제2 터치 전극층은 블랙 매트릭스의 수직 투사 영역 내에 위치하는 것을 특징으로 하는 터치 스크린에 사용하기 위한 어레이 기판.
  9. 삭제
  10. 터치 스크린에 있어서,
    이는 어레이 기판, 컬러 필터 기판 및 상기 어레이 기판과 상기 컬러 필터 기판 사이에 위치하는 액정층을 포함하고, 상기 어레이 기판은 픽셀 전극층, 제1 터치 전극층 및 상기 제1 터치 전극층에 순차적으로 적층 설치되는 절연층, 제2 터치 전극층을 포함하고;
    상기 픽셀 전극층은 상기 제1 터치 전극층, 상기 제2 터치 전극층 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 상기 픽셀 전극층의 수직 투사 영역에 상기 절연층이 제공되지 않고,
    상기 어레이 기판은 패시베이션층을 더 포함하고;
    상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층에 간격을 두고 배열되는 다수의 절연층을 포함하며, 상기 제2 터치 전극층은 그 중 하나의 상기 절연층에 위치하고, 상기 패시베이션층은 상기 제2 터치 전극층 및 절연층 사이의 제1 터치 전극층에 설치되며, 상기 다수의 픽셀 전극봉은 절연층 사이의 상기 패시베이션층에 각각 설치되고, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역에 상기 절연층이 제공되지 않는 것을 특징으로 하는 터치 스크린.
  11. 터치 스크린에 있어서,
    이는 어레이 기판, 컬러 필터 기판 및 상기 어레이 기판과 상기 컬러 필터 기판 사이에 위치하는 액정층을 포함하고, 상기 어레이 기판은 픽셀 전극층, 제1 터치 전극층 및 상기 제1 터치 전극층에 순차적으로 적층 설치되는 절연층, 제2 터치 전극층을 포함하고;
    상기 픽셀 전극층은 상기 제1 터치 전극층, 상기 제2 터치 전극층 중의 적어도 하나와 중첩되지 않으며, 또한 적어도 상기 픽셀 전극층의 수직 투사 영역에 상기 절연층이 제공되지 않고,
    상기 어레이 기판은 패시베이션층을 더 포함하고;
    상기 픽셀 전극층은 상기 제2 터치 전극층과 중첩되지 않으며, 상기 픽셀 전극층은 다수의 픽셀 전극봉을 포함하고, 상기 절연층은 상기 제1 터치 전극층을 부분적으로 커버하며, 상기 패시베이션층은 상기 제2 터치 전극층 및 상기 절연층에 커버되지 않은 상기 제1 터치 전극층에 설치되고, 상기 다수의 픽셀 전극봉은 상기 패시베이션층에 설치되며, 매 하나의 상기 픽셀 전극봉의 수직 투사 영역 및 픽셀 전극봉 사이에 상기 절연층이 제공되지 않는 것을 특징으로 하는 터치 스크린.
  12. 제 10항 또는 제 11항에 있어서,
    상기 제1 터치 전극층은 공통 전극층인 것을 특징으로 하는 터치 스크린.
  13. 제 10항 또는 제 11항에 있어서,
    상기 컬러 필터 기판은 블랙 매트릭스를 포함하고, 상기 제2 터치 전극층은 상기 블랙 매트릭스의 수직 투사 영역 내에 위치하는 것을 특징으로 하는 터치 스크린.
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