KR101485024B1 - 저항 변화 메모리 소자 - Google Patents
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Abstract
본원은, 제 1 전극; 상기 제 1 전극 상에 형성되며 서로 접합된 저항변화층과 스위치층을 포함하는 박막층; 및 상기 박막층 상에 형성된 제 2 전극을 포함하는, 저항 변화 메모리 소자, 및 상기 저항 변화 메모리 소자를 포함하는 메모리 어레이를 제공한다.
Description
본원은, 저항 변화 메모리 소자 및 그의 제조 방법에 관한 것으로, 보다 상세하게는, 각각 저항 변화 및 스위치의 특성을 가지는 두 개의 층을 접합시켜 형성된 박막층을 포함하는, 저항 변화 메모리 소자에 관한 것이다.
반도체 메모리 소자의 대부분을 차지하는 실리콘 기반의 메모리는 소자의 크기를 줄여 나감에 있어서, 터널링과 같은 양자 역학적인 한계에 부딪히게 되면서 새로운 개념의 메모리 소자에 대한 요구가 커지고 있다. 이러한 차세대 메모리 소자의 후보로 산화물에서의 양극성 저항 변화 현상 (bipolar resistance switching)을 이용한 저항 변화 메모리(Resistance Random Access Memory; RRAM)가 제안 되고 있다.
양극성(bipolar) 저항 변화 현상은 인가된 전압의 극성에 의해 낮고 높은 두 개의 저항상태가 순차적으로 바뀔 수 있는 현상이다. 저항 변화 메모리는 상기 양극성 저항 변화 현상을 이용함으로써 매우 빠른 작동 속도, 비휘발성, nm 크기의 소자에서 작동 가능한 점 등으로 인해서 최근에 큰 관심을 받고 있다.
저항 변화 메모리의 집적도를 높이기 위해서는 종래의 3 차원 크로스바(crossbar) 구조를 만들어야 한다. 하지만 3 차원 크로스바 구조를 구현함에 있어서 두 가지 중요한 문제들이 발생한다. 첫째로, 크로스바 구조에서 임의의 소자에 저장되어 있는 정보를 읽고자 할 때, 주위에 있는 소자들에 흐르는 누설전류들과의 간섭에 의해 원하는 소자의 정보를 잘못 읽게 되는 경우가 발생하며, 이를 스니크 경로 문제(sneak path problem)라 한다. 둘째로, 통상적으로 크로스바 구조에서는 임의의 저항 변화 메모리를 선택하기 위해서 Si 기반의 트랜지스터를 사용하지만, 이러한 트랜지스터를 사용하는 경우 저항 변화 메모리의 고집적화를 구현하는데 있어서 구조적인 한계가 존재한다는 문제점이 발생한다.
이에, 본원은 고집적화의 한계로 작용하고 있는 스니크 경로 문제를 해결하기 위하여, 중간전극을 사용하지 않고 서로 접합된 저항변화층과 스위치층을 포함하는 박막층을 포함하여 형성되는 저항 변화 메모리 소자를 제공하고자 한다.
그러나, 본원이 해결하고자 하는 과제는 이상에서 기술한 과제로 제한되지 않으며, 기술되지 않은 또 다른 과제들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.
상기와 같은 목적을 달성하기 위하여, 본원의 일 측면은, 제 1 전극; 상기 제 1 전극 상에 형성되며 서로 접합된 저항변화층과 스위치층을 포함하는 박막층; 및, 상기 박막층 상에 형성된 제 2 전극을 포함하는, 저항 변화 메모리 소자를 제공한다.
본원의 다른 측면은, 제 1 방향으로 형성된 복수개의 제 1 전극 라인; 각각의 상기 제 1 전극 라인 상에 형성되며, 서로 접합된 저항변화층과 스위치층을 포함하는 박막층; 및, 상기 박막층 상에 제 2 방향으로 형성된 복수개의 제 2 전극 라인을 포함하는, 저항 변화 메모리 어레이를 제공한다.
본원의 저항 변화 메모리 소자는, 스위칭 물질로서 종래 사용되던 트랜지스터가 아닌 양방향 (bi-directional) 스위치층을 저항변화층 상에 직접 접합시킨 박막 구조를 사용함으로써 스니크 경로 문제를 방지할 수 있다. 또한, 본원에 따른 상기 저항 변화 메모리 소자는 종래 제안되었던 중간전극을 가지는 메모리 소자와 달리, 중간전극을 필요로 하지 않는 상기 스위치층 및 상기 저항변화층의 접합구조를 통하여 고집적의 저항 변화 메모리 어레이를 제작할 수 있을 뿐만 아니라, 상기 메모리 어레이의 제작 공정을 단순화 할 수 있다.
도 1은 종래의 저항 변화 메모리 소자에서 스니크 경로 문제를 보여주는 모식도이다.
도 2는 본원의 일 구현예에 따른 저항 변화 메모리 소자의 단면도이다.
도 3은 본원의 일 실시예에 따른 저항 변화 메모리 소자가 스니크 경로 문제를 해결하는 모식도이다.
도 4는 본원의 일 구현예에 따른 저항 변화 메모리 어레이의 사시도이다.
도 5는 본원의 일 실시예에 따른 저항 변화 메모리 어레이의 모습과 성능을 실험한 그래프이다.
도 6은 본원의 일 실시예에 따른 저항 변화 메모리 어레이에 펄스 전압을 인가하여 성능 실험한 결과이다.
도 7은 본원의 일 실시예에 따른 저항 변화 메모리 소자에 대한 전도 원자 힘 현미경 (conducting atomic force microscopy: C-AFM)를 이용한 최소 전극 크기에서의 성능 실험 결과이다.
도 2는 본원의 일 구현예에 따른 저항 변화 메모리 소자의 단면도이다.
도 3은 본원의 일 실시예에 따른 저항 변화 메모리 소자가 스니크 경로 문제를 해결하는 모식도이다.
도 4는 본원의 일 구현예에 따른 저항 변화 메모리 어레이의 사시도이다.
도 5는 본원의 일 실시예에 따른 저항 변화 메모리 어레이의 모습과 성능을 실험한 그래프이다.
도 6은 본원의 일 실시예에 따른 저항 변화 메모리 어레이에 펄스 전압을 인가하여 성능 실험한 결과이다.
도 7은 본원의 일 실시예에 따른 저항 변화 메모리 소자에 대한 전도 원자 힘 현미경 (conducting atomic force microscopy: C-AFM)를 이용한 최소 전극 크기에서의 성능 실험 결과이다.
이하, 첨부한 도면을 참조하여 본원이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 본원의 구현예 및 실시예를 상세히 설명한다.
그러나 본원은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 구현예 및 실시예에 한정되지 않는다. 그리고 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 유사한 부분에 대해서는 유사한 도면 부호를 붙였다.
본원 명세서 전체에서, 어떤 부분이 어떤 구성 요소를 "포함"한다고 할 때, 이는 특별히 반대되는 기재가 없는 한 다른 구성 요소를 제외하는 것이 아니라 다른 구성 요소를 더 포함할 수 있는 것을 의미한다.
본 명세서에서 사용되는 정도의 용어 "약", "실질적으로" 등은 언급된 의미에 고유한 제조 및 물질 허용오차가 제시될 때 그 수치에서 또는 그 수치에 근접한 의미로 사용되고, 본원의 이해를 돕기 위해 정확하거나 절대적인 수치가 언급된 개시 내용을 비양심적인 침해자가 부당하게 이용하는 것을 방지하기 위해 사용된다.
본 명세서에서 사용되는 용어 "양극성(bipolar) 저항 변화 물질" 이란, 가역적인 두 저항 상태가 스위칭을 일으킬 때 필요한 전압의 극성이 두 개(양쪽)인 성질을 가지는 물질을 의미한다.
본 명세서에서 사용되는 용어 "양방향(bi-directional) 스위칭" 물질이란, 양방향으로 모두 정류작용을 할 수 있는 물질 또는 소자를 의미한다(도 3f 참조).
본원의 일 측면에 따른 저항 변화 메모리 소자는 제 1 전극; 상기 제 1 전극 상에 형성되며 서로 접합된 저항변화층 및 스위치층을 포함하는 박막층; 및, 상기 박막층 상에 형성된 제 2 전극을 포함한다.
본원의 상기 서로 접합된 저항변화층 및 스위치층을 포함하는 박막층이란, 상기 저항변화층 및 상기 스위치층이 접합되어 적층되어 있는 구조로서 상기 저항변화층 및 상기 스위치층 사이에 중간전극을 포함하지 않고 상기 각 층의 계면이 직접적으로 서로 맞닿아 접합구조를 형성한 박막층을 의미한다. 따라서, 상기 박막층은 서로 접합된 저항변화층 및 스위치층을 포함하는 것으로서 상기 각 층이 저항변화층의 역할을 할 수 있는 물질 및 스위치층의 역할을 할 수 있는 물질로써 형성되는 것이면 상기 각각의 층을 형성하는 성분에는 특별히 제한이 없다. 예를 들어, 상기 박막층을 형성하는 저항변화층과 스위치층은 동일한 산화물로 형성되거나, 또는 서로 다른 산화물로 형성된 이종 접합구조를 형성할 수 있다.
예시적 구현예에서, 상기 저항변화층은 양극성 성질을 가지는 것이라면 제한없이 사용가능하다. 일 구현예로, 상기 저항변화층은 산화물, 폴리머, 또는 고체전해질(solid electrolyte)을 포함할 수 있다. 예를 들어, 상기 산화물은 Ni 산화물, Cu 산화물, Ti 산화물, Co 산화물, Hf 산화물, Zr 산화물, Zn 산화물, W 산화물, Nb 산화물, TiNi 산화물, LiNi 산화물, Al 산화물, InZn 산화물, V 산화물, SrZr 산화물, SrTi 산화물, 망가나이트(Manganite) 산화물, Cr 산화물, Fe 산화물, Ta 산화물 및 이들의 조합으로 이루어진 군에서 선택된 산화물을 포함할 수 있으나, 이에 제한되는 것은 아니다.
상기 스위치층은 양방향 스위칭(bi-directional switching) 특성을 가지는 물질로서 당업계에서 통상적으로 사용되는 것이라면 특별히 제한없이 사용할 수 있다. 일 구현예에서, 상기 스위치층은 양방향 스위치 특성을 가지는 산화물을 포함하는 것일 수 있으나, 이에 제한되는 것은 아니다. 예를 들어, 상기 스위치층은 V 산화물, Ni 산화물, Ti 산화물, Zr 산화물, Nb 산화물 및 이들의 조합으로 이루어진 군에서 선택된 산화물을 포함할 수 있으나, 이에 제한되는 것은 아니다.
예시적 구현예에서, 상기 박막층을 형성하는 상기 저항변화층 또는 상기 스위치층은 각각 독립적으로 단일층 또는 복수층을 형성할 수 있다. 또한, 상기 저항변화층 또는 상기 스위치층이 복수층인 경우, 상기 저항변화층 또는 상기 스위치층의 층수는 동일하거나 상이할 수 있으며, 이에 제한되는 것은 아니다. 일 구현예에서, 상기 복수층의 저항변화층 또는 상기 복수층의 스위치층을 형성하는 각각의 산화물은 동일하거나 상이한 산화물일 수 있으나, 이에 제한되는 것은 아니다.
예시적 구현예에서, 상기 저항변화층 또는 상기 스위치층의 두께는 각각 독립적으로 수십 나노미터에서 수 마이크로미터의 두께를 포함할 수 있으나, 이에 제한되는 것은 아니다. 예컨대, 저항변화층과 스위치층의 저항과 전압 관계를 고려하여 도 3f와 같은 I-V 곡선을 얻을 수 있으면 두께는 제한되지 않는다.
예시적 구현예에서, 상기 저항변화층 또는 상기 스위치층의 두께는 각각 독립적으로 수십 나노미터에서 수 마이크로미터의 두께를 포함할 수 있으나, 이에 제한되는 것은 아니다. 예컨대, 저항변화층과 스위치층의 저항과 전압 관계를 고려하여 도 3f와 같은 I-V 곡선을 얻을 수 있으면 두께는 제한되지 않는다.
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예를 들어, 상기 스위치층은 약 50 nm 내지 약 200 nm, 상기 저항변화층은 약 40 nm 내지 약 150 nm의 두께일 수 있으나, 이에 제한되는 것은 아니다.
본원에서 사용되는 전극(제 1 전극 또는 제 2 전극)은 당업계에서 저항 변화 메모리 소자에 통상적으로 사용하는 것이라면 제한 없이 사용되며, 상기 제 1 전극 또는 상기 제 2 전극 각각은 독립적으로 금속 전극 또는 산화물 전극을 포함할 수 있다. 예를 들어, 상기 전극이 금속 전극인 경우에는, Pt, Ir, Al, Ti, TiN, Ag, Bi, Hf, Ni 및 이들의 조합으로 이루어진 군에서 선택되는 금속을 포함할 수 있으나, 이에 제한되는 것은 아니다. 또한, 상기 전극이 산화물 전극인 경우, 란탄-니켈 산화물, 스트론튬-루테늄 산화물(SrRuO3), 인듐-주석 산화물(ITO), 이리듐 산화물, 스트론튬-티타늄 산화물 및 이들의 조합으로 이루어진 군에서 선택되는 산화물 전극을 포함할 수 있으나, 이에 제한되는 것은 아니다. 일 구현예에 있어서, 상기 제 1 전극 및 상기 제 2 전극은 각각 투명성 전도성 산화물로서 형성된 투명 전극일 수 있으나, 이에 제한되는 것은 아니다. 상기 투명성 전도성 산화물은 당업계에 공지된 것들을 특별히 제한없이 사용할 수 있다.
본원의 다른 구현예에 따른 저항 변화 메모리 소자의 제조 방법은, 기판 상에 제 1 전극을 형성하는 단계; 상기 제 1 전극 상에 저항변화층 및 스위치층의 접합구조를 포함하는 박막을 형성하는 단계; 및, 상기 박막층 상에 제 2 전극을 형성하는 단계를 포함한다.
예시적 구현예에서, 상기 박막층을 형성하는 단계는, 상기 제 1 전극 상에 저항변화층 및 상기 저항변화층에 접합되는 스위치층을 순차적으로 형성하거나, 상기 제 1 전극 상에 스위치층 및 상기 스위치층에 접합되는 저항변화층을 순차적으로 형성하는 것을 포함할 수 있으나, 이에 제한되는 것은 아니다.
예시적 구현예에서, 상기 박막층은 화학기상증착, 펄스 레이져 증착, 스퍼터링, 단원자층 증착, 분자선 증착, 또는 전자빔 증착에 의해 형성되는 것일 수 있으나, 이에 제한되는 것은 아니다.
예시적 구현예에서, 상기 저항 변화 메모리 소자의 제조 방법은 상기 제 1 전극 및 상기 제 2 전극 각각을 복수개 형성하되, 상기 제 1 전극 및 상기 제 2 전극은 서로 교차하도록 형성하며 상기 제 1 전극 및 상기 제 2 전극의 교차점에 상기 박막층을 배치하는 것을 포함할 수 있으나, 이에 제한되는 것은 아니다.
상기 저항 변화 메모리 소자의 제조 방법은 상기 저항 변화 메모리에 대하여 기술된 내용 및 저항 변화 메모리 제조에 대하여 당업계에 공지된 내용을 모두 포함할 수 있으며, 편의상 중복기재를 생략한다.
본원의 또 다른 측면에 따른 저항 변화 메모리 어레이는, 제 1 방향으로 형성된 복수개의 제 1 전극 라인; 각각의 상기 제 1 전극 라인 상에 형성되며, 서로 접합된 저항변화층과 스위치층을 포함하는 박막층; 및, 상기 박막층 상에 제 2 방향으로 형성된 복수개의 제 2 전극 라인을 포함한다.
예시적 구현예에서, 상기 저항 변화 메모리 어레이는 상기 제 1 전극 라인 및 상기 제 2 전극 라인 각각을 복수개 포함하며, 각각의 상기 제 1 전극 라인 및 각각의 상기 제 2 전극 라인은 서로 교차하며 상기 제 1 전극 라인 및 상기 제 2 전극 라인의 각 교차점에 배치된 상기 박막층을 포함할 수 있으나, 이에 제한되는 것은 아니다.
예시적 구현예에서, 상기 저항 변화 메모리 어레이는 1.6 Tb/inch2 이상의 집적도를 가지는 것을 포함할 수 있으나, 이에 제한되는 것은 아니다.
예시적 구현예에서, 상기 복수개의 제 1 전극 라인 및 상기 복수개의 제 2 전극 라인은 서로 교차하여 반복 적층되며, 상기 제 1 전극 라인 및 상기 제 2 전극 라인의 교차점에 상기 박막층이 형성되어 있는 3 차원의 크로스바 구조를 형성하는 것을 포함할 수 있으나, 이에 제한되는 것은 아니다.
상기 저항 변화 메모리 어레이는 상기 저항 변화 메모리 및 이의 제조 방법에 대하여 기술된 내용 및 저항 변화 메모리 및 그의 어레이에 대하여 당업계에 공지된 내용을 모두 포함할 수 있으며, 편의상 중복기재를 생략한다.
이하, 도면을 참조하여, 본원의 저항 변화 메모리 소자 및 이의 제조방법, 저항 변화 메모리 소자 어레이에 대해 구체적으로 설명하도록 한다. 그러나, 본원이 이에 제한되는 것은 아니다.
도 1을 참조하여, 스니크 경로(sneak path) 문제에 대하여 보다 구체적으로 설명한다. 도 1a에서와 같이, 저항 변화 메모리 어레이는 2D 크로스바 구조의 워드 라인(제 1 전극)과 비트 라인(제 2 전극) 사이에 저항변화층(혹은 메모리층)으로 형성된다. 도 1a에서와 같이 워드 라인과 비트 라인 사이에 외부 전압이 인가되면 원하는 1 번 소자의 정보가 아닌 원하지 않는 4 번 소자의 정보를 읽는 경우가 발생하며, 이를 스니크 경로라 한다. 이러한 스니크 경로 문제는 저항변화층과 전극 사이에 추가적으로 스위칭 물질을 형성함으로써 해결될 수 있으며, 일 구현예로 도 1b를 참조하면, 상기 스위칭 물질은 원치 않은 소자에 누설 전류가 흐르는 것을 방지하기 위하여, 상기 스위치를 OFF 함으로써, 원하는 1 번 소자의 정보를 정확하게 읽을 수 있게 한다.
도 1b에서와 같이, 상기한 스니크 경로 문제를 해결하기 위한 방법으로 종래에 저항변화층과 전극 사이에 스위칭 소자를 형성하는 방법이 제시되나, 이러한 스위칭 소자는 고집적화가 곤란하며, 실제 구동에 있어서 개선될 필요성이 있다. 예를 들어, 상기 스위칭 소자는 대부분 단극성 (unipolar) 저항 변화 물질을 기반으로 하는데, 이는 구동 시 매우 고전압을 요구하며 구동 시에 매우 큰 변동(fluctuation)이 발생하는 문제점이 있다. 또한, 종래 상기 스위칭 소자를 양극성 저항 변화 물질을 사용하는 경우에는 저항변화층과 양방향 스위칭 물질 간에 적어도 하나의 중간 전극을 형성하는 방식이 일반적이었으며, 이는 소자의 고집적화에 불리한 문제점이 있다.
이에, 본원은, 상기한 바와 같은 스니크 경로(sneak path) 문제의 발생을 방지하기 위하여, 종래 스위칭 소자로 사용되던 트랜지스터 또는 다이오드가 아닌 단순히 양극성 성질을 가지는 저항변화층과 스위치층의 접합구조를 가지는 박막층을 사용하고자 한다. 예를 들어， 상기 박막층은 서로 다른 산화물이 적층되어 있는 이종접합 산화물층일 수 있으나, 이에 제한되는 것은 아니다．
도 2는 본원의 저항 변화 메모리 소자의 단면도이다. 상기 저항 변화 메모리 소자는 제 1 전극(10); 상기 제 1 전극 상에 형성되는 박막층(20); 및 상기 박막층 상에 형성된 제 2 전극(30)으로 형성되며, 보다 구체적으로, 상기 박막층은 저항변화층(21) 및 스위치층(22)을 포함한다. 상기 박막층은 상기 저항변화층 및 상기 스위치층이 순차적으로 적층되어 있는 구조라면 제한이 없으며, 도 2b와 같이 상기 박막층은 저항변화층 및 스위치층이 순차적으로 형성되어 있거나, 반대로, 도 2c와 같이 스위치층 상에 저항변화층이 형성되어 있을 수 있다. 이와 같이, 본원의 저항 변화 메모리 소자는 상기 언급한 바와 같이 종래 제안되어 왔던 형태에서 사용되던 중간 전극 등을 필요로 하지 않는 단순한 구조를 형성함으로써, 복수개의 메모리의 적층을 용이하게 할 수 있다．
이하, 본원의 일 실시예를 도 3을 참조하여 설명한다.
Pt 전극 상에 VO2 를 포함하는 스위치층, 상기 스위치층 상에 TiO2 를 포함하는 저항변화층을 형성하여 저항 변화 메모리 소자를 제조하였다. 보다 구체적으로, TiO2 는 Nb: SrTiO3 단결정 기판 상에, VO2 는 Al2O3 단결정 기판 상에 펄스 레이저 증착 시스템을 이용하여 각각 증착하였다. 이후, TiO2/VO2 박막층은 Pt (150-nm thick)/TiOx/SiO2/Si 기판 상에서 펄스 레이저 증착 시스템에 의해 성장되었다. 상기 기판 상에 상기 박막층을 증착하기 전에 금속성 SrRuO3 층을 추가로 버퍼층으로서 형성할 수 있다. 상기 스위치층(VO2)은 600℃와 15 mTorr 챔버 압력하에서 증착되었다. 또한, 상기 저항변화층(TiO2) 은 600℃에서 성장되었다. 상기 저항변화층은 산소 분압을 달리하여 증착할 수 있으나, 이에 제한되는 것은 아니다. 예를 들어, 상기 저항변화층 증착 시, 산소 분압을 20 분간 5 x 10-6 Torr, 5 분간 50 mTorr 로 유지하여 형성할 수 있다. Pt(50-nm 두께)는 상부 전극으로서, 상온에서 축상의 스퍼터링에 의해 형성되고, 포토리소그래피에 의해 패터닝 된다.
도 3a와 도 3b 를 참조하면, 상기 스위치층(VO2)은 인가되는 전압의 정도에 따라 두 개의 저항 상태를 가진다. 보다 구체적으로, 인가전압이 문턱전압(threshold voltage, Vth)보다 커지면 ON 상태가 되고, 문턱전압보다 작아지면 OFF 상태가 된다. 상기 스위치층(VO2)은 일차 상전이 현상에 의한 이력 현상을 가지고 있으나, 이는 스위치 소자의 구동에 있어서 반드시 필요한 것은 아니다. 도 3c와 도 3d에서 보듯이, 저항변화층(TiO2)은 높은 저항 상태와 낮은 저항 상태를 가지는 쌍안정(bistable) 상태를 가지며, 상기 높은 저항 상태와 상기 낮은 저항 상태는 각각 OFF 상태와 ON 상태로 구동된다. 이 때, 상기 저항변화층에 셋전압(VSET)이라는 포지티브 전압을 인가함으로써, OFF 상태는 ON 상태로 변경될수 있으며, 이와 반대로 ON 상태에서 OFF 상태는 리셋전압을 인가함으로써 변경될 수 있다.
도 3e와 도 3f를 참조하면, Vread 전압이 인가될 때, 상기 저항변화층의 정보를 읽을 수 있으며, 이는 상기 저항변화층이 ON 상태인지 OFF 상태인지를 구별할 수 있게 된다. 한편, Vread/2 전압이 인가되면, 스위치층은 항상 OFF 상태로 되어 저항변화층의 상태가 ON이라도 전체 저항은 OFF가 된다. 즉, 상기 스위치층으로 인해, V th보다 낮은 전압이 인가될 경우, 소자에 전류가 흐르는 것을 막게 된다． 따라서, 상기 저항 변화 메모리 소자가 구동되기 위해서는 문턱전압(Vth) < |리셋전압(VRESET)|, 그리고 문턱전압(Vth) < 셋전압(VSET) 이어야 하며, 또한，Vread/2 < 문턱전압 < Vread 전압일 때 상기 언급한 스니크 경로 문제를 방지할 수 있다．
본 실시예의 저항 변화 메모리 소자(1S-1BR)의 실행 가능성을 테스트하기 위하여, 도 3a, 도 3c, 그리고 도 3e에서와 같이, 실제 VO2, TiO2, 그리고 TiO2/VO2 박막층을 증착하였고 도 3g와 같이 전기적 측정을 수행하였다. 도 3g의 위 두 그림에서 보듯이, TiO2 (혹은 VO2) 단층만을 증착한 경우, TiO2 저항 스위치층(혹은 VO2 스위치층)은 잘 작동됨을 알 수 있었다. TiO2의 ON, OFF 상태의 저항비는 약 104 정도였으며, 이와 같이, 단순히 TiO2만 이용할 경우, 크로스바 구조에서 주변의 ON 상태를 가지는 TiO2 소자들로 인해, 읽어야 하는 소자의 정보를 읽지 못하게 되는 스니크 경로 문제를 야기하였음을 확인할 수 있다. 도 3g의 아래 그림은 본 실시예의 TiO2/VO2 박막층의 I-V 특징 실험 결과를 보여주며, 이는 이상적인 1S-1BR의 결과와 매우 유사함을 알 수 있었다.
도 4는 본 실시예의 저항 변화 메모리 어레이의 모습을 보여주는 사시도이다. 보다 구체적으로, 도 4를 참조하면, 상기 저항 변화 메모리 어레이는 제 1 방향으로 형성된 복수개의 제 1 전극 라인(100); 상기 제 1 전극 라인 상에 형성된 박막층(20); 및, 상기 박막층 상에 제 2 방향으로 형성된 복수개의 제 2 전극 라인(200)을 포함할 수 있다. 상기 제 1 전극 라인과 상기 제 2 전극 라인은 서로 교차하며, 상기 제 1 전극 라인 및 상기 제 2 전극 라인의 교차점에 서로 접합된 상기 저항변화층(21) 및 스위치층(22)을 포함하는 박막층이 형성되어 있는 크로스바 구조일 수 있다． 이처럼, 상기 복수개의 제 1 전극 라인 및 상기 복수개의 제 2 전극 라인을 서로 교차하여 적층함으로써, 3 차원의 크로스바 구조를 가지는 고집적의 저항 변화 메모리 어레이를 제조할 수 있다.
도 5a는 본 실시예에 따른 2×2 저항 변화 메모리 어레이 배열의 사시도이다. 상기 저항 변화 메모리 어레이의 제 1 전극(Pt)은 축상에 스퍼터링과 e-beam 리소그래피에 의해 SiO2/Si 상에 성장되었다. TiO2/VO2 박막층은 상기 제 1 전극 상에 버퍼층(SrRuO3: SRO)의 존재 여부에 상관없이 상기 제 1 전극 상에 형성될 수 있다. 버퍼층 없이 상기 박막층을 증착하는 경우, e-beam 리소그래피에 의해 상기 TiO2/VO2 박막층을 패터닝한 후에, 상기 패터닝된 TiO2/VO2 박막층 상에 제 2 전극(Pt)을 상온에서 축상의 스퍼터링에 의해 형성하였다. 상기 Pt 전극의 선폭은 약 200 nm 내지 약 1,000 nm 를 포함할 수 있다.
도 5ｂ를 참조하면， 상기 저항 변화 메모리 어레이의 단면을 투과전자현미경(TEM)으로 관찰하였으며, TiO2/VO2 박막층이 Pt 기판 상에 형성되어있음을 알 수 있다. 도 5c는 상기 저항 변화 메모리 어레이 배열의 상면을 보여주며, 소자 사이즈는 약 200 nm × 200 nm 이다. 상기 저항 변화 메모리 어레이의 I-V 특성을 측정한 결과, 도 5에 나타난 TiO2/VO2 박막층의 I-V 특성은 이상적인 1S-1BR 구조의 I-V 특성과 같은 결과를 확인하였다. 도 5d를 참조하면, 상기 TiO2/VO2 박막층을 포함하는 저항 변화 메모리 어레이에서, 스니크 경로 문제는 발생하지 않으며, 다른 소자들은 ON 상태일 경우에, R 11 소자(도 5a 참조)의 OFF 상태를 읽을 수 있음을 확인할 수 있다.
본 실시예의 박막층을 포함하는 저항 변화 메모리 어레이에서, 저항변화층과 스위치층은 서로 다른 상태를 가질 수 있다． 보다 구체적으로， 도 6a를 참조하면, 가해준 펄스의 크기에 따라 TiO2/VO2 박막층 내에서 저항변화층과 스위치층이 서로 다른 상태를 가질 수 있음을 알 수 있다. 도 6a를 참조하여 보다 구체적으로 설명하면, 초기의 상기 저항변화층과 상기 스위치층은 모두 OFF로 되어 있다. 소자에 가해지는 전압이 증가하여, 상기 스위치층이 문턱전압(Vth )을 넘을 경우, 상기 스위치층은 상기 저항변화층의 변화 없이 ON 상태가 된다(α 단계). 이후, 전압이 보다 증가하여 셋전압(VSET )에 이르면, 셋 오퍼레이션이 발생하며, 상기 저항변화층과 상기 스위치층 모두 ON 상태가 된다. 전압이 Vth 보다 클 경우, 이 상태가 지속된다 (β 단계). 전압이 Vth 보다 감소할 경우, 상기 스위치층은 OFF로 되지만, 여전히 저항변화층은 ON 상태를 유지한다 (γ 단계). -Vth 정도의 음의 전압에서, 1S 는 다시 ON 상태가 된다. 이후 전압이 VRESET 보다 커지면, 저항변화층이 ON 상태에서 OFF 상태로 변화하게 된다. 전압이 Vth 보다 작아지게 되면, 저항변화층과 스위치층이 모두 OFF 상태가 된다(δ 단계)．
도 6b 및 도 6c는 본 실시예의 박막층을 포함하는 저항 변화 메모리 어레이의 성능을 펄스 측정장치를 사용하여 관찰한 결과이다. 스니크 경로 문제를 테스트 하기 위하여, 모든 저항변화층과 스위치층을 OFF로 초기화시켰다. 도 6ｂ를 참조하면, 소자 １(도 1a 참조)에서 인가되는 펄스 전압 크기가 Vth 를 넘어 서로 다른 a와 b 단계의 저항변화층의 정보를 읽을 수 있다. 이는 본 실시예의 저항 변화 메모리 어레이가 비휘발성 메모리로 작동함을 입증한다. 추가로, 도 6c를 참조하면, 인가한 펄스 전압의 크기가 V th 보다 작을 경우, 저항변화층의 저항상태가 ON과 OFF로 다름에도 불구하고, 본 실시예의 저항 변화 메모리 어레이 소자에 있어서, γ 단계와 δ 단계 소자의 출력(Output) 신호의 차이는 없음을 볼 수 있다. 이는 V th 보다 낮은 전압이 본 실시예의 소자에 인가될 경우, 메모리 어레이 소자는 모두 OFF 상태로 되어, 스니크 경로 문제가 발생하지 않음을 알 수 있다.
상기 언급한 I-V 측정은 상온에서 반도체 파라미터 분석기(Agilent 4155C, Agilent Technologies)를 이용하여 측정된다. 절연파괴 방지를 위하여, 전류를 최대값(컴플라이언스 전류값)으로 제한하였다. 펄스 측정은 상온에서 요코가와 FG300, 전기교정장비, 요코가와 DL7100 디지털 오실로스코프에 의해 수행되었다. 또한, C-AFM 측정은 백금이 코팅된 칩을 가지는 Park system(XE-100)에 의해 수행되었다.
도 7은 본 실시예의 소자가 정상적으로 작동할 수 있는 크기 한계를 검사하기 위해, C-AFM 팁을 이용하여, 국소적인 I-V 곡선을 측정한 그래프이다. 상기 실험에서 상기 C-AFM의 팁(tip)을 상기 전극 사이즈의 크기로 생각할 경우, 대략 10 nm 지름의 원으로 생각할 수 있다. 상기 언급한 C-AFM 실험을 통해 메모리 소자 크기(F = 10 nm)까지 작동될 수 있음을 나타내며, 이는 2D 나노크로스바 메모리를 본 실시예의 TiO2/VO2 소자로 만들 경우, 1.6 Tb/inch2 의 집적도를 얻을 수 있음을 보여준다.
도 7의 소자의 전극 사이즈가 줄어들수록, 리셋 전류는 10-8 A까지 감소하였다. 이는 통상 다른 소자에서 나타나는 리셋 전류 (10-5 A)보다 적은 값이다. 이러한 리셋 전류의 크기 감소는 소자 작동의 신뢰성 향상에 큰 영향을 미친다.
상기에서는 본원의 바람직한 구현예 및 실시예를 참조하여 설명하였지만, 해당 기술 분야에서 통상의 지식을 가진 자라면 하기의 특허청구범위에 기재된 본원의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본원을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.
10: 제 1 전극
20: 박막층
21: 저항변화층
22: 스위치층
30: 제 2 전극
100: 제 1 전극 라인
200: 제 2 전극 라인
20: 박막층
21: 저항변화층
22: 스위치층
30: 제 2 전극
100: 제 1 전극 라인
200: 제 2 전극 라인
Claims (9)
- 제 1 전극;
상기 제 1 전극 상에 형성되며 서로 접합된 저항변화층과 스위치층을 포함하는 박막층; 및,
상기 박막층 상에 형성된 제 2 전극:
을 포함하는, 저항 변화 메모리 소자로서,
상기 저항 변화 메모리 소자에 있어서, 상기 스위치층으로부터 정보가 읽혀지는 문턱전압(Vth)이 하기 조건들을 만족하는 것이며:
Vth ＜ ｜VRESET｜;
Vth ＜ VSET; 및,
Vread/2 ＜ Vth ＜ Vread;
여기서, Vread(리드 전압)은 상기 저항변화층의 정보를 읽기 위해 상기 저항 변화 메모리 소자에 인가된 전압이고, VSET(셋 전압)은 상기 저항변화층이 ON 상태로 변화하는 전압이고, 및 VRESET(리셋 전압)은 상기 저항변화층이 OFF 상태로 변화하는 전압이며,
상기 스위치층은 양방향(bi-directional) 스위칭 특성을 가지는 VO2를 포함하는 것이며,
상기 전극의 크기가 줄어들수록 리셋 전류가 10-8 A까지 감소하는 것인,
저항 변화 메모리 소자.
- 제 1 항에 있어서,
상기 저항변화층은 양극성 (bipolar) 저항 변화 성질을 가지는 물질을 포함하는 것인, 저항 변화 메모리 소자.
- 제 1 항에 있어서,
상기 저항변화층은 Ni 산화물, Cu 산화물, Ti 산화물, Co 산화물, Hf 산화물, Zr 산화물, Zn 산화물, W 산화물, Nb 산화물, TiNi 산화물, LiNi 산화물, Al 산화물, InZn 산화물, V 산화물, SrZr 산화물, SrTi 산화물, 망가나이트(Manganite) 산화물, Cr 산화물, Fe 산화물, Ta 산화물 및 이들의 조합으로 이루어진 군에서 선택된 산화물을 포함하는 것인, 저항 변화 메모리 소자.
- 삭제
- 삭제
- 제 1 항에 있어서,
상기 제 1 전극 또는 상기 제 2 전극 각각은 독립적으로 금속 전극 또는 산화물 전극을 포함하는 것인, 저항 변화 메모리 소자.
- 제 1 항에 있어서,
상기 저항변화층 또는 상기 스위치층은 각각 독립적으로 단일층 또는 복수층을 포함하는 것인, 저항 변화 메모리 소자.
- 제 1 방향으로 형성된 복수개의 제 1 전극 라인;
각각의 상기 제 1 전극 라인 상에 형성되며, 서로 접합된 저항변화층과 스위치층을 포함하는 박막층; 및,
상기 박막층 상에 제 2 방향으로 형성된 복수개의 제 2 전극 라인:
을 포함하는, 저항 변화 메모리 어레이로서,
상기 저항 변화 메모리 어레이에 있어서, 상기 스위치층으로부터 정보가 읽혀지는 문턱전압(Vth)이 하기 조건들을 만족하는 것이며:
Vth ＜ ｜VRESET｜;
Vth ＜ VSET; 및,
Vread/2 ＜ Vth ＜ Vread;
여기서, Vread(리드 전압)은 상기 저항변화층의 정보를 읽기 위해 상기 저항 변화 메모리 어레이에 인가된 전압이고, VSET(셋 전압)은 상기 저항변화층이 ON 상태로 변화하는 전압이고, 및 상기 VRESET(리셋 전압)은 상기 저항변화층이 OFF 상태로 변화하는 전압이며,
상기 스위치층은 양방향(bi-directional) 스위칭 특성을 가지는 VO2를 포함하는 것이며,
상기 전극의 크기가 줄어들수록 리셋 전류가 10-8 A까지 감소하는 것인,
저항 변화 메모리 어레이.
- 제 8 항에 있어서,
상기 복수개의 제 1 전극 라인 및 상기 복수개의 제 2 전극 라인은 서로 교차하여 반복 적층되며, 상기 제 1 전극 라인 및 상기 제 2 전극 라인의 교차점에 상기 박막층이 형성되어 있는 3 차원의 크로스바 구조를 형성하는, 저항 변화 메모리 어레이.
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