KR101174718B1 - Ｐｄｐ 구동회로 및 그 구동방법 - Google Patents

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Abstract

본 발명은 구동회로를 간소화함과 함께 유지방전 파형을 안정적으로 담보할 수 있는 PDP 구동회로 및 그 구동방법에 관한 것으로서, 본 발명에 따른 PDP 구동방법은 램프-업과 램프-다운, 스캔 펄스 및 유지방전 전압을 인가하는 제 1 전극과 제 2 전극, 어드레스 구간에서 방전 셀을 선택하기 위한 데이터 전압을 인가하는 제 3 전극을 구비하고 리셋 구간, 어드레스 구간 및 서스테인 구간으로 구분되는 구동파형을 이용하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 상기 서스테인 구간에서 상기 제 1 전극에 양의 유지방전 전압과 음의 유지방전 전압을 교대로 인가하고, 상기 제 2 전극에 레벨 전압을 인가하는 것을 특징으로 한다.
PDP, 구동회로

Description

ＰＤＰ 구동회로 및 그 구동방법{Driving circuit of plasma display panel and driving method thereof}
본 발명은 PDP 구동회로 및 그 구동방법에 관한 것으로서, 보다 상세하게는 구동회로를 간소화함과 함께 유지방전 파형을 안정적으로 담보할 수 있는 PDP 구동회로 및 그 구동방법에 관한 것이다.
교류형 플라즈마 디스플레이 패널(AC-PDP)은 스캔 전극(Y), 서스테인 전극(X) 및 어드레스 전극(A)의 3개의 전극을 구비하는 구조로 되어 있으며, 각 전극에 인가되는 전압을 이용하여 셀의 안정적 방전을 유도함으로써 밝기를 제어한다. 이와 같은 AC-PDP는 화상의 계조(gray scale)를 구현하기 위해 하나의 프레임을 발광횟수가 다른 여러 개의 서브필드(subfield)로 나누어 시분할 구동하는 방식을 택하고 있다.
각 서브필드는 리셋 구간, 어드레스 구간 및 서스테인 구간 등의 3개의 구간으로 나누는데, 상기 리셋 구간은 어드레스 구간에서 안정적인 어드레스 방전을 유 도하기 위하여, 인가된 외부전압에 대하여 패널의 모든 셀의 방전 조건에 적합한 균일한 벽전하의 상태를 유지하도록 조정하는 구간이다. 또한, 어드레스 구간은 모든 스캔 전극에 순차적으로 스캔 펄스를 인가함과 동시에 어드레스 전극에 데이터 전압(Vd) 펄스를 인가하여 방전시킴으로써 서스테인 구간에 방전할 셀과 방전하지 않을 셀을 구분하는 구간이다. 이 때, 방전 셀은 벽전하의 큰 변화가 일어나며 서스테인 구간에서 유지방전을 지속적으로 할 수 있는 조건이 형성된다. 마지막으로, 서스테인 구간은 스캔 전극과 서스테인 전극 사이에 교대로 높은 유지방전 전압(Vsus)을 인가함으로써 어드레스 구간에서 방전 셀로 선택된 셀에 한하여 지속적인 유지방전이 발생하도록 유도하는 구간이다.
한편, AC-PDP에서는 구동파형으로서 도 1에 도시한 바와 같은 램프 형태를 갖는 리셋 구동파형이 보편적으로 이용되고 있다. 램프 형태의 리셋 파형은 리셋 구간의 가장 큰 목적인 벽전하의 균일화 및 배경광 휘도가 크게 발생하지 않는다는 장점이 있다. 램프 형태의 리셋 파형의 최종 전압인 램프 전압(Vramp)은 높은 명암비를 고려하여 서브필드가 진행됨에 따라서 변화하기도 하는데, 상기 램프 전압(Vramp)은 감소하는 것이 일반적이다.
도 1의 구동파형을 구현하기 위한 PDP 구동회로는 도 2와 같이 구성된다. 도 2의 PDP 구동회로를 구체적으로 살펴보면, 도 2에 도시한 바와 같이 크게 스캔 전극(Y) 보드와 서스테인 전극(X) 보드로 구성하며, 두 보드 사이에 패널(CP)이 연결된다. 상기 Y 보드 회로는 제어 스위치 SW3, SW4로 구성하는 유지방전 전압 공급 회로, 패널(CP)에 공급한 에너지를 회수하기 위하여 제어 스위치 SW1, SW2와 역전 류제한 다이오드 D1, D2 및 에너지 회수용 커패시터(CRY)와 보조 인덕터(LRY)로 구성하는 에너지 회수회로, 기울기를 갖는 램프-업 파형을 출력하기 위하여 제어 스위치 SW5, SW7 및 커패시터 C1로 구성되는 램프-업 제어 회로, 제어 스위치 SW6, SW8, SW9로 구성하는 기울기를 갖는 램프-다운 파형을 출력하기 위한 램프-다운 제어 회로, 어드레스 구간의 Y 전극의 레벨 전압(Vyl)을 생성하기 위하여 제어 스위치 SW10, SW11로 구성하는 레벨 전압 공급 회로 및 스캔 소자(Scan-IC)의 제어 스위치(SW12, SW13) 회로로 구성된다. 한편, 상기 X 보드 회로는 구동파형이 Y 파형보다 간단하기 때문에 구동회로 또한 간단하여, 서스테인 구동 전압을 공급하는 회로(SW16, SW17), 방전 에너지 효율을 개선하기 위한 에너지 회수회로(SW14, SW15, D4, D5, CRX, LRX)와 어드레스 구간의 X 레벨 전압(Vxl)을 공급하기 위한 X 레벨 전압(Vxl) 제어 회로(SW18, SW19)로 구성된다.
이상 살펴본 바와 같이, 종래의 PDP 구동회로는 복수의 제어 스위치를 포함하여 매우 복잡한 형태를 취하고 있음을 알 수 있다. 이에 따라, 회로 구성에 많은 비용이 소요되는 문제점이 있다.
본 발명은 상기와 같은 문제점을 해결하기 위해 안출한 것으로서, 구동회로를 간소화함과 함께 유지방전 파형을 안정적으로 담보할 수 있는 PDP 구동회로 및 그 구동방법을 제공하는데 그 목적이 있다.
상기의 목적을 달성하기 위한 본 발명에 따른 PDP 구동방법은 램프-업과 램프-다운, 스캔 펄스 및 유지방전 전압을 인가하는 제 1 전극과 제 2 전극, 어드레스 구간에서 방전 셀을 선택하기 위한 데이터 전압을 인가하는 제 3 전극을 구비하고, 리셋 구간, 어드레스 구간 및 서스테인 구간으로 구분하는 구동파형을 이용하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 상기 서스테인 구간에서 상기 제 1 전극에 양의 유지방전 전압과 음의 유지방전 전압을 교대로 인가하고, 상기 제 2 전극에 레벨 전압을 인가하는 것을 특징으로 한다.
상기 구동 파형의 리셋 구간 중, 램프-업 구간에서 상기 제 1 전극에 인가하는 최고 전압값은 서브필드마다 서로 다르게 설정할 수 있으며, 램프-업 구간에서의 제 1 전극의 최고 전압값은 양의 유지방전 전압과 제 1 전극의 레벨 전압의 합과 같거나 혹은 작다.
상기 램프-업 구간에서 상기 제 1 전극에 인가하는 전압에 레벨 전압 성분이 포함되지 않고 양의 유지방전 전압을 이용하여 기울기를 갖는 파형만으로 구성할 수 있으며, 상기 램프-업 구간의 시작 전 상기 제 1 전극에 음의 유지방전 전압이 인가될 수도 있다.
또한, 상기 램프-업 구간에서 기울기를 갖는 램프 전압은 서로 다른 2개의 기울기를 갖고 상승할 수 있다. 이 경우에는 보통은 첫 번째 기울기가 두 번째 기울기보다 경사가 급하나 그 반대의 경우도 가능하다.
상기 리셋 구간의 완료 시점에서의 전압(Vyd)은 음의 유지방전 전압(-Vsus)과 같거나 높다. 또한, 상기 램프-다운 구간에서의 기울기를 갖는 전압 파형이 서로 다른 2개의 기울기를 갖고 하강할 수 있으며, 보통은 첫 번째 기울기가 두 번째 기울기보다 경사가 급하다.
상기 양의 유지방전 전압(+Vsus)과 음의 유지방전 전압(-Vsus)의 절대값은 동일한 크기를 갖도록 설정하는 것이 통상적이나, 다르게 설정하는 것도 가능하다.
상기 제 2 전극에는, 램프-다운 구간에서 레벨 전압이 인가될 수 있으며, 이 레벨 전압은 경우에 따라서는 0V가 인가될 수도 있다. 필요에 따라서는 상기 어드레스 구간에서 상기 제 2 전극에 인가되는 레벨 전압도 0V인 GND를 인가하는 것도 가능하다.
본 발명에 따른 PDP 구동회로는 리셋 구간, 어드레스 구간 및 서스테인 구간으로 구분되는 구동파형을 제어하고, 제 1 전극에 인가하는 램프-업과 램프-다운, 스캔 펄스 및 유지방전 전압과, 제 2 전극에 인가하는 레벨 전압 및 제 3 전극(A 전극)에 인가하는 데이터 전압을 제어하는 플라즈마 디스플레이 패널의 구동회로에 있어서, 상기 제 1 전극에 인가하는 전압을 제어하는 제 1 전극 보드와, 상기 제 2 전극에 인가하는 전압을 제어하는 제 2 전극 보드의 조합으로 이루어지며, 상기 제 1 전극 보드는, 양의 유지방전 전압(Vsus)을 공급하는 제 3 제어 스위치(SW3)와, 음의 유지방전 전압(-Vsus)을 공급하는 제 4 제어 스위치(SW4)와, 양의 유지방전 전압과 연결되어 기울기를 갖고 상승하는 램프-업 파형을 생성하는 제 5 제어 스위치(SW5) 및 음의 유지방전 전압과 연결되어 기울기를 갖고 하강하는 램프-다운 파형을 생성하는 제 6 제어 스위치(SW6)를 포함하여 이루어지는 것을 특징으로 한다.
상기 제 1 전극 보드에, 제 1 및 제 2 제어 스위치(SW1, SW2)로 구성하는 에너지 회수용 제어 스위치 소자와, 상기 제 1 및 제 2 제어 스위치에 의해 회수된 에너지를 저장하는 역할을 하는 커패시터(CR)가 더 구비된다. 회수한 에너지를 저장하는 역할을 하는 상기 커패시터(CR)의 음의 단자는 음의 유지방전 전압(-Vsus)과 연결되거나 혹은 커패시터(CR)을 없애고 커패시터(CR)의 양의 단자를 GND(0V)와 연결시키는 것도 동일한 효과를 나타낼 수 있다.
또한, 상기 제 1 전극 보드에 제 9 및 제 10 제어 스위치(SW9, SW10)로 구성하는 스캔 소자가 더 구비되며, 상기 제 9 제어 스위치의 양의 단자는 제 1 전극의 레벨 전압(Vyl)과 연결된다. 또는, 상기 레벨 전압(Vyl)의 양의 전압 인가 단자가 역전류를 제한하는 다이오드(D3)와 상기 레벨 전압(Vyl)을 안정화시키기 위한 커패시터(C1)와 연결되고, 상기 레벨 전압원의 음의 단자는 음의 유지방전 전압(-Vsus)과 연결될 수 있다.
한편, 상기 제 2 전극 보드는, 제 2 전극의 레벨 전압(Vxl)을 인가하는 제 7 제어 스위치(SW7)와 접지 전압을 인가하는 제 8 제어 스위치(SW8)를 포함하여 이루어진다. 특별히, 상기 제 2 전극의 레벨 전압(Vxl)을 0V로 하는 경우에는 플라즈마 디스플레이 패널의 제 2 전극 부분을 접지 전압(GND)과 바로 연결하는 것이 가능하며, 이 경우에는 상기 제 2 전극 보드는 일체의 제어 스위치를 사용하지 않을 수 있다.
상기 구동 파형 및 구동 회로에서 제 1 전극에 0V의 전압을 사용하지 않는 것을 설명하고 있으나, 0V의 전압을 사용하는 것도 가능하다. 상기의 이 경우에는 램프-업 구간 이전 단계 및 서스테인 구간에 진입하기 이전 단계 등에서 상기 제 1 전극에 0V의 전압을 인가할 수 있으며, 0V의 전압의 인가를 수행하는 것으로서, 제 11 제어 스위치(SW11) 및 상기 제 11 제어 스위치와 직렬로 연결되는 다이오드(D4)가 더 구비되고, 상기 다이오드(D4)는 접지 전압과 연결될 수 있다. 또는 직렬로 연결되는 제 12 및 제 13 제어 스위치(SW12, SW13)를 더 구비하며, 상기 제 12 제어 스위치는 접지 전압과 연결될 수 있다.
본 발명에 따른 PDP 구동회로 및 그 구동방법은 다음과 같은 효과가 있다.
종래의 PDP 구동회로에 비해 회로 구성이 간단하고 유지방전 전압을 보다 안정적으로 패널에 공급하는 것이 가능하다. 종래의 PDP 구동회로인 도 2의 경우에 스캔 전극에 유지방전 전압을 인가하는 동안에 2개의 제어 스위치(SW5, SW6)를 사용하나 본 발명의 경우 해당 제어 스위치의 사용이 불필요하며, 이로 인하여 회로 가 소모하는 전체 소비전력 및 발열량을 감소킬 수 있음과 동시에 유지방전 전압을 보다 안정적으로 패널에 공급할 수 있게 된다. 또한, 스캔 전압인 -Vsc 전압 생성을 위한 DC/DC 회로가 필요 없기 때문에 회로 제작 비용을 절감할 수 있다.
이하, 도면을 참조하여 본 발명의 일 실시예에 따른 PDP 구동회로 및 그 구동방법을 상세히 설명하기로 한다. 도 3은 본 발명의 제 1 실시예에 따른 PDP 구동파형이다.
먼저, 도 3에 도시된 본 발명의 제 1 실시예에 따른 PDP 구동파형을 살펴보면 다음과 같은 특징이 있다. 제 1 전극(스캔 전극)에 인가하는 전압 파형은 특별히 양의 유지방전 전압(+Vsus)과 음의 유지방전 전압(-Vsus)이 교대로 반복적으로 인가되는 형태를 취하고 있는 유지 방전 파형으로 구성되어 있다. 또한, 어드레스 구간 동안에 스캔 펄스가 인가되는 시점의 전압이자 스캔 소자의 고전압 입력부 중에서 음의 전압이 인가되는 단자에 입력되는 전압인 Vsc 전압이 음의 유지방전 전압인 Vsus와 동일한 전압 크기를 갖는 것을 특징으로 한다. 제 2 전극(서스테인 전극)에 인가하는 전압은 어드레스 구간에만 레벨 전압(Vxl)을 인가하고 나머지 구간에서는 항상 접지 상태(GND)를 유지한다.
도 3의 PDP 구동파형을 시계열적으로 살펴보면, T1, T2, T3 및 T4의 단계로 나누어 설명할 수 있다.
먼저, T1 단계는 리셋 구간 중에서 램프-업(ramp-up) 구간에 해당된다. 램프 -업 과정은 이전 서브필드에서 방전 셀과 비방전 셀에 존재하는 벽전하의 차이를 줄여주는 역할을 한다. 이전 서브필드에서 방전 셀의 경우 유지방전에 의해 제 2 전극측 셀 벽면에는 음(-)의 전하가, 제 1 전극측 셀 벽면에는 양(+)의 전하가 축적된 상태로서, 유지방전 전압이 인가되었을 때 유지방전을 할 수 있는 상태에 있다. 반면, 비방전 셀의 경우에는 상기의 제 1 전극 및 제 2 전극측 셀 벽면에는 이전 서브필드의 리셋 구간 중에서 램프-다운(ramp-down) 구간 동안에 형성되었던 벽전하의 상태를 그대로 유지하고 있다. 즉, 이전 서브필드의 최종 시점 혹은 현 서브필드의 시작 시점에서 유지방전을 위하여 선택되었던 방전 셀과 선택되지 않았던 비방전 셀 사이의 벽전하의 상태가 다르기 때문에 균일하게 재조정할 필요가 있다. 이전 서브필드에서 방전 셀이었던 셀들은 최종 방전을 위한 유지방전 전압 펄스인 음의 유지방전 전압 펄스에 의해, 셀 내부의 제 1 전극 부분의 유전체 상에 양(+)의 전하와 제 2 전극 부분의 유전체 상에 음(-)의 전하가 쌓여 있다. 여기서, 구형파 형태를 갖는 양의 유지방전 전압 펄스 대신에 램프-업 형태를 갖는 리셋 구동파형을 인가하여 약방전을 유도하여 벽전하의 급격한 변화를 방지한다. 비방전 셀의 경우에는 양의 유지방전 전압(Vsus)까지 상승하여도 약방전은 발생하지 않는다. 그러나 이보다 높은 전압이 인가된다면, 이전 서브필드에서 방전했던 방전 셀과 마찬가지로 약방전이 발생시킨다. 이것은 영상을 표현하기 위한 서브필드 중에서 최초의 서브필드에서는 높은 램프 전압을 인가하여 실시한다.
이후의 서브필드에서는 배경광 휘도를 감소시키기 위해서 첫 서브필드에서 수행한 높은 램프 전압을 사용하지 않고 그 보다 낮은 램프 전압을 사용하는 것이 일반적이다. 상기 비방전 셀의 벽전하의 상태는 리셋이 완료된 T2 단계의 종료 시점의 상태와 동일하기 때문에 필요에 따라 일부 서브필드의 경우에는 램프-업 최고 전압이 첫 번째 서브필드보다 작거나, 램프-업 형태를 갖는 리셋 구동 파형구간인 T1의 구간이 사용되지 않을 수도 있다. 또한, 상기의 램프-업 구간에서 제 1 전극의 레벨 전압 Vyl을 포함하지 않을 수도 있다. 도 4는 상기의 램프-업 구간에서 레벨 전압 Vyl을 사용하지 않는 본 발명의 제 2 실시예에 따른 PDP 구동파형을 나타낸 것이다.
상기 T1 단계의 완료 시점에서 방전 셀과 비방전 셀의 벽전하의 상태는 완전히 동일한 상태는 아니며, 램프-다운 구간인 T2 단계를 수행함으로써 동일하게 된다. 상기 램프-다운 구간은 제 1 전극의 전압이 리셋 완료 시점의 전압(Vyd)까지 감소하는 단계이다. 이 때, 도 4 및 도 5에 도시한 바와 같이 Vyd까지 전압이 감소됨에 있어 2개의 기울기를 갖고 전압을 감소시킬 수 있다. 여기서, 도 5는 본 발명의 제 3 실시예에 따른 PDP 구동파형을 나타낸 것이다. 첫 번째 단계의 전압 감소는 상대적으로 큰 기울기를 갖고 방전이 발생되지 않는 정도까지 빠른 속도로 감소시키며, 두 번째 단계의 전압 감소는 상대적으로 작은 기울기로 서서히 약방전을 일으키며 감소시킨다. 이와 같이 2개의 기울기를 갖고 전압을 Vyd까지 감소시키게 되면 오방전이 발생되지 않음과 함께 제 1 전극의 출력 전압을 Vyd까지 빠르게 감소시킴으로써 구동 시간을 절약할 수 있게 된다. 여기서, Vyd는 어드레스 구간에 스캔 소자의 2개의 고전압 단자 중에서 음의 단자에 인가되는 스캔 전압(Vsc)과 같거나 필요에 따라서는 높게 설정된다. 이 때, 제 2 전극에는 제 2 전극의 레벨 전 압(Vxl)이 인가된다. 상기 제 2 전극의 레벨 전압은 패널의 구동 특성에 따라 T2 구간 동안에 사용하지 않을 수도 있다. 즉, 0V의 접지(GND) 전압이 인가될 수도 있다.
이와 같은 T2 단계에 있어서, 램프-업을 갖는 리셋 동안에 이전 서브필드에서 방전 셀이었던 셀의 벽전하는 비방전 셀의 벽전하보다 많은 벽전하를 형성하고 있는 상태이기 때문에 상대적으로 많은 약방전을 한다. 이를 통해 방전 셀과 비방전 셀이 벽전하 상태가 균일화되면서 어드레스 방전의 준비 과정인 리셋 방전 과정이 완료된다.
상기 리셋 구간인 상기 T1 구간과 T2 구간이 완료된 후에, 어드레스 구간인 T3 단계가 진행된다. 상기 T3 단계에서는 스캔 전극인 제 1 전극의 각 스캔 라인에 순차에 따라 스캔 펄스를 인가한다. 우선 모든 제 1 전극에 스캔 소자의 양의 고전압 입력 단자에 인가하는 제 1 전극의 레벨 전압인 Vyl 전압이 스캔 소자의 음의 고전압 입력 단자에 인가하는 Vsc 전압을 기준으로 하여 인가한다. 상기 Vyl 전압은 각 스캔 라인의 출력으로 연결되어 셀에 인가하는 중에, 스캔 라인의 순차에 따라 1개의 스캔 라인씩 차례대로 Vsc 전압을 각 스캔 라인의 출력으로 연결함으로써 각 스캔 라인을 순차적으로 선택한다. 이와 동시에 어드레스 전극(A)인 제 3 전극에 데이터 전압(Vd)을 인가하여 어드레스 방전을 유도한다. 이 때, 데이터 전압은 선택한 스캔 라인의 모든 셀 중에서 방전하고자 하는 셀의 데이터 라인에만 인가되도록 제어한다. 어드레스 방전이 발생한 셀은 제 1 전극의 셀 내부 벽면에 양(+)의 전하가 쌓이고, 제 2 전극의 셀 내부 벽면에는 음(-)의 전하가 축적된다. T3 구간에서도 T2 구간과 마찬가지로 패널의 상태에 따라 제 2 전극의 레벨 전압이 0V로 설정될 수 있다.
어드레스 방전으로 방전 셀로 선택된 셀은 T4 단계에서 유지방전 전압이 인가됨에 따라 연속적인 유지방전이 발생한다. 유지방전은 Y 전극에 양의 유지방전 전압 Vsus와 음의 유지방전 전압 -Vsus가 교대로 반복적으로 인가되면서 지속적인 유지방전이 발생한다. 반면, 비방전 셀의 경우에는 유지방전 전압만으로는 방전을 할 수 없을 정도의 벽전하가 축적되어 있기 때문에 방전이 일어나지 않는다. 유지방전의 펄스의 숫자는 휘도를 표현하기 위해 제어되는 것으로서 각 서브필드에 따라 달라질 수 있다.
이상, 본 발명의 일 실시예에 따른 PDP 구동파형을 살펴보았다. 이하에서는, 상술한 PDP 구동파형을 구현하기 위한 본 발명의 일 실시예에 따른 PDP 구동회로를 설명하기로 한다. 도 6은 본 발명의 제 1 내지 제 3 실시예에 따른 PDP 구동회로의 회로 구성도이고, 도 7과 도 8은 본 발명의 제 1 내지 제 3 실시예에 따른 PDP 구동회로의 또 다른 형태의 회로 구성도이다.
도 6에 도시한 바와 같이 본 발명의 제 1 실시예에 따른 PDP 구동회로는 제 1 전극 보드와 제 2 전극 보드의 조합으로 이루어지며, 상기 제 1 전극 보드는 SW1 내지 SW6 및 스캔 소자로 구성하며, 상기 제 2 전극 보드는 SW7과 SW8로 구성한다. 상기 제 1 전극 보드 및 제 2 전극 보드를 구성하는 제어 스위치를 구체적으로 살 펴보면 다음과 같다.
먼저, 상기 제 1 전극 보드에서 제어 스위치 SW1과 SW2는 에너지 회수를 위한 제어용 소자이며, 상기 제어 스위치 SW1과 SW2 사이에 연결한 커패시터 CR은 회수된 에너지를 충전하는 역할을 하는 에너지 회수용 커패시터이다. 상기 에너지 회수용 커패시터(CR)의 음의 단자는 음의 유지방전 전압(-Vsus)과 연결되는데, 경우에 따라서는 상기 회수용 커패시터를 사용하지 않고, 제 1 제어 스위치(SW1)의 드레인 단자와 제 2 제어 스위치(SW2)의 소스 단자가 연결된 중간 노드를 접지(GND)와 연결할 수도 있다. 제어 스위치 SW3은 양의 유지방전 전압(+Vsus)을 패널에 공급하는 역할을 하는 것으로서 Vsus와 연결되며, 제어 스위치 SW4는 음의 유지방전 전압(-Vsus)을 패널에 공급하는 역할을 하는 것으로서 -Vsus와 연결된다. 제어 스위치 SW5는 소정의 기울기로 상승하는 램프-업 파형을 만들기 위한 것으로서 양의 유지방전 전압(Vsus)과 연결되어 최고 Vsus까지 공급이 가능하도록 설계된다. 제어 스위치 SW6은 소정의 기울기로 하강하는 램프-다운 파형을 만들기 위한 것으로서 음의 유지방전 전압(-Vsus)과 연결되며, 어드레스 구간에 스캔 소자에 음의 고전압을 공급하기 위한 제어 스위치로는 음의 유지방전 전압(-Vsus)을 인가하는 제어 스위치 SW4를 공동으로 사용한다.
한편, 제 1 전극의 레벨 전압 Vyl은 스캔 소자의 음의 고전압 입력단자를 기준으로 일정한 전압 수준을 갖고 양의 고전압 입력단자에 인가되도록 회로가 설계된다. 상기 제 1 전극의 레벨 전압의 음의 단자는 도 7에 도시한 바와 같이 음의 유지방전 전압(-Vsus)과 연결될 수 있으며, 이 경우 스캔 소자의 양의 입력단자와 바로 연결되지 않고 다이오드 D3과 커패시터 C1로 구성된 회로가 추가된다. 상기 다이오드(D3)와 커패시터(C1)를 추가, 구비시키는 이유는 도 6의 노드 (A)에 인가되는 전압이 음의 유지방전 전압(-Vsus)이 되는 시점에 커패시터 C1에 다이오드 D3을 통하여 Vyl 전압이 충전되고 나머지의 경우에는 다이오드 D3이 역 바이어스 상태가 되어 과도 전압이 Vyl 측으로 흐르는 것을 방지하기 위함이다. 스위치 SW9와 SW10은 스캔 소자를 간략화하여 그린 것이다.
제 2 전극 보드의 경우, 제 2 전극의 레벨 전압 Vxl을 인가하는 역할을 하는 제어 스위치 SW7과 접지(GND) 전압인 0V를 인가하는 역할을 하는 제어 스위치 SW8로 구성된다. 경우에 따라서는 제 2 전극 보드에 인가하는 전압 중에서 레벨 전압인 Vxl을 전 영역에 걸쳐서 0V를 인가할 수도 있는데, 이 경우에는 도 8과 같이 제어 스위치 SW7 및 SW8을 생략할 수 있다.
이와 같이 구성되는 본 발명의 일 실시예에 따른 PDP 구동회로의 동작을 타이밍도를 참조하여 설명하면 다음과 같다. 도 9a는 도 3의 구동파형을 구현하기 위한 도 6의 SW1 내지 SW10의 온/오프 상태를 나타낸 타이밍도이고, 도 9b 내지 도 9f는 도 9a의 T1 내지 T4 구간의 각 구간에 상응하는 도 6의 구동회로의 전류 흐름도이다.
도 3 및 도 9a에 도시한 바와 같이 본 발명의 일 실시예에 따른 PDP 구동파형은 시계열적으로 T1 내지 T4 구간으로 구분되며, 각 구간별 도 6의 회로 동작을 살펴보면 다음과 같다.
먼저, T1 구간은 도 9b에 도시한 바와 같다. 구체적으로, 램프-업 구간의 기울기를 생성하는 구간의 동작은, 제 1 전극 보드의 경우 램프-업 파형을 위한 제어 스위치 SW5가 온(ON) 상태가 되도록 하고, Vsus보다 높은 램프 전압을 형성하도록 하기 위하여 제 1 전극 레벨 전압 Vyl을 인가하기 위하여 스캔 소자의 제어 스위치 SW9를 온(ON) 한다. 이와 동시에 제 2 전극 보드의 경우는 제어 스위치 SW8을 온 상태로 한다. 그리고 나머지 제어 스위치들은 오프(OFF) 상태를 유지한다. 이렇게 하면, 제 1 전극 보드의 노드 (A)의 전압이 제어 스위치 SW5에 인가하는 게이트 전압의 크기에 따라서 점차적으로 상승하는 램프 파형을 만들 수 있으며, 제 1 전극 보드의 최종 출력 전압은 노드 (A)의 전압과 제 1 전극의 레벨 전압인 Vyl이 합하여진 것이 된다. 따라서 T1 구간의 초기 출력 전압은 Vyl이고 이후 점차적으로 증가하여 상기 램프-업 구간의 램프 전압 Vramp의 최종값은 Vyl과 Vsus의 합이 된다. 여기서, Vramp 전압은 경우에 따라서 Vyl과 Vsus가 합하여진 값보다 낮게 설정할 수도 있다. 이는 제어 SW5에 의해 제어하는 상기 램프-업 구간의 램프 전압이 Vsus에 도달하기 전에 제어 스위치 SW5를 오프시킴으로써 가능하다. 이러한 동작 제어는 패널의 전기적 방전 특성을 고려하여 결정할 수 있으며, 배경광의 휘도를 낮게 하기 위한 것으로서 명암비를 개선하는 장점이 있다. 상기 T1 구간에서 도 4에서와 같이 상기 램프-업 구간에서 제 1 전극의 레벨 전압 Vyl을 인가하지 않는 경우에는 스캔 소자의 SW9를 켜지 않고 SW10을 켜는 것으로 제어 가능하다.
다음으로, T2 구간은 상승한 제 1 전극의 출력 전압을 Vyd 전압까지 하강시키는 것이 목적인데, 이 구간에서 중요한 것은 어떠한 강방전을 발생시키지 않으면 서도 안정적인 벽전하의 균일화를 이룰 수 있는가에 있다. 이를 위해, 먼저 양의 유지방전 전압 또는 그 이상으로 상승한 Vramp 전압을 양의 유지방전 전압으로 감소시킨다. 이 때, 제 1 전극 보드의 경우 스캔 소자의 스위치 SW9가 오프되면서 스위치 SW10이 온되고, 양의 유지방전 전압 Vsus를 공급하기 위한 제어 스위치 SW3이 온된다. 제 2 전극 보드는 제어 스위치 SW8이 온 상태를 그대로 유지한다. 이 때, 전류는 도 9c에 도시한 바와 같이 제 1 전극 보드에서는 Vsus → SW3 → SW10을 통하여 패널(CP)로 흐르고, 제 2 전극 보드에서는 제어 스위치 SW8을 통하여 흐른다.
이후, 램프-다운 구간으로서 기울기를 갖고 램프-다운의 최종전압인 Vyd 전압까지 하강하는 과정의 제어 스위치 동작이 이루어진다. 구체적으로, 제 1 전극 보드의 경우 램프-다운의 기울기를 생성하기 위한 제어 스위치 SW6을 온하며, 제 2 전극 보드 경우 제어 스위치 SW7을 온하고 제어 스위치 SW8을 오프하여 제 2 전극의 레벨 전압인 Vxl을 인가한다. 여기서, 제 2 전극의 레벨 전압(Vxl)을 어드레스 구간인 T3 구간부터 인가할 수도 있는데, 이 경우에는 제 2 전극 보드에서의 제어 스위치 전환 동작이 일어나지 않는다. 이 때, 제 1 전극 보드의 출력 전압을, 기울기를 갖고 지속적으로 감소시키는 경우에, 도 4 및 도 5에 도시한 PDP 구동 파형과 같이 2개의 기울기를 갖도록 감소시킬 수도 있다. 도 4 및 도 5의 2개의 기울기를 구현하기 위한 방법으로는 서로 다른 기울기로 조정 가능한 제어 스위치 회로를 복수 개 만들어서 사용하거나 또는 하나의 스위칭에 2개의 제어 신호를 이용하여 제어하는 방법이 있다.
T2 구간에서의 전류 흐름은 도 9d에 도시한 바와 같이 Y 보드에서는 패 널(CP)에서부터 SW10 → SW6을 통하여 음의 유지방전 전압(-Vsus)으로 흐르고, X 보드에서는 Vxl → SW8을 통하여 패널(CP)로 흐른다. 여기서, X 전극에서 접지 상태(GND)를 유지하는 경우에는 SW9를 통하여 흐른다. 또한, Y 보드의 출력 전압 중에서 리셋 완료 시점의 전압인 Vyd의 경우에는 -Vsc 전압과 같거나 높게 설정할 수 있다. 참고로, -Vsc 전압은 -Vsus 전압과 동일한 전압을 사용한다.
다음으로, 방전 셀과 비방전 셀을 구분하기 위하여 어드레스 방전을 유도하는 구간인 T3 구간의 경우에는 2개의 전압이 제 1 전극 보드의 스캔 소자를 통하여 각 스캔 전극에 인가된다. 스캔 소자에는 스캔 라인의 수와 동일한 개수의 제어 스위치 SW9와 SW10이 존재한다. 참고로, 본 발명의 도면에서는 이를 간략히 하기 위해 하나의 제어 스위치 쌍(SW9와 SW10)으로만 나타내었다.
T3 구간의 회로 동작을 살펴보면, 스캔 소자의 음의 고전압 입력단자에는 -Vsc 전압이 인가되며 이 전압은 음의 유지방전 전압인 -Vsus와 같은 전압이다. 이와 동시에 스캔 소자의 양의 고전압 입력단자에는 -Vsc 전압보다 Vyl 만큼 높은 전압(Vyl-Vsc)이 인가된다. 이 경우, 제어 스위치 SW4가 온 상태를 유지하며 스캔 소자 내의 SW9 및 SW10은 스캔 라인의 순서에 따라 하나의 스캔 라인씩 SW10을 온(on)하는 방법으로 진행되면서 스캔 펄스를 인가한다. 여기서, 제 전극 보드의 레벨 전압 Vyl은 스캔 소자의 최대 허용 인가전압보다 크지 않아야 한다. 스캔 펄스는 SW9가 온되고 SW10이 오프되어 Vyl-Vsc 전압이 각 스캔 전극에 인가되고 있는 중에 해당 스캔 라인이 선택되었을 때 해당 스캔 라인만 SW9가 오프되고 SW10이 온되는 절차에 의하여 -Vsc 전압이 인가된다. 이 때, 제 2 전극 보드의 경우 제 2 전 극의 레벨 전압 Vxl을 인기하기 위하여 제어 스위치 SW8을 오프하고 제어 스위치 SW7은 온한다.
T3 구간에서의 전류 흐름은 도 9e에 도시한 바와 같이 제 1 전극 보드의 제어 스위치 SW9가 온되고 SW10이 오프되는 경우에는 전류(IsH)가 패널(CP)에서부터 SW9 → Vyl → SW4 → -Vsus를 통하여 흐르고, 제어 스위치 SW9가 오프되고 제어 스위치 SW10이 온되는 경우 스캔 라인의 전류(IsL)는 패널(CP)로부터 SW10 → SW4를 통하여 음의 유지방전 전압인 -Vsus로 흐른다. 제 2 전극 보드의 경우에는 전류가 Vxl에서 제어 스위치 SW7을 통하여 패널(CP)로 흐른다. 여기서, T3 구간인 어드레스 구간 동안에 제 2 전극의 레벨 전압으로 도 8과 같이 GND를 사용하는 경우에는 제 2 전극 보드의 스위칭 제어는 없다.
마지막으로, T4 구간을 살펴보면 다음과 같다. 유지방전 구간인 T4 구간은 T1, T2, T3에 비하여 다소 복잡하게 진행된다. 먼저, 어드레스 구간인 T3 구간이 완료된 후에 에너지 회수회로의 제어 스위치 SW1이 온되고 제어 스위치 SW4는 오프된다. 스캔 소자의 제어 스위치는 SW9가 오프되고 SW10은 온 상태로 된다. 이와 같이 제어 스위치 SW1이 온되면 스캔 소자의 음의 고전압 단자에 걸려있던 전압은 에너지 회수회로의 인덕터(LR)와 패널(CP)의 커패시터 성분에 의한 LC 공진에 의하여 전압이 부드럽게 상승하고 이후, 양의 유지방전 전압인 Vsus를 인가하기 위해 제어 스위치 SW3을 온시키면서 방전 셀은 방전을 한다. 이 때, 제어 스위치 SW1은 오프될 수도 있고 온될 수도 있다. 그런 다음, 충분한 방전이 발생하도록 일정한 시간을 유지한 후에, 제어 스위치 SW1과 SW3을 오프시키고 패널에 공급하였던 에너지를 회수하기 위해 제어 스위치 SW2를 온시킨다. 이렇게 되면, 에너지 회수회로의 인덕터(LR)와 회수용 커패시터(CR)의 LC 공진에 의하여 음의 유지방전 전압(-Vsus)으로 파형은 변화된다. 이후, 음의 유지방전 전압을 인가하기 위한 제어 스위치 SW4를 온시키면, 방전 셀은 제 1 전극이 음인 방전을 하게 된다. 이 경우에도 제어 스위치 SW2를 오프시킬 수도 있고 온 상태를 유지할 수도 있다. 제 1 전극 보드의 스위칭이 유지방전 전압을 인가하기 위해 스위칭이 이루어지는 모든 구간에 있어서 제 2 전극 보드의 경우에는 항상 제어 스위치 SW9가 온되어 0V 전압이 인가된다.
T4 구간에서의 전류 흐름은 도 9f에 도시한 바와 같다. 구체적으로, 제 1 전극 보드의 제어 스위치 SW1이 온되는 경우에서의 전류 흐름(Isus1)은 커패시터 CR에서부터 SW1 → D1 → LR → SW10을 통하여 패널의 제 1 전극에 인가되고, 제어 스위치 SW3이 온되는 유지방전 구간의 전류 흐름(Isus2)은 양의 유지방전 전압인 Vsus에서부터 SW3 → SW10을 통하여 패널의 제 1 전극에 인가된다. 반면, 에너지를 회수하면서 음의 유지방전 전압으로 스위칭하는 동안인 제어 스위치 SW2가 온되는 경우에서의 전류 흐름(Isus3)은 패널(CP)에서부터 SW10 → LR → D2 → SW2를 거쳐 커패시터 CR로 흐르며, 음의 유지방전 전압으로 방전하는 제어 스위치 SW4가 온하는 경우에서의 전류 흐름(Isus4)은 패널(CP)로부터 제어 스위치 SW10과 SW4를 통하여 음의 유지방전 전압원인 -Vsus로 흐른다.
이상, T1 내지 T4 구간에서의 회로 동작을 설명하였으며, T4 구간이 완료된 이후의 Y 전극의 전압파형은 다음 서브필드의 리셋 파형과 연결된다. 또한, 상기 T1 구간에서 설명한 스위칭 구동전압을 상승시키기 위한 방법으로 2가지 방법이 사 용될 수 있다. 첫 번째로는 에너지 회수회로의 SW1을 온시켜 일정수준까지 전압을 상승시킨 후에 SW1을 오프시키고 T1 단계로 넘어가는 방법이며, 두 번째 방법으로는 상술한 바와 같이 SW5를 이용하여 2가지의 기울기를 갖는 구동회로를 이용하는 방법이 있다.
이상 살펴본 바와 같은 본 발명에 따른 PDP 구동회로는 도 2에 도시된 바와 같은 종래의 PDP 구동회로에 비해 회로 구성이 간단하며, 도 2의 경우 스캔 전극에 유지방전 전압이 인가되는 동안에 2개의 제어 스위치(SW5, SW6)가 사용되나 본 발명의 경우 해당 제어 스위치의 사용이 불필요하여 유지방전 전압을 보다 안정적으로 패널에 공급할 수 있게 된다. 또한, 스캔 전압인 -Vsc 전압 생성을 위한 DC/DC 회로가 요구되지 않는다.
한편, 본 발명의 다른 실시예로 Y 전극 파형에 GND 전압이 인가하는 경우를 제시하고자 한다. 도 10은 본 발명의 다른 실시예에 따른 PDP 구동파형이며, 도 11은 도 10의 구동파형을 구현하기 위한 본 발명의 다른 실시예에 따른 PDP 구동회로의 회로 구성도이다.
도 10에 도시한 바와 같이 음의 유지방전 전압 -Vsus가 인가된 후 램프-업 구간이 시작되는 시점에, 바로 램프-업 제어 스위치 SW5를 온하거나 에너지 회수회로의 SW1을 이용하는 2단계의 기울기를 갖는 제어방법을 사용하지 않고 그 이전 단계로 제 1 보드의 출력 전압을 접지 상태(GND)로 먼저 천이하는 단계를 거치도록 한 후에 T1 단계로 진입하도록 하는 것을 특징으로 한다. 이 때, 접지 상태(GND)로 천이하기 위한 전 단계로 에너지 회수회로의 제어 스위치 SW1을 온시켜 음의 유지 방전 전압으로부터 일정 전압까지 상승시킴으로써 오버슈트(overshoot)성 노이즈를 저감하는 것도 가능하다.
도 10의 PDP 구동파형을 구현하기 위한 구동회로를 살펴보면 도 11에 도시한 바와 같이, 접지 상태(GND)로 천이하기 위한 제어 스위치로 SW11가 구비되며 제어 스위치 SW11은 역바이어스를 방지하기 위한 다이오드(D4)와 직렬로 구성되어 접지(GND)와 연결된다. 상기 다이오드(D4)를 사용하지 않으면 양의 유지방전 전압이 제 1 전극을 통해 출력되는 경우에 제어 스위치 SW11을 통하여 GND 단자로 대전류가 흐르기 때문에 다이오드(D4)를 반드시 구비시켜야 한다. 물론, 도 12에 도시한 바와 같이 다이오드(D4) 없이 2개의 제어 스위치(SW12, SW13)를 배치시킴으로써 대전류가 흐르는 것을 방지할 수도 있다.
도 1은 종래 기술에 따른 PDP 구동파형을 나타낸 도면.
도 2는 종래 기술에 따른 PDP 구동회로의 회로 구성도.
도 3은 본 발명의 제 1 실시예에 따른 PDP 구동파형을 나타낸 도면.
도 4는 본 발명의 제 2 실시예에 따른 PDP 구동파형을 나타낸 도면.
도 5는 본 발명의 제 3 실시예에 따른 PDP 구동파형을 나타낸 도면.
도 6은 본 발명의 실시예에 따른 PDP 구동회로의 회로 구성도.
도 7은 본 발명의 PDP 구동파형의 실시예에 따른 PDP 구동회로의 다른 회로 구성도.
도 8은 본 발명의 PDP 구동파형의 실시예에 따른 PDP 구동회로의 또 다른 회로 구성도.
도 9a는 도 3의 구동파형을 구현하기 위한 도 6의 SW1 내지 SW10의 온/오프 상태를 나타낸 타이밍도.
도 9b 내지 도 9f는 도 9a의 T1 내지 T4 구간의 각 구간에 상응하는 도 3의 구동회로의 전류 흐름도.
도 10은 본 발명의 다른 실시예에 따른 PDP 구동파형을 나타낸 도면.
도 11은 도 10의 구동파형을 구현하기 위한 본 발명의 다른 실시예에 따른 PDP 구동회로의 회로 구성도.
도 12는 도 11의 제 1 전극 보드에 GND 전압을 인가하기 위한 또 다른 회로 구성도.

Claims (23)

  1. 램프-업과 램프-다운, 스캔 전압, 제 1 전극 레벨전압 및 유지방전 전압을 인가하는 제 1 전극과 접지(GND)전압과 제 2 전극 레벨 전압을 인가하는 제 2 전극 및 어드레스 구간에서 방전 셀을 선택하기 위한 데이터 전압을 인가하는 제 3 전극을 구비하고, 리셋 구간, 어드레스 구간 및 서스테인 구간으로 구분되는 구동파형을 이용하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 서스테인 구간에서 상기 제 1 전극에 양의 유지방전 전압과 음의 유지방전 전압을 교대로 인가하고 상기 제 2 전극에 접지(GND) 전압을 인가하며,
    상기 리셋 구간의 램프-업 구간에서의 제 1 전극의 램프 전압의 최고값은 양의 유지방전 전압과 제 1 전극의 레벨 전압의 합을 초과하지 않으며,
    상기 램프-업 구간에서 상기 제 1 전극에 인가하는 램프 전압 최고값이 서브필드마다 서로 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 삭제
  3. 삭제
  4. 제 1 항에 있어서, 상기 램프-업 구간에서 상기 제 1 전극에 인가하는 전압에 레벨 전압 성분이 포함되지 않고 양의 유지방전 전압을 이용하여 기울기를 갖는 파형만이 존재하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 1 항에 있어서, 상기 램프-업 구간에서 제 1 전극에 인가하는 기울기를 갖고 상승하는 램프 전압이 서로 다른 2개의 기울기를 갖고 상승하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 제 5 항에 있어서, 첫 번째 기울기가 두 번째 기울기보다 경사가 급한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  7. 제 1 항에 있어서, 상기 램프-업 구간의 시작 전 상기 제 1 전극에 음의 유지방전 전압이 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  8. 제 1 항에 있어서, 상기 리셋 구간의 램프-다운 구간에서 기울기를 갖고 하강함에 있어서, 서로 다른 2개의 기울기를 갖고 하강하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  9. 제 8 항에 있어서, 첫 번째 기울기가 두 번째 기울기보다 경사가 급한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제 1 항에 있어서, 상기 리셋 구간의 완료 시점에서의 제 1 전극에 인가된 전압이 음의 유지방전 전압과 같거나 높은 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  11. 제 1 항에 있어서, 상기 램프-다운 구간에서 상기 제 2 전극에 접지(GND)전압이 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  12. 제 11 항에 있어서, 상기 어드레스 구간에서 상기 제 2 전극에 인가되는 전 압이 접지(GND)전압인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  13. 제 1 항에 있어서, 상기 제 1 전극에 인가하는 양의 유지방전 전압과 음의 유지방전 전압의 절대값은 동일한 크기를 갖는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  14. 제 1 항에서, 제 1 전극에 인가하는 전압으로 0V 전압을 사용하지 않는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  15. 리셋 구간, 어드레스 구간 및 서스테인 구간으로 구분되는 구동파형을 제어하고, 제 1 전극에 인가되는 램프-업과 램프-다운, 스캔 펄스 및 유지방전 전압과, 제 2 전극에 인가되는 레벨전압 및 유지방전 전압과, 제 3 전극에 인가되는 데이터 전압을 제어하는 플라즈마 디스플레이 패널의 구동회로에 있어서,
    상기 구동회로는 상기 제 1 전극에 인가되는 전압을 제어하는 제 1 전극 보드와, 상기 제 2 전극에 인가되는 전압을 제어하는 제 2 전극 보드의 조합으로 이루어지며,
    상기 제 1 전극 보드는,
    양의 유지방전 전압(Vsus)을 공급하는 제어 스위치(SW3)와,
    음의 유지방전 전압(-Vsus)을 공급하는 제어 스위치(SW4)와,
    양의 유지방전 전압과 연결되어 기울기를 갖고 상승하는 램프-업 파형을 생성하는 제어 스위치(SW5) 및
    음의 유지방전 전압과 연결되어 기울기를 갖고 하강하는 램프-다운 파형을 생성하는 제어 스위치(SW6)를 포함하여 이루어지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동회로.
  16. 제 15 항에 있어서, 상기 제 1 전극 보드에 에너지를 회수하는 제어 스위치(SW2) 및 회수된 에너지를 공급하는 제어 스위치(SW1)와 상기 제어 스위치(SW2)에 의해 회수된 에너지를 저장하는 역할을 하는 커패시터(CR)가 더 구비되고, 상기 에너지 회수용 커패시터(CR)의 음의 단자는 음의 유지방전 전압과 연결되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동회로.
  17. 제 15 항에 있어서, 상기 제 1 전극 보드에 에너지를 회수하는 제어 스위치(SW2) 및 회수된 에너지를 공급하는 제어 스위치(SW1)가 더 구비되고, 상기 제어 스위치(SW1, SW2) 사이의 접점이 접지 전압과 연결되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동회로.
  18. 제 15 항에 있어서, 상기 제 1 전극 보드에 고전압 출력을 제어하는 제어 스위치(SW9, SW10)로 구성되는 스캔 소자가 더 구비되며, 상기 스캔 소자의 고전압 입력부의 하이(High)측 단자는 제 1 전극의 레벨 전압(Vyl)의 양의 단자와 연결되고, 상기 스캔 소자의 고전압 입력부의 로우(Low)측 단자는 제 1 전극의 레벨 전압의 음의 단자와 연결되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동회로.
  19. 제 18 항에 있어서, 상기 제 1 전극의 레벨 전압(Vyl)과 상기 스캔 소자의 양의 고전압 입력 단자 사이에 다이오드(D3)와 커패시터(C1)가 더 구비되며, 상기 레벨 전압의 음의 단자는 음의 유지방전 전압(-Vsus)과 연결되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동회로.
  20. 제 15 항에 있어서, 상기 제 2 전극 보드는,
    제 2 전극의 레벨 전압(Vxl)을 인가하는 제어 스위치(SW7)와 접지 전압을 인가하는 제어 스위치(SW8)를 포함하여 이루어지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동회로.
  21. 제 15 항에 있어서, 상기 제 2 전극 보드는,
    접지(GND)전압만을 인가하도록 구성함에 있어서, 그 어떤 제어 스위치도 사용하지 않는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동회로.
  22. 제 15 항에 있어서, 상기 램프-업 구간 이전 단계에서 상기 제 1 전극에 접지(GND) 전압을 인가하는 역할을 수행하는 제어 스위치(SW11) 및 상기 제어 스위치(SW11)와 직렬로 연결되는 다이오드(D4)가 더 구비되고, 상기 다이오드(D4)는 접지 전압과 연결되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동회로.
  23. 제 15 항에 있어서, 상기 램프-업 구간 이전 단계에서 상기 제 1 전극에 접지(GND) 전압을 인가하는 역할을 수행하는 것으로서, 직렬로 연결되는 두 개의 제어 스위치(SW12, SW13)를 더 구비하며, 상기 제어 스위치(SW12)는 접지 전압과 연결되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동회로.
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