KR101059810B1 - Method of manufacturing semiconductor device - Google Patents

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KR101059810B1 KR1020040038322A KR20040038322A KR101059810B1 KR 101059810 B1 KR101059810 B1 KR 101059810B1 KR 1020040038322 A KR1020040038322 A KR 1020040038322A KR 20040038322 A KR20040038322 A KR 20040038322A KR 101059810 B1 KR101059810 B1 KR 101059810B1
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이광호
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매그나칩 반도체 유한회사
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Abstract

본 발명은 소자의 특성 저하를 방지하기 위한 반도체 소자의 제조방법을 개시한다. 개시된 본 발명의 방법은, 액티브영역과 필드영역이 정의된 실리콘 기판을 제공하는 단계; 상기 실리콘 기판 상에 상기 필드영역을 노출시키는 패드산화막과 패드질화막을 차례로 형성하는 단계; 상기 노출된 기판의 필드영역을 식각하여 트렌치를 형성하는 단계; 상기 기판 결과물 상에 산화막 및 제1질화막을 차례로 형성하는 단계; 상기 결과물 전면에 상기 트렌치를 매립시키도록 매립산화막을 형성하는 단계; 상기 패드질화막이 노출될 때까지 상기 결과물을 씨엠피하여 소자분리막을 형성하는 단계; 상기 패드질화막을 제거함과 동시에 상기 잔류된 제1질화막의 일부를 식각하는 단계; 상기 패드산화막을 제거함과 동시에 상기 잔류된 산화막의 일부를 제거하는 단계; 상기 결과의 기판의 액티브영역 상에 플로팅 게이트를 형성하는 단계; 상기 플로팅 게이트를 포함한 기판 전면에 제2질화막을 형성하는 단계; 및 상기 제2질화막을 식각하여 상기 플로팅 게이트의 양측벽에 제1스페이서를 형성함과 동시에, 상기 소자분리막의 상부 측벽에 상기 잔류된 제1질화막과 연결되는 제2스페이서를 형성하는 단계를 포함한다. The present invention discloses a method for manufacturing a semiconductor device for preventing the deterioration of device characteristics. The disclosed method comprises the steps of providing a silicon substrate having active and field regions defined therein; Sequentially forming a pad oxide film and a pad nitride film exposing the field region on the silicon substrate; Etching a field region of the exposed substrate to form a trench; Sequentially forming an oxide film and a first nitride film on the substrate resultant; Forming a buried oxide film to fill the trench in the entire surface of the resultant material; Forming a device isolation film by CMP the resultant material until the pad nitride film is exposed; Removing the pad nitride film and etching a portion of the remaining first nitride film; Removing a portion of the remaining oxide film while simultaneously removing the pad oxide film; Forming a floating gate on an active region of the resulting substrate; Forming a second nitride film on an entire surface of the substrate including the floating gate; And etching the second nitride film to form first spacers on both sidewalls of the floating gate, and simultaneously forming second spacers connected to the remaining first nitride film on an upper sidewall of the device isolation layer. .

Description

반도체 소자의 제조방법{METHOD FOR MANUFACTURING SEMICONDUCTOR DEVICE}Manufacturing method of semiconductor device {METHOD FOR MANUFACTURING SEMICONDUCTOR DEVICE}

도 1a 내지 도 1f는 종래의 기술에 따른 반도체 소자의 제조방법을 설명하기 위한 공정별 단면도.1A to 1F are cross-sectional views illustrating processes for manufacturing a semiconductor device according to the related art.

도 2는 종래의 기술에 따른 문제점을 설명하기 위한 단면도.2 is a cross-sectional view for explaining a problem according to the prior art.

도 3a 내지 도 3g는 본 발명의 실시예에 따른 반도체 소자의 제조방법을 설명하기 위한 공정별 단면도.3A to 3G are cross-sectional views of processes for describing a method of manufacturing a semiconductor device, according to an embodiment of the present invention.

-도면의 주요 부분에 대한 부호의 설명-Explanation of symbols on main parts of drawing

30 : 실리콘 기판 31 : 패터닝후 잔류된 패드산화막30 silicon substrate 31 pad oxide film remaining after patterning

32 : 패터닝후 잔류된 패드질화막 33 : 트렌치32: pad nitride film remaining after patterning 33: trench

34 : 열산화막 35 : TEOS 산화막34: thermal oxide film 35: TEOS oxide film

36 : 제1질화막 37 : 매립산화막36: first nitride film 37: buried oxide film

35a : 씨엠피후 잔류된 TEOS 산화막 36a : 씨엠피후 잔류된 제1질화막35a: TEOS oxide film remaining after CMP 36a: first nitride film remaining after CMP

35b : 세정 공정후 잔류된 TEOS 산화막 36b : 식각후 잔류된 제1질화막35b: TEOS oxide film remaining after cleaning process 36b: First nitride film remaining after etching

37a : 소자분리막 38 : 터널산화막37a: device isolation layer 38: tunnel oxide layer

39 : 폴리실리콘막 40 : 하드마스크막39 polysilicon film 40 hard mask film

41 : 플로팅 게이트 42 : 제2질화막 41: floating gate 42: second nitride film

42a : 제1스페이서 42b : 제2스페이서 42a: first spacer 42b: second spacer                 

A : 라운딩A: rounding

본 발명은 반도체 소자의 제조방법에 관한 것으로, 보다 상세하게는, 소자의 특성 저하를 방지할 수 있는 반도체 소자의 제조방법에 관한 것이다. The present invention relates to a method for manufacturing a semiconductor device, and more particularly, to a method for manufacturing a semiconductor device capable of preventing the deterioration of device characteristics.

반도체 기술의 진보와 더불어, 반도체 소자의 고속화 및 고집적화가 급속하게 진행되고 있고, 이에 수반해서 패턴의 미세화 및 패턴 칫수의 고정밀화에 대한 요구가 점점 높아지고 있다. 이러한 요구는 소자 영역에 형성되는 패턴은 물론 상대적으로 넓은 영역을 차지하는 소자분리막에도 적용된다. 이것은 고집적 소자로 갈수록 소자 영역의 폭이 감소되고 있는 추세에서 상대적으로 소자 영역의 폭을 증가시키기 위해서는 소자분리 영역의 폭을 감소시켜야만 하기 때문이다. With the progress of semiconductor technology, the speed and the high integration of semiconductor devices are progressing rapidly, and with this, the demand for refinement | miniaturization of a pattern and high precision of a pattern dimension is increasing. This requirement applies not only to patterns formed in device regions, but also to device isolation films that occupy a relatively large area. This is because the width of the device region must decrease in order to increase the width of the device region in the trend that the width of the device region is decreasing toward the highly integrated device.

여기서, 기존의 소자분리막은 로코스(LOCOS) 공정에 의해 형성되어져 왔는데, 상기 로코스 공정에 의한 소자분리막은, 주지된 바와 같이, 그 가장자리 부분에서 새부리 형상의 버즈-빅(bird's-beak)이 발생되기 때문에 소자분리막의 면적을 증대시키면서 누설전류를 발생시키는 단점이 있다.Here, a conventional device isolation film has been formed by a LOCOS process, and the device isolation film by the LOCOS process, as is well known, has a bird's-beak having a beak shape at its edge portion. Since it is generated, there is a disadvantage in that a leakage current is generated while increasing the area of the device isolation film.

따라서, 상기 로코스 공정에 의한 소자분리막의 형성방법을 대신해서, 적은 폭을 가지면서 우수한 소자 분리 특성을 갖는 STI(Shallow Trench Isolation) 공정을 이용한 소자분리막의 형성방법이 제안되었고, 현재 대부분의 반도체 소자는 STI 공정을 적용해서 소자분리막을 형성하고 있다. Therefore, instead of the method of forming a device isolation film by the LOCOS process, a method of forming a device isolation film using a shallow trench isolation (STI) process having a small width and excellent device isolation characteristics has been proposed. The device is an STI process to form a device isolation film.                         

도 1a 내지 도 1f는 종래의 기술에 따른 반도체 소자의 제조방법을 설명하기 위한 공정별 단면도이다.1A to 1F are cross-sectional views of processes for describing a method of manufacturing a semiconductor device according to the related art.

상기 STI 공정을 적용한 종래의 반도체 소자의 제조방법에 대하여 도 1a 내지 도 1f를 참조하여 간략하게 설명하면 다음과 같다. A method of manufacturing a conventional semiconductor device to which the STI process is applied will be briefly described with reference to FIGS. 1A to 1F.

종래의 반도체 소자의 제조방법은, 도 1a에 도시된 바와 같이, 먼저, 액티브영역(미도시)과 필드영역(미도시)이 정의된 실리콘 기판(10) 상에 패드산화막(미도시)과 패드질화막(미도시)을 차례로 형성한다. 이어서, 상기 기판(10)의 필드영역을 노출시키도록 상기 패드질화막과 패드산화막을 패터닝한다. 다음으로, 상기 노출된 기판(10)의 필드영역을 식각하여 소정 깊이의 트렌치(13)를 형성한다. 이때, 도 1a에서 미설명된 도면부호 11은 패터닝후 잔류된 패드산화막을 나타낸 것이고, 12는 패터닝후 잔류된 패드질화막을 나타낸 것이다. In the conventional method of manufacturing a semiconductor device, as shown in FIG. 1A, first, a pad oxide film (not shown) and a pad are formed on a silicon substrate 10 in which an active region (not shown) and a field region (not shown) are defined. A nitride film (not shown) is formed in sequence. Subsequently, the pad nitride film and the pad oxide film are patterned to expose the field region of the substrate 10. Next, the trench 13 having a predetermined depth is formed by etching the field region of the exposed substrate 10. In this case, reference numeral 11, which is not described in FIG. 1A, illustrates a pad oxide film remaining after patterning, and 12 illustrates a pad nitride film remaining after patterning.

그런다음, 도 1b에 도시된 바와 같이, 상기 트렌치(13)의 상부 코너(Top Corner)를 라운딩(Rounding)(A)시키도록 상기 트렌치(13) 표면에 열산화막(14)을 형성한다. 계속해서, 상기 트렌치(13)를 매립시키도록 상기 결과의 구조 전면에 매립산화막(15)을 형성한다. 이때, 상기 매립산화막(15)으로는 HDP(High Density Plasma) 산화막을 이용한다. Then, as illustrated in FIG. 1B, a thermal oxide layer 14 is formed on the surface of the trench 13 to round (A) the top corner of the trench 13. Subsequently, a buried oxide film 15 is formed on the entire structure of the resultant structure so as to fill the trench 13. In this case, a high density plasma (HDP) oxide film is used as the buried oxide film 15.

그리고나서, 도 1c에 도시된 바와 같이, 상기 패드질화막이 노출될 때까지 상기 매립산화막을 화학적 기계적 연마(Chemical Mechanical Polishing ; 이하, 씨엠피)하여 소자분리막(15a)을 형성한다. 이어, 상기 패드질화막을 제거한다. 그런 후에, 세정 공정을 실시하여 상기 패드산화막을 제거한다. 이때, 상기 세정 공정은 H20와 HF가 19:1의 비율로 혼합된 용액(이하, HF 용액이라 칭함)을 이용하여 35초 동안 실시한다. Then, as shown in FIG. 1C, the buried oxide layer is chemically mechanically polished (CMP) until the pad nitride layer is exposed to form the device isolation layer 15a. Next, the pad nitride film is removed. Thereafter, a washing process is performed to remove the pad oxide film. At this time, the cleaning process is carried out for 35 seconds using a solution (hereinafter referred to as HF solution) in which H20 and HF are mixed in a ratio of 19: 1.

그런후에, 도 1d에 도시된 바와 같이, 상기 실리콘 기판(10) 상에 터널(Tunnel)산화막(16)을 형성한 다음, 상기 결과물의 액티브영역 상에 폴리실리콘막(17) 및 하드마스크(Hard Mask)막(18)이 차례로 적층된 구조를 갖는 플로팅 게이트(Floating Gate)(19)를 형성한다. Then, as shown in FIG. 1D, a tunnel oxide film 16 is formed on the silicon substrate 10, and then a polysilicon film 17 and a hard mask are formed on the resultant active region. A Floating Gate 19 having a structure in which a Mask film 18 is sequentially stacked is formed.

이어서, 도 1e에 도시된 바와 같이, 상기 플로팅 게이트(19)를 포함한 기판 전면에 플로팅 게이트의 스페이서용 질화막(20)을 형성한다. Subsequently, as shown in FIG. 1E, a nitride film 20 for spacers of the floating gate is formed on the entire surface of the substrate including the floating gate 19.

이후, 도 1f에 도시된 바와 같이, 상기 스페이서용 질화막을 식각하여 상기 플로팅 게이트(19)의 양측벽에 플로팅 게이트 스페이서(20a)를 형성한다.1F, the nitride film for spacers is etched to form floating gate spacers 20a on both sidewalls of the floating gate 19.

그러나, 전술한 바와 같은 종래의 기술에 따르면 다음과 같은 문제점이 발생된다. 도 2는 종래의 기술에 따른 문제점을 설명하기 위한 단면도이다.However, according to the prior art as described above, the following problems occur. 2 is a cross-sectional view illustrating a problem according to the prior art.

종래의 기술에서는, 도 2에 도시된 바와 같이, 상기 패드산화막을 제거하기 위한 HF 용액을 이용한 세정 공정이 진행됨에 따라, 상기 소자분리막(15a) 상부 코너부의 매립산화막, 즉, HDP 산화막이 과도하게 침식되어 모트(Moat)(M)가 발생하게 된다. 따라서, 이후의 플로팅 게이트의 스페이서용 질화막 식각 공정시, 상기 스페이서용 질화막이 상기 모트(M) 발생부분인 상기 소자분리막(15a)의 상부 측벽에 잔류하게 된다. 이때, 상기 식각후 잔류된 스페이서용 질화막(B)이 후속의 세정 공정에 의해 떨어져 나가게 되면 액티브영역을 오염시켜 소자의 특성을 저하시키게 된다. In the related art, as shown in FIG. 2, as the cleaning process using the HF solution for removing the pad oxide film proceeds, the buried oxide film of the upper corner portion of the device isolation layer 15a, that is, the HDP oxide film is excessively formed. Erosion causes moat (M). Therefore, in the subsequent etching process of the spacer nitride film of the floating gate, the spacer nitride film remains on the upper sidewall of the device isolation layer 15a which is the moat M generation portion. At this time, when the spacer nitride film B remaining after the etching is separated by a subsequent cleaning process, the active region is contaminated to deteriorate the characteristics of the device.

따라서, 본 발명은 상기와 같은 문제점을 해결하기 위하여 안출된 것으로서, 플로팅 게이트의 스페이서용 질화막 식각 공정시, 상기 스페이서용 질화막이 소자분리막의 상부 측벽에 잔류된 다음, 후속의 세정 공정에 의해 떨어져 나가 액티브영역을 오염시키는 것을 방지하여, 소자의 특성 저하를 방지할 수 있는 반도체 소자의 제조방법을 제공함에 그 목적이 있다. Accordingly, the present invention has been made to solve the above problems, in the spacer nitride film etching process of the floating gate, the spacer nitride film is left on the upper sidewall of the device isolation film, and then separated by a subsequent cleaning process It is an object of the present invention to provide a method for manufacturing a semiconductor device which can prevent contamination of the active region and prevent the deterioration of device characteristics.

상기와 같은 목적을 달성하기 위한 본 발명의 실시예에 따른 반도체 소자의 제조방법은, 액티브영역과 필드영역이 정의된 실리콘 기판을 제공하는 단계; 상기 실리콘 기판 상에 상기 필드영역을 노출시키는 패드산화막과 패드질화막을 차례로 형성하는 단계; 상기 노출된 기판의 필드영역을 식각하여 트렌치를 형성하는 단계; 상기 기판 결과물 상에 산화막 및 제1질화막을 차례로 형성하는 단계; 상기 결과물 전면에 상기 트렌치를 매립시키도록 매립산화막을 형성하는 단계; 상기 패드질화막이 노출될 때까지 상기 결과물을 씨엠피하여 소자분리막을 형성하는 단계; 상기 패드질화막을 제거함과 동시에 상기 잔류된 제1질화막의 일부를 식각하는 단계; 상기 패드산화막을 제거함과 동시에 상기 잔류된 산화막의 일부를 제거하는 단계; 상기 결과의 기판의 액티브영역 상에 플로팅 게이트를 형성하는 단계; 상기 플로팅 게이트를 포함한 기판 전면에 제2질화막을 형성하는 단계; 및 상기 제2질화막을 식각하여 상기 플로팅 게이트의 양측벽에 제1스페이서를 형성함과 동시에, 상기 소자분리막의 상부 측벽에 상기 잔류된 제1질화막과 연결되는 제2스페이서를 형성하는 단계 를 포함한다. According to an aspect of the present invention, there is provided a method of fabricating a semiconductor device, the method including: providing a silicon substrate in which an active region and a field region are defined; Sequentially forming a pad oxide film and a pad nitride film exposing the field region on the silicon substrate; Etching a field region of the exposed substrate to form a trench; Sequentially forming an oxide film and a first nitride film on the substrate resultant; Forming a buried oxide film to fill the trench in the entire surface of the resultant material; Forming a device isolation film by CMP the resultant material until the pad nitride film is exposed; Removing the pad nitride film and etching a portion of the remaining first nitride film; Removing a portion of the remaining oxide film while simultaneously removing the pad oxide film; Forming a floating gate on an active region of the resulting substrate; Forming a second nitride film on an entire surface of the substrate including the floating gate; And etching the second nitride film to form first spacers on both sidewalls of the floating gate, and forming a second spacer connected to the remaining first nitride film on an upper sidewall of the device isolation layer. .

여기서, 상기 산화막은 TEOS 산화막으로 이루어지고, 이때, 상기 TEOS 산화막은 650℃ 이상의 온도에서 TEOS와 O2 가스를 이용하여 100Å의 두께로 형성한다. 또한, 상기 제1질화막은 750℃ 이상의 온도에서 NH3와 SiCl2H2의 혼합 가스를 이용하여 100Å의 두께로 형성한다. 그리고, 상기 잔류된 제1질화막의 일부를 식각하는 단계는, 상기 제1질화막을 800Å의 두께만큼 습식 식각한다. Here, the oxide film is made of a TEOS oxide film, wherein the TEOS oxide film is formed to a thickness of 100Å by using TEOS and O2 gas at a temperature of 650 ℃ or more. In addition, the first nitride film is formed to a thickness of 100 kPa using a mixed gas of NH3 and SiCl2H2 at a temperature of 750 ℃ or more. In the etching of the remaining portion of the first nitride film, the first nitride film is wet-etched by a thickness of 800 kPa.

(실시예)(Example)

이하, 첨부된 도면에 의거하여 본 발명의 바람직한 실시예를 상세하게 설명하도록 한다.Hereinafter, preferred embodiments of the present invention will be described in detail with reference to the accompanying drawings.

도 3a 내지 도 3g는 본 발명의 실시예에 따른 반도체 소자의 제조방법을 설명하기 위한 공정별 단면도이다.3A to 3G are cross-sectional views of processes for describing a method of manufacturing a semiconductor device, according to an embodiment of the present invention.

본 발명의 실시예에 따른 반도체 소자의 제조방법은, 도 3a에 도시된 바와 같이, 먼저, 액티브영역(미도시)과 필드영역(미도시)이 정의된 실리콘 기판(30) 상에 패드산화막(미도시)과 패드질화막(미도시)을 차례로 형성한다. 이어서, 상기 기판(30)의 필드영역을 노출시키도록 상기 패드질화막과 패드산화막을 패터닝한다. 다음으로, 상기 노출된 기판(30)의 필드영역을 식각하여 소정 깊이의 트렌치(33)를 형성한다. 이때, 도 3a에서 미설명된 도면부호 31은 패터닝후 잔류된 패드산화막을 나타낸 것이고, 32는 패터닝후 잔류된 패드질화막을 나타낸 것이다. In the method of manufacturing a semiconductor device according to an embodiment of the present invention, as shown in FIG. 3A, first, a pad oxide layer is formed on a silicon substrate 30 in which an active region (not shown) and a field region (not shown) are defined. A pad nitride film (not shown) is formed in this order. Subsequently, the pad nitride film and the pad oxide film are patterned to expose the field region of the substrate 30. Next, the field region of the exposed substrate 30 is etched to form a trench 33 having a predetermined depth. In this case, reference numeral 31, which is not described in FIG. 3A, indicates a pad oxide film remaining after patterning, and 32 indicates a pad nitride film remaining after patterning.

그런다음, 도 3b에 도시된 바와 같이, 상기 트렌치(33)의 상부 코너를 라운딩(Rounding)(A)시키도록 상기 트렌치(33) 표면에 열산화막(34)을 형성한다. 계속해서, 상기 기판 결과물 상에 TEOS(Tetra Ethyl Ortho Sillicate) 산화막(35)을 형성한다. 이때, 상기 TEOS 산화막(35)은 650℃ 이상의 온도에서 TEOS(Tetra Ethyl Ortho Sillicate)와 O2 가스를 이용하여 100Å의 두께로 형성한다.Then, as illustrated in FIG. 3B, a thermal oxide layer 34 is formed on the surface of the trench 33 to round (A) the upper corner of the trench 33. Subsequently, a TEOS (Tetra Ethyl Ortho Sillicate) oxide film 35 is formed on the substrate resultant. At this time, the TEOS oxide layer 35 is formed to a thickness of 100 kV using TEOS (Tetra Ethyl Ortho Sillicate) and O2 gas at a temperature of 650 ℃ or more.

그런후에, 상기 TEOS 산화막(35) 상에 제1질화막(36)을 형성한다. 이때, 상기 제1질화막(36)은 750℃ 이상의 온도에서 NH3와 SiCl2H2의 혼합 가스를 이용하여 100Å의 두께로 형성한다. 이어서, 상기 트렌치(33)를 매립시키도록 상기 제1질화막(36) 상에 매립산화막(37)을 형성한다. 이때, 상기 매립산화막(37)으로는 HDP(High Density Plasma) 산화막을 이용한다. Thereafter, a first nitride film 36 is formed on the TEOS oxide film 35. At this time, the first nitride film 36 is formed to a thickness of 100 kPa using a mixed gas of NH 3 and SiCl 2 H 2 at a temperature of 750 ℃ or more. Subsequently, a buried oxide film 37 is formed on the first nitride film 36 to fill the trench 33. In this case, a high density plasma (HDP) oxide film is used as the buried oxide film 37.

그리고나서, 도 3c에 도시된 바와 같이, 상기 패드질화막(32)이 노출될 때까지 상기 결과물을 씨엠피하여 소자분리막(37a)을 형성한다. 이때, 도 3c에서 미설명된 도면부호 35a, 36a는 각각 씨엠피후 잔류된 TEOS 산화막, 제1질화막을 나타낸 것이다. 3C, the resultant CMP is formed until the pad nitride layer 32 is exposed to form the device isolation layer 37a. In this case, reference numerals 35a and 36a, which are not described in FIG. 3C, respectively indicate the TEOS oxide film and the first nitride film remaining after the CMP.

이어, 도 3d에 도시된 바와 같이, 상기 패드질화막을 제거함과 동시에, 상기 씨엠피후 잔류된 제1질화막의 일부를 식각한다. 이때, 상기 제1질화막을 800Å 두께만큼 습식 식각한다. 여기서, 상기 TEOS 산화막(35a)은 상기 제1질화막을 습식 식각할 때에, 액티브영역으로 과도한 식각이 진행되는 것을 막아주는 역할을 한다. 한편, 도 3d에서 미설명된 도면부호 36b는 식각후 잔류된 제1질화막을 나타낸 것이다.Subsequently, as shown in FIG. 3D, the pad nitride film is removed and a portion of the first nitride film remaining after the CMP is etched. In this case, the first nitride film is wet-etched by 800 mm thick. Here, the TEOS oxide layer 35a prevents excessive etching to the active region when wet etching the first nitride layer. Meanwhile, reference numeral 36b, which is not described in FIG. 3D, indicates the first nitride film remaining after etching.

이어서, 도 3e에 도시된 바와 같이, 상기 결과의 기판에 대한 세정 공정을 실시하여 상기 패드산화막을 제거함과 동시에, 상기 소자분리막(37a)의 상부 에지 부에 인접한 TEOS 산화막 부분을 제거한다. 이때, 상기 세정 공정은 HF 용액을 이용하여 35초 동안 실시한다. 한편, 도 3e에서 미설명된 도면부호 35b는 세정 공정후 잔류된 TEOS 산화막을 나타낸 것이다. Subsequently, as shown in FIG. 3E, the resultant substrate is cleaned to remove the pad oxide film, and at the same time, the portion of the TEOS oxide film adjacent to the upper edge portion of the device isolation film 37a is removed. At this time, the cleaning process is carried out for 35 seconds using HF solution. Meanwhile, reference numeral 35b, which is not described in FIG. 3E, shows the TEOS oxide film remaining after the cleaning process.

다음으로, 도 3f에 도시된 바와 같이, 상기 결과의 실리콘 기판(30) 상에 터널산화막(38)을 형성한 다음, 상기 기판 결과물의 액티브영역 상에 폴리실리콘막(39) 및 하드마스크(Hard Mask)막(40)이 차례로 적층된 구조를 갖는 플로팅 게이트(Floating Gate)(41)를 형성한다. 이어서, 상기 플로팅 게이트(41)를 포함한 기판 전면에 스페이서용 질화막인 제2질화막(42)을 형성한다. Next, as shown in FIG. 3F, a tunnel oxide film 38 is formed on the resultant silicon substrate 30, and then a polysilicon film 39 and a hard mask are formed on the active region of the substrate resultant. A Floating Gate 41 having a structure in which a Mask film 40 is sequentially stacked is formed. Subsequently, a second nitride film 42, which is a nitride film for spacers, is formed on the entire surface of the substrate including the floating gate 41.

이후, 도 3g에 도시된 바와 같이, 상기 제2질화막을 식각하여 상기 플로팅 게이트(41) 양측벽에 제1스페이서(42a)를 형성함과 동시에, 상기 소자분리막(37a)의 상부 측벽에 상기 식각후 잔류된 제1질화막(36b)과 연결되는 제2스페이서(42b)를 형성한다. 이때, 상기 제2스페이서(42b)는 상기 식각후 잔류된 제1질화막(36b)에 연결 및 고정되므로, 후속의 세정 공정에 의해 떨어져 나가지 않는다. Thereafter, as illustrated in FIG. 3G, the second nitride layer is etched to form first spacers 42a on both sidewalls of the floating gate 41, and at the same time, the etching is performed on the upper sidewalls of the device isolation layer 37a. After that, a second spacer 42b connected to the remaining first nitride layer 36b is formed. In this case, since the second spacer 42b is connected to and fixed to the first nitride film 36b remaining after the etching, the second spacer 42b does not fall off by a subsequent cleaning process.

이상에서와 같이, 본 발명은 소자분리막과 기판 사이에 질화막을 개재시킴으로써, 이후의 플로팅 게이트의 스페이서용 질화막 식각 공정시, 상기 소자분리막의 상부 측벽에 잔류되는 상기 플로팅 게이트의 스페이서용 질화막이 상기 소자분리막과 기판 사이에 개재된 질화막에 의해 연결 및 고정된다. 따라서, 상기 소자분리막의 상부 측벽에 잔류되는 상기 플로팅 게이트의 스페이서용 질화막이 후속의 세정 공정에 의해 떨어져 나가서 액티브영역을 오염시키는 것을 막을 수 있다. As described above, according to the present invention, a nitride film is interposed between the device isolation film and the substrate so that the nitride film for the spacer of the floating gate remaining on the upper sidewall of the device isolation film during the subsequent etching process of the nitride film for the spacer of the floating gate is performed. It is connected and fixed by a nitride film interposed between the separator and the substrate. Therefore, the spacer nitride film of the floating gate remaining on the upper sidewall of the device isolation film can be prevented from coming off by a subsequent cleaning process to contaminate the active region.                     

결국, 본 발명은 소자의 특성 저하를 방지할 수 있다. As a result, the present invention can prevent deterioration of the characteristics of the device.

Claims (5)

액티브영역과 필드영역이 정의된 실리콘 기판을 제공하는 단계;Providing a silicon substrate in which an active region and a field region are defined; 상기 실리콘 기판 상에 상기 필드영역을 노출시키는 패드산화막과 패드질화막을 차례로 형성하는 단계;Sequentially forming a pad oxide film and a pad nitride film exposing the field region on the silicon substrate; 상기 노출된 기판의 필드영역을 식각하여 트렌치를 형성하는 단계;Etching a field region of the exposed substrate to form a trench; 상기 트렌치가 형성된 기판 결과물 상에 산화막 및 제1질화막을 차례로 형성하는 단계;Sequentially forming an oxide film and a first nitride film on the trench formed substrate resultant; 상기 제1질화막 상에 상기 트렌치를 매립시키도록 매립산화막을 형성하는 단계; Forming a buried oxide film to fill the trench on the first nitride film; 상기 패드질화막이 노출될 때까지 상기 매립산화막을 씨엠피하여 소자분리막을 형성하는 단계;Forming a device isolation film by CMPing the buried oxide film until the pad nitride film is exposed; 상기 패드질화막을 제거하는 단계;Removing the pad nitride film; 상기 패드산화막을 제거하는 단계;Removing the pad oxide film; 상기 기판의 액티브영역 상에 플로팅 게이트를 형성하는 단계;Forming a floating gate on an active region of the substrate; 상기 플로팅 게이트를 포함한 기판 전면에 제2질화막을 형성하는 단계; 및Forming a second nitride film on an entire surface of the substrate including the floating gate; And 상기 제2질화막을 식각하여 상기 플로팅 게이트의 양측벽에 제1스페이서를 형성함과 동시에, 상기 소자분리막의 상부 측벽에 상기 잔류된 제1질화막과 연결되는 제2스페이서를 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 소자의 제조방법.Etching the second nitride film to form first spacers on both sidewalls of the floating gate, and forming a second spacer connected to the remaining first nitride film on the upper sidewall of the device isolation layer. A semiconductor device manufacturing method characterized by the above-mentioned. 제 1항에 있어서, 상기 산화막은 TEOS 산화막으로 이루어지는 것을 특징으로 하는 반도체 소자의 제조방법.The method of claim 1, wherein the oxide film is formed of a TEOS oxide film. 삭제delete 삭제delete 제 1항에 있어서, 상기 패드질화막 제거공정 시, 상기 제1질화막을 800Å의 두께만큼 습식 식각하는 것을 특징으로 하는 반도체 소자의 제조방법. The method of claim 1, wherein the first nitride film is wet-etched by a thickness of about 800 kPa during the pad nitride film removing step.
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