KR100955674B1 - 반도체소자의 불순물영역 저항 조절방법 - Google Patents

반도체소자의 불순물영역 저항 조절방법 Download PDF

Info

Publication number
KR100955674B1
KR100955674B1 KR1020070065847A KR20070065847A KR100955674B1 KR 100955674 B1 KR100955674 B1 KR 100955674B1 KR 1020070065847 A KR1020070065847 A KR 1020070065847A KR 20070065847 A KR20070065847 A KR 20070065847A KR 100955674 B1 KR100955674 B1 KR 100955674B1
Authority
KR
South Korea
Prior art keywords
impurity region
impurity
heat treatment
semiconductor device
resistance
Prior art date
Application number
KR1020070065847A
Other languages
English (en)
Other versions
KR20090002485A (ko
Inventor
노경봉
김동석
Original Assignee
주식회사 하이닉스반도체
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 주식회사 하이닉스반도체 filed Critical 주식회사 하이닉스반도체
Priority to KR1020070065847A priority Critical patent/KR100955674B1/ko
Publication of KR20090002485A publication Critical patent/KR20090002485A/ko
Application granted granted Critical
Publication of KR100955674B1 publication Critical patent/KR100955674B1/ko

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/26Bombardment with radiation
    • H01L21/263Bombardment with radiation with high-energy radiation
    • H01L21/265Bombardment with radiation with high-energy radiation producing ion implantation
    • H01L21/26586Bombardment with radiation with high-energy radiation producing ion implantation characterised by the angle between the ion beam and the crystal planes or the main crystal surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/26Bombardment with radiation
    • H01L21/263Bombardment with radiation with high-energy radiation
    • H01L21/265Bombardment with radiation with high-energy radiation producing ion implantation
    • H01L21/26506Bombardment with radiation with high-energy radiation producing ion implantation in group IV semiconductors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/324Thermal treatment for modifying the properties of semiconductor bodies, e.g. annealing, sintering

Landscapes

  • Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • High Energy & Nuclear Physics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Health & Medical Sciences (AREA)
  • Toxicology (AREA)
  • Chemical & Material Sciences (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Semiconductor Integrated Circuits (AREA)
  • Insulated Gate Type Field-Effect Transistor (AREA)

Abstract

본 발명의 반도체소자의 불순물영역 저항 조절방법은, 기판에 불순물이온의 주입을 0°주입방법으로 수행하는 단계와, 불순물이온이 주입된 기판에 대해 급속열처리를 수행하여 불순물영역을 형성하되, 급속열처리는 온도증가에 따라 불순물영역의 저항이 증가하는 온도범위 내에서 온도를 증가하면서 수행하는 단계를 포함한다.
불순물영역, 급속열처리(RTA), 문턱전압, 저항, 0°이온주입

Description

반도체소자의 불순물영역 저항 조절방법{Method of controling the sheet resistance in impurity region of semiconductor device}
도 1 및 도 2는 본 발명의 일 실시예에 따른 반도체소자의 불순물영역 저항 조절방법을 설명하기 위하여 나타내 보인 단면도들이다.
도 3 및 도 4는 도 2의 급속열처리공정을 설명하기 위하여 나타내 보인 도면들이다.
도 5는 도 3의 급속열처리장치에서의 온도에 따른 면저항 변화를 나타내 보인 그래프이다.
도 6은 도 4의 급속열처리장치에서의 온도에 따른 면저항 변화를 나타내 보인 그래프이다.
도 7은 본 발명의 다른 실시예에 따른 반도체소자의 불순물영역 저항 조절방법을 설명하기 위하여 나타내 보인 단면도이다.
본 발명은 반도체소자에 관한 것으로서, 특히 반도체소자의 불순물영역 저항 조절방법에 관한 것이다.
일반적으로 디램(DRAM; Dynamic Random Access Memory)과 같은 반도체소자는 여러가지 능동소자들과 수동소자들로 이루어진다. 능동소자들 중 대표적인 것으로는 트랜지스터(transistor)가 있으며, 수동소자들 중 대표적인 것으로는 레지스터(resistor)가 있다. 특히 트랜지스터는 증폭기(amplifier)로 작용하기도 하고, 또는 스위칭(switching) 소자로 작용하기도 한다. 어느 경우이던지 트랜지스터가 갖는 저항은 반도체소자의 여러 성능에 큰 영향을 준다.
일반적으로 트랜지스터가 갖는 저항은 낮을수록 좋다. 트랜지스터가 갖는 저항이 낮을수록 전류구동능력이 향상되기 때문이다. 따라서 트랜지스터를 형성하는데 있어서 그 저항을 줄이기 위하여, 불순물영역 형성을 위한 이온주입시 도즈(dose)량을 증가시키고, 또한 열처리시 온도와 시간을 증가시키는 방법이 사용되고 있다. 이는 도즈량이 증가되고, 열처리시 온도와 시간을 증가시키면 저항이 감소하는 것으로 알려져 있기 때문이다.
그런데 경우에 따라서 트랜지스터가 높은 저항을 가질것이 요구되기도 한다. 일 예로서, 여러개의 소자들이 다단계(multi-stage)로 배치될 때, 일정 소자들의 입력 임피던스(impedance)가 높아야 하는 경우가 있다. 이 경우에는 트랜지스터의 저항을 일정 크기로 증가시켜야 할 필요가 있다. 트랜지스터의 저항을 증가시키기 위해서는 주입되는 불순물이온의 도즈를 감소시켜야 하는데, 이 경우에는 문턱전압이 증가하고, 문턱전압이 증가하면 소모전력이 증가하는 등 소자에 나쁜 영향을 끼친다. 따라서 문턱전압의 증가없이, 즉 불순물이온의 도즈량 감소 없이 트랜지스터의 저항을 증가시키기 위히서는, 제조단계에서의 공정적인 해결보다는 다른 여러가 지 설계적인 방법들을 사용하고 있는 실정이다.
본 발명이 이루고자 하는 기술적 과제는, 문턱전압의 증가없이 공정적인 방법으로 반도체소자의 불순물영역에서의 저항을 증대시키는 방법을 제공하는 것이다.
본 발명의 일 실시예에 따른 반도체소자의 불순물영역 저항 조절방법은, 기판에 불순물이온의 주입을 0°주입방법으로 수행하는 단계; 및 상기 불순물이온이 주입된 기판에 대해 급속열처리를 수행하여 불순물영역을 형성하되, 상기 급속열처리는 온도증가에 따라 상기 불순물영역의 저항이 증가하는 온도범위 내에서 온도를 증가하면서 수행하는 단계를 포함한다.
상기 불순물이온은 As, BF2, B, P 또는 In을 포함할 수 있다.
상기 급속열처리는 서셉터 타입 또는 램프 타입 장비에서 수행할 수 있다.
상기 급속열처리를 수행하는 온도범위는 800℃ 내지 900℃일 수 있다.
상기 급속열처리는 산소 분위기에서 수행할 수 있다.
상기 급속열처리는 수소 분위기에서 수행할 수도 있다.
본 발명의 다른 실시예에 따른 반도체소자의 불순물영역 저항 조절방법은, 기판에 불순물이온을 주입하되, 상기 불순물이온의 주입은 0°주입방법과 일정 각도의 경사를 갖는 틸트 주입방법을 혼합하여 수행하는 단계; 및 상기 불순물이온이 주입된 기판에 대해 급속열처리를 수행하여 불순물영역을 형성하되, 상기 급속열처리는 온도증가에 따라 상기 불순물영역의 저항이 증가하는 온도범위 내에서 수행하는 단계를 포함한다.
상기 틸트 주입방법의 경사 각도는 7°로 설정할 수 있다.
상기 불순물이온의 전체 도즈 중 일부는 상기 0°주입방법으로 주입하고, 상기 전체 도즈 중 나머지는 상기 틸트 주입방법으로 주입할 수 있다.
상기 급속열처리를 수행하는 온도범위는 800℃ 내지 900℃일 수 있다.
이하 첨부도면을 참조하면서, 본 발명의 실시예들을 보다 상세하게 설명하기로 한다.
도 1 및 도 2는 본 발명의 일 실시예에 따른 반도체소자의 불순물영역 저항 조절방법을 설명하기 위하여 나타내 보인 단면도들이다.
먼저 도 1을 참조하면, 실리콘기판과 같은 반도체기판(100)에 불순물이온(110)을 주입한다. 이때 불순물이온(110) 주입은 통상의 이온주입방법에 의해 수행하며, 다만 도면에서 화살표(150)로 나타낸 바와 같이, 불순물이온(110)의 주입각도가 0°가 되도록 하는 0°이온주입방법을 사용하여 불순물이온(110)을 주입한다. 불순물이온(110)을 0°이온주입방법으로 주입하면, 후속의 급속열처리(RTA; Rapid Thermal Annealing)를 수행하는 과정에서 일정 온도 범위에서는 온도를 증가시켜도 불순물영역의 면저항(Rs; sheet resistance)이 증가되는 현상이 발생한다. 불순물이온으로는 As, BF2, B, P 또는 In을 포함할 수 있다.
다음에 도 2를 참조하면, 불순물이온(도 1의 110)이 주입된 반도체기판(100)에 대해 급속열처리(RTA)를 수행하여 주입된 불순물이온(도 1의 110)을 활성화시키면서 동시에 확산되도록 하여 불순물영역(112)이 형성되도록 한다. 앞서 언급한 바와 같이, 불순물이온(도 1의 110)의 주입을 0°이온주입방법으로 수행하였으므로, 온도가 증가할수록 불순물영역(112)에서의 면저항(Rs)이 증가하는 온도범위 내에서 급속열처리(RTA)를 수행하게 되면 불순물영역(112)에서의 면저항(Rs)은 증가된다. 상기 급속열처리(RTA)는 산소 분위기에서 수행하거나, 또는 수소 분위기에서 수행할 수도 있다. 산소 분위기에서 급속열처리(RTA)를 수행할 경우, 급속열처리(RTA) 수행 후에 표면에 형성된 얇은 산화막을 제거하는 세정을 수행할 수 있다. 수소 분위기에서 급속열처리(RTA)를 수행할 경우, 수소가 불순물이온, 예컨대 보론(B)의 비활성화(deactivation)을 유도하며, 이에 따라 저항이 증가하는 효과가 발생된다.
도 3 및 도 4는 도 2의 급속열처리공정을 설명하기 위하여 나타내 보인 도면들이다. 그리고 도 5 및 도 6은 각각 도 3 및 도 4의 급속열처리장치에서의 온도에 따른 면저항 변화를 나타내 보인 그래프이다.
먼저 도 3은 서셉터(susceptor) 타입의 급속열처리장치(300)를 나타내 보인 것이다. 서셉터 타입의 급속열처리장치(300)의 하부에는 서셉터(310)가 배치된다. 그리고 서셉터(310) 위에는 불순물이온(도 1의 110)이 주입된 반도체기판(100)이 배치된다. 비록 도면에 나타내지는 않았지만, 서셉터(310) 내에는 히터(heater)와 같은 열공급장치(미도시)가 배치되며, 이 열공급장치에 의해 반도체기판(100)에 열이 공급된다. 이와 같은 서셉터 타입의 급속열처리장치(300)에서 급속열처리(RTA) 를 수행하게 되면, 0°이온주입에 의해 불순물이온을 주입한 경우에서와 틸트(tilt) 이온주입에 의해 불순물이온을 주입한 경우에서의 온도증가에 따른 면저항 변화가 다르게 나타난다.
구체적으로 도 5에 나타낸 바와 같이, 통상의 틸트 이온주입에 의해 불순물이온을 주입한 경우(510으로 나타낸 선 참조), a에서 c까지의 온도범위 내에서 온도가 증가할수록 면저항(Rs)은 감소한다. 그러나 0°이온주입에 의해 불순물이온을 주입한 경우(520)으로 나타낸 선 참조), a에서 c까지의 온도범위 내에서 온도가 증가할수록 면저항(Rs)이 증가하는 현상이 발생하며, 특히 이 현상은 a에서 b까지의 온도범위 내에서 현격하게 발생한다. 따라서 0°이온주입방법에 의해 불순물이온을 주입한 후, 서셉터 타입의 급속열처리장치(300)에서의 급속열처리(RTA)를 a에서 c까지의 온도범위 내에서 온도를 증가시키면서 수행할 경우 불순물영역에서의 면저항(Rs)은 감소하는 것이 아니라 오히려 증가된다. 아스나이드(As)를 120KeV의 주입에너지 및 1013의 도즈로 0°이온주입을 수행한 후에, 도 3의 급속열처리장치(300)에서의 급속열처리(RTA)를 20초동안 수행한 시뮬레이션 결과, 온도 a는 대략 855℃로 관측되었고, 온도 b는 대략 880℃로 관측되었으며, 그리고 온도 c는 대략 905℃로 관측되었다. 따라서 급속열처리(RTA) 후에 면저항(Rs)을 증가시키기 위해서는 대략 800℃ 내지 900℃의 온도범위에서 온도를 증가시키면서 급속열처리(RTA)를 수행하면 된다.
다음에 도 4는 램프(ramp) 타입의 급속열처리장치(400)를 나타내 보인 것이 다. 램프 타입의 급속열처리장치(400)의 하부에는 지지대(410)가 배치된다. 그리고 지지대(410) 위에는 불순물이온(도 1의 110)이 주입된 반도체기판(100)이 배치된다. 램프 타입의 급속열처리장치(400)의 상부에는 램프(420)가 배치된다. 램프(420)는 일정 증가율로 증가되는 열을 발생시키고, 이 열은 반도체기판(100)에 공급된다. 이와 같은 램프 타입의 급속열처리장치(400)에서 급속열처리(RTA)를 수행하게 되면, 0°이온주입에 의해 불순물이온을 주입한 경우에서와 틸트(tilt) 이온주입에 의해 불순물이온을 주입한 경우에서의 온도증가에 따른 면저항 변화가 다르게 나타난다.
구체적으로 도 6에 나타낸 바와 같이, 통상의 틸트 이온주입에 의해 불순물이온을 주입한 경우(610으로 나타낸 선 참조), d에서 f까지의 온도범위 내에서 온도가 증가할수록 면저항(Rs)은 감소한다. 그러나 0°이온주입에 의해 불순물이온을 주입한 경우(620)으로 나타낸 선 참조), d에서 f까지의 온도범위 내에서 온도가 증가할수록 면저항(Rs)이 증가하는 현상이 발생하며, 특히 이 현상은 e에서 f까지의 온도범위 내에서 현격하게 발생한다. 따라서 0°이온주입방법에 의해 불순물이온을 주입한 후, 램프 타입의 급속열처리장치(400)에서의 급속열처리(RTA)를 d에서 f까지의 온도범위 내에서 온도를 증가시키면서 수행할 경우 불순물영역에서의 면저항(Rs)은 감소하는 것이 아니라 오히려 증가된다. 아스나이드(As)를 120KeV의 주입에너지 및 1013의 도즈로 0°이온주입을 수행한 후에, 도 4의 급속열처리장치(400)에서의 급속열처리(RTA)를 20초동안 수행한 시뮬레이션 결과, 온도 d는 대략 850℃ 로 관측되었고, 온도 e는 대략 875℃로 관측되었으며, 그리고 온도 f는 대략 900℃로 관측되었다. 따라서 급속열처리(RTA) 후에 면저항(Rs)을 증가시키기 위해서는 대략 800℃ 내지 900℃의 온도범위에서 온도를 증가시키면서 급속열처리(RTA)를 수행하면 된다.
도 7은 본 발명의 다른 실시예에 따른 반도체소자의 불순물영역 저항 조절방법을 설명하기 위하여 나타내 보인 단면도이다.
도 7을 참조하면, 본 실시예는 불순물이온 주입시 0°이온주입과 틸트 이온주입을 혼합하여 수행한다는 점에서 도 1 및 도 2를 참조하여 설명한 앞선 실시예와 상이하다. 구체적으로 반도체기판(100)에 불순물이온(110)을 주입할 때, 전체 도즈 중 일부 도즈는, 도면에서 화살표(150)로 나타낸 바와 같이, 0°이온주입방법으로 주입한다. 그리고 전체 도즈 중 이미 주입된 도즈를 뺀 나머지 도즈는, 도면에서 화살표(170)로 나타낸 바와 같이, 일정한 경사 각도를 갖는 틸트 이온주입방법으로 주입한다. 틸트 이온주입방법을 사용한 이온주입시 경사각도는 7°가 되도록 한다. 경우에 따라서는 7°와 그 외의 다른 각도로 복수회 수행되도록 할 수도 있다. 이 경우에도 0°이온주입방법에 의해 일부 도즈만큼 불순물이온이 주입되었으므로, 도 5 및 도 6을 참조하여 설명한 바와 같이, 일정 온도 범위 내에서 온도를 증가시켜면서 급속열처리(RTA)를 수행하더라도 불순물영역에서의 면저항(Rs)을 오히려 증가시킬 수 있게 된다.
지금까지 설명한 바와 같이, 본 발명에 따른 반도체소자의 불순물영역 저항 조절방법에 따르면, 불순물이온 주입시 0°이온주입을 포함한 방법으로 주입한 후에 일정 온도 범위 내에서 온도를 증가시키면서 급속열처리를 수행함으로써, 급속열처리에 의한 문턱전압을 낮추는 동시에 불순물영역에서의 면저항을 증가시킬 수 있다.

Claims (10)

  1. 기판에 불순물이온의 주입을 0°주입방법으로 수행하는 단계; 및
    상기 불순물이온이 주입된 기판에 대해 급속열처리를 수행하여 불순물영역을 형성하되, 상기 급속열처리는 온도증가에 따라 상기 불순물영역의 저항이 증가하는 온도범위 내에서 온도를 증가하면서 수행하는 단계를 포함하는 반도체소자의 불순물영역 저항 조절방법.
  2. 제1항에 있어서,
    상기 불순물이온은 As, BF2, B, P 또는 In을 포함하는 반도체소자의 불순물영역 저항 조절방법.
  3. 제1항에 있어서,
    상기 급속열처리는 서셉터 타입 또는 램프 타입 장비에서 수행하는 반도체소자의 불순물영역 저항 조절방법.
  4. 제1항에 있어서,
    상기 급속열처리를 수행하는 온도범위는 800℃ 내지 900℃인 반도체소자의 불순물영역 저항 조절방법.
  5. 제1항에 있어서,
    상기 급속열처리는 산소 분위기에서 수행하는 반도체소자의 불순물영역 저항 조절방법.
  6. 제1항에 있어서,
    상기 급속열처리는 수소 분위기에서 수행하는 반도체소자의 불순물영역 저항 조절방법.
  7. 기판에 불순물이온을 주입하되, 상기 불순물이온의 주입은 0°주입방법과 일정 각도의 경사를 갖는 틸트 주입방법을 혼합하여 수행하는 단계; 및
    상기 불순물이온이 주입된 기판에 대해 급속열처리를 수행하여 불순물영역을 형성하되, 상기 급속열처리는 온도증가에 따라 상기 불순물영역의 저항이 증가하는 온도범위 내에서 수행하는 단계를 포함하는 반도체소자의 불순물영역 저항 조절방법.
  8. 제7항에 있어서,
    상기 틸트 주입방법의 경사 각도는 7°로 설정하는 반도체소자의 불순물영역 저항 조절방법.
  9. 제7항에 있어서,
    상기 불순물이온의 전체 도즈 중 일부는 상기 0°주입방법으로 주입하고, 상기 전체 도즈 중 나머지는 상기 틸트 주입방법으로 주입하는 반도체소자의 불순물영역 저항 조절방법.
  10. 제7항에 있어서,
    상기 급속열처리를 수행하는 온도범위는 800℃ 내지 900℃인 반도체소자의 불순물영역 저항 조절방법.
KR1020070065847A 2007-06-29 2007-06-29 반도체소자의 불순물영역 저항 조절방법 KR100955674B1 (ko)

Priority Applications (1)

Application Number Priority Date Filing Date Title
KR1020070065847A KR100955674B1 (ko) 2007-06-29 2007-06-29 반도체소자의 불순물영역 저항 조절방법

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
KR1020070065847A KR100955674B1 (ko) 2007-06-29 2007-06-29 반도체소자의 불순물영역 저항 조절방법

Publications (2)

Publication Number Publication Date
KR20090002485A KR20090002485A (ko) 2009-01-09
KR100955674B1 true KR100955674B1 (ko) 2010-05-06

Family

ID=40485475

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1020070065847A KR100955674B1 (ko) 2007-06-29 2007-06-29 반도체소자의 불순물영역 저항 조절방법

Country Status (1)

Country Link
KR (1) KR100955674B1 (ko)

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11163387A (ja) 1997-11-21 1999-06-18 Osaka Gas Co Ltd 受光素子、紫外線受光素子の製造方法及び受光素子

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11163387A (ja) 1997-11-21 1999-06-18 Osaka Gas Co Ltd 受光素子、紫外線受光素子の製造方法及び受光素子

Also Published As

Publication number Publication date
KR20090002485A (ko) 2009-01-09

Similar Documents

Publication Publication Date Title
US5989963A (en) Method for obtaining a steep retrograde channel profile
WO2016203545A1 (ja) 半導体装置の製造方法
US4502205A (en) Method of manufacturing an MIS type semiconductor device
US6214707B1 (en) Method of forming a doped region in a semiconductor substrate
JP2004289154A (ja) 超浅型接合のための接合狭小化用相補インプラント
JP2002502124A (ja) アニール中制御された低レベル酸素周囲を使用して半導体ウエーハに浅部ジャンクションを形成する方法
US7994016B2 (en) Method for obtaining quality ultra-shallow doped regions and device having same
KR100955674B1 (ko) 반도체소자의 불순물영역 저항 조절방법
US7947559B2 (en) Method of fabricating semiconductor device
KR100429556B1 (ko) 채널 특성을 개선시킨 반도체소자의 제조 방법
KR100524465B1 (ko) 반도체소자의 제조방법
KR100746622B1 (ko) 모스 트랜지스터 제조방법
KR100870324B1 (ko) 반도체 소자의 제조방법
KR20090056671A (ko) 웨이퍼를 어닐링하는 급속 열처리 장치 및 방법
US6383901B1 (en) Method for forming the ultra-shallow junction by using the arsenic plasma
JPH10233457A (ja) 半導体装置の製造方法
KR100468695B1 (ko) 짧은채널효과를개선시키기위한채널도우핑프로파일을갖는고성능모스트랜지스터제조방법
KR100702131B1 (ko) 반도체 소자의 제조방법
KR100587074B1 (ko) 반도체 장치의 트랜지스터 형성 방법
JP2000091260A (ja) 半導体製造方法
KR100552853B1 (ko) n채널형 모스 트랜지스터의 문턱 전압 조절을 위한불순물 주입 방법
JP2012004584A (ja) 回路製造方法、アニール制御方法、および情報記録媒体
KR20050110272A (ko) 플래쉬 메모리 소자의 문턱 전압 조절을 위한 이온 주입방법
KR20040007024A (ko) 반도체 소자의 접합영역 형성 방법
KR19990005877A (ko) 반도체 소자의 고부하 레지스터 제조방법

Legal Events

Date Code Title Description
A201 Request for examination
E902 Notification of reason for refusal
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
LAPS Lapse due to unpaid annual fee