KR100943854B1 - 구성가능한 능동/수동 믹서 및 공유된 ｇｍ 스테이지를위한 방법 및 시스템 - Google Patents

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Abstract

구성 가능한 능동/수동 믹서 및 공유된 GM(transconductance) 스테이지를 위한 방법 및 시스템의 측면들은 주파수 복조기에서의 RF 믹서가 능동 모드 또는 수동 모드로 동작가능하도록 구성하는 것을 포함한다. 상기 RF 믹서의 동위상(I) 처리 경로 및 직교(Q) 처리 경로는 단일 공유된 GM 스테이지를 이용한다. 하나 또는 그 이상의 스위치들은 상기 RF 믹서에 대하여 상기 능동 모드 또는 상기 수동 모드가 가능하도록 활성화될 수 있다.
능동, 수동, 공유, 스테이지, GM, 믹서, 복조기

Description

구성가능한 능동/수동 믹서 및 공유된 ＧＭ 스테이지를 위한 방법 및 시스템{METHOD AND SYSTEM FOR CONFIGURABLE ACTIVE/PASSIVE MIXER AND SHARED GM STAGE}
본 발명의 몇몇 실시예들은 전자 회로 설계 및 신호 처리에 관한 것이다. 좀더 상세하게는 본 발명의 몇몇 실시예들은 구성가능한 능동/수동 믹서 및 공유된 GM(transconductance) 스테이지에 관한 것이다.
무선 통신 시스템들에서, 수신된 무선 주파수(radio frequency :RF) 신호는 중간 주파수(intermediate frequency : IF)로 변환될 수 있으며, 그 다음 중간 주파수로부터 기저대역 기호로 변환될 수 있으며, 여기에서 중간 주파수는 메가 헤르츠 범위에 있을 수 있다. 몇몇 시스템들에 대하여는, RF로부터 기저대역으로 직접 변환되는 것이 가능할 수 있다. 일반적으로 RF 신호는 두 신호들의 주파수들과 상기 두 신호들의 차이에 대한 합이 되는 두(더블)측대역 신호들을 가져오는 국부 발진기 신호와 혼합될 수 있는데, 여기에서 상기 차이는 "비트 주파수"(beat frequency)라고 종종 불린다. 상기 더 낮은 주파수 성분(lower frequency component)은 전형적으로 상기 신호에 대한 추가 처리를 필요로 하는 신호이다. 상 기 두 측대역 신호들 중 하나는 IF 신호로 선택될 수 있으며, 이 IF 신호는 모든 수신된 RF 신호들에 대하여 동일할 수 있다. 그러므로, 무선 LAN 무선장치와 같은 복수의 채널들을 수신할 수 있는 무선 장치(radio)는 상기 IF가 동일하게 남아있도록 상기 국부 발진기 신호 주파수를 변경함으로써 11 표준 채널들 중 하나에 상응하는 특정 주파수에 동조할 수 있다. 일정한 IF를 가지는 경우, 수신 경로의 대부분은 수신기에서 공통일 수 있다.
오늘날, 무선 수신기의 많은 발전은 주로 핸드셋을 포함하는 이동 무선 통신 디바이스들에 대한 막대한 요구에 의해 추진되어 왔다. 이동 핸드셋들의 계속적으로 축소되는 크기와 함께, 작아지는 배터리들의 용량들이 관심거리가 될 수 있다. 이들 핸드셋들의 대부분은 아날로그-디지털 변환을 위해, 그리고 음성 및 데이터 신호들의 처리의 대부분을 위해 CMOS(complementary metal-oxide semiconductor) 기술을 사용함에 따라, 고려해야할 아주 중요한 인자는 CMOS 디바이스들이 낮은 주파수들에서 동작하는 것이 유리할 수 있다는 점이다. 이것은 CMOS 디바이스들은 상기 CMOS 디바이스들이 스위칭하는 속도에 직접적으로 관련된 전력 소모를 가지기 때문에 결정적일 수 있다. 상기 주파수들이 빠를수록, 상기 CMOS 디바이스 스위칭 속도가 빠를수록, 소모되는 전력의 양은 많아진다. 그러므로, 수신기들은 기가헤르츠 범위에 있을 수 있는 고주파 RF를 낮은 주파수, 바람직하게는 기저대역 주파수로 가능한 한 빠르게 하향변환하도록 설계될 수 있다.
주파수의 하향 변환의 동작 외에, 상기 복조 회로는 또한 동위상(I) 채널을 직교(Q) 채널로부터 분리한다. 상기 수신된 RF 신호는 상기 캐리어 주파수에서 코사인(cosine)상으로 변조된 성분 및 상기 캐리어 주파수에서 사인(sine)상으로 변조된 성분의 합으로써 기록될 수 있다. 사인파는 90도 위상 이동을 가지고 코사인과 등가이기 때문에, 상기 코사인을 변조하는 성분은 동위상(I) 성분이라고 하고, 상기 사인을 변조하는 항은 직교 성분이라고 한다.
상기 채널의 분리는 상기 수신된 신호와 상기 언급된 국부 발진기를 곱함으로써 달성될 수 있다. 이 동작의 상기 기저대역 성분은 I 채널로서 처리된다. 상기 Q 채널을 얻기 위해, 상기 수신된 신호는 90도 위상 이동된 상기 국부 발진기 신호와 곱해질 수 있다.
고려해야할 다른 중요점은 신호 경로에서의 신호 무결성(signal integrity)일 수 있다. 수신기의 안테나에서 수신된 신호들은 예를 들어 6mV로 매우 약하기 때문에, 상기 수신된 신호를 처리해야 할 제1 구성요소는 증폭될 신호에 대하여 매우 작은 추가 잡음이 더해지는 동안, 신호들을 증폭하기 위해 설계된 저잡음 증폭기(LNA)일 수 있다. 상기 증폭된 신호는 원하지 않는 신호들을 감쇄시키기 위해 필터링되고, 상기 신호의 세기를 증가시키기 위해 추가적으로 증폭되며, 더 낮은 주파수들로 하향변환하기 위해 국부 발진기 신호들과 혼합될 수 있다. PVT(process, voltage and temperature) 변화량(variations)과 같은 인자들은 또한 DC 오프셋을 초래할 수 있다.
전력 소모에 대한 제한점들로 인해, 특히 이동 통신 단말에 대하여, 구성요소들의 수 및 아날로그 RF 회로를 위해 필요한 다이(die) 영역을 줄이는 것은 결정적이다. 구성요소들, 특별히 능동 구성요소들을 적게 하는 것은 상기 회로들이 쉬 고 있을 때, 바이어싱 전류들을 줄임으로써 열 소실(heat dissipation)을 낮게 유지할 수 있으며 전력 소모를 줄일 수 있다. 또한 몇몇 아날로그 구성요소들은 집적 회로들상에서 부적절하게 차지하는 공간의 양을 차지할 수 있으며, 그러므로 그들의 이용이 최소로 될 수 있는 것은 매우 의미가 있다. 예들은 인덕터들과 큰 용량의 커패시터들이다.
나아가, 종래의 전형적인 접근들이 가지는 한계점들과 단점들은 종래의 시스템들과 본 출원의 나머지 부분들에서 도면들을 참조하여 전개될 본 발명의 몇몇 측면들의 비교를 통해 당해 기술분야의 숙련된 자에게 명백해질 것이다.
본 발명이 해결하고자 하는 과제는 구성가능한 능동/수동 믹서 및 공유된 GM(transconductance) 스테이지를 위한 방법 및 시스템을 제공하는 것이다.
본 발명에 따른 구성 가능한 능동/수동 믹서 및 공유된 GM 스테이지를 위한 방법 및/또는 시스템은 실질적으로 적어도 하나의 도면들과 연관하여 보여지거나 설명되는 것처럼 청구범위에서 좀더 완전하게 전개될 것이다.
본 발명의 일측면에 의하면, 통신 시스템에서 신호들을 처리하기 위한 방법은 주파수 복조기에서의 RF 믹서가 능동 모드 또는 수동 모드로 동작하도록 구성하는 단계를 포함한다.
바람직하게는, 상기 방법은 상기 주파수 복조기에서의 상기 RF 믹서의 하나 또는 그 이상의 믹서 스테이지들을 수동 구성으로부터 능동 구성으로 변환하는 단계를 더 포함한다.
바람직하게는, 상기 방법은 상기 RF 믹서의 동위상(I) 처리 경로 및 직교(Q) 처리 경로에 의해 단일 GM(transconductance) 스테이지를 공유하는 단계를 더 포함한다.
바람직하게는, 상기 방법은 상기 RF 믹서에 대하여 상기 능동 모드 또는 상기 수동 모드의 동작이 가능하도록 하나 또는 그 이상의 스위치들을 활성화시키는 단계를 더 포함한다.
바람직하게는, 상기 방법은 상기 주파수 복조기가 상기 능동 모드로 동작하도록 구성되는 경우, 광대역 변조된 신호들을 처리하는 단계를 더 포함한다.
바람직하게는, 상기 방법은 상기 주파수 복조기가 상기 수동 모드로 동작하도록 구성되는 경우, 협대역 변조된 신호들을 처리하는 단계를 더 포함한다.
본 발명의 다른 측면에 의하면, 통신 시스템에서 신호들을 처리하기 위한 시스템이 제공되며, 상기 시스템은 주파수 복조기에서의 RF 믹서가 능동 모드 또는 수동 모드로 동작하도록 구성하는 하나 또는 그 이상의 회로들을 포함한다.
바람직하게는, 상기 하나 또는 그 이상의 회로들은 상기 주파수 복조기에서의 상기 RF 믹서의 하나 또는 그 이상의 믹서 스테이지들이 수동 구성으로부터 능동 구성으로 변환하는 것을 가능하게 한다.
바람직하게는, 상기 시스템은 상기 RF 믹서의 동위상(I) 처리 경로 및 직교(Q) 처리 경로에 의해 공유되는 단일 GM 스테이지를 더 포함한다.
바람직하게는, 상기 하나 또는 그 이상의 회로들은 상기 RF 믹서에 대하여 상기 능동 모드 또는 상기 수동 모드의 동작이 가능하도록 하나 또는 그 이상의 스위치들을 활성화시킨다.
바람직하게는, 상기 시스템은 상기 주파수 복조기가 상기 능동 모드로 동작하도록 구성되는 경우, 광대역 변조된 신호들을 처리하는 것을 더 포함한다.
바람직하게는, 상기 시스템은 상기 주파수 복조기가 상기 수동 모드로 동작하도록 구성되는 경우, 협대역 변조된 신호들을 처리하는 것을 더 포함한다.
본 발명의 이러한 장점들 및 다른 장점들과 신규한 특징들은 본 발명의 도시된 실시예들의 상세한 사항들뿐만 아니라 하기의 상세한 설명 및 도면으로부터 더 잘 이해될 것이다.
본 발명에 의하면, 구성가능한 능동/수동 믹서 및 공유된 GM 스테이지를 위한 방법 및 시스템을 제공할 수 있다.
본 발명의 몇몇 실시예들은 구성가능한 능동/수동 믹서 및 공유된 GM 스테이지를 위한 방법 및 시스템에 관한 것이다. 본 발명의 몇몇 측면들은 주파수 복조기에서의 RF 믹서가 능동 모드 또는 수동 모드로 동작하도록 구성하는 것을 포함한다. 상기 RF 믹서의 동위상(I) 처리 경로 및 직교(Q) 처리 경로는 단일 공유된 GM 스테이지를 이용할 수 있다. 상기 주파수 복조기에서의 상기 RF 믹서의 하나 또는 그 이상의 믹서 스테이지들은 수동 구성으로부터 능동 구성으로 변환될 수 있다. 하나 또는 그 이상의 스위치들은 상기 RF 믹서에 대하여 상기 능동 모드 또는 수동 모드의 동작이 가능하도록 활성화될 수 있다.
도 1a는 본 발명의 일실시예에 따른 대표적인 무선 단말을 예시하는 블록도이다. 도 1a를 참조하면, RF 수신기(153a), RF 송신기(153b), 디지털 기저대역 프로세서(159), 프로세서(155), 및 메모리(157)를 포함하는 무선 단말(150)이 도시되어 있다. 본 발명의 몇몇 실시예들에서, RF 수신기(153a) 및 RF 송신기(153b)는 예를 들어 RF 송수신기(152)내에 통합화될 수 있다. 단일 송신 및 수신 안테나(151a)는 RF 수신기(153a) 및 RF 송신기(153b)에 통신가능하게 결합될 수 있다. 스위치 또는 스위칭 기능들을 가지는 디바이스(153c)가 RF 수신기(153a) 및 RF 송신기(153b)의 사이에 결합될 수 있으며, 송신 및 수신 기능들 사이에서 상기 안테나를 스위칭하기 위해 사용될 수 있다. 무선 단말(150)은 예를 들어 WLAN(Wireless Local Area Network), 셀룰러망 및/또는 디지털 비디오 브로드캐스트 네트워크와 같은 시스템에서 동작될 수 있다. 이러한 면에서, 무선 단말(150)은 WLAN 망들을 위한 IEEE 802.11n 표준 스펙들을 포함하는 복수의 무선 통신 프로토콜들을 지원할 수 있다.
RF 수신기(153a)는 수신된 RF 신호들을 처리할 수 있는 적절한 로직, 회로, /또는 코드를 포함한다. RF 수신기(153a)는 무선 단말(150)에 의해 지원될 수 있는 무선 통신 프로토콜들에 따라 복수의 주파수 대역들에서의 RF 신호들을 수신할 수 있다. RF 수신기(153a)에 의해 지원되는 각 주파수 대역은 예를 들어 저잡음 증폭 및 하향 변환 동작들을 핸들링하기 위해 해당 프론트-엔드(front-end) 회로를 구비할 수 있다. 이러한 면에서, RF 수신기(153a)는 하나 이상의 주파수 대역을 지원할 때, 멀티-대역 수신기(multi-band receiver)라고 할 수 있다. 본 발명의 다른 실시예에서, 무선 단말(150)은 하나 이상의 RF 수신기(153a)를 포함할 수 있으며, 여기에서 RF 수신기(153a)의 각각은 단일 대역 또는 멀티 대역 수신기일 수 있다. RF 수신기(153a)는 칩상에 구현될 수 있다. 본 발명의 일실시예에서, RF 수신기(153a)는 예를 들어 칩상에서 RF 송신기(153b)와 통합화되어 RF 송수신기(152)를 구성할 수 있다. 본 발명의 다른 실시예에서, RF 수신기(153a)는 무선 단말(150)에서 하나 이상의 구성요소들과 칩상에서 통합화될 수 있다.
RF 수신기(153a)는 수신된 RF 신호를 동위상(I) 성분 및 직교(Q) 성분을 포함하는 기저대역 주파수 신호로 직교 하향 변환할 수 있다. RF 수신기(153a)는 예를 들어 수신된 RF 신호를 기저대역 신호로 직접 하향 변환할 수 있다. 몇몇 예에서, RF 수신기(153a)는 상기 기저대역 신호 성분들을 디지털 기저대역 프로세서(159)로 전달하기 전에 상기 기저대역 신호 성분들의 아날로그-디지털 변환을 가능하게 할 수 있다. 다른 예들에서, RF 수신기(153a)는 상기 기저대역 신호 성분들을 아날로그 형태로 전달할 수 있다.
디지털 기저대역 프로세서(159)는 기저대역 주파수 신호들의 처리 및/또는 핸들링이 가능할 수 있는 적절한 로직, 회로, 및/또는 코드를 포함할 수 있다. 이러한 면에서, 디지털 기저대역 프로세서(159)는 RF 수신기(153a)로부터 수신된 신호들 및/또는 상기 망에 전송하기 위해 RF 송신기(153b)가 존재하는 경우 상기 RF 송신기(153b)에 전달될 신호들을 처리 또는 핸들링할 수 있다. 디지털 기저대역 프로세서(159)는 상기 처리된 신호들로부터의 정보에 기반하여 제어 및/또는 피드백 정보를 RF 수신기(153a) 및 RF 송신기(153b)에 또한 제공할 수 있다. 디지털 기저대역 프로세서(159)는 상기 처리된 신호들로부터의 정보 및/또는 데이터를 프로세서(155) 및/또는 메모리(157)에 또한 통신할 수 있다. 더욱이, 디지털 기저대역 프로세서(159)는 프로세서(155)로부터의 및/또는 메모리(157)로의 정보를 수신할 수 있으며, 상기 정보는 처리되어 상기 망으로의 전송을 위해 RF 송신기(153b)에 전달될 수 있다. 본 발명의 일실시예에서, 디지털 기저대역 프로세서(159)는 무선 단말(150)에서의 하나 이상의 구성요소와 함께 칩상에 통합화될 수 있다.
RF 송신기(153b)는 전송을 위해 RF 신호들을 처리할 수 있는 적절한 로직, 회로, 및/또는 코드를 포함할 수 있다. RF 송신기(153b)는 복수의 주파수 대역들에서의 RF 신호들을 전송할 수 있다. RF 송신기(153b)에 의해 지원되는 각 주파수 대역은 예를 들어 증폭 및 상향 변환 동작들을 핸들링하기 위한 해당 프론트-엔드 회로를 구비할 수 있다. 이러한 면에서, RF 송신기(153b)는 하나 이상의 주파수 대역을 지원하는 경우 멀티-대역 송신기라고 할 수 있다. 본 발명의 다른 실시예에서, 무선 단말(150)은 하나 이상의 RF 송신기(135b)를 포함할 수 있으며, 여기에서 RF 송신기(153b)의 각각은 단일 대역 또는 멀티 대역 송신기일 수 있다. RF 송신기(153b)는 칩상에 구현될 수 있다. 본 발명의 일실시예에서, RF 송신기(153b)는 예를 들어 칩상에 RF 수신기(153a)와 함께 통합화되어 RF 송수신기(152)를 구성할 수 있다. 본 발명의 다른 실시예에서, RF 송신기(153b)는 무선 단말(150)에서의 하나 이상의 구성요소들과 함께 칩상에 통합될 수 있다.
RF 송신기(153b)는 I/Q 성분들을 포함하는 상기 기저대역 주파수 신호를 RF 신호로 직교 상향 변환할 수 있다. RF 송신기(153b)는 예를 들어 상기 기저대역 주파수 신호를 RF 신호로 직접 상향 변환할 수 있다. 몇몇 예들에서, RF 송신기(153b)는 상향 변환하기 전에 디지털 기저대역 프로세서(159)로부터 수신된 상기 기저대역 신호 성분들의 디지털-아날로그 변환을 가능하게 할 수 있다. 다른 예들에서, RF 송신기(153b)는 기저대역 신호 성분들을 아날로그 형태로 수신할 수 있다.
프로세서(155)는 무선 단말(150)을 위하여 제어 및/또는 데이터 처리 동작들을 가능하게 할 수 있는 적절한 로직, 회로, 및/또는 코드를 포함할 수 있다. 프로세서(155)는 RF 수신기(153a), RF 송신기(153b), 디지털 기저대역 프로세서(159), 및/또는 메모리(157)의 적어도 일부를 제어하는데 사용될 수 있다. 이러한 면에서, 프로세서(155)는 무선 단말(150)내에서 동작들을 제어하기 위한 적어도 하나의 신호를 생성할 수 있다. 예를 들어, 프로세서(155)는 적어도 하나의 제어 신호를 생성하는 것 및/또는 무선 단말(150)에서의 현재 또는 제안되는 WLAN 통신들을 가능하게 할 수 있는 어플리케이션들을 실행할 수 있다.
메모리(157)는 무선 단말(150)에 의해 이용될 수 있는 데이터 및/또는 다른 정보를 저장할 수 있는 적절한 로직, 회로, 및/또는 코드를 포함할 수 있다. 예를 들어, 메모리(157)는 디지털 기저대역 프로세서(159) 및/또는 프로세서(155)에 의해 생성된 처리된 데이터를 저장하기 위해 사용될 수 있다. 메모리(157)는 무선 단말(150)에서의 적어도 한 블록의 동작을 제어하기 위해 사용될 수 있는 구성 정보와 같은 정보를 저장하는데 또한 사용될 수 있다. 예를 들어, 메모리(157)는 적절 한 주파수 대역에서의 WLAN 신호들을 수신하기 위해 RF 수신기(153a)를 구성하는데 필요한 정보를 포함할 수 있다.
본 발명은 RF 수신기(153a)의 아날로그 신호 처리에 특별히 적용될 수 있다.
도 1b는 본 발명의 일실시예에 따른 대표적인 RF 프론트 엔드 구조를 예시하는 블록도이다. 도 1b를 참조하면, 안테나(160), 발룬(balun), 저잡음 증폭기(164), 및 복조기(166)가 도시되어 있다. 복조기(166)는 승산기들(168, 170)을 포함할 수 있다. 도 1b에 전압 신호들(VIP, VIN, VIP_MAIN, VIN_MAIN, TIA_OUT_IP, TIA_OUT_IN, TIA_OUT_QP, TIA_OUT_QN, VLOIN, VLOIP, VLOQP, 및 VLOQN)이 또한 도시되어 있다.
무선 주파수 통신 시스템들에서, 상기 수신된 신호는 전형적으로 상기 기저대역 신호의 대역폭보다 더 높을 수 있는 캐리어 주파수로 변조될 수 있는 정보-캐링(information carrying) 기저대역 신호를 포함할 수 있다. 그러므로, 상기 RF 수신기 프론트 엔드에서, 상기 수신된 신호를 복조함으로써 상기 캐리어로부터 상기 정보 캐링 기저대역 신호를 제거하는 것이 이용될 수 있다. 더욱이, 상기 수신된 RF 신호는 동위상 및 직교 위상 성분 모두를 포함할 수 있다. 이들 두 신호 성분들이 분리된 수신기 체인들에서 처리될 수 있음에 따라, 상기 동위상(I) 채널을 상기 직교(Q) 채널로부터 분리하는 것이 필요할 수 있다.
상기 수신된 신호는 안테나(160)에 캡쳐링될 수 있다. 상기 수신된 신호는 전형적으로 언밸런스(unbalanced)한 신호일 수 있으며, 그로 인하여 발룬(162)으로 공급되어 후속 처리를 위해 밸런스된(balanced) 신호로 변환될 수 있다. 발 룬(balun)은 bal-anced(밸런스된)과 un-balanced(언밸런스된)에 기반하여 조합된 말(word-construct)이다. 발룬들은 밸런스된 신호와 언밸런스된 신호간의 변환을 가능하게 하기 위해 아주 다양한 종류의 가능성있는 다른 구현들에서의 전자기적인 결합 디바이스들이다.
밸런스된 라인(balanced line)은 그라운드와 관련하여 신호를 전달하는 두 도전체들로 이루어진 전송선이다. 상기 신호들은 각각의 전자기장들이 서로 상쇄될 수 있도록 하는 방법으로 설계함으로써 그들이 함께 만들어내는 간섭을 최소화도록 설계될 수 있다. 예를 들어 상기 신호들은 서로의 역이 되도록 선택될 수 있다. 또한, 밸런스된 신호들은 간섭에 강한데, 이는 양 도전체들상에서 발생될 수 있는 간섭이 쉽게 제거될 수 있기 때문이다.
그러므로, 밸런스된 신호들(VIP 및 VIN)에 의해 주어진 발룬(162)의 상기 밸런스된 라인 출력은 후속 처리를 하기 전에 증폭을 위해 저잡음 증폭기(164)로 공급될 수 있다. 그 다음 상기 증폭된 신호들(VIP_MAIN 및 VIN_MAIN)은 복조기(166)에 공급될 수 있는데, 여기에서 상기 캐리어는 제거될 수 있으며, 상기 I 채널은 상기 Q 채널로부터 분리될 수 있다. 상기 신호의 복조 및 분리는 VIN_MAIN 및 VIN_MAIN에 주어진 입력 신호를 차동입력(VLOIP 및 VLOIN)에 의해 주어진 국부 발진기 신호와 곱함으로써 달성될 수 있다. 승산기(168)에서의 곱셈은 TIA_OUT_IP/TIA_OUT_IN상에서 I 채널에 대하여 밸런스된 출력 신호를 생성할 수 있으며, 승산기(170)에서 국부 발진기 신호의 위상 이동된 버전, 즉 VLOQP/VLOQN과의 곱셈은 Q 채널을 생성할 수 있다.
상기 국부 발진기 주파수는 상기 캐리어 주파수와 같을 수 있다. 일부 시스템들에서, 상기 복조는 제1 복조기가 상기 신호를 중간 주파수로 복조하고 이후 제2 복조기가 상기 신호를 기저대역 주파수로 복조하는 2 스테이지들(stages)에 의해 달성될 수 있다. 도 1b에서 상기 복조기(166)는 상기 캐리어 주파수와 동일한 복조 주파수를 사용할 수 있으며, 주어진 TIA_OUT_IP/TIA_OUT_IN에서 I 채널에 대하여, 주어진 TIA_OUT_QN/TIA_OUT_QP에 Q 채널에 대하여 기저대역 출력 신호를 생성할 수 있다.
도 2는 본 발명의 일실시예와 연관된 공유된 GM 스테이지를 가지는 동위상 채널 처리 체인 및 직교 채널 처리 체인의 대표적인 구조를 예시하는 블록도이다. 도 2를 참조하면, GM 스테이지(202), 부하(204), 결합 커패시터들(206, 208), 및 I 채널 처리 블록(210) 및 Q 채널 처리 블록(212)이 도시되어 있다. I 채널 처리 블록(210)은 격리 저항들(214 및 216), 및 믹서 블록(218)을 포함할 수 있다. Q 채널 처리 블록(212)은 격리 저항들(224, 226) 및 믹서 블록(228)을 포함할 수 있다. 도 2에는 입력 신호들(VIP_MAIN, VIN_MAIN, VIP_AUX, VIN_AUX, VLOIN, VLOIP, VLOQN 및 VLOQP), 전류들(IRFN, IRFP) 및 출력 전류들(ION, IOP, IOQP, IOQN)이 더 도시되어 있다. 공유된 GM 스테이지를 구비한 상기 동위상 채널 처리 체인 및 직교 채널 처리 체인은 도 1b에 도시된 복조기(166)에 사용될 수 있다.
차동 RF 입력 신호(VIP_MAIN/VIN_MAIN) 및 보조(auxiliary) GM 스테이지 선형화 신호들은 GM 스테이지(202)에 입력될 수 있다. GM 스테이지(202)의 차동 출력 전류(IRFN/IRFP)는 부하(204)에 공급될 수 있다. 커패시터(206)의 한 단자는 부하(204)의 IRFN 단자에 결합될 수 있다. 커패시터(206)의 다른 단자는 저항들(214 및 224)에 결합될 수 있다. 저항(214)의 다른 단자는 믹서(218)에 결합될 수 있다. 저항(224)의 다른 단자는 믹서(228)에 결합될 수 있다. 커패시터(208)의 한 단자는 부하(204)의 IRFN 단자에 결합될 수 있다. 커패시터(208)의 다른 단자는 저항들(216 및 226)에 결합될 수 있다. 저항(216)의 다른 단자는 믹서(218)에 결합될 수 있다. 저항(226)의 다른 단자는 믹서(228)에 결합될 수 있다. 차동 국부 발진기 신호(VLOIN/VLOIP)는 믹서(218)에 공급될 수 있으며, 믹서(218)의 차동 출력 전류들은 ION/IOP 일 수 있다. 차동 국부 발진기 신호(VLOQN/VLOQP)는 믹서(228)에 공급될 수 있으며, 믹서(228)의 차동 출력 전류들은 IOQN/IOQP 일 수 있다.
상기 I 채널은 도 1b에 대하여 설명된 바와 같이 상기 수신된 신호를 상기 국부 발진기 신호 및 위상 이동된 국부 발진기 신호를 각각 곱셈함으로써 Q 채널로부터 분리될 수 있다. 도 2로부터 I 채널 처리 및 Q 채널 처리의 동작들은 전류들(IRFN/IRFP)이 각각 처리 블록들(210 및 212)로 입력될 때까지 동일할 수 있음을 알 수 있다. 그러므로, 본 발명의 다양한 실시예들은 GM 스테이지 및 부하를 각각 포함하는 I 채널 및 Q 채널을 포함하는 2개의 전체적인 처리 체인들 대신에 공통 GM 스테이지(202), 코일형 부하(204) 및 결합 커패시터들(206 및 208)을 사용할 수 있다. 이것은 인덕터들을 포함하는 상기 부하 블록들 중 하나가 생략될 수 있기 때문에, 특히 집적된 회로에서 상기 회로를 구현하기 위해 필요한 영역을 현저하게 줄일 수 있다.
그러나, 공통 GM 스테이지(202)가 사용될 수 있는 경우들에서, 상기 Q 채널 믹서(228)로의 상기 I 채널 믹서(218)로부터 상기 국부 발진기 신호(VLOIN/VLOIP)의 누설 및 상기 I 채널 믹서(218)로의 상기 Q 채널 믹서(228)로부터 상기 위상 이동된 국부 발진기 신호(VLOQP/VLOQN)의 누설이 있을 수 있다. 따라서, 본 발명의 다양한 실시예들에서, 믹서(218)는 상기 신호 경로로의 작은 격리 저항들(214, 216, 224, 및 226)을 도입함으로써 도 2에 도시된 바와 같이 믹서(228)로부터 격리될 수 있다. 상기 격리 저항들은 상기 믹서들로부터의 상기 발진기 누설을 충분히 줄임에 반하여 상기 믹서들(218 및 228)에 대하여 입력 신호를 아주 작게 로딩하기 위해 작을 수 있다. 상기 복조기 회로의 잡음 수치는 상기 격리 저항들(214, 216, 224, 및 226)에 기인하여 낮아진다.
도 3은 본 발명의 일실시예에 따른 대표적인 능동 믹서 구조를 예시하는 블록도이다. 도 3을 참조하면, GM 스테이지(306), 부하(308), 결합 커패시터들(310, 312), 전류 소스들(318 및 320), 스위치들(314 및 316), 격리 저항들(322, 324., 326, 및 328), 및 능동 믹서 블록들(302 및 304)이 도시되어 있다. 능동 믹서 블록(302)은 수동 믹서(330), 공통 모드 피드백(CMFB) 블록(332), 및 스위치들(334 및 336)을 포함할 수 있다. 능동 믹서 블록(304)은 수동 믹서(340), 공통 모드 피드백(CMFB) 블록(342) 및 스위치들(344 및 346)을 포함할 수 있다. 도 3에는 전압 신호들(VIP_MAIN, VIN_MAIN, VIP_AUX, VIN_AUX, VLOIN, VLOIP, avss, VLOQP 및 VLOQN), 및 전류 신호들(I_bias, IRFN, IRFP, ION, IOP, IOQN 및 IOQP)이 또한 도시되어 있다.
차동 RF 입력 신호(VIP_MAIN/VIN_MAIN) 및 보조 GM 스테이지 선형화 신호들 이 GM 스테이지(306)에 입력될 수 있다. GM 스테이지(306)의 차동 출력 전류(IRFN/IRFP)는 부하(308)에 공급될 수 있다. 커패시터(310)의 한 단자는 부하(308)의 IRFN 단자에 결합될 수 있다. 커패시터(310)의 다른 단자는 저항들(322 및 326) 및 스위치(SW1)(316)에 결합될 수 있다. 저항(322)의 다른 단자는 믹서(330)에 결합될 수 있다. 저항(326)의 다른 단자는 믹서(340)에 결합될 수 있다. 스위치(SW1)(316)의 다른 단자는 전류 소스(318)에 결합될 수 있다. 전류 소스(318)의 다른 단자는 avss에 결합될 수 있다. 커패시터(312)의 한 단자는 부하(308)의 IRFN 단자에 결합될 수 있다. 커패시터(312)의 다른 단자는 저항들(324 및 328) 및 스위치(SW2)(314)에 결합될 수 있다. 저항(324)의 다른 단자는 믹서(330)에 결합될 수 있다. 저항(328)의 다른 단자는 믹서(340)에 결합될 수 있다. 스위치(SW2)(314)의 다른 단자는 전류 소스(320)에 연결될 수 있다. 전류 소스(320)의 다른 단자는 avss에 결합될 수 있다. 차동 국부 발진기 신호(VLOIN/VLOIP)는 믹서(330)로 공급되며, 믹서(330)의 차동 출력 전류들은 ION/IOP일 수 있다. ION은 스위치(SW3)(334)에 결합될 수 있다. 스위치(SW3)(334)의다른 단자는 CMFB 블록(332)에 결합될 수 있다. IOP는 스위치(SW4)(336)에 결합될 수 있다. 스위치(SW4)의 다른 단자는 CMFB 블록(332)에 결합될 수 있다. 차동 국부 발진기 신호(VLOQN/VLOQP)는 믹서(340)로 공급될 수 있으며, 믹서(340)의 차동 출력 전류들은 IOQN/IOQP 일 수 있다. IOQN은 스위치(SW5)(344)에 결합될 수 있다. 스위치(SW5)(344)의 다른 단자는 CMFB 블록(342)에 결합될 수 있다. IOQP는 스위치(SW6)(346)에 결합될 수 있다. 스위치(SW6)(346)의 다른 단자는 CMFB 블 록(342)에 결합될 수 있다.
도 3에 도시된 능동 믹서 구조는 도 1b에 도시된 복조기(166)의 성능을 개선할 수 있다. 예를 들어, 국부 발생기 입력들(VLOIN/VLOIP 및 VLOQN/VLOQP)의 진폭은 도 2에 도시된 수동 구조에 비하여 도 3의 능동 구조에서 감소될 수 있는 한편, 동일한 성능을 유지한다. 이것은 국부 발진기 생성 회로에서 상당한 전력 절감을 가져올 수 있다. 더욱이 상기 국부 발진기 신호들(VLOIN/VLOIP 및 VLOQN/VLOQP)의 진폭이 감소되기 때문에, Q 채널 믹서(340)로의 I 채널로부터 발진기 신호의 누설 및 그 반대로의 누설이 적을 수 있다. 이에 반해서, 도 2에 도시된 수동 믹서의 잡음 수치는 더 낮은 플리커 잡음(flicker noise)에 기인하여, 특별히 낮은 기저 대역 주파수들에서, 도 3에 도시된 능동 믹서에 대하여 적을 수 있다. 이것은 상기 수동 믹서가 자신의 코어 디바이스들을 통하여 DC 전류없이 동작하기 때문이다. 이러한 방식으로, 협 대역폭 변조들에 대하여, 낮은 플리커 잡음을 가지는 상기 수동 믹서가 사용되고, 반면 광대역 변조들에 대하여는 능동 믹서가 사용될 수 있는, 멀티 표준 직접 변환(multi-standard direct conversion) 또는 저-중간 주파수 최적 믹서(low-IF optimal mixer)가 구현될 수 있다.
도 2와 도 3을 비교하면, 믹서(218)는 수동 믹서(330)에 해당하고 믹서(228)는 수동 믹서(340)에 각각 해당할 수 있다. 스위치들((SW1)(316) 및 (SW2)(314)), 및 I 채널 처리 체인에 대한 공통 모드 피드백 블록(332), Q 채널 처리 체인에 대한 공통 모드 피드백 블록(342)을 통해 바이어스 전류(I_bias)를 더함으로써, 수동 믹서 블록들(330 및 340)은 능동 믹서들(302 및 304)로 각각 변환될 수 있다. 도 3 의 대표적인 능동 믹서 구조는 스위치들(SW1(316), SW2(314), SW3(334), SW4(336), SW5(344) 및 SW6(346))을 개방함으로써 상기 구조를 도 2에 도시된 대표적인 실시예로 복귀시켜서 능동 모드로부터 수동 모드로 스위칭될 수 있다.
도 4는 본 발명의 일실시예에 따른 능동 믹서의 대표적인 실시예를 예시하는 회로도이다. 도 4를 참조하면, 결합 커패시터들(414 및 416), 바이어싱 블록(412), 격리 저항들(418 및 420), 수동 믹서(410) 및 공통 모드 피드백 블록(426)이 도시되어 있다. 바이어싱 블록(412)은 MOSFET들(452 및 454)을 포함할 수 있다. 수동 믹서(410)는 다이오드들(440 및 424), MOSFET들(444, 446, 448 및 450)을 포함할 수 있다. 공통 모드 피드백 블록(426)은 저항들(456, 458, 468, 및 470), 커패시터들(460, 462, 464, 466, 472 및 478), 전류 소스(490), 전압 소스(482) 및 MOSFET들(474, 476, 480, 484, 486, 488, 492 및 494)을 포함할 수 있다. 도 4에는 입력 전류들(IRFN, IRFP 및 IBIAS_MAIN) 및 출력 전류들(ION 및 IOP), 공급 전압들(avdd 및 avss), 및 국부 발진기 입력들(VLOIP 및 VLOIN)이 또한 도시되어 있다.
MOSFET들(452 및 454)을 포함하는 바이어싱 블록(412)은 도 3에 도시된 스위치들(SW1(316) 및 SW2(314))에 각각 해당할 수 있다. 격리 저항들(418 및 420)은 도 3에 도시된 격리 저항들(322 및 324)에 해당될 수 있다. 수동 믹서(410)는 도 3에 도시된 믹서(330)의 대표적인 실시예이다. 공통 모드 피드백 블록(426)은 도 3에 도시된 공통 모드 피드백 블록(332)의 대표적인 실시예에 해당한다.
차동 전류들(IRFN)은 커패시터(414)에 공급될 수 있다. 커패시터(414)의 다른 단자는 MOSFET(452)의 드레인에 결합될 수 있다. IRFP는 커패시터(416)에 공급 될 수 있다. 커패시터(416)의 다른 단자는 MOSFET(454)의 드레인에 결합될 수 있다. MOSFET들(452 및 454)의 소스들은 IBIAS_MAIN에 결합될 수 있다. 저항(418)의 한 단자는 MOSFET(452)의 드레인에 결합될 수 있다. 저항(418)의 다른 단자는 MOSFET들(444 및 446)의 소스에 결합될 수 있다. MOSFET(446)의 드레인은 MOSFET(448)의 드레인에 결합될 수 있고, MOSFET(446)의 드레인은 MOSFET(450)의 드레인에 결합될 수 있다.MOSFET들(444 및 446)의 기판은 다이오드(440)에 결합될 수 있다. 다이오드(440)의 다른 단자는 avdd에 연결될 수 있다. 저항(420)의 한 단자는 MOSFET(454)의 드레인에 결합될 수 있다. 저항(420)의 다른 단자는 MOSFET들(448 및 450)의 소스들에 결합될 수 있다. MOSFET들(448 및 450)의 기판들은 다이오드(424)에 결합될 수 있다. 다이오드(424)의 다른 단자는 avdd에 결합될 수 있다. MOSFET들(444 및 450)의 게이트들은 VLOIP에 결합될 수 있고, MOSFET들(446 및 448)은 VLOIN에 결합될 수 있다. 저항(456)의 한 단자는 MOSFET(444)의 드레인 및 MOSFET(474)의 드레인에 결합될 수 있다. 다른 단자는 MOSFET(486)의 게이트에 연결될 수 있다.
MOSFET(486)의 게이트는 또한 커패시터들(460 및 462) 및 저항(458)의 한 단자에 결합될 수 있다. 저항(458)의 다른 단자는 MOSFET(450)의 드레인 및 MOSFET(476)의 드레인에 결합될 수 있다. 커패시터(460)의 다른 단자는 MOSFET(474)의 드레인에 결합될 수 있다. 커패시터(462)의 다른 단자는 MOSFET(476)의 드레인에 결합될 수 있다. 커패시터(472)의 한 단자는 MOSFET(474)의 드레인에 결합될 수 있는 반면에, 커패시터(472)의 다른 단자는 MOSFET(474)의 소스에 결합될 수 있다. MOSFET(474)의 게이트는 저항들(468 및 470)의 한 단자 및 MOSFET(476)의 게이트 및 MOSFET(494)의 드레인에 결합될 수 있다. 저항(468)의 다른 단자는 커패시터(464)에 결합될 수 있다. 커패시터(464)의 다른 단자는 MOSFET(474)의 드레인에 결합될 수 있다. 저항(470)의 다른 단자는 커패시터(466)에 결합될 수 있다. 커패시터(466)의 다른 단자는 MOSFET(476)의 드레인 및 커패시터(478)에 결합될 수 있다. 커패시터(478)의 다른 단자는 avdd에 결합될 수 있는 MOSFET들(474 및 476)의 소스들에 결합될 수 있다.
MOSFET(494)의 소스는 MOSFET(492)의 소스 및 avdd에 결합될 수 있다. MOSFET(494)의 게이트는 MOSFET(492)의 게이트 및 드레인에 결합될 수 있다. MOSFET(492)의 드레인은 또한 MOSFET(486)의 드레인에 결합될 수 있다. MOSFET(486)의 소스는 MOSFET(488)의 소스 및 MOSFET(480)의 드레인에 결합될 수 있다. MOSFET(488)의 드레인은 MOSFET(494)의 드레인에 결합될 수 있다. MOSFET(488)의 게이트는 전압 소스(482)의 양의 단자에 결합될 수 있다. 전압 소스(482)의 음의 단자는 avdd에 결합될 수 있다. MOSFET(480)은 avdd에 결합될 수 있다. MOSFET(480)의 게이트는 MOSFET(484)의 게이트에 결합될 수 있다. MOSFET(484)의 게이트는 또한 자신의 드레인 및 전류 소스(490)의 한 단자에 결합될 수 있다. 전류 소스(490)의 다른 단자는 avdd에 결합될 수 있다. MOSFET(484)의 소소는 avss에 연결될 수 있다. 바이어싱 블록(412)은 수동 및 능동 동작 모드 사이에서 상기 능동 믹서 구조를 스위칭하는데 사용될 수 있다.
도 5는 본 발명의 일실시예에 따른 대표적인 능동 부하를 예시하는 도면이 다. 도 5를 참조하면, 부하 블록(502) 및 공통 모드 피드백 블록(504)이 도시되어 있다. 부하 블록(502)은 커패시터들(506 및 508), 저항들(510 및 512), 및 MOSFET들(514, 516, 518, 및 520)을 포함할 수 있다. 공통 모드 피드백 블록(504)은 전압 소스(524), 전류 소스(532) 및 MOSFET들(522, 526, 528, 530, 534 및 536)을 포함할 수 있다. 도 5에는 입력 전류들(IRFP 및 IRFN), 전압 입력들(VIP_MAIN2, VIN_MAIN2, IAIAS_MAIN2, VIP_AUX2 및 VIN_AUX2), 및 공급 전원들(avdd 및 avss)이 더 도시되어 있다.
저항(510) 및 커패시터(506)의 한 단자는 IRFP에 결합될 수 있다. 저항(510)의 다른 단자는 커패시터(506)의 다른 단자 및 저항(512) 및 커패시터(508)의 한 단자 및 MOSFET(528)의 게이트와 결합될 수 있다. 저항(512) 및 커패시터(508)의 다른 단자는 IRFN에 결합될 수 있다. MOSFET(514)의 게이트는 VIP_AUX2에 결합될 수 있으며, MOSFET(514)의 드레인은 IRFP에 결합될 수 있으며, MOSFET(514)의 소스는 avdd에 결합될 수 있다. MOSFET(518)의 게이트는 VIP_MAIN2에 결합될 수 있으며, MOSFET(518)의 드레인은 IRFP에 결합될 수 있으며, MOSFET(518)의 소스는 avdd에 결합될 수 있다. MOSFET(516)의 게이트는 VIN_AUX2에 결합될 수 있으며, MOSFET(516)의 드레인은 IRFN에 결합될 수 있으며, MOSFET(516)의 소스는 avdd에 결합될 수 있다.
MOSFET(520)의 게이트는 VIN_MAIN2에 결합될 수 있으며, MOSFET(520)의 드레인은 IRFN에 결합될 수 있으며, MOSFET(520)의 소스는 avdd에 결합될 수 있다. MOSFET(528)의 드레인은 MOSFET(534)의 드레인 및 게이트 및 MOSFET(536)의 게이트 에 결합될 수 있다. MOSFET들(534 및 536)의 소스들은 avdd에 결합될 수 있다. MOSFET들(528 및 530)의 소스들은 MOSFET(522)의 드레인에 결합될 수 있다. MOSFET(522)의 소스는 avss에 결합될 수 있다. MOSFET(522)의 게이트는 MOSFET(526)의 게이트 및 드레인에 결합될 수 있다. MOSFET(526)의 소스는 avss에 결합될 수 있다. 전압 소스(524)의 양의 단자는 MOSFET(530)의 게이트에 결합될 수 있으며, 전압 소스(524)의 음의 단자는 avss에 결합될 수 있다. 전류 소스(532)의 한 단자는 avdd에 결합될 수 있으며, 전류 소스(532)의 다른 단자는 MOSFET(526)의 드레인에 결합될 수 있다.
도 5에 도시된 대표적인 회로는 도 3에서 코일형(inductive) 부하(308)를 대체하는데 사용될 수 있다. 인덕터들은 큰 다이 영역들을 필요로 하기 때문에 그것은 상기 인덕터들을 능동 부하로 대체하는데 이점이 있다. 그러한 구조는 다이 영역을 줄일 수 있으며, 큰 대역의 동작 주파수들, 즉, 광대역 동작을 통해 좀더 일정한 부하를 또한 제공할 수 있다. 공통 모드 피드백 블록(504)은 능동 부하(502)의 안정적인 바이어싱을 제공하는데 사용될 수 있다.
본 발명의 일실시예에 따라, 구성 가능한 능동/수동 믹서(330 및 340), 및 공유된 GM 스테이지(306)를 위한 방법 및 시스템은 능동 모드 또는 수동 모드로 동작하기 위해, 도 1에 도시된 바와 같이 주파수 복조기(166)에 RF 믹서(168 및 170)를 구성하는 것을 포함할 수 있다. RF 믹서(330 및 340)의 동위상(I) 처리 블록(302) 및 직교(Q) 처리 블록(304)은 단일 공유 GM 스테이지(306)를 이용할 수 있다. 하나 또는 그 이상의 스위치들(314, 316, 334, 336, 344, 및 346)은 RF 믹서 들(330 및 340)에 대하여 능동 모드 또는 수동 모드를 가능하게 하기 위해 활성화될 수 있다.
따라서, 본 발명은 하드웨어, 또는 소프트웨어, 또는 하드웨어 및 소프트웨어 둘 다의 조합으로 구현될 수 있다. 본 발명은 적어도 하나의 컴퓨터 시스템을 가지는 중앙 방식(centralized fashion)으로 구현될 수 있거나, 다른 구성요소들이 몇몇 서로 연결된 컴퓨터 시스템들에 흩어져 있는 분산 방식(distributed fashion)으로 구현될 수도 있다. 여기에서 기술된 방법들을 실행하기 위해 채택된 어떠한 종류의 컴퓨터 시스템이나 다른 장치도 적절하다. 하드웨어 및 소프트웨어의 전형적인 조합에는 컴퓨터 시스템에서 로딩되어 실행되었을 때, 여기에서 기술된 방법들을 실행하도록 컴퓨터 시스템을 제어하기 위한 컴퓨터 프로그램을 가지는 범용 컴퓨터 시스템이 있을 수 있다.
본 발명은 여기에서 기술된 방법들의 실행을 가능하게 하는 모든 특징들을 포함하고, 컴퓨터 시스템에 로딩되었을 때 이 방법들을 실행할 수 있는 컴퓨터 프로그램 제품에 임베디드(embedded)될 수 있다. 여기에서, 컴퓨터 프로그램은 임의의 언어, 또는 코드(code), 또는 기호(notation)에서 명령들 집합을 표현하는 어떤 것이라도 의미한다. 이 명령들 집합의 표현들은 직접적으로, 또는 a) 다른 언어, 코드, 또는 기호로의 변환(conversion) b) 다른 매체 형태로의 재생(reproduction)중에서 어느 하나 또는 둘 모두를 수행한 후에 시스템이 특정한 기능을 수행하기 위한 정보 처리 능력을 가지도록 의도된 것이다. 그러나, 당해 기술 분야에서 숙련된 자들의 이해 범위내에 있는 컴퓨터 프로그램의 다른 의미들도 본 발명에 의해 또한 예상될 수 있을 것이다.
본 발명은 몇몇 실시예들을 참조하여 설명되었지만, 본 발명의 범주로부터 벗어나지 않고 다양한 변형이 이루어질 수 있으며, 균등물들이 대신될 수 있음은 당해 기술 분야에 숙련된 자들에게 이해될 것이다. 또한, 본 발명의 범주를 벗어나지 않고 특정한 상황 또는 매체를 본 발명의 기술들에 채택하기 위하여 많은 변형들이 있을 수 있다. 따라서, 본 발명은 개시된 특정 실시예들에 한정되지 않아야 하며, 첨부되는 청구항들의 범위내에 있는 모든 실시예들을 포함할 것이다.
도 1a는 본 발명의 일실시예에 따른 대표적인 무선 단말을 예시하는 블록도이다.
도 1b는 본 발명의 일실시예에 따른 대표적인 RF 프론트 엔드 구조를 예시하는 블록도이다.
도 2는 본 발명의 일실시예와 연관된 공유된 GM 스테이지를 가지는 동위상 채널 처리 체인 및 직교 채널 처리 체인의 대표적인 구조를 예시하는 블록도이다.
도 3은 본 발명의 일실시예에 따른 대표적인 능동 믹서 구조를 예시하는 블록도이다.
도 4는 본 발명의 일실시예에 따른 능동 믹서의 대표적인 실시예를 예시하는 회로도이다.
도 5는 본 발명의 일실시예에 따른 대표적인 능동 부하를 예시하는 도면이다.

Claims (10)

  1. 통신 시스템에서 신호들을 처리하기 위한 방법으로,
    주파수 복조기에서의 RF 믹서가 능동 모드 또는 수동 모드로 동작하도록 구성하는 단계; 및
    상기 RF 믹서에 대하여 주파수 대역에 따라 상기 능동 모드 또는 상기 수동 모드의 동작이 가능하도록 하나 또는 그 이상의 스위치들을 활성화시키는 단계를 포함하되,
    상기 RF 믹서는 동위상(I) 처리 경로를 구성하도록 I 채널 수동 믹서를 포함하는 I 채널 처리부와, 직교(Q) 처리 경로를 구성하도록 Q 채널 수동 믹서를 포함하는 Q 채널 처리부를 포함하며,
    상기 RF 믹서의 상기 동위상(I) 처리 경로 및 상기 직교(Q) 처리 경로에 의해 단일 GM(transconductance) 스테이지가 공유되되,
    상기 I 채널 처리부 및 상기 Q 채널 처리부는 상기 단일 GM 스테이지에 병렬로 연결되고,
    상기 I 채널 처리부 및 상기 Q 채널 처리부는 격리 저항들을 개재하여 상기 단일 GM 스테이지에 연결되며;
    상기 I 채널 처리부 및 상기 Q 채널 처리부는 상기 능동 모드시에만 선택적으로 연결되어 바이어스 전류를 제공하도록 동작하는 공통 모드 피드백 회로를 각각 더 포함하는 것을 특징으로 하는 신호 처리 방법.
  2. 청구항 1에 있어서,
    상기 주파수 복조기에서의 상기 RF 믹서의 하나 또는 그 이상의 믹서 스테이지들을 수동 구성으로부터 능동 구성으로 변환하는 단계를 포함하는 신호 처리 방법.
  3. 삭제
  4. 삭제
  5. 청구항 1에 있어서,
    상기 주파수 복조기가 상기 능동 모드로 동작하도록 구성되는 경우, 광대역 변조된 신호들을 처리하는 단계를 포함하는 신호 처리 방법.
  6. 청구항 1에 있어서,
    상기 주파수 복조기가 상기 수동 모드로 동작하도록 구성되는 경우, 협대역 변조된 신호들을 처리하는 단계를 포함하는 신호 처리 방법.
  7. 통신 시스템에서 신호들을 처리하기 위한 시스템으로,
    주파수 복조기에서의 RF 믹서가 능동 모드 또는 수동 모드로 동작하도록 구성하는 하나 또는 그 이상의 회로들을 포함하되,
    상기 하나 또는 그 이상의 회로들은 상기 RF 믹서에 대하여 주파수 대역에 따라 상기 능동 모드 또는 상기 수동 모드의 동작이 가능하도록 하나 또는 그 이상의 스위치들을 활성화시키며,
    상기 RF 믹서는 동위상(I) 처리 경로를 구성하도록 I 채널 수동 믹서를 포함하는 I 채널 처리부와, 직교(Q) 처리 경로를 구성하도록 Q 채널 수동 믹서를 포함하는 Q 채널 처리부를 포함하며,
    상기 RF 믹서의 상기 동위상(I) 처리 경로 및 상기 직교(Q) 처리 경로에 의해 단일 GM(transconductance) 스테이지가 공유되되,
    상기 I 채널 처리부 및 상기 Q 채널 처리부는 상기 단일 GM 스테이지에 병렬로 연결되고,
    상기 I 채널 처리부 및 상기 Q 채널 처리부는 격리 저항들을 개재하여 상기 단일 GM 스테이지에 연결되며;
    상기 I 채널 처리부 및 상기 Q 채널 처리부는 상기 능동 모드시에만 선택적으로 연결되어 바이어스 전류를 제공하도록 동작하는 공통 모드 피드백 회로를 각각 더 포함하는 것을 특징으로 하는 신호 처리 시스템.
  8. 청구항 7에 있어서,
    상기 하나 또는 그 이상의 회로들은 상기 주파수 복조기에서의 상기 RF 믹서의 하나 또는 그 이상의 믹서 스테이지들이 수동 구성으로부터 능동 구성으로 변환하는 것을 가능하게 하는 신호 처리 시스템.
  9. 삭제
  10. 삭제
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