KR100859648B1 - 플라즈마 디스플레이 장치 - Google Patents

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Abstract

플라즈마 디스플레이 장치의 발광 효율의 향상 및 서스테인 방전 발생의 신뢰성의 향상을 과제로 한다.
교대로 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극(X, Y)과, 제1 방향에 수직인 제2 방향으로 연장되는 복수의 제3 전극(18)과, 제1 방향으로 연장되어 방전을 행하는 공간(16)에 노출된 복수의 제4 전극(15)을 구비하고, 서스테인 동작이 행해질 때, 서스테인 동작이 행해지는 제1 및 제2 전극 간에 설치된 제4 전극에는 제1 전극에 인가되는 전압과 제2 전극에 인가되는 전압 간의 소정의 전압이 인가되는 플라즈마 디스플레이 장치이다.
Figure R1020010060373
플라즈마 디스플레이 장치, 스캔 드라이버, 시프트 레지스터, 발광 효율, 서스테인 동작

Description

플라즈마 디스플레이 장치{PLASMA DISPLAY APPARATUS}
도 1은 본 발명의 제1 실시예의 PDP 장치의 전체 구성을 나타내는 블록도.
도 2는 제1 실시예의 플라즈마 디스플레이 패널의 단면도.
도 3은 제1 실시예의 홀수 필드의 구동 파형을 나타내는 도면.
도 4는 제1 실시예의 짝수 필드의 구동 파형을 나타내는 도면.
도 5는 본 발명의 제2 실시예의 PDP 장치의 전체 구성을 나타내는 블록도.
<도면의 주요 부분에 대한 부호의 설명>
10 : 플라즈마 디스플레이 패널
15 : 제4 전극(TGE 전극)
16 : 방전 공간
21 : 제어 회로
22 : 어드레스 드라이버
23 : Y 스캔 드라이버
24 : 홀수 Y 서스테인 회로
25 : 짝수 Y 서스테인 회로
26 : 홀수 X 서스테인 회로
27 : 짝수 X 서스테인 회로
28 : TGEA-1 구동 회로
29 : TGEA-2 구동 회로
30 : TGEB-1 구동 회로
31 : TGEB-2 구동 회로
본 발명은 플라즈마 디스플레이 장치(PDP 장치)에 관한 것으로, 특히 복수의 제1 및 제2 전극과 동일한 방향으로 연장되는 방전 공간에 노출된 제4 전극을 갖는 새로운 방식의 플라즈마 디스플레이 장치에 관한 것이다.
플라즈마 디스플레이 장치는 자기 발광형이기 때문에 시인성이 좋고, 박형으로 대화면 표시 및 고속 표시가 가능하기 때문에, CRT 대신에 표시 장치로서 주목받고 있다. 일반적인 PDP 장치의 패널은 n개의 X 전극과 Y 전극을 인접하여 교대로 배치하고, n조의 X 전극과 Y 전극의 조를 형성하고, X 전극과 Y 전극이 연장되는 방향에 수직인 방향으로 m개의 어드레스 전극을 배치한다. 전면을 동일한 상태로 하는 리세트 동작을 행한 후 Y 전극에 스캔 펄스를 인가한다. 스캔 펄스의 인가에 동기하여 어드레스 전극에 점등의 유무를 나타내는 신호(데이터 신호)를 인가하고, 표시 셀을 표시 데이터에 따른 상태로 함으로써, 발광시키는 표시 셀이 선택되고, 다음의 유지 방전 시에 필요한 전하가 전극 상의 유전체층에 축적된다. Y 전극에 순차 스캔 펄스를 인가하면서 상기한 동작을 행하고, 전면의 표시 셀을 표 시 데이터에 따른 상태로 한다. 이것이 어드레스 동작이다. 이 상태에서 X 전극과 Y 전극 간에 유지 방전(서스테인) 펄스를 인가한다. 어드레스 동작으로 표면에 전하(벽전하라고 칭한다.)가 축적되어 있는 표시 셀은 이 전하에 의한 전압이 서스테인 펄스에 중첩되기 때문에 방전하여 발광하지만, 표면에 전하가 축적되어 있지 않은 표시 셀은 서스테인 펄스가 인가되어도 방전의 임계치에 도달하지 않기 때문에 발광하지는 않는다. 이것이 유지 방전(서스테인) 동작이며, 이 동작의 방전이 서스테인 방전이고 표시 발광에 관계된 방전이다. 이상의 동작을 반복함으로써 표시가 행해진다. X 전극과 Y 전극은, 표시 전극이라고 불린다.
상기한 통상형 PDP 장치에서는 각 조의 X 전극과 Y 전극 간에 표시를 위한 발광을 행하기 때문에 n개의 표시 라인을 형성하기 위해서는 n조의 X 전극과 Y 전극이 필요하였다. 즉, n개의 표시 라인을 형성하기 위해서는 2n개의 표시 전극(Y 전극과 X 전극)이 필요하다.
이것에 대하여, 특허 제2801893호에는 모든 표시 전극 간에 표시를 위한 발광을 행하는 Alternate Lighting of Surfaces(이하, ALIS라고 한다.) 방식의 플라즈마 디스플레이 장치가 개시되어 있다. ALIS 방식의 상세한 구성은 이 특허에 개시되어 있고 여기서는 상세한 설명은 생략한다.
통상형 PDP 장치 및 ALIS 방식의 PDP 장치에서는 고휘도의 표시를 행하기 위해서 발광 효율의 향상이 요구되고 있다. 본 발명의 제1 목적은 발광 효율을 향상시키는 새로운 구성을 실현하는 것이다.
또한, 발광 효율은 표시 전극 간의 물리적인 거리를 증가시킴으로써 증가하는 것이 알려져 있지만, 표시 전극 간의 물리적인 거리를 증가시키면 그 만큼 방전 개시 전압이 증가하기 때문에, 서스테인 펄스의 전압을 높게 할 필요가 있다. 그러나, 서스테인 펄스의 전압을 높게 하면 후술하는 발광을 할 필요가 없는 표시 셀이 방전하는 역슬릿 방전이 발생될 가능성이 높아진다는 문제가 생긴다.
또한, PDP 장치에서는 서스테인 방전이 확실하게 발생하는 것이 필요하고, 서스테인 동작 시에는 상기한 바와 같이 서스테인 펄스의 전압을 높게 함과 함께, 최초의 펄스 폭을 넓게 함으로써, 확실하게 서스테인 방전이 개시되도록 하고 있다. 그러나, 서스테인 펄스의 전압을 높게 하는 것은 상기한 문제가 있어, 최초의 펄스폭을 넓게 하면 그 만큼 서스테인 동작에 요하는 시간이 길어진다는 문제가 생긴다. 그래서, 서스테인 방전을 확실하게 발생시키는 구성이 요구되고 있고, 특히 표시 전극 간의 물리적인 거리를 증가시킨 경우도, 서스테인 펄스의 전압을 증가시키지 않고 확실하게 서스테인 방전을 발생시키는 구성이 요구되고 있다. 본 발명의 제2 목적은 서스테인 방전을 확실하게 발생시키는 새로운 구성을 실현하는 것이다.
또한, 리세트 동작 시에는 X 전극에 인가하는 리세트 펄스의 전압이나 폭을 크게 함으로써 확실하게 리세트 동작을 위한 방전이 발생하도록 하고 있다. 그러나, 리세트 펄스에 의한 방전은 표시에 관계되지 않기 때문에, 리세트 펄스의 전압을 높게 하면 표시에 관계되지 않는 방전 강도가 증가하여 콘트라스트를 저하시킨다는 문제가 생긴다. 또한, 리세트 펄스나 서스테인 펄스의 최초의 펄스의 폭을 크게 하면, 그 만큼 리세트 시간이 길어진다는 문제가 생긴다. 그 때문에, 리세트 동작 시의 방전을 확실하게 발생시키는 다른 방법이 요구되고 있다. 본 발명의 제3 목적은 리세트 동작 시의 방전을 확실하게 발생시키는 구성을 실현하는 것이다.
또한, 종래의 리세트 동작에서는 패널의 전면에 걸쳐 전하를 중화시키고, 전극 상의 유전체층의 전하의 분포가 없도록 하였다. 그러나, 전면에 걸쳐 어느 정도의 전하를 일정하게 남김으로써 다음 어드레스 동작을 용이하게 하는 것이 고려된다. 그 때문에, 원하는 전하가 남도록 제어 가능한 간단한 리세트 동작이 요망되고 있다. 본 발명의 제4 목적은 원하는 전하가 남도록 제어 가능한 간단한 리세트 동작의 구성을 실현하는 것이다.
또한, 통상형의 PDP 장치에서는 Y 전극의 한쪽 측의 X 전극 간에서만 서스테인 방전이 행해지고, 다른 쪽 측의 X 전극과의 사이(역 슬릿)에서는 서스테인 방전이 발생하지 않도록, 다른 쪽 측의 X 전극과의(역 슬릿) 간격을 넓게 하여 방전이 발생하지 않도록 하고 있다. 역슬릿으로 생기는 서스테인 방전을 역슬릿 방전이라고 부른다. 또한, 통상형 PDP 장치에서는 다른 쪽 측의 X 전극과의 사이에는 차광막을 설치하고, 가령 역슬릿 방전이 발생해도 표시에 영향을 주지 않도록 하고 있다. 그러나, 역슬릿을 넓게 하면 표시에 관계되지 않는 부분이 차지하는 비율이 넓어지게 되어 PDP 장치의 고정밀화의 관점에서 바람직하지 못하다. 본 발명의 제5 목적은 역슬릿 방전의 발생을 저감하는 구성을 실현하는 것이다.
본 발명은 상기한 제1 내지 제5 목적을 실현하는 것이다.
상기한 제1 내지 제5 목적을 실현하기 위해서, 본 발명의 플라즈마 디스플레이 장치(PDP 장치)는 제1 전극(X 전극)과 제2 전극(Y 전극)과 동일한 방향으로 연장되는 방전 공간에 노출된 복수의 제4 전극을 설치하는 것을 특징으로 한다. 제4 전극을 설치하는 위치나 제4 전극에 인가하는 전압은 사용 목적이나 PDP 장치의 방식에 따라 다르다.
예를 들면, 상기 제1 및 제2 목적을 실현하기 위해서는 제4 전극을 서스테인 방전이 행해지는 제1 및 제2 전극 간에 배치한다. 그리고, 제1 목적을 실현하기 위해서는 서스테인 동작이 행해질 때, 서스테인 동작이 행해지는 제1 및 제2 전극 간에 설치된 제4 전극에 제1 전극에 인가되는 전압과 제2 전극에 인가되는 전압 간의 소정의 전압을 인가하여, 제1 및 제2 전극 간의 전계를 일정하게 한다. 이에 따라, 발광 효율이 향상된다. 이 경우, 제4 전극은 그리드와 같이 기능한다.
또한, 제2 목적을 실현하기 위해서는 서스테인 동작 시에 교류의 최초 펄스를 인가할 때, 서스테인 동작이 행해지는 제1 및 제2 전극 간에 설치된 제4 전극에 방전의 개시를 쉽게 하는 펄스를 인가한다. 이 펄스에 의해 트리거 방전이 발생하고 그 이후의 방전이 확실하게 행해진다.
제1 목적을 실현하는 구성과 제2 목적을 실현하는 구성을 조합하는 것도 가능하고, 그 경우에는 제4 전극을 서스테인 방전이 행해지는 제1 및 제2 전극 간에 배치하고, 서스테인 동작 시의 교류의 최초의 펄스를 인가할 때에는 방전의 개시를 쉽게 하는 펄스를, 그 이후는 전계를 일정하게 하는 전압을 제4 전극에 인가한다.
통상형 PDP 장치에서는 제4 전극은 제2 전극의 한쪽 측의 제1 전극과의 사이의 서스테인 동작이 행해지는 부분에 설치되면 되고, 다른 쪽 측의 제1 전극과의 사이에는 설치할 필요는 없다. 모든 제4 전극에는 동일한 신호가 인가되기 때문에, 제4 전극은 공통으로 접속되고, 하나의 제4 전극 구동 회로로 구동되도록 구성한다.
ALIS 방식의 PDP 장치는 제2 전극의 양측의 제1 전극과의 사이에 설치할 필요가 있다. 또한, 제4 전극은 배열 순으로 1번째가 제1 그룹, 2번째가 제2 그룹, 3번째가 제3 그룹, 4번째가 제4 그룹이라는 상태로 4개의 그룹으로 분류되고, 각 그룹의 제4 전극은 각각 4개의 제4 전극 구동 회로로 독립적으로 구동되도록 구성한다. 홀수 필드의 서스테인 동작이 행해질 때는 제1 및 제3 그룹의 제4 전극에, 짝수 필드의 서스테인 동작이 행해질 때는 제2 및 제4 그룹의 제4 전극에, 상기한 제1 및 제2 목적을 실현하는 전압을 인가한다.
또, ALIS 방식의 PDP 장치에서는 X 전극과 Y 전극의 모든 라인이 표시 라인으로서 사용되기 때문에, X 전극과 Y 전극과의 간격은 전부 동일하다. 그 때문에, 표시를 행하지 않은 라인의 X 전극과 Y 전극에는 동극성의 전압을 인가하여 방전이 발생하지 않도록 하고 있다. 그 때문에, 서스테인 동작 시에 상기한 제1 및 제2 목적을 실현하는 전압이 인가되는 그룹 이외의 그룹의 제4 전극에는 양측의 제1 및 제2 전극에 인가되는 신호와 동일한 신호를 인가할 필요가 있다. 즉, 홀수 필드의 서스테인 동작이 행해질 때는 제2 및 제4 그룹의 제4 전극에는 이 제4 전극의 양측의 제1 및 제2 전극에 인가되는 신호와 동일한 신호가 인가되고, 짝수 필드의 서스 테인 동작이 행해질 때는 제1 및 제3 그룹의 제4 전극에는 이 제4 전극의 양측의 제1 및 제2 전극에 인가되는 신호와 동일한 신호가 인가된다.
제3 및 제4 목적을 실현하기 위해서는 인접하는 제4 전극 간에 소정의 전압을 인가하여 리세트 동작을 행한다. 리세트 동작은 전면에서 행할 필요가 있기 때문에, 이 경우에는 제4 전극은 제1 및 제2 전극의 모두의 사이에 설치되고, 또한 최외측의 제1 또는 제2 전극의 외측에도 또한 설치된다. 인접하는 제4 전극 간에 소정의 전압을 인가할 필요가 있으므로, 제4 전극은 배열순으로 교대로 두개의 그룹으로 분류되고, 각 그룹의 제4 전극은 두개의 제4 전극 구동 회로로 각각 독립적으로 구동된다. 제4 전극은 노출되어 있고 폭이 좁은 펄스를 인가해도 벽전하를 흡수하는 것이 가능하며 리세트 시간을 단축할 수 있다. 또한, 제4 전극에 인가하는 펄스의 전압이나 폭을 조정함으로써, 잔류하는 벽전하를 용이하게 조정하는 것이 가능하다.
제5 목적은 실현하기 위해서는 통상형 PDP 장치에서 서스테인 동작이 행해지지 않는 역슬릿 부분에 제4 전극을 설치하고, 서스테인 동작 시에 제1 및 제2 전극 간의 역슬릿 방전의 발생을 방지하는 전압을 인가한다. 모든 제4 전극은 공통으로 접속되고, 하나의 제4 전극 구동 회로로 구동하는 것이 가능하다.
이상, 본 발명의 각 목적을 실현하기 위한 제4 전극의 배치와 그것에 인가하는 전압에 대하여 설명하였지만, 각각의 배치 및 인가하는 전압을 조합하여 복수의 목적에 부합하여 실현하는 것도 가능하다.
<발명의 실시 형태>
도 1은 본 발명의 제1 실시예의 PDP 장치의 전체 구성을 나타내는 도면이다. 제1 실시예는 본 발명을 ALIS 방식의 PDP 장치에 적용한 실시예이다. ALIS 방식의 PDP 장치에 대해서는, 특허 제2801893호에 개시되어 있기 때문에, 여기서는 자세한 설명은 생략하고, 발명의 특징에 관계된 부분에 대해서만 설명한다.
도 1에 도시한 바와 같이, ALIS 방식의 플라즈마 디스플레이 패널(PDP: 10)에서는, n개의 Y 전극(제2 전극)과 n+1개의 X 전극(제1 전극)을 인접하여 교대로 배치하여, 모든 표시 전극(Y 전극과 X 전극) 간에 표시 발광을 행한다. 따라서, 2 n+1개의 표시 전극으로 2n개의 표시 라인이 형성된다. 즉, ALIS 방식은 종래형 PDP 장치와 동등한 표시 전극수로 2배의 정밀도를 실현할 수 있다. 또한, 방전 공간을 낭비없이 사용할 수 있고 또한 전극 등에 따른 차광이 작기 때문에, 높은 개구율이 얻어져서 고휘도를 실현할 수 있다는 특징을 갖는다.
홀수번째와 짝수번째의 X 전극은 각각 공통으로 접속되고, 홀수번째의 X 전극은 홀수 X 구동 회로(26)에 의해 구동되고, 짝수번째의 X 전극은 짝수 X 구동 회로(27)에 의해 구동된다. Y 전극은 Y 스캔 드라이버(23)에 의해 구동된다. Y 스캔 드라이버(23)는 시프트 레지스터(231)와 구동 회로(232)를 갖는다. 구동 회로(232)는 어드레스 동작 시에는 시프트 레지스터(231)가 발생하는 스캔 펄스를 Y 전극에 순차 인가하고, 그 이외일 때는 홀수 Y 서스테인 회로(24)가 발생하는 신호를 홀수번째의 Y 전극에, 짝수 Y 서스테인 회로(25)가 발생하는 신호를 짝수번째의 Y 전극에 인가한다. 어드레스 드라이버(22)는 어드레스 동작 시에 스캔 펄스에 동기하여 어드레스 전극에 데이터 신호를 인가한다. 제어 회로(21)는 이상의 각 회로를 제어하는 제어 신호를 발생한다. 이상의 구성은 종래의 ALIS 방식의 PDP 장치와 동일하다.
제1 실시예의 PDP(10)에서는 상기한 구성 외에 X 전극과 Y 전극의 모두의 사이 및 양측(최외측)의 X 전극의 외측에 또한 제4 전극(TGE)이 설치되고 있다. TGE 전극은 도시한 바와 같이, X 전극과 Y 전극과 동일한 방향으로 연장되는 전극이고, 순서대로 4개의 그룹으로 나누어진다. 즉, n 번째(n은 정수)의 TGE 전극은 TGEA-1 전극 그룹으로, 공통으로 TGEA-1 구동 회로(28)에 접속된다. n+1번째의 TGE 전극은 TGEB-1 전극 그룹으로, 공통으로 TGEB-1 구동 회로(30)에 접속된다. n+2번째의 TGE 전극은 TGEA-2 전극 그룹으로, 공통으로 TGEA-2 구동 회로(29)에 접속된다. n+3번째의 TGE 전극은 TGEB-2 전극 그룹으로, 공통으로 TGEB-2 구동 회로(31)에 접속된다.
도 2는 제1 실시예의 PDP(10)의 단면도와, 조립 방법을 나타내는 도면이다. 도 2의 (a)에 도시한 바와 같이, 유리 기판(11) 상에 X 및 Y 전극에 상당하는 투명 전극(13)과 그 위에 설치된 금속 전극(12)을 포함하는 표시 전극이 복수개 형성되고 유전체층(14)으로 덮혀져 있다. 다른 쪽의 유리 기판(19) 상에는 어드레스 전극(18)과 그것을 덮는 유전체층(17)이 설치되어 있다. 두개의 기판은 임의의 간격을 두고 대향되고, 그 사이의 공간(16)에 방전 가스가 봉입된다. 이 공간(16)이 방전 공간이다. 제1 실시예에서는 유전체층(14) 상의 표시 전극의 중간 위치에 방전 공간(16)에 노출된 TGE 전극(15)이 설치되어 있다. TGE 전극(15)은 금속층으로 만들어진다.
도 2의 (b)에 도시한 바와 같이, 유리 기판(19)의 유전체층(17) 상에서는 어드레스 전극(18)의 중간 위치에 방전이 가로 방향(X와 Y 전극이 연장되는 방향)으로 확산하는 것을 방지하기 위한 장벽(20)이 설치되어 있다. 종래의 패널에서는 유전체층(14)의 표면은 평면으로, 장벽(20)이 유전체층(14)의 표면에 접촉하도록 하여 배치하고 있다. 그러나, 제1 실시예에서는 TGE 전극(15)이 유전체층(14)의 표면에 설치되어 있어, 그대로 대향하면 장벽(20)이 TGE 전극(15)에 접촉하여 장벽(20)과 유전체층(14)의 표면과의 사이에 간극을 발생시킨다. 이러한 간극이 있으면, 방전이 가로 방향으로 확산될 가능성이 있다. 그래서, 제1 실시예에서는 도 2의 (b)에 도시한 바와 같이, 장벽(20)이 TGE 전극(15)과 교차하는 부분에 홈(201)을 설치하고, 장벽(20)이 유전체층(14)의 표면 및 TGE 전극(15)과 긴밀히 접촉하여 간극을 생기지 않도록 하고 있다. 또, 장벽(20)에 홈(201)을 설치하는 대신에, 유전체층(14)의 표면에 홈을 형성하여, 그 부분에 TGE 전극을 형성하는 것도 가능하다.
도 3과 도 4는 제1 실시예의 PDP 장치의 구동 파형을 나타내는 도면으로, 도 3은 홀수 필드의 구동 파형을, 도 4는 짝수 필드의 구동 파형을 나타낸다. ALIS 방식의 PDP 장치에서는 모든 표시 전극 간을 표시를 위한 방전에 이용하지만, 이들의 방전을 동시에 발생할 수는 없다. 그래서, 표시를 홀수 라인과 짝수 라인으로 시간적으로 분할하여 행하는, 소위 인터레이스 주사를 행한다. 홀수 필드에서는 홀수번째의 표시 라인으로 표시를 행하고, 짝수 필드에서는 짝수번째의 표시 라인으로 표시를 행하고, 전체로서는 홀수 필드와 짝수 필드의 표시를 합한 표시가 얻 어진다.
도 3에 도시한 바와 같이, 리세트 동작 시에는 X 전극, Y 전극 및 어드레스 전극에 동일한 전압(접지 레벨 G)을 인가한 뒤에 TGEA-1 전극과 TGEA-2 전극(합하여 TGEA 전극)에는 플러스의 펄스(예를 들면, 약 +150V)를 인가하고, TGEB-1 전극과 TGEB-2 전극(합하여 TGEB 전극)에는 마이너스의 펄스(예를 들면, 약 -150V)를 인가하여, 그 사이에 형성되는 전계로 벽전하를 흡수, 소멸시킨다. TGEA 전극과 TGEB 전극 간의 이러한 전압을 인가함으로써 방전이 발생하지만, 반드시 방전을 발생할 필요는 없고, 벽전하를 흡수, 소멸할 수 있으면 된다. 어쨌든, 본 실시예에서는 노출된 전극 간에 전압을 인가하여 벽전하를 흡수하기 때문에, 강도가 작은 방전 또는 방전이 없는 벽전하를 소멸시키는 것이 가능하며, 표시에 관계되지 않는 방전을 저감할 수 있기 때문에, 표시의 콘트라스트가 향상된다. 또, TGEA 전극과 TGEB 전극 간에 인가하는 펄스의 전압 및 폭을 적당하게 설정함으로써, 벽전하를 전부 소멸시키지 않고 적당한 양을 잔류시키는 것도 가능하다. 또, TGEA 전극과 TCEB 전극 사이를 사용하여 리세트 동작을 행하지 않고, 후술하는 트리거나 그리드로서만 사용하는 경우에는 종래와 마찬가지의 리세트 동작을 행해도 되며, 그 경우에는 TGEA 전극과 TGEB 전극을 접지 레벨로 하거나 하이 임피던스 상태로 한다.
어드레스 동작 시에는 TGEA 전극과 TGEB 전극에는 동일한 전압(접지 레벨 G)이 인가되고, 종래의 ALIS 방식의 PDP 장치와 동일한 동작이 행해진다. 따라서, 자세한 설명은 생략한다. 또, 이 때 TGEA 전극과 TGEB 전극에는 전압을 인가하지 않고 하이 임피던스 상태로 해도 된다.
홀수 필드의 서스테인 동작 시에는 홀수번째의 X 전극과 Y 전극 사이에 및 짝수번째의 X 전극과 Y 전극 사이에 서스테인 방전이 행해진다. 그 때문에, 홀수번째의 X 전극과 짝수번째의 Y 전극의 조와, 홀수번째의 Y 전극과 짝수번째의 X 전극의 조에는 정부 역극성의 서스테인 펄스가 인가된다. 여기서, 어드레스 동작에 의해 발광시키는 표시 셀의 X 전극 부분에는 마이너스의 벽전하가 형성되고, Y 전극 부분에는 플러스의 벽전하가 형성되어 있다. 따라서, 발광시키는 표시 셀에서는 X1 전극(홀수번째의 X 전극)에 인가되는 마이너스의 펄스 X1a에는 이 마이너스의 벽전하가 중첩되고, Y1 전극(홀수번째의 Y 전극)에 인가되는 플러스의 펄스 Y1a에는 이 플러스의 벽전하에 의한 전압이 중첩되기 때문에, X1 전극과 Y1 전극 간의 전압은 커져서 서스테인 방전이 발생한다. 그러나, X2 전극(홀수번째의 X 전극)과 Y2 전극(짝수번째의 Y 전극)에서는 인가되는 펄스 X2a와 Y2a에 대하여 벽전하가 감산하는 방향으로 작용하기 때문에 서스테인 방전은 발생하지 않는다. 그리고, 다음에 X2 전극에 마이너스의 펄스 X2b가 인가되며, Y2 전극에 플러스의 펄스 Y2b가 인가되면 서스테인 방전이 발생한다. 본 발명에서는, 이 펄스까지를 서스테인 펄스의 최초의 펄스라고 한다. 또, X1 전극과 Y1 전극 간에는 최초의 서스테인 방전에 의해, 벽전하가 이동하고 있기 때문에, X1 전극에 플러스의 펄스 X1b가 인가되어, Y1 전극에 마이너스의 펄스 Y1b가 인가되면 서스테인 방전을 발생한다. 이상의 동작은 종래의 ALIS 방식도 마찬가지이다.
제1 실시예의 PDP 장치에서는 X1 전극에 마이너스의 펄스 X1a가 인가되고, Y1 전극에 플러스의 펄스 Y1a가 인가되어 X1 전극과 Y1 전극 간에 최초의 서스테인 방전이 행해질 때, 그 사이의 TGEB-1 전극에 플러스의 펄스 Ta를 인가한다. 이에 따라, TGEB-1 전극과, 마이너스의 벽전하(전자)가 축적되고, 마이너스의 펄스 X1a가 인가된 X1 전극과의 사이의 전위차는 커지고, 방전이 발생하기 쉬워져서, 방전이 확실하게 발생한다. 일단 이 방전이 발생하면, 방전 공간에 전하가 생성되고, 그것을 트리거로서 X1 전극과 Y1 전극 간에 정규 서스테인 방전이 일어난다. 이와 같이 하여, X1 전극과 Y1 전극 간에 최초의 서스테인 방전이 확실하게 발생된다.
또한, X2 전극에 마이너스의 펄스 X2b가 인가되고, Y2 전극에 플러스의 펄스 Y2b가 인가되어 X2 전극과 Y2 전극 간에 최초의 서스테인 방전이 행해질 때에, 그 사이의 TGEB-2 전극에 플러스의 펄스 Tb를 인가한다. 이에 따라, TGEB-2 전극과, 마이너스의 벽전하(전자)가 축적되고, 마이너스의 펄스 X2b가 인가된 X2 전극과의 사이의 전위차는 커지고, 방전이 발생하기 쉬워져서 방전이 확실하게 발생한다. 일단 이 방전이 발생하면, 방전 공간에 전하가 생성되고, 그것을 트리거로 하여 X2 전극과 Y2 전극 간에 정규 서스테인 방전이 일어난다. 이와 같이 하여, X2 전극과 Y2 전극 간에 최초의 서스테인 방전이 확실하게 발생된다.
최초의 서스테인 방전이 발생한 후의 서스테인 동작 동안에, TGEB-1 전극과 TGEB-2 전극에는 서스테인 동작 시에 X 전극과 Y 전극에 인가되는 전압(예를 들면, +80V와 -80V) 간의 전압 VG가 인가된다. 서스테인 방전은 TGEB-1 전극 또는 TGEB-2 전극의 바로 상측의 방전 공간에서 행해진다. TGEB-1 전극 또는 TGEB-2 전극에 전압 VG을 인가함으로써, 양측의 X 전극과 Y 전극에 의해 형성되는 전계의 변이를 보정하여 발광 효율이 향상된다. 또, 전계의 변이를 보정할 필요가 없으면, 전압 VG를 접지 레벨로 해도 되며 또는 하이 임피던스 상태로 해도 된다.
또한, 트리거용 펄스를 인가하지 않고 서스테인 동작 동안에, TGEB-1 전극과 TGEB-2 전극에 전압 VG을 인가하도록 하거나 하이 임피던스 상태로 해도 된다.
서스테인 동작 동안에, TGEA-1 전극과 TGEA-2 전극의 양측의 X 전극과 Y 전극에는 동일한 극성의 서스테인 펄스가 인가되기 때문에, TGEA-1 전극과 TGEA-2 전극에도 양측의 X 전극과 Y 전극에는 동일한 극성의 서스테인 펄스를 인가하여 오방전이 발생하지 않도록 한다. 또, 양측의 X 전극과 Y 전극에는 동일한 극성의 서스테인 펄스가 인가되기 때문에, TGEA-1 전극과 TGEA-2 전극에 다소 다른 전압의 펄스를 인가해도 방전은 발생하지 않기 때문에, 접지 G를 인가하거나 하이 임피던스 상태로 하는 것도 가능하다.
도 4에 도시한 바와 같이, 짝수 필드의 리세트 동작에서는 홀수 필드와 마찬가지로, X 전극, Y 전극 및 어드레스 전극에 동일한 전압(접지 레벨 G)을 인가한 뒤에, TGEA-1 전극과 TGEA-2 전극(합하여 TGEA 전극)에는 플러스의 펄스(예를 들면, 약 +150V)를 인가하고, TGEB-1 전극과 TGEB-2 전극(합하여 TGEB 전극)에는 마이너스의 펄스(예를 들면, 약 -150V)를 인가하고, 그 사이에 형성되는 전계로 벽전하를 흡수, 소멸시킨다. 어드레스 동작은 선택하는 라인 이외는 동일하다.
서스테인 동작 시에는 짝수번째의 Y 전극(도시되지 않음)과 X1 전극(홀수번째의 X 전극) 간의 TGEA-1 전극과, Y1 전극(홀수번째의 Y 전극)과 X2 전극(짝수번째의 X 전극) 간의 TGEA-2 전극에 각각 트리거 펄스 Tb와 Ta를 인가하고, 그 후 TGEA-1 전극과 TGEA-2 전극에 전압 VG를 인가한다. 또한, TGEB-1 전극과 TGEB-2 전극에는 양측의 X 전극과 Y 전극에는 동일한 극성의 서스테인 펄스를 인가하여 오방전이 발생하지 않도록 한다.
이상, 본 발명을 ALIS 방식의 PDP 장치에 적용한 제1 실시예를 설명하였지만, 각종 변형예가 가능하다. 예를 들면, 제1 실시예에서는 TGEA 전극과 TGEB 전극을 사용하여 리세트 동작 및 서스테인 동작 시의 제어를 행하였지만, 한쪽만을 행하는 것도 가능하다. 예를 들면, 리세트 동작을 행하지 않을 때는 최외측의 X 전극의 외측에 또한 설치된 TGEA 전극은 필요없다. 또한, TGEA 전극과 TGEB 전극에 인가하는 전압은 적절하게 설정된다.
다음에, 본 발명을 통상형의 PDP 장치에 적용한 제2 실시예를 설명한다. 도 5는 본 발명의 제2 실시예의 PDP 장치의 구성을 나타내는 도면이다. 통상형의 PDP 장치이므로, X 전극은 모두 공통으로 접속되고, X 서스테인 회로(32)에 의해 공통으로 제어된다. 제어 회로(21), 어드레스 드라이버(22), Y 스캔 드라이버(23), Y 서스테인 회로(31) 및 X 서스테인 회로(32)는 종래예와 동일하다. 제2 실시예의 PDP 장치의 패널(10)은 X 전극과 Y 전극의 모두의 사이 및 최외측의 X 전극의 외측에 또한 TGE 전극을 갖는다. 이 TGE 전극은 제1 실시예와 마찬가지로, 방전 공간에 노출된 전극이다. 홀수번째의 TGE 전극은, TGEA 전극의 그룹과, TGEB 전극의 그룹으로 나누어지고, TGEA 전극의 그룹은 공통으로 TGEA 구동 회로(33)에 접속되며, TGEB 전극의 그룹은 공통으로 TGEB 구동 회로(34)에 접속되어 있다. TGE 전극을 이용하여 리세트 동작을 행할 때에는 TGEA 전극과 TGEB 전극에 역극성의 펄스를 인가한다. 또한, 서스테인 동작 시에는 TGEB 전극에 전압을 인가하여 트리거나 그 리드의 기능을 하게 하고 TGEA 전극에는 역슬릿 방전의 발생을 방지하는 전압을 인가한다.
이상 설명한 실시예에 개시된 발명의 구성을 종합하면 다음과 같다.
〔부기 1〕 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향에 수직인 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되어, 상기 방전을 행하는 공간에 노출된 복수의 제4 전극을 구비하고,
상기 서스테인 동작이 행해질 때, 상기 서스테인 동작이 행해지는 상기 제1 및 제2 전극 간에 설치된 상기 제4 전극에는 상기 제1 전극에 인가되는 전압과 제2 전극에 인가되는 전압 간의 소정의 전압이 인가되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
〔부기 2〕 부기 1에 기재된 플라즈마 디스플레이 장치에 있어서,
상기 서스테인 동작 시에 상기 제4 전극에 인가되는 전압은 상기 제1 및 제2 전극 간의 전계를 일정하게 하도록 설정되는 플라즈마 디스플레이 장치.
〔부기 3〕 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향에 수직인 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되어 상기 방전을 행하는 공간에 노출된 복수의 제4 전극을 구비하고,
상기 서스테인 동작 시에 인가되는 상기 교류의 최초의 펄스가 인가될 때, 상기 서스테인 동작이 행해지는 상기 제1 및 제2 전극 간에 설치된 상기 제4 전극 에는 방전의 개시를 쉽게 하는 펄스가 인가되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
〔부기 4〕 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향에 수직인 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되어 상기 방전을 행하는 공간에 노출된 복수의 제4 전극을 구비하고,
상기 서스테인 동작이 행해질 때, 상기 서스테인 동작이 행해지는 상기 제1 및 제2 전극 간에 설치된 상기 제4 전극에 인가되는 전압은 상기 교류의 최초의 펄스가 인가될 때와 그 이후에 다른 것을 특징으로 하는 플라즈마 디스플레이 장치.
〔부기 5〕 부기 1 내지 4 중 어느 한 항에 기재된 플라즈마 디스플레이 장치에 있어서,
상기 복수의 제4 전극은 상기 제2 전극의 한쪽 측의 상기 제1 전극과의 사이의 상기 서스테인 동작이 행해지는 부분에 설치되고, 공통으로 접속되고 또한 하나의 제4 전극 구동 회로로 구동되는 플라즈마 디스플레이 장치.
〔부기 6〕 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향에 수직인 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되어 상기 방전을 행하는 공간에 노출된 복수의 제4 전극을 구비하고,
상기 제2 전극의 한쪽에 인접하는 상기 제1 전극에서 제1 표시 라인을 형성하고, 상기 제2 전극 다른쪽에 인접하는 상기 제1 전극에서 제2 표시 라인을 형성하고,
1 화면의 표시는 상기 제1 표시 라인에서의 표시를 행하는 홀수 필드와, 상기 제2 표시 라인에서의 표시를 행하는 짝수 필드를 포함하고,
상기 복수의 제4 전극은 상기 제2 전극 양측의 상기 제1 전극과의 사이에 설치되며, 배열순으로 1번째가 제1 그룹, 2번째가 제2 그룹, 3번째가 제3 그룹, 4번째가 제4 그룹이라는 상태로 4개의 그룹으로 분류되고,
각 그룹의 상기 제4 전극을 각각 독립적으로 구동하는 4개의 제4 전극 구동 회로를 구비하고,
상기 홀수 필드의 상기 서스테인 동작이 행해질 때는 상기 제1 및 제3 그룹의 상기 제4 전극에 상기 소정의 전압이 인가되고,
상기 짝수 필드의 상기 서스테인 동작이 행해질 때는 상기 제2 및 제4 그룹의 상기 제4 전극에 상기 소정의 전압이 인가되는 플라즈마 디스플레이 장치.
〔부기 7〕 부기 6에 기재된 플라즈마 디스플레이 장치에 있어서,
상기 홀수 필드의 상기 서스테인 동작이 행해질 때는 상기 제2 및 제4 그룹의 상기 제4 전극에는 상기 제4 전극 양측의 상기 제1 및 제2 전극에 인가되는 신호와 동일한 신호가 인가되고,
상기 짝수 필드의 상기 서스테인 동작이 행해질 때는 상기 제1 및 제3 그룹의 상기 제4 전극에는 상기 제4 전극의 양측의 상기 제1 및 제2 전극에 인가되는 신호와 동일한 신호가 인가되는 플라즈마 디스플레이 장치.
〔부기 8〕 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향으로 수직인 제2 방향으로 연장되는 복수의 제3 전극을 구비하고, 모든 셀을 초기 상태로 하는 리세트 동작 후, 상기 복수의 제2 전극에 순차 주사 펄스를 인가하면서 각 제3 전극에 선택적으로 전압을 인가하여 표시하는 셀을 선택적으로 방전시켜, 표시해야 할 셀을 선택하는 어드레스 동작을 행하고, 또한 상기 제1 전극과 상기 제2 전극 간에 교류를 인가하여 상기 어드레스 동작에서 선택된 셀을 선택적으로 방전시키는 서스테인 동작을 행하고, 상기 리세트 동작과 상기 어드레스 동작과 상기 서스테인 동작을 반복하는 플라즈마 디스플레이 장치에 있어서,
상기 제1 방향으로 연장되어 상기 방전을 행하는 공간에 노출된 복수의 제4 전극을 구비하고,
상기 리세트 동작은 상기 복수의 제4 전극 중의 인접하는 전극 간에 소정의 전압차의 펄스를 인가함으로써 행해지는 것을 특징으로 하는 플라즈마 디스플레이 장치.
〔부기 9〕 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향에 수직인 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되고 상기 방전을 행하는 공간에 노출된 복수의 제4 전극을 구비하고,
상기 복수의 제4 전극은 상기 제1 및 제2 전극의 모두의 사이와 최외측의 제1 또는 제2 전극의 외측에도 추가로 설치되고,
상기 복수의 제4 전극은 배열순으로 교대로 두개의 그룹으로 분류되고,
각 그룹의 상기 제4 전극을 각각 독립적으로 구동하는 두개의 제4 전극 구동 회로를 구비하는 플라즈마 디스플레이 장치.
〔부기 10〕 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향으로 수직인 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되고 상기 방전을 행하는 공간에 노출된 복수의 제4 전극을 구비하고,
상기 복수의 제4 전극은, 상기 제2 전극의 한쪽 측의 상기 제1 전극과의 사이의 상기 서스테인 동작이 행해지지 않는 부분에 설치되고, 공통으로 접속되고, 또한 하나의 제4 전극 구동 회로에 의해 상기 서스테인 동작 시에 상기 제1 및 제2 전극 간의 방전의 발생을 방지하는 전압이 인가되는 플라즈마 디스플레이 장치.
이상 설명한 바와 같이, 본 발명에 따르면, 최초의 서스테인 방전이 확실하게 발생됨과 함께 발광 효율이 개선되고, PDP 장치의 신뢰성이 향상된다. 또한, 리세트 동작에 요하는 시간을 단축할 수 있음과 함께 리세트 동작 후에 원하는 벽전하를 잔류시키는 것이 가능해진다. 이에 따라 표시의 콘트라스트가 향상되고 PDP 장치의 신뢰성이 향상된다.

Claims (7)

  1. 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향과 교차하는 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되고 방전을 행하는 공간에 노출되는 복수의 제4 전극을 포함하고,
    서스테인 동작이 행해질 때, 상기 서스테인 동작이 행해지는 상기 제1 및 제2 전극 간에 설치된 상기 제4 전극에는, 상기 제1 전극에 인가되는 전압과 제2 전극에 인가되는 전압 간의 직류 전압이 인가되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  2. 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향과 교차하는 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되고 방전을 행하는 공간에 노출되는 복수의 제4 전극을 포함하고,
    서스테인 동작 시에 인가되는 최초의 정극성 펄스가 상기 제1 및 제2 전극의 어느 한쪽에 인가될 때, 상기 서스테인 동작이 행해지는 상기 제1 및 제2 전극 간에 설치된 상기 제4 전극에는, 전압값이 상기 정극성 펄스 이하의 펄스가 인가되고, 상기 제4 전극에 인가되는 펄스는, 해당 펄스의 인가 이후에 상기 제4 전극에 인가되는 전압값보다 높은 전압값을 갖는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  3. 삭제
  4. 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향과 교차하는 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되고 방전을 행하는 공간에 노출되는 복수의 제4 전극을 포함하고,
    상기 제2 전극의 한쪽에 인접하는 상기 제1 전극에서 제1 표시 라인을 형성하고, 상기 제2 전극의 다른쪽에 인접하는 상기 제1 전극에서 제2 표시 라인을 형성하고,
    1 화면의 표시는, 상기 제1 표시 라인에서의 표시를 행하는 홀수 필드와, 상기 제2 표시 라인에서의 표시를 행하는 짝수 필드로 구성되고,
    상기 복수의 제4 전극은 상기 제2 전극의 양측의 상기 제1 전극과의 사이에 설치되고, 배열순으로, 1번째가 제1 그룹, 2번째가 제2 그룹, 3번째가 제3 그룹, 4번째가 제4 그룹이라는 상태로 4개의 그룹으로 분류되고,
    각 그룹의 상기 제4 전극을 각각 독립적으로 구동하는 4개의 제4 전극 구동 회로를 포함하고,
    상기 홀수 필드의 서스테인 동작이 행해질 때에는 상기 제1 및 제3 그룹의 상기 제4 전극에 상기 제1 전극에 인가되는 전압과 제2 전극에 인가되는 전압 간의 직류 전압이 인가되고,
    상기 짝수 필드의 상기 서스테인 동작이 행해질 때에는 상기 제2 및 제4 그룹의 상기 제4 전극에 상기 직류 전압이 인가되는 플라즈마 디스플레이 장치.
  5. 삭제
  6. 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향에 수직인 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되고 방전을 행하는 공간에 노출되는 복수의 제4 전극을 포함하고,
    상기 복수의 제4 전극은 상기 제1 및 제2 전극 모두의 사이와 최외측의 제1 또는 제2 전극의 외측에도 추가로 설치되고,
    상기 복수의 제4 전극은, 배열순으로 교호로 두개의 그룹으로 분류되고,
    각 그룹의 상기 제4 전극을 각각 독립적으로 구동하는 두개의 제4 전극 구동 회로를 포함하는 플라즈마 디스플레이 장치.
  7. 상호 인접하여 배치한 제1 방향으로 연장되는 복수의 제1 및 제2 전극과, 상기 제1 방향과 교차하는 제2 방향으로 연장되는 복수의 제3 전극과, 상기 제1 방향으로 연장되고 방전을 행하는 공간에 노출되는 복수의 제4 전극을 포함하고,
    상기 복수의 제4 전극은, 상기 제2 전극의 한쪽 측의 상기 제1 전극과의 사이의 서스테인 동작이 행해지지 않는 부분에 설치되고, 공통으로 접속되고, 또한 하나의 제4 전극 구동 회로에서 상기 서스테인 동작 시에 인접하는 상기 제1 및 제2 전극에 인가되는 펄스와 실질적으로 동일한 전압값의 펄스가 인가되는 플라즈마 디스플레이 장치.
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