KR100800465B1 - Plasma Display Apparatus - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것으로, 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나에 양의 서스테인 신호와 음의 서스테인 신호를 인가하고, 나머지 하나에는 바이어스 신호를 인가함으로써, 서스테인 방전 효율을 증가시키는 효과가 있다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a plasma display device, wherein a positive sustain signal and a negative sustain signal are applied to either the scan electrode Y or the sustain electrode Z, and a bias signal is applied to the other. This has the effect of increasing the sustain discharge efficiency.

이러한, 본 발명의 플라즈마 디스플레이 장치는 스캔 전극, 서스테인 전극 및 어드레스 전극이 형성되는 플라즈마 디스플레이 패널과, 영상 표시를 위한 서스테인 기간에서 스캔 전극 또는 서스테인 전극 중 어느 하나에 그라운드 레벨(GND)의 전압보다 큰 제 1 전압까지 상승하는 양(+)의 서스테인 신호와 그라운드 레벨의 전압보다 작은 제 2 전압까지 하강하는 음(-)의 서스테인 신호를 인가하고, 제 1 전압의 크기를 제 2 전압의 크기보다 더 크도록 하고, 스캔 전극 또는 서스테인 전극에 양(+)의 서스테인 신호와 음(-)의 서스테인 신호가 인가하는 동안 어드레스 전극에는 바이어스 신호를 인가하는 구동부를 포함하는 것이 바람직하다.The plasma display apparatus of the present invention has a plasma display panel on which scan electrodes, sustain electrodes and address electrodes are formed, and a voltage greater than the ground level GND at any one of the scan electrodes and the sustain electrodes in the sustain period for displaying an image. A positive sustain signal rising to the first voltage and a negative sustain signal falling to a second voltage smaller than the voltage at ground level are applied, and the magnitude of the first voltage is greater than the magnitude of the second voltage. It is preferable to include a driving unit which is made large so as to apply a bias signal to the address electrode while a positive sustain signal and a negative sustain signal are applied to the scan electrode or the sustain electrode.

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}Plasma Display Apparatus {Plasma Display Apparatus}

도 1은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면.BRIEF DESCRIPTION OF DRAWINGS Fig. 1 is a diagram for explaining the configuration of a plasma display device of the present invention.

도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면.2A to 2B are views for explaining an example of the structure of a plasma display panel included in the plasma display device of the present invention.

도 3은 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면.FIG. 3 is a diagram for explaining a frame for implementing grayscale of an image in the plasma display device of the present invention; FIG.

도 4는 본 발명의 플라즈마 디스플레이 장치의 동작의 일례를 설명하기 위한 도면.4 is a view for explaining an example of the operation of the plasma display device of the present invention;

도 5a 내지 도 5b는 상승 램프 신호 또는 제 2 하강 램프 신호의 또 다른 형태에 대해 설명하기 위한 도면.5A to 5B are diagrams for explaining another form of the rising ramp signal or the second falling ramp signal.

도 6은 서스테인 신호에 대해 보다 상세히 설명하기 위한 도면.6 is a diagram for explaining a sustain signal in more detail.

도 7은 양의 서스테인 신호와 음의 서스테인 신호의 전압의 크기에 대해 보다 상세히 설명하기 위한 도면.7 is a diagram for explaining the magnitudes of the voltages of the positive sustain signal and the negative sustain signal in more detail.

도 8은 서스테인 신호의 또 다른 형태를 설명하기 위한 도면.Fig. 8 is a diagram for explaining another form of the sustain signal.

도 9는 기준 전압이 고려된 서스테인 신호에 대해 설명하기 위한 도면.9 is a diagram for explaining a sustain signal considering a reference voltage.

도 10은 양의 서스테인 신호와 음의 서스테인 신호를 인가하는 순서를 변경하는 방법의 일례를 설명하기 위한 도면.10 is a view for explaining an example of a method of changing the order of applying a positive sustain signal and a negative sustain signal.

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>

100 : 플라즈마 디스플레이 패널 110 : 구동부100: plasma display panel 110: driver

본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.The present invention relates to a plasma display device (Plasma Display Apparatus).

플라즈마 디스플레이 장치는 전극이 형성된 플라즈마 디스플레이 패널과, 이러한 플라즈마 디스플레이 패널의 전극에 소정의 구동 신호를 인가하는 구동부를 포함하여 이루어진다.The plasma display apparatus includes a plasma display panel having electrodes formed thereon, and a driver for applying a predetermined driving signal to the electrodes of the plasma display panel.

일반적으로 플라즈마 디스플레이 패널에는 격벽으로 구획된 방전 셀(Cell) 내에 형광체 층이 형성되고, 아울러 복수의 전극(Electrode)이 형성된다.In general, a phosphor layer is formed in a discharge cell (Cell) partitioned by a partition, and a plurality of electrodes are formed in the plasma display panel.

그리고 구동부는 전극을 통해 방전 셀로 구동 신호를 인가한다.The driving unit applies a driving signal to the discharge cell through the electrode.

그러면, 방전 셀 내에서는 공급되는 구동 신호에 의해 방전이 발생한다. 여기서, 방전 셀 내에서 구동 신호에 의해 방전이 될 때, 방전 셀 내에 충진 되어 있는 방전 가스가 진공자외선(Vacuum Ultraviolet rays)을 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체를 발광시켜 가시 광을 발생시킨다. 이러한 가시 광에 의해 플라즈마 디스플레이 패널의 화면상에 영상이 표시된다.Then, the discharge is generated by the drive signal supplied in the discharge cell. Here, when discharged by a drive signal in the discharge cell, the discharge gas filled in the discharge cell generates vacuum ultraviolet rays, and the vacuum ultraviolet light emits the phosphor formed in the discharge cell to emit visible light. Generate. The visible light displays an image on the screen of the plasma display panel.

이러한 플라즈마 디스플레이 장치에서는 방전 셀 내에서 방전이 발생할 때 방전 효율이 저하되는 문제점이 있다.In such a plasma display device, there is a problem that the discharge efficiency is lowered when a discharge occurs in the discharge cell.

상술한 문제점을 해결하기 위해 본 발명은 영상 표시를 위한 서스테인 기간에서 인가되는 서스테인 신호를 개선하여 방전 효율이 저하되는 것을 억제하는 플라즈마 디스플레이 장치를 제공하는데 그 목적이 있다.SUMMARY OF THE INVENTION In order to solve the above problems, an object of the present invention is to provide a plasma display device which suppresses a decrease in discharge efficiency by improving a sustain signal applied in a sustain period for displaying an image.

상술한 목적을 이루기 위한 본 발명의 플라즈마 디스플레이 장치는 스캔 전극, 서스테인 전극 및 어드레스 전극이 형성되는 플라즈마 디스플레이 패널과, 영상 표시를 위한 서스테인 기간에서 스캔 전극 또는 서스테인 전극 중 어느 하나에 그라운드 레벨(GND)의 전압보다 큰 제 1 전압까지 상승하는 양(+)의 서스테인 신호와 그라운드 레벨의 전압보다 작은 제 2 전압까지 하강하는 음(-)의 서스테인 신호를 인가하고, 제 1 전압의 크기를 제 2 전압의 크기보다 더 크도록 하고, 스캔 전극 또는 서스테인 전극에 양(+)의 서스테인 신호와 음(-)의 서스테인 신호가 인가하는 동안 어드레스 전극에는 바이어스 신호를 인가하는 구동부를 포함하는 것이 바람직하다.The plasma display device of the present invention for achieving the above object is a ground level (GND) of any one of the scan electrode or the sustain electrode in the sustain period for the image display and the plasma display panel is formed of the scan electrode, the sustain electrode and the address electrode A positive sustain signal rising to the first voltage greater than the voltage of and a negative sustain signal falling to the second voltage smaller than the voltage of the ground level are applied, and the magnitude of the first voltage is applied to the second voltage. It is preferable to include a driver for applying a bias signal to the address electrode while the positive electrode and the negative sustain signal are applied to the scan electrode or the sustain electrode.

또한, 구동부는 양의 서스테인 신호와 음의 서스테인 신호를 번갈아가며 인가하는 것을 특징으로 한다.In addition, the driving unit is characterized in that the alternating application of a positive sustain signal and a negative sustain signal.

또한, 제 1 전압과 제 2 전압의 크기의 차이는 대략 10V이상 40V이하인 것을 특징으로 한다.In addition, the difference between the magnitude of the first voltage and the second voltage is characterized in that about 10V or more and 40V or less.

또한, 제 1 전압과 제 2 전압의 크기의 차이는 대략 20V이상 30V이하인 것을 특징으로 한다.In addition, the difference between the magnitude of the first voltage and the second voltage is characterized in that about 20V or more and 30V or less.

또한, 제 1 전압의 크기는 대략 180V이상 190V이하이고, 제 2 전압의 크기는 대략 150V이상 170V이하인 것을 특징으로 한다.In addition, the magnitude of the first voltage is about 180V or more and 190V or less, and the magnitude of the second voltage is about 150V or more and 170V or less.

또한, 구동부는 스캔 전극 또는 서스테인 전극 중 나머지 하나의 전극에는 바이어스 신호를 인가하는 것을 특징으로 한다.The driving unit may apply a bias signal to the other one of the scan electrode and the sustain electrode.

또한, 바이어스 신호는 그라운드 레벨의 전압을 실질적으로 일정하게 유지하는 것을 특징으로 한다.In addition, the bias signal is characterized in that the voltage at the ground level is kept substantially constant.

이하, 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 장치를 상세히 설명하기로 한다.Hereinafter, a plasma display device of the present invention will be described in detail with reference to the accompanying drawings.

도 1은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면이다.1 is a view for explaining the configuration of the plasma display device of the present invention.

도 1을 살펴보면, 본 발명의 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(100)과 구동부(110)를 포함한다.Referring to FIG. 1, the plasma display apparatus of the present invention includes a plasma display panel 100 and a driver 110.

구동부(110)는 영상 표시를 위한 서스테인 기간에서 플라즈마 디스플레이 패널(100)의 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나에 그라운드 레벨(GND)의 전압보다 큰 제 1 전압까지 상승하는 양(+)의 서스테인 신호와 그라운드 레벨의 전압보다 작은 제 2 전압까지 하강하는 음(-)의 서스테인 신호를 인가하고, 여기서 제 1 전압의 크기를 제 2 전압의 크기보다 더 크도록 한다.In the sustain period for displaying an image, the driver 110 increases the first voltage higher than the voltage of the ground level GND to either the scan electrode Y or the sustain electrode Z of the plasma display panel 100. A positive sustain signal and a negative sustain signal falling down to a second voltage smaller than the voltage at ground level are applied, where the magnitude of the first voltage is greater than the magnitude of the second voltage.

이러한 본 발명의 플라즈마 디스플레이 장치의 구동부(110)에 대해서는 이후의 설명을 통해 보다 명확히 하도록 한다.The driving unit 110 of the plasma display device of the present invention will be more clearly described later.

플라즈마 디스플레이 패널(100)은 서로 나란한 스캔 전극(Y)과 서스테인 전극(Z)이 형성되는 것이 바람직하다.In the plasma display panel 100, scan electrodes Y and sustain electrodes Z parallel to each other are formed.

이러한 플라즈마 디스플레이 패널(100)의 구조의 일례를 첨부된 도 2a 내지 도 2b를 결부하여 상세히 살펴보면 다음과 같다.An example of the structure of the plasma display panel 100 will be described in detail with reference to FIGS. 2A to 2B.

도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면이다.2A to 2B are views for explaining an example of the structure of the plasma display panel included in the plasma display device of the present invention.

먼저, 도 2a를 살펴보면 본 발명의 플라즈마 디스플레이 패널은 전극(Electrode), 바람직하게는 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 형성되는 전면 기판(201)을 포함하는 전면 패널(400)과, 전술한 스캔 전극(202, Y) 및 서스테인 전극(203, Z)과 교차하는 전극, 바람직하게는 어드레스 전극(213, X)이 형성되는 후면 기판(211)을 포함하는 후면 패널(210)이 합착되어 이루어진다.First, referring to FIG. 2A, a plasma display panel according to the present invention includes a front panel 201 including an electrode, preferably a front substrate 201 on which scan electrodes 202 and Y and sustain electrodes 203 and Z are formed. A rear panel including a back substrate 211 on which an electrode intersecting the scan electrodes 202 and Y and the sustain electrodes 203 and Z, preferably the address electrodes 213 and X, is formed. 210 is made of a combination.

여기서, 전면 기판(201) 상에 형성되는 전극, 바람직하게는 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 방전 공간, 즉 방전 셀(Cell)에서 방전을 발생시키고 아울러 방전 셀의 방전을 유지한다.Here, the electrodes formed on the front substrate 201, preferably the scan electrodes 202 and Y and the sustain electrodes 203 and Z, generate a discharge in a discharge space, that is, a discharge cell, and at the same time Maintain the discharge.

이러한 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 형성된 전면 기판(201)의 상부에는 스캔 전극(202, Y)과 서스테인 전극(203, Z)을 덮도록 유전체 층, 바람직하게는 상부 유전체 층(204)이 형성된다.The dielectric layer, preferably on the upper surface of the front substrate 201 where the scan electrodes 202 and Y and the sustain electrodes 203 and Z are formed to cover the scan electrodes 202 and Y and the sustain electrodes 203 and Z. Upper dielectric layer 204 is formed.

이러한, 상부 유전체 층(204)은 스캔 전극(202, Y) 및 서스테인 전극(203, Z)의 방전 전류를 제한하며 스캔 전극(202, Y)과 서스테인 전극(203, Z) 간을 절연시킨다.This upper dielectric layer 204 limits the discharge current of the scan electrodes 202 and Y and the sustain electrodes 203 and Z and insulates the scan electrodes 202 and Y from the sustain electrodes 203 and Z.

이러한, 상부 유전체 층(204) 상면에는 방전 조건을 용이하게 하기 위한 보호 층(205)이 형성된다. 이러한 보호 층(205)은 산화마그네슘(MgO) 등의 재료를 상부 유전체 층(204) 상부에 증착하는 방법 등을 통해 형성된다.A protective layer 205 is formed on the top surface of the upper dielectric layer 204 to facilitate discharge conditions. The protective layer 205 is formed by, for example, depositing a material such as magnesium oxide (MgO) over the upper dielectric layer 204.

한편, 후면 기판(211) 상에 형성되는 전극, 바람직하게는 어드레스 전극(213, X)은 방전 셀에 데이터(Data) 신호를 인가하는 전극이다.Meanwhile, the electrodes formed on the rear substrate 211, preferably the address electrodes 213 and X, are electrodes that apply a data signal to the discharge cells.

이러한 어드레스 전극(213, X)이 형성된 후면 기판(211)의 상부에는 어드레스 전극(213, X)을 덮도록 유전체 층, 바람직하게는 하부 유전체 층(215)이 형성된다.A dielectric layer, preferably a lower dielectric layer 215 is formed on the rear substrate 211 on which the address electrodes 213 and X are formed to cover the address electrodes 213 and X.

이러한, 하부 유전체 층(215)은 어드레스 전극(213, X)을 절연시킨다.This lower dielectric layer 215 insulates the address electrodes 213, X.

이러한 하부 유전체 층(215)의 상부에는 방전 공간 즉, 방전 셀을 구획하기 위한 스트라이프 타입(Stripe Type), 웰 타입(Well Type), 델타 타입(Delta Type), 벌집 타입 등의 격벽(212)이 형성된다. 이에 따라, 전면 기판(201)과 후면 기판(211)의 사이에서 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 등의 방전 셀이 형성된다.On top of the lower dielectric layer 215, a partition 212, such as a stripe type, a well type, a delta type, a honeycomb type, for partitioning a discharge cell, that is, a discharge cell, is formed. Is formed. Accordingly, discharge cells such as red (R), green (G), and blue (B) are formed between the front substrate 201 and the rear substrate 211.

여기서, 격벽(212)에 의해 구획된 방전 셀 내에는 소정의 방전 가스가 채워진다.Here, a predetermined discharge gas is filled in the discharge cell partitioned by the partition wall 212.

아울러, 격벽(212)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(214)이 형성된다. 예를 들면, 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성될 수 있다.In addition, a phosphor layer 214 is formed in a discharge cell partitioned by the partition 212 to emit visible light for image display during address discharge. For example, red (R), green (G), and blue (B) phosphor layers may be formed.

이상에서 설명한 본 발명의 플라즈마 디스플레이 패널에서는 스캔 전극(202, Y), 서스테인 전극(203, Z) 또는 어드레스 전극(213, X) 중 적어도 하나 이상의 전극으로 구동 신호가 공급되면, 격벽(212)에 의해 구획된 방전 셀 내에서 방전이 발생한다.In the plasma display panel of the present invention described above, when the driving signal is supplied to at least one of the scan electrodes 202, Y, the sustain electrodes 203, Z, and the address electrodes 213, X, the barrier rib 212 is provided. Discharges occur within the discharge cells partitioned by each other.

그러면, 방전 셀 내에 채워진 방전 가스에서 진공 자외선이 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체 층(214)에 가해진다. 그러면, 형광체 층(214)에서 소정의 가시광선이 발생되고, 이렇게 발생된 가시광선이 상부 유전체 층(204)이 형성된 전면 기판(201)을 통해 외부로 방출되고, 이에 따라 전면 기판(201)의 외부 면에 소정의 영상이 표시된다.Then, vacuum ultraviolet rays are generated in the discharge gas filled in the discharge cells, and the vacuum ultraviolet rays are applied to the phosphor layer 214 formed in the discharge cells. Then, a predetermined visible light is generated in the phosphor layer 214, and the visible light is emitted to the outside through the front substrate 201 in which the upper dielectric layer 204 is formed. A predetermined image is displayed on the outer surface.

한편, 여기 도 2a의 설명에서는 스캔 전극(202, Y) 및 서스테인 전극(203, Z)이 각각 하나의 층(Layer)으로 이루어지는 경우만을 도시하고 설명하였지만, 이와는 다르게 스캔 전극(202, Y) 또는 서스테인 전극(203, Z) 중 하나 이상이 복수의 층으로 이루어지는 것도 가능하다. 이에 대해 도 2b를 참조하여 살펴보면 다음과 같다.Meanwhile, in the description of FIG. 2A, only the case where the scan electrodes 202 and Y and the sustain electrodes 203 and Z are each formed of one layer is illustrated and described. However, the scan electrodes 202 and Y or the It is also possible that at least one of the sustain electrodes 203 and Z consists of a plurality of layers. This will be described with reference to FIG. 2B.

도 2b를 살펴보면, 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 각각 두 개의 층(Layer)으로 이루어질 수 있다.Referring to FIG. 2B, the scan electrodes 202 and Y and the sustain electrodes 203 and Z may be formed of two layers, respectively.

특히, 광 투과율 및 전기 전도도를 고려하면 방전 셀 내에서 발생한 광을 외부로 방출시키며 아울러 구동 효율을 확보하는 차원에서 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 불투명한 은(Ag) 재질의 버스 전극(202b, 203b)과 투명한 인듐 틴 옥사이드(Indium Tin Oxide : ITO) 재질의 투명 전극(202a, 203a)을 포함하는 것이 바람직하다.In particular, in consideration of light transmittance and electrical conductivity, the scan electrodes 202 and Y and the sustain electrodes 203 and Z are opaque silver (Ag) to emit light generated in the discharge cell to the outside and to secure driving efficiency. Bus electrodes 202b and 203b and transparent electrodes 202a and 203a made of transparent indium tin oxide (ITO).

이와 같이, 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 투명 전극(202a, 203a)을 포함하도록 하는 이유는, 방전 셀 내에서 발생한 가시 광이 플라즈마 디스플레이 패널의 외부로 방출될 때 효과적으로 방출되도록 하기 위해서이다.As such, the reason why the scan electrodes 202 and Y and the sustain electrodes 203 and Z include the transparent electrodes 202a and 203a is that when visible light generated in the discharge cells is emitted to the outside of the plasma display panel. To be released effectively.

아울러, 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 버스 전극(202b, 203b)을 포함하도록 하는 이유는, 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 투명 전극(202a, 203a)만을 포함하는 경우에는 투명 전극(202a, 203a)의 전기 전도도가 상대적으로 낮기 때문에 구동 효율이 감소할 수 있어서, 이러한 구동 효율의 감소를 야기할 수 있는 투명 전극(202a, 203a)의 낮은 전기 전도도를 보상하기 위해서이다.In addition, the reason why the scan electrodes 202 and Y and the sustain electrodes 203 and Z include the bus electrodes 202b and 203b is that the scan electrodes 202 and Y and the sustain electrodes 203 and Z are transparent electrodes. In the case of including only 202a and 203a, the driving efficiency can be reduced because the electrical conductivity of the transparent electrodes 202a and 203a is relatively low, so that the transparent electrodes 202a and 203a can cause such a reduction in the driving efficiency. To compensate for the low electrical conductivity.

이와 같이 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 버스 전극(202b, 203b)을 포함하는 경우에, 버스 전극(202b, 203b)에 의한 외부 광의 반사를 방지하기 위해 투명 전극(202a, 203a)과 버스 전극(202b, 203b)의 사이에 블랙 층(Black Layer : 220, 221)이 더 구비되는 것이 바람직하다.As described above, in the case where the scan electrodes 202 and Y and the sustain electrodes 203 and Z include the bus electrodes 202b and 203b, the transparent electrodes (202b and 203b) prevent the reflection of external light by the bus electrodes 202b and 203b. Black layers 220 and 221 may be further provided between the 202a and 203a and the bus electrodes 202b and 203b.

한편, 앞선 도 2b에서와 같은 구조에서 투명 전극(202a, 203a)이 생략되는 것도 가능하다. 다시 말해 ITO-Less 인 경우도 가능한 것이다.Meanwhile, the transparent electrodes 202a and 203a may be omitted in the same structure as in FIG. 2B. In other words, ITO-Less is also possible.

예를 들면, 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 도 2b에서 투명 전극(202a, 203a)이 생략되고, 버스 전극(202b, 203b)만으로 이루어질 수 있다. 즉, 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 버스 전극(202b, 203b)의 하나의 층(Layer)으로 이루어질 수 있다.For example, the scan electrodes 202 and Y and the sustain electrodes 203 and Z may be made of only the bus electrodes 202b and 203b without the transparent electrodes 202a and 203a in FIG. 2B. That is, the scan electrodes 202 and Y and the sustain electrodes 203 and Z may be formed of one layer of the bus electrodes 202b and 203b.

이상의 도 2a 내지 도 2b에서는 본 발명의 플라즈마 디스플레이 패널의 일례만을 도시하고 설명한 것으로써, 본 발명이 여기 도 2a 내지 도 2b와 같은 구조의 플라즈마 디스플레이 패널에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 여기 도 2a 내지 도 2b의 플라즈마 디스플레이 패널에는 상부 유전체 층(204) 및 하부 유전 체 층(215)이 각각 하나의 층(Layer)인 경우만을 도시하고 있지만, 상부 유전체 층(204) 및 하부 유전체 층(215) 중 적어도 하나 이상은 복수의 층으로 이루지는 것도 가능한 것이다.2A to 2B, only one example of the plasma display panel of the present invention is shown and described, and it is to be understood that the present invention is not limited to the plasma display panel having the structure as shown in FIGS. 2A to 2B. For example, the plasma display panel of FIGS. 2A-2B shows only the case where the upper dielectric layer 204 and the lower dielectric layer 215 are each one layer, but the upper dielectric layer 204 is shown. And at least one of the lower dielectric layers 215 may be formed of a plurality of layers.

아울러, 격벽(212)으로 인한 외부 광의 반사를 방지하기 위해 격벽(212)의 상부에 외부 광을 흡수할 수 있는 블랙 층(미도시)을 더 형성할 수도 있다.In addition, a black layer (not shown) may be further formed on the top of the partition 212 to prevent reflection of the external light due to the partition 212.

이와 같이, 본 발명의 플라즈마 디스플레이 장치에 적용되는 플라즈마 디스플레이 패널의 구조는 다양하게 변경될 수 있다.As such, the structure of the plasma display panel applied to the plasma display apparatus of the present invention may be variously changed.

이러한 플라즈마 디스플레이 패널을 포함하는 본 발명의 플라즈마 디스플레이 장치의 동작의 일례에 대해 첨부된 도 3 내지 도 4를 결부하여 살펴보면 다음과 같다.An example of the operation of the plasma display apparatus of the present invention including the plasma display panel will be described with reference to FIGS. 3 to 4.

도 3은 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면이다.FIG. 3 is a diagram for explaining a frame for implementing gray levels of an image in the plasma display apparatus of the present invention.

또한, 도 4는 본 발명의 플라즈마 디스플레이 장치의 동작의 일례를 설명하기 위한 도면이다.4 is a view for explaining an example of the operation of the plasma display device of the present invention.

먼저, 도 3을 살펴보면 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조(Gray Level)를 구현하기 위한 프레임은 발광횟수가 다른 여러 서브필드로 나누어진다.First, referring to FIG. 3, in the plasma display device of the present invention, a frame for implementing gray levels of an image is divided into several subfields having different emission counts.

아울러, 도시하지는 않았지만 각 서브필드는 다시 모든 방전 셀을 초기화시키기 위한 리셋 기간(Reset Period), 방전될 방전 셀을 선택하기 위한 어드레스 기간(Address Period) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(Sustain Period)으로 나누어 질 수 있다.In addition, although not shown, each subfield may further include a reset period for initializing all discharge cells, an address period for selecting discharge cells to be discharged, and a sustain period for implementing gray levels according to the number of discharges. Sustain Period).

예를 들어, 256 계조로 영상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 예컨대, 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어지게 된다.For example, when displaying an image with 256 gray levels, a frame period (16.67 ms) corresponding to 1/60 second is divided into eight subfields SF1 to SF8 as shown in FIG. Each of the subfields SF1 to SF8 is divided into a reset period, an address period, and a sustain period.

한편, 서스테인 기간에 공급되는 서스테인 신호의 개수를 조절하여 해당 서브필드의 계조 가중치를 설정할 수 있다. 즉, 서스테인 기간을 이용하여 각각의 서브필드에 소정의 계조 가중치를 부여할 수 있다. 예를 들면, 제 1 서브필드의 계조 가중치를 20 으로 설정하고, 제 2 서브필드의 계조 가중치를 21 으로 설정하는 방법으로 각 서브필드의 계조 가중치가 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가되도록 각 서브필드의 계조 가중치를 결정할 수 있다. 이와 같이 각 서브필드에서 계조 가중치에 따라 각 서브필드의 서스테인 기간에서 공급되는 서스테인 신호의 개수를 조절함으로써, 다양한 영상의 계조를 구현하게 된다.The gray scale weight of the corresponding subfield may be set by adjusting the number of the sustain signals supplied in the sustain period. That is, a predetermined gray scale weight can be given to each subfield using the sustain period. For example, the gray scale weight of each subfield is 2n by setting the gray scale weight of the first subfield to 2 0 and the gray scale weight of the second subfield to 21, where n = 0, 1, and 2 , 3, 4, 5, 6, and 7) can be determined to increase the gray scale weight of each subfield. As described above, the number of sustain signals supplied in the sustain period of each subfield is adjusted according to the gray scale weight in each subfield, thereby implementing gray levels of various images.

이러한 본 발명의 플라즈마 디스플레이 장치는 1초의 영상을 표시하기 위해 복수의 프레임을 사용한다. 예를 들면, 1초의 영상을 표시하기 위해 60개의 프레임을 사용하는 것이다.The plasma display device of the present invention uses a plurality of frames to display an image of one second. For example, 60 frames are used to display an image of 1 second.

여기 도 3에서는 하나의 프레임이 8개의 서브필드로 이루어진 경우만으로 도시하고 설명하였지만, 이와는 다르게 하나의 프레임을 이루는 서브필드의 개수는 다양하게 변경될 수 있다. 예를 들면, 제 1 서브필드부터 제 12 서브필드까지의 12 개의 서브필드로 하나의 프레임을 구성할 수도 있고, 10개의 서브필드로 하나의 프레임을 구성할 수도 있는 것이다.In FIG. 3, only one frame is composed of eight subfields. However, the number of subfields forming one frame may be changed in various ways. For example, one frame may be configured with 12 subfields from the first subfield to the twelfth subfield, or one frame may be configured with 10 subfields.

이러한, 프레임으로 영상의 계조를 구현하는 플라즈마 디스플레이 장치가 구현하는 영상의 화질은 프레임에 포함되는 서브필드의 개수에 따라 결정될 수 있다. 즉, 프레임에 포함되는 서브필드가 12개인 경우는 212 가지의 영상의 계조를 표현할 수 있고, 프레임에 포함되는 서브필드가 8개인 경우는 28 가지의 영상의 계조를 구현할 수 있게 되는 것이다.The image quality of the image implemented by the plasma display apparatus implementing the gray level of the image using the frame may be determined according to the number of subfields included in the frame. That is, when 12 subfields are included in a frame, gray levels of 212 images can be expressed. When 8 subfields are included in a frame, 28 gray levels can be realized.

또한, 여기 도 3에서는 하나의 프레임에서 계조 가중치의 크기가 증가하는 순서에 따라 서브필드들이 배열되었지만, 이와는 다르게 하나의 프레임에서 서브필드들이 계조 가중치가 감소하는 순서에 따라 배열될 수도 있고, 또는 계조 가중치에 관계없이 서브필드들이 배열될 수도 있는 것이다.Also, in FIG. 3, subfields are arranged according to the order of increasing the magnitude of gray scale weight in one frame. Alternatively, subfields may be arranged in the order of decreasing gray scale weight in one frame. Subfields may be arranged regardless of the weight.

다음, 도 4를 살펴보면 앞선 도 3과 같은 프레임에 포함된 복수의 서브필드 어느 하나의 서브필드(Subfield)에서의 본 발명의 플라즈마 디스플레이 장치의 동작의 일례가 나타나 있다.Next, referring to FIG. 4, an example of an operation of the plasma display apparatus of the present invention in any one of a plurality of subfields included in the same frame as in FIG. 3 is shown.

앞선, 도 1의 부호 110의 구동부는 리셋 기간 이전의 프리 리셋 기간에서 스캔 전극(Y)에 제 1 하강 램프(Ramp-Down) 신호를 인가한다.First, the driving unit 110 of FIG. 1 applies a first ramp-down signal to the scan electrode Y in the pre-reset period before the reset period.

아울러, 구동부(110)는 스캔 전극(Y)에 제 1 하강 램프 신호가 인가되는 동안 제 1 하강 램프 신호와 반대 극성 방향의 제 1 서스테인 바이어스 신호를 서스테인 전극(Z)에 인가한다.In addition, the driving unit 110 applies a first sustain bias signal in a direction opposite to the first falling ramp signal to the sustain electrode Z while the first falling ramp signal is applied to the scan electrode Y.

여기서, 스캔 전극(Y)에 인가되는 제 1 하강 램프 신호는 제 10 전압(V10)까 지 점진적으로 하강하는 것이 바람직하다. 바람직하게는, 제 1 하강 램프 신호는 그라운드 레벨(GND)의 전압으로부터 점진적으로 하강하는 것이 바람직하다.Here, it is preferable that the first falling ramp signal applied to the scan electrode Y gradually descends to the tenth voltage V10. Preferably, the first falling ramp signal is preferably gradually lowered from the voltage of the ground level GND.

아울러, 제 1 서스테인 바이어스 신호는 제 1 서스테인 바이어스 전압(Vz1)을 실질적으로 일정하게 유지하는 것이 바람직하다. 여기서, 제 1 서스테인 바이어스 전압(Vz1)은 이후의 서스테인 기간에서 인가되는 서스테인 신호(SUS)의 전압, 즉 서스테인 전압(Vs)과 대략 동일한 전압인 것이 바람직하다.In addition, the first sustain bias signal preferably maintains the first sustain bias voltage Vz1 substantially constant. Here, it is preferable that the first sustain bias voltage Vz1 is approximately the same voltage as the voltage of the sustain signal SUS applied in the subsequent sustain period, that is, the sustain voltage Vs.

이와 같이, 프리 리셋 기간에서 스캔 전극(Y)에 제 1 하강 램프 신호가 인가되고, 이와 함께 서스테인 전극(Z)에 제 1 서스테인 바이어스 신호가 인가되면 스캔 전극(Y) 상에 소정 극성의 벽 전하(Wall Charge)가 쌓이고, 서스테인 전극(Z) 상에는 스캔 전극(Y)과 반대 극성의 벽 전하들이 쌓인다. 예를 들면, 스캔 전극(Y) 상에는 양(+)의 벽 전하(Wall Charge)가 쌓이고, 서스테인 전극(Z) 상에는 음(-)의 벽 전하가 쌓이게 된다.As described above, when the first falling ramp signal is applied to the scan electrode Y and the first sustain bias signal is applied to the sustain electrode Z in the pre-reset period, the wall charge of a predetermined polarity is applied to the scan electrode Y. Wall charges are accumulated, and wall charges of opposite polarity to the scan electrode Y are accumulated on the sustain electrode Z. For example, positive wall charges are accumulated on the scan electrode Y, and negative wall charges are accumulated on the sustain electrode Z.

이에 따라, 이후의 리셋 기간에서 충분한 세기의 셋업 방전을 발생시킬 수 있게 되고, 이에 따라 초기화를 충분히 안정적으로 수행할 수 있게 된다.This makes it possible to generate a setup discharge of sufficient intensity in the subsequent reset period, thereby enabling the initialization to be sufficiently stable.

심지어는, 방전 셀 내에 벽 전하의 양이 부족한 경우에서도 충분한 세기의 셋업 방전을 발생시킬 수 있다.Even when the amount of wall charges in the discharge cell is insufficient, a setup discharge of sufficient intensity can be generated.

아울러, 리셋 기간에서 스캔 전극(Y)으로 인가되는 상승 램프 신호(Ramp-Up)의 전압이 더 작아지더라도 충분한 세기의 셋업 방전을 발생시킬 수 있게 된다.In addition, even when the voltage of the rising ramp signal Ramp-Up applied to the scan electrode Y becomes smaller in the reset period, setup discharge of sufficient intensity can be generated.

이상에서 설명한 프리 리셋 기간은 프레임(Frame)의 모든 서브필드에서 리셋 기간이전에 포함될 수 있다.The pre-reset period described above may be included before the reset period in all subfields of the frame.

또는, 구동 시간을 확보하는 관점에서 프레임의 서브필드 중에서 계조 가중치가 가장 작은 하나의 서브필드에서 리셋 기간이전에 프리 리셋 기간이 포함되거나 또는 프레임의 서브필드 중 2개 또는 3개의 서브필드에서 리셋 기간이전에 프리 리셋 기간이 포함되는 것도 가능한 것이다.Alternatively, a pre-reset period is included before the reset period in one subfield having the smallest gray scale weight among the subfields of the frame from the viewpoint of securing the driving time, or a reset period in two or three subfields of the subfields of the frame. It is also possible to include a pre-reset period before.

프리 리셋 기간 이후, 초기화를 위한 리셋 기간의 셋업(Set-Up) 기간에서는 구동부(110)는 스캔 전극(Y)으로 제 1 하강 램프 신호와 반대 극성 방향의 상승 램프(Ramp-Up) 신호를 인가한다.After the pre-reset period, in the set-up period of the reset period for initialization, the driving unit 110 applies a ramp-up signal in a direction opposite to the first falling ramp signal to the scan electrode Y. do.

여기서, 상승 램프 신호는 제 20 전압(V20)부터 제 30 전압(V30)까지 제 1 기울기로 점진적으로 상승하는 제 1 상승 램프 신호와 제 30 전압(V30)부터 제 40 전압(V40)까지 제 2 기울기로 상승하는 제 2 상승 램프 신호를 포함하는 것이 바람직하다.Here, the rising ramp signal may include a first rising ramp signal gradually increasing with a first slope from the twentieth voltage V20 to the thirtieth voltage V30 and the second rising ramp signal from the thirtieth voltage V30 to the forty-th voltage V40. It is preferred to include a second rising ramp signal that rises with a slope.

이때, 구동부(110)는 서스테인 전극(Z)에 제 1 서스테인 바이어스 신호의 제 1 서스테인 바이어스 전압(Vz1)보다 낮은 전압을 갖는 제 2 서스테인 바이어스 신호를 인가하는 것이 바람직하다.At this time, the driving unit 110 preferably applies a second sustain bias signal having a voltage lower than the first sustain bias voltage Vz1 of the first sustain bias signal to the sustain electrode Z.

여기서, 제 2 서스테인 바이어스 신호는 제 2 서스테인 바이어스 전압(Vz2)을 실질적으로 유지하는 것이 바람직하고, 아울러 이러한 제 2 서스테인 바이어스 전압(Vz2)은 그라운드 레벨(GND)의 전압일 수 있다.Here, the second sustain bias signal preferably maintains the second sustain bias voltage Vz2 substantially, and the second sustain bias voltage Vz2 may be a voltage of the ground level GND.

이러한 셋업 기간에서는 상승 램프 신호에 의해 방전 셀 내에는 약한 암방전(Dark Discharge), 즉 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 어느 정도의 벽 전하(Wall Charge)가 쌓이게 된다.In this setup period, a weak dark discharge, that is, setup discharge, occurs in the discharge cell by the rising ramp signal. This setup discharge causes a certain amount of wall charges to accumulate in the discharge cell.

여기서, 제 2 상승 램프 신호의 제 2 기울기는 제 1 기울기보다 더 완만한 것이 바람직하다. 이와 같이, 제 2 기울기를 제 1 기울기보다 더 완만하게 하게 되면, 셋업 방전이 발생하기 이전까지는 전압을 상대적으로 빠르게 상승시키고, 셋업 방전이 발생하는 동안에는 전압을 상대적으로 느리게 상승시키는 효과를 획득함으로써, 셋업 방전에 의해 발생하는 광의 양을 저감시킬 수 있다.Here, it is preferable that the second slope of the second rising ramp signal is gentler than the first slope. As such, when the second slope is made gentler than the first slope, the voltage is increased relatively quickly until the setup discharge occurs, and the voltage is increased relatively slowly while the setup discharge occurs. The amount of light generated by the setup discharge can be reduced.

이에 따라, 콘트라스트(Contrast) 특성을 개선할 수 있다.Accordingly, the contrast characteristic can be improved.

셋업 기간 이후의 셋다운(Set-Down) 기간에서는 구동부(110)는 상승 램프 신호 이후에 이러한 상승 램프 신호와 반대 극성 방향의 제 2 하강 램프(Ramp-Down) 신호를 스캔 전극(Y)에 인가한다.In the set-down period after the set-up period, the driving unit 110 applies a second ramp-down signal in the opposite polarity direction to the scan electrode Y after the ramp ramp signal. .

여기서, 제 2 하강 램프 신호는 제 20 전압(V20)부터 제 50 전압(V50)까지 점진적으로 하강하는 것이 바람직하다.Here, it is preferable that the second falling ramp signal gradually decreases from the twentieth voltage V20 to the fifty voltage V50.

이때, 구동부(110)는 리셋 기간에서 스캔 전극(Y)에 제 2 하강 램프 신호가 인가되는 동안의 일부에서는 실질적으로 제 2 서스테인 바이어스 전압(Vz2)을 유지하는 제 2 서스테인 바이어스 신호(Vz2)를 인가하는 것이 바람직하다.In this case, the driving unit 110 may receive the second sustain bias signal Vz2 that substantially maintains the second sustain bias voltage Vz2 in a part while the second falling ramp signal is applied to the scan electrode Y in the reset period. It is preferable to apply.

이에 따라, 방전 셀 내에서 미약한 소거 방전(Erase Discharge), 즉 셋다운 방전이 발생한다. 이 셋다운 방전에 의해 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류된다.As a result, weak erase discharge, that is, set-down discharge, occurs in the discharge cell. By this set-down discharge, wall charges such that address discharge can be stably generated in the discharge cells remain uniformly.

한편, 여기 도 4와는 다르게 상승 램프 신호 또는 제 2 하강 램프 신호를 설정할 수도 있는데, 이에 대해 첨부된 도 5a 내지 도 5b를 결부하여 살펴보면 다음과 같다.Meanwhile, unlike FIG. 4, the rising ramp signal or the second falling ramp signal may be set, which will be described below with reference to FIGS. 5A to 5B.

도 5a 내지 도 5b는 상승 램프 신호 또는 제 2 하강 램프 신호의 또 다른 형태에 대해 설명하기 위한 도면이다.5A to 5B are diagrams for explaining another form of the rising ramp signal or the second falling ramp signal.

먼저, 도 5a를 살펴보면, 상승 램프 신호는 제 30 전압(V30)까지는 급격히 상승한 이후에 제 30 전압(V30)부터 제 40 전압(V40)까지 점진적으로 상승하는 형태이다.First, referring to FIG. 5A, the rising ramp signal gradually increases from the thirtieth voltage V30 to the forty-th voltage V40 after rapidly rising to the thirtieth voltage V30.

이와 같이, 상승 램프 신호는 도 4에서와 같이 두 단계에 걸쳐 서로 다른 기울기로 점진적으로 상승하는 것도 가능하고, 여기 도 5a에서와 같이 하나의 단계에서 점진적으로 상승하는 것도 가능한 것과 같이, 다양한 형태로 변경되는 것이 가능한 것이다.As such, the rising ramp signal may rise gradually with different inclinations over two stages, as shown in FIG. 4, and in various forms, such as gradually rising in one stage as shown here in FIG. 5A. It is possible to change.

다음, 도 5b를 살펴보면 제 2 하강 램프 신호는 제 30 전압(V30)에서부터 전압이 점진적으로 하강하는 형태이다.Next, referring to FIG. 5B, the second falling ramp signal has a form in which the voltage gradually decreases from the thirtieth voltage V30.

이와 같이, 제 2 하강 램프 신호는 전압이 하강하는 시점을 다르게 변경하는 것도 가능한 것과 같이, 다양한 형태로 변경되는 것이 가능한 것이다.As described above, the second falling ramp signal may be changed in various forms, such as a different point in time at which the voltage falls.

이상 도 5a 내지 도 5b에 대한 설명을 마무리하기로 한다.This concludes the description of FIGS. 5A to 5B.

한편, 리셋 기간 이후의 어드레스 기간에서는 구동부(110)는 제 2 하강 램프 신호의 제 50 전압(V50)보다는 높은 전압을 실질적으로 유지하는 스캔 바이어스 신호를 스캔 전극(Y)에 인가할 수 있다.Meanwhile, in the address period after the reset period, the driver 110 may apply a scan bias signal to the scan electrode Y that substantially maintains a voltage higher than the 50 th voltage V50 of the second falling ramp signal.

아울러, 스캔 바이어스 신호로부터 제 60 전압(V60)까지 하강하는 스캔 신호(Scan)를 모든 스캔 전극(Y1~Yn)에 인가한다.In addition, a scan signal Scan, which drops from the scan bias signal to the sixtieth voltage V60, is applied to all the scan electrodes Y1 to Yn.

예를 들면, 첫 번째 스캔 전극(Y1)에 첫 번째 스캔 신호(Scan 1)를 인가하 고, 이후에 두 번째 스캔 전극(Y2)에 두 번째 스캔 신호(Scan 2)를 인가하고, n 번째 스캔 전극(Yn)에는 n 번째 스캔 신호(Scan n)를 인가한다.For example, the first scan signal Scan 1 is applied to the first scan electrode Y1, the second scan signal Scan 2 is applied to the second scan electrode Y2, and the nth scan is applied. The nth scan signal Scan n is applied to the electrode Yn.

이와 같이, 제 60 전압(V60)까지 하강하는 스캔 신호(Scan)를 스캔 전극(Y)으로 인가할 때, 이에 대응되게 어드레스 전극(X)에 데이터 전압(Vd)까지 상승하는 데이터 신호를 인가할 수 있다.As such, when the scan signal falling down to the 60th voltage V60 is applied to the scan electrode Y, the data signal rising up to the data voltage Vd is applied to the address electrode X correspondingly. Can be.

이에 따라, 스캔 신호(Scan)의 부극성 스캔 전압(-Vy)과 데이터 신호의 데이터 전압(Vd) 간의 전압 차와 리셋 기간에 생성된 벽 전하들에 의한 벽 전압이 더해지면서 데이터 신호의 전압(Vd)이 인가되는 방전 셀 내에는 어드레스 방전이 발생된다.Accordingly, the voltage difference between the negative scan voltage (-Vy) of the scan signal Scan and the data voltage Vd of the data signal and the wall voltage generated by the wall charges generated in the reset period are added to the voltage of the data signal ( An address discharge is generated in the discharge cell to which Vd) is applied.

이러한, 어드레스 방전에 의해 선택된 방전 셀 내에는 이후의 서스테인 기간에서 서스테인 신호(SUS)가 인가될 때 서스테인 방전이 일어날 수 있게 하는 정도의 벽 전하가 형성된다.In this discharge cell selected by the address discharge, wall charges such that sustain discharge can occur when the sustain signal SUS is applied in a subsequent sustain period are formed.

아울러, 이러한 어드레스 기간에서는 구동부(110)는 서스테인 전극(Z)에 의한 간섭에 의해 어드레스 방전이 불안정해지는 것을 방지하기 위해 서스테인 전극(Z)에 제 3 서스테인 바이어스 신호를 인가하는 것이 바람직하다.In addition, in such an address period, the driving unit 110 preferably applies a third sustain bias signal to the sustain electrode Z in order to prevent the address discharge from becoming unstable due to interference by the sustain electrode Z.

여기서, 제 3 서스테인 바이어스 신호는 제 1 서스테인 바이어스 전압(Vz1)보다는 작고 제 2 서스테인 바이어스 전압(Vz2)보다는 큰 제 3 서스테인 바이어스 전압(Vz3)을 실질적으로 일정하게 유지하는 것이 바람직하다.Here, it is preferable that the third sustain bias signal maintains the third sustain bias voltage Vz3 substantially smaller than the first sustain bias voltage Vz1 and greater than the second sustain bias voltage Vz2.

이후, 구동부(110)는 영상 표시를 위한 서스테인 기간에서는 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나에 서스테인 신호(SUS)를 인가한다. 바람직하 게는 스캔 전극(Y) 또는 서스테인 전극(Z) 중 스캔 전극에 양(+)의 서스테인 신호와 음(-)의 서스테인 신호를 번갈아가면 인가한다.Thereafter, the driver 110 applies the sustain signal SUS to either the scan electrode Y or the sustain electrode Z during the sustain period for displaying an image. Preferably, a positive sustain signal and a negative sustain signal are alternately applied to the scan electrode among the scan electrode (Y) or the sustain electrode (Z).

이와 같이 스캔 전극(Y)에 양의 서스테인 신호와 음의 서스테인 신호가 인가되는 동안 구동부(110)는 나머지 서스테인 전극(Z)에는 바이어스 신호를 인가하는 것이 바람직하다.As described above, while the positive sustain signal and the negative sustain signal are applied to the scan electrode Y, the driving unit 110 preferably applies a bias signal to the remaining sustain electrode Z.

여기서, 바이어스 신호는 그라운드 레벨(GND)의 전압을 실질적으로 일정하게 유지하는 것이 바람직하다.Here, the bias signal preferably maintains the voltage at the ground level GND substantially constant.

이에 따라 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 신호(SUS)의 서스테인 전압(Vs)이 더해지면서 매 서스테인 신호(SUS)가 인가될 때 마다 스캔 전극(Y)과 서스테인 전극(Z) 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다. 이에 따라, 플라즈마 디스플레이 패널 상에 소정의 영상이 구현되는 것이다.As a result, the discharge cells selected by the address discharge have the scan voltage Y and the sustain electrode each time the sustain signal Vs is applied while the wall voltage in the discharge cell and the sustain voltage Vs of the sustain signal Vs are added. A sustain discharge, that is, a display discharge occurs between Z). Accordingly, a predetermined image is implemented on the plasma display panel.

이와 같이 서스테인 기간에서 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나에만 서스테인 신호를 인가하고, 나머지 하나의 전극에는 바이어스 신호를 인가하게 되면, 구동부의 형태를 보다 단순화 할 수 있다.As such, when the sustain signal is applied to only one of the scan electrode Y and the sustain electrode Z and the bias signal is applied to the other electrode in the sustain period, the shape of the driving unit can be simplified.

예를 들어, 스캔 전극(Y)에도 서스테인 신호를 인가하고, 서스테인 전극(Z)에도 서스테인 신호를 인가하는 경우에는 스캔 전극(Y)에 서스테인 신호를 인가하기 위한 회로들이 배치되는 구동 보드(Board)와 서스테인 전극(Z)에 서스테인 신호를 인가하기 위한 회로들이 배치되는 구동 보드가 각각 필요하게 된다.For example, when a sustain signal is applied to the scan electrode Y, and a sustain signal is also applied to the sustain electrode Z, a driving board on which circuits for applying the sustain signal to the scan electrode Y are arranged And driving boards on which circuits for applying a sustain signal to the sustain electrode Z are arranged.

반면에, 본 발명에서와 같이 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나의 전극에만 서스테인 신호를 인가하는 경우에는 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나의 전극에 서스테인 신호를 인가하기 위한 회로들이 배치되는 하나의 구동 보드만이 구비되면 된다.On the other hand, when the sustain signal is applied to only one of the scan electrode (Y) and the sustain electrode (Z) as in the present invention, the sustain is applied to any one of the scan electrode (Y) or the sustain electrode (Z). Only one driving board on which circuits for applying a signal are arranged is required.

이에 따라, 구동부의 전체 크기를 줄일 수 있고, 이에 따라 제조 단가를 저감시킬 수 있게 된다.As a result, the overall size of the driving unit can be reduced, thereby reducing the manufacturing cost.

여기서, 서스테인 기간에서 인가되는 서스테인 신호에 대해 보다 상세히 살펴보면 다음과 같다.Here, the sustain signal applied in the sustain period will be described in more detail as follows.

도 6은 서스테인 신호에 대해 보다 상세히 설명하기 위한 도면이다.6 is a diagram for explaining the sustain signal in more detail.

도 6을 살펴보면, 영상 표시를 위한 서스테인 기간에서 스캔 전극(Y)으로 인가되는 서스테인 신호는 그라운드 레벨(GND)의 전압보다 큰 제 1 전압(V1)까지 상승하는 양(+)의 서스테인 신호와 그라운드 레벨(GND)의 전압보다 작은 제 2 전압(V2)까지 하강하는 음(-)의 서스테인 신호를 포함한다. 특히, 여기서 제 1 전압(V1)의 크기는 제 2 전압(V2)의 크기보다 더 크다. 즉, ΔV1이 ΔV2보다 더 큰 것이다. 다르게 표현하면 양의 서스테인 신호의 크기는 음의 서스테인 신호의 크기보다 더 큰 것이다.Referring to FIG. 6, in the sustain period for displaying an image, the sustain signal applied to the scan electrode Y is increased to the first voltage V1 which is greater than the voltage of the ground level GND. And a negative sustain signal falling down to the second voltage V2 which is smaller than the voltage of the level GND. In particular, the magnitude of the first voltage V1 is greater than the magnitude of the second voltage V2 here. That is, ΔV1 is larger than ΔV2. In other words, the magnitude of the positive sustain signal is larger than that of the negative sustain signal.

여기서, 양의 서스테인 신호와 음의 서스테인 신호는 번갈아가며 스캔 전극(Y)에 인가되는 것이 바람직하다.Here, it is preferable that the positive sustain signal and the negative sustain signal are alternately applied to the scan electrode (Y).

이와 같이, 양의 서스테인 신호의 크기를 음의 서스테인 신호의 크기보다 더 크게 하는 이유는 양의 서스테인 신호에 의해 발생하는 서스테인 방전의 특성과 음의 서스테인 신호에 의해 발생하는 서스테인 방전의 특성이 서로 달라질 수 있기 때문이다.As such, the reason for making the magnitude of the positive sustain signal larger than the magnitude of the negative sustain signal is that the characteristics of the sustain discharge generated by the positive sustain signal and that of the sustain discharge generated by the negative sustain signal are different from each other. Because it can.

보다 자세하게는, 양의 벽 전하, 즉 양 전하의 질량이 음의 벽 전하, 즉 전자의 질량에 비해 상대적으로 더 큰 값을 갖는다.More specifically, the positive wall charge, ie the mass of the positive charge, has a relatively larger value compared to the negative wall charge, ie the mass of the electrons.

이에 따라 양의 서스테인 신호를 인가함으로써 양의 벽 전하의 반발력을 충분히 이용하여 발생시키는 서스테인 방전의 에너지의 양이 음의 서스테인 인가함으로써 발생시키는 서스테인 방전의 에너지의 양에 비해 상대적으로 더 크게 된다.Accordingly, the amount of energy of the sustain discharge generated by fully utilizing the repulsive force of the positive wall charge by applying the positive sustain signal becomes relatively larger than the amount of energy of the sustain discharge generated by applying the negative sustain.

따라서 양의 서스테인 신호의 크기를 음의 서스테인 신호의 크기에 비해 더 크게 하는 것이 에너지 효율의 측면에서 더욱 유리한 것이다.Therefore, it is more advantageous in terms of energy efficiency to make the magnitude of the positive sustain signal larger than the magnitude of the negative sustain signal.

예를 들어, -160V까지 하강하는 음의 서스테인 신호와 +160V까지 상승하는 서스테인 신호를 가정하자. 이러한 경우는 -160V부터 +160까지 총 320V를 스윙(Swing)하는 타입인 것이다. 이를 제 1 타입(Type 1)이라 하자.For example, assume a negative sustain signal falling to -160V and a sustain signal rising to + 160V. In this case, the total swing is 320V from -160V to +160. Let this be a first type (Type 1).

반면에, -140V까지 하강하는 음의 서스테인 신호와 +180V까지 상승하는 서스테인 신호를 가정하자. 이러한 경우는 -140V부터 +180까지 총 320V를 스윙(Swing)하는 타입인 것이다. 이를 제 2 타입(Type 2)이라 하자.On the other hand, suppose a negative sustain signal falling to -140V and a sustain signal rising to + 180V. In this case, the total swing is 320V from -140V to +180. Let this be a second type (Type 2).

이러한 제 1 타입과 제 2 타입은 전체 전압의 스윙 폭은 서로 같지만, 제 2 타입이 제 1 타입에 비해 상대적으로 양의 전압의 방향으로 더 크게 스윙하는 경우이다.The first type and the second type have the same swing widths of the total voltages, but the second type swings larger in the direction of the positive voltage than the first type.

여기서, 제 2 타입이 제 1 타입과 동일한 스윙(Swing) 폭을 갖더라도 양의 전압 방향으로 더 크게 스윙하기 때문에 서스테인 방전의 효율이 상대적으로 더 높은 것이다.Here, even if the second type has the same swing width as the first type, since the swing swings larger in the positive voltage direction, the efficiency of the sustain discharge is relatively higher.

여기서, 양의 서스테인 신호와 음의 서스테인 신호의 전압의 차이, 즉 제 1 전압(V1)과 제 2 전압(V2)의 크기의 차이는 서스테인 방전의 효율 및 서스테인 방전의 균형의 측면이 고려되어 결정되는 것이 바람직하다.Here, the difference between the voltages of the positive sustain signal and the negative sustain signal, that is, the difference between the magnitudes of the first voltage V1 and the second voltage V2 is determined by considering the efficiency of the sustain discharge and the balance of the sustain discharge. It is desirable to be.

예를 들어, 제 1 전압(V1)의 크기가 제 2 전압(V2)의 크기보다 더 커야만 서스테인 방전의 효율의 증가를 기대할 수 있고, 아울러 제 1 전압(V1)과 제 2 전압(V2)의 크기의 차이가 과도하게 증가하는 경우, 즉 제 1 전압(V1)의 크기가 제 2 전압(V2)의 크기보다 과도하게 큰 경우에는 서스테인 방전이 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나의 방향으로 과도하게 치우치게 됨으로써, 오히려 서스테인 방전의 효율이 감소할 수 있게 된다.For example, an increase in the efficiency of the sustain discharge can be expected only when the magnitude of the first voltage V1 is greater than the magnitude of the second voltage V2, and the first voltage V1 and the second voltage V2 are also expected to be increased. In the case where the magnitude of the difference is excessively increased, that is, when the magnitude of the first voltage V1 is excessively larger than the magnitude of the second voltage V2, the sustain discharge is in the scan electrode Y or the sustain electrode Z. By being excessively biased in either direction, the efficiency of the sustain discharge can be reduced rather.

이를 고려할 때, 제 1 전압(V1)과 제 2 전압(V2)의 크기의 차이, 즉 ΔV1-ΔV2는 대략 10V이상 40V이하인 것이 바람직하다.In consideration of this, it is preferable that the difference between the magnitudes of the first voltage V1 and the second voltage V2, that is, ΔV1-ΔV2 is approximately 10V or more and 40V or less.

여기서, 서스테인 방전의 균형의 측면을 더욱 고려할 때, 제 1 전압(V1)과 제 2 전압(V2)의 크기의 차이, 즉 ΔV1-ΔV2는 대략 20V이상 30V이하인 것이 더욱 바람직하다.Here, when further considering the balance of the sustain discharge, it is more preferable that the difference between the magnitudes of the first voltage V1 and the second voltage V2, that is, ΔV1-ΔV2 is approximately 20V or more and 30V or less.

더욱 바람직하게는, 양의 서스테인 신호의 크기, 즉 제 1 전압(V1)의 크기는 대략 180V이상 190V이하이고, 음의 서스테인 신호의 크기, 즉 제 2 전압(V2)의 크기는 대략 150V이상 170V이하인 것이 바람직하다.More preferably, the magnitude of the positive sustain signal, that is, the magnitude of the first voltage V1 is about 180V or more and 190V or less, and the magnitude of the negative sustain signal, that is, the magnitude of the second voltage V2 is about 150V or more and 170V. It is preferable that it is the following.

즉, 제 2 전압(V2)이 그라운드 레벨(GND) 이하의 전압인 것을 고려할 때, 제 2 전압(V2)은 대략 -170V이상 -150V이하인 것이 바람직한 것이다.That is, considering that the second voltage V2 is a voltage below the ground level GND, the second voltage V2 is preferably about -170V or more and -150V or less.

이러한 제 1 전압(V1)과 제 2 전압(V2)의 관계, 즉 양의 서스테인 신호와 음 의 서스테인 신호의 전압의 크기에 대해 도 7을 결부하여 보다 상세히 살펴보면 다음과 같다.The relationship between the first voltage V1 and the second voltage V2, that is, the magnitudes of the voltages of the positive sustain signal and the negative sustain signal will be described in more detail with reference to FIG. 7.

도 7은 양의 서스테인 신호와 음의 서스테인 신호의 전압의 크기에 대해 보다 상세히 설명하기 위한 도면이다.FIG. 7 is a diagram for describing the magnitudes of voltages of a positive sustain signal and a negative sustain signal in more detail.

도 7을 살펴보면, (●)의 표시는 양의 서스테인 신호의 크기를 고정시킨 상태에서 음의 서스테인 신호의 크기를 변경하는 경우이고, (▲)의 표시는 양의 서스테인 신호의 크기와 음의 서스테인 신호의 크기를 동일하게 하면서 변경하는 경우이고, (■)의 표시는 음의 서스테인 신호의 크기를 고정시킨 상태에서 양의 서스테인 신호의 크기를 변경하는 경우를 나타낸다.Referring to FIG. 7, the indication of (●) is a case where the magnitude of the negative sustain signal is changed while the magnitude of the positive sustain signal is fixed, and the indication of (▲) is the magnitude and negative sustain of the positive sustain signal. This is a case where the magnitude of the signal is changed while being the same, and the indication (■) shows a case where the magnitude of the positive sustain signal is changed while the magnitude of the negative sustain signal is fixed.

먼저, 양의 서스테인 신호의 크기를 160V로 고정시킨 상태에서 음의 서스테인 신호의 크기를 160V부터 190V까지의 범위 내에서 변경하는 (●)의 표시를 살펴보면, 상대적인 방전 효율(Relative Efficiency : A.U)은 대략 0.175부터 0.16까지 점진적으로 악화되는 것을 확인할 수 있다.First, when the magnitude of the negative sustain signal is fixed at 160 V and the negative signal is changed within the range of 160 V to 190 V, the relative discharge efficiency (AU) is It can be seen that it gradually worsens from about 0.175 to 0.16.

다음, 양의 서스테인 신호와 음의 서스테인 신호의 크기를 동일하게 하고, 아울러 이러한 양의 서스테인 신호와 음의 서스테인 신호의 크기를 160V부터 190V까지 변경하는 (▲)의 표시를 살펴보면, 상대적인 방전 효율은 대략 0.175부터 0.19까지 점진적으로 향상되는 것을 확인할 수 있다.Next, looking at the mark (▲) that equalizes the magnitude of the positive sustain signal and the negative sustain signal and changes the magnitude of the positive sustain signal and the negative sustain signal from 160V to 190V, the relative discharge efficiency is It can be seen that it gradually improves from about 0.175 to 0.19.

다음, 음의 서스테인 신호의 크기를 160V로 고정시킨 상태에서 양의 서스테인 신호의 크기를 160V부터 190V까지의 범위 내에서 변경하는 (■)의 표시를 살펴보면, 상대적인 방전 효율은 대략 0.175부터 0.215까지 점진적으로 향상되는 것을 확인할 수 있다.Next, look at the indication (■) of changing the magnitude of the positive sustain signal within the range of 160V to 190V with the magnitude of the negative sustain signal fixed at 160V, and the relative discharge efficiency is gradually increased from approximately 0.175 to 0.215. It can be seen that the improvement.

이는 양의 서스테인 신호와 음의 서스테인 신호의 크기를 동일하게 하는 (▲)의 표시의 경우보다 방전 효율이 더 높은 것을 확인할 수 있다. 특히, 음의 서스테인 신호의 크기가 160V이고, 양의 서스테인 신호의 크기가 대략 180V이상 190V이하인 경우에 방전 효율이 대략 0.215 정도로 상대적으로 높은 것을 확인할 수 있다.This confirms that the discharge efficiency is higher than in the case of the display of (▲) equalizing the magnitude of the positive sustain signal and the negative sustain signal. In particular, it can be seen that the discharge efficiency is relatively high when the magnitude of the negative sustain signal is 160V and the magnitude of the positive sustain signal is about 180V or more and 190V or less.

이는, 도 6의 양의 서스테인 신호의 크기, 즉 제 1 전압(V1)의 크기가 대략 180V이상 190V이하이고, 음의 서스테인 신호의 크기, 즉 제 2 전압(V2)의 크기는 대략 160V인 경우에 방전 효율이 상대적으로 높은 것을 의미할 수 있다.This is the case where the magnitude of the positive sustain signal of FIG. 6, that is, the magnitude of the first voltage V1 is approximately 180V or more and 190V or less, and the magnitude of the negative sustain signal, that is, the magnitude of the second voltage V2 is approximately 160V. This may mean that the discharge efficiency is relatively high.

다음, 도 8은 서스테인 신호의 또 다른 형태를 설명하기 위한 도면이다.Next, FIG. 8 is a diagram for explaining another form of the sustain signal.

도 8을 살펴보면, 스캔 전극(Y) 또는 서스테인 전극(Z) 중 서스테인 전극(Z)에 양의 서스테인 신호와 음의 서스테인 신호가 인가되고, 스캔 전극(Y)에는 바이어스 신호가 인가된다. 즉, 앞선 도 4의 경우와는 반대의 경우인 것이다.Referring to FIG. 8, a positive sustain signal and a negative sustain signal are applied to the sustain electrode Z among the scan electrode Y or the sustain electrode Z, and a bias signal is applied to the scan electrode Y. That is, the case is opposite to the case of FIG.

이와 같이, 양의 서스테인 신호와 음의 서스테인 신호가 인가되는 전극은 변경될 수 있는 것이다.As such, the electrodes to which the positive sustain signal and the negative sustain signal are applied may be changed.

한편, 이상의 설명에서는 양의 서스테인 신호는 그라운드 레벨(GND)의 전압으로부터 제 1 전압(V1)까지 상승하고, 음의 서스테인 신호는 그라운드 레벨(GND)의 전압으로부터 제 2 전압(V2)까지 하강하는 것으로만 도시하고 설명하고 있지만, 이와 다른 형태도 가능하다. 이에 대해 살펴보면 다음과 같다.On the other hand, in the above description, the positive sustain signal rises from the voltage of the ground level GND to the first voltage V1, and the negative sustain signal falls from the voltage of the ground level GND to the second voltage V2. Although only illustrated and described as being possible, other forms are possible. This is as follows.

도 9는 기준 전압이 고려된 서스테인 신호에 대해 설명하기 위한 도면이다.FIG. 9 is a diagram for explaining a sustain signal considering a reference voltage. FIG.

도 9를 살펴보면, 양의 서스테인 신호는 기준 전압(V3)으로부터 제 1 전압까지 상승하고, 음의 서스테인 신호는 기준 전압(V3)으로부터 제 2 전압(V2)까지 하강하는 형태이다.9, the positive sustain signal rises from the reference voltage V3 to the first voltage, and the negative sustain signal falls from the reference voltage V3 to the second voltage V2.

여기서, 기준 전압(V3)은 그라운드 레벨(GND)의 전압보다는 높은 레벨의 전압이다.Here, the reference voltage V3 is a voltage having a higher level than the voltage of the ground level GND.

따라서 기준 전압(V3)과 제 1 전압(V1)의 크기의 차이(ΔV10)와 기준 전압(V3)과 제 2 전압(V2)의 크기의 차이(ΔV20)가 실질적으로 동일하다고 하더라도, 양의 서스테인 신호의 크기, 즉 제 1 전압(V1)과 그라운드 레벨(GND)의 전압의 크기의 차이(ΔV1)는 음의 서스테인 신호의 크기, 즉 그라운드 레벨(GND)의 전압과 제 2 전압(V2)의 크기의 차이(ΔV2)보다 더 크게 된다.Therefore, even if the difference ΔV10 between the magnitude of the reference voltage V3 and the first voltage V1 and the difference ΔV20 between the magnitude of the reference voltage V3 and the second voltage V2 are substantially the same, the positive sustain is positive. The magnitude of the signal, that is, the difference ΔV1 between the first voltage V1 and the voltage of the ground level GND, is the magnitude of the negative sustain signal, that is, the voltage of the ground level GND and the second voltage V2. It is larger than the difference ΔV2 in magnitude.

이와 같이, 기준 전압(V3)을 설정하고, 이러한 기준 전압(V3)으로부터 스윙하는 타입의 서스테인 신호도 적용 가능한 것이다.In this manner, a sustain signal of a type that sets the reference voltage V3 and swings from the reference voltage V3 can also be applied.

다음, 도 10은 양의 서스테인 신호와 음의 서스테인 신호를 인가하는 순서를 변경하는 방법의 일례를 설명하기 위한 도면이다.Next, FIG. 10 is a diagram for explaining an example of a method of changing the order of applying the positive sustain signal and the negative sustain signal.

도 10을 살펴보면, 제 1 전압(V1)까지 상승하는 제 1 양의 서스테인 신호, 제 2 전압(V2)까지 하강하는 제 1 음의 서스테인 신호, 제 2 양의 서스테인 신호, 제 2 음의 서스테인 신호 및 제 3 양의 서스테인 신호가 순차적으로 인가된 이후에, 제 3 음의 서스테인 신호가 인가되지 않고 제 4 양의 서스테인 신호가 인가된다.Referring to FIG. 10, a first positive sustain signal rising to the first voltage V1, a first negative sustain signal falling to the second voltage V2, a second positive sustain signal, and a second negative sustain signal And after the third positive sustain signal is sequentially applied, the third negative sustain signal is not applied and the fourth positive sustain signal is applied.

즉, 양의 서스테인 신호와 음의 서스테인 신호가 번갈아가면 인가되는 것도 가능하지만, 여기 도 10에서와 같이 양의 서스테인 신호 또는 음의 서스테인 신호 중 하나 이상을 두 번 이상 연속적으로 인가하는 것도 가능한 등 다양하게 변경할 수 있는 것이다.That is, the positive sustain signal and the negative sustain signal may be applied alternately, but as shown in FIG. 10, one or more of the positive sustain signal or the negative sustain signal may be applied continuously two or more times. It can be changed.

이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.As such, the technical configuration of the present invention described above can be understood by those skilled in the art that the present invention can be implemented in other specific forms without changing the technical spirit or essential features of the present invention.

그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.Therefore, the exemplary embodiments described above are to be understood as illustrative and not restrictive in all respects, and the scope of the present invention is indicated by the appended claims rather than the foregoing detailed description, and the meaning and scope of the claims are as follows. And all changes or modifications derived from the equivalent concept should be interpreted as being included in the scope of the present invention.

이상에서 상세히 설명한 바와 같이, 본 발명의 플라즈마 디스플레이 장치는 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나에 양의 서스테인 신호와 음의 서스테인 신호를 인가하고, 나머지 하나에는 바이어스 신호를 인가함으로써, 서스테인 방전 효율을 증가시키는 효과가 있다.As described in detail above, the plasma display apparatus of the present invention applies a positive sustain signal and a negative sustain signal to either the scan electrode Y or the sustain electrode Z, and applies a bias signal to the other. This has the effect of increasing the sustain discharge efficiency.

Claims (7)

스캔 전극, 서스테인 전극 및 어드레스 전극이 형성되는 플라즈마 디스플레이 패널과,A plasma display panel in which scan electrodes, sustain electrodes and address electrodes are formed; 영상 표시를 위한 서스테인 기간에서 상기 스캔 전극 또는 서스테인 전극 중 어느 하나에 그라운드 레벨(GND)의 전압보다 큰 제 1 전압까지 상승하는 양(+)의 서스테인 신호와 상기 그라운드 레벨의 전압보다 작은 제 2 전압까지 하강하는 음(-)의 서스테인 신호를 인가하고, 상기 제 1 전압의 크기를 상기 제 2 전압의 크기보다 더 크도록 하고,A positive sustain signal rising to a first voltage greater than the voltage of the ground level GND to either the scan electrode or the sustain electrode in the sustain period for displaying an image and a second voltage smaller than the voltage of the ground level Apply a negative sustain signal that descends to and make the magnitude of the first voltage greater than the magnitude of the second voltage, 상기 스캔 전극 또는 서스테인 전극에 상기 양(+)의 서스테인 신호와 상기 음(-)의 서스테인 신호가 인가하는 동안 상기 어드레스 전극에는 바이어스 신호를 인가하는 구동부;A driver configured to apply a bias signal to the address electrode while the positive sustain signal and the negative sustain signal are applied to the scan electrode or the sustain electrode; 를 포함하는 플라즈마 디스플레이 장치.Plasma display device comprising a. 제 1 항에 있어서,The method of claim 1, 상기 구동부는The driving unit 상기 양의 서스테인 신호와 음의 서스테인 신호를 번갈아가며 인가하는 것을 특징으로 하는 플라즈마 디스플레이 장치.And applying the positive sustain signal and the negative sustain signal alternately. 제 1 항에 있어서,The method of claim 1, 상기 제 1 전압과 제 2 전압의 크기의 차이는 10V이상 40V이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.The difference between the magnitudes of the first voltage and the second voltage is 10V or more and 40V or less. 제 3 항에 있어서,The method of claim 3, wherein 상기 제 1 전압과 제 2 전압의 크기의 차이는 20V이상 30V이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.And the difference between the magnitudes of the first voltage and the second voltage is 20V or more and 30V or less. 제 1 항에 있어서,The method of claim 1, 상기 제 1 전압의 크기는 180V이상 190V이하이고, 상기 제 2 전압의 크기는 150V이상 170V이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.And the magnitude of the first voltage is greater than or equal to 180V and less than or equal to 190V, and the magnitude of the second voltage is greater than or equal to 150V and less than or equal to 170V. 제 1 항에 있어서,The method of claim 1, 상기 구동부는The driving unit 상기 스캔 전극 또는 서스테인 전극 중 나머지 하나의 전극에는 바이어스 신호를 인가하는 것을 특징으로 하는 플라즈마 디스플레이 장치.And applying a bias signal to the other one of the scan electrode and the sustain electrode. 제 6 항에 있어서,The method of claim 6, 상기 바이어스 신호는 그라운드 레벨의 전압을 실질적으로 일정하게 유지하는 것을 특징으로 하는 플라즈마 디스플레이 장치.And the bias signal maintains a substantially constant voltage at ground level.
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