KR100790460B1 - Plasma display panel - Google Patents
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Abstract
Description
도 1 은 본 발명에 따른 플라즈마 디스플레이 패널의 구조에 대한 제 1 실시예를 나타내는 사시도이다.1 is a perspective view showing a first embodiment of the structure of a plasma display panel according to the present invention.
도 2 는 본 발명에 따를 플라즈마 디스플레이 패널의 구조에 대한 제 2 실시예를 나타내는 사시도이다.2 is a perspective view showing a second embodiment of the structure of the plasma display panel according to the present invention.
도 3 은 본 발명에 따른 플라즈마 디스플레이 패널의 상판 패널 구조에 대한 제 1 실시예를 개략적으로 나타내는 단면도이다.3 is a cross-sectional view schematically illustrating a first embodiment of a top panel structure of a plasma display panel according to the present invention.
도 4 는 본 발명에 따른 플라즈마 디스플레이 패널의 전극 배치에 대한 제 1 실시예를 나타내는 단면도이다.4 is a cross-sectional view showing a first embodiment of the electrode arrangement of the plasma display panel according to the present invention.
도 5 는 본 발명에 따른 플라즈마 디스플레이 패널에 전면 필터가 합착된 구조에 대한 제 1 실시예를 나타내는 단면도이다.5 is a cross-sectional view illustrating a first embodiment of a structure in which a front filter is attached to a plasma display panel according to the present invention.
도 6 은 본 발명에 따른 플라즈마 디스플레이 패널 구조에 전면 필터가 합착된 구조에 대한 제 2 실시예를 나타내는 단면도이다.6 is a cross-sectional view illustrating a second embodiment of a structure in which a front filter is attached to a plasma display panel structure according to the present invention.
도 7 은 본 발명에 따른 플라즈마 디스플레이 패널의 전면 필터를 나타내는 사시도이다.7 is a perspective view illustrating a front filter of a plasma display panel according to the present invention.
도 8 은 하나의 프레임(frame)을 복수의 서브필드(subfield)로 나누어 플라즈마 디스플레이 패널을 시분할 구동시키는 방법에 대한 제 1 실시예를 나타내는 타이밍도이다.FIG. 8 is a timing diagram illustrating a first embodiment of a method of time-divisionally driving a plasma display panel by dividing one frame into a plurality of subfields.
도 9 는 플라즈마 디스플레이 패널을 구동시키기 위한 구동 신호들에 대한 제 1 실시예를 나타내는 타이밍도이다.9 is a timing diagram showing a first embodiment of drive signals for driving a plasma display panel.
본 발명은 플라즈마 디스플레이 패널에 관한 것으로서, 패널의 상판 글래스의 전면에 단일 층(One Layer)의 전면 필터가 직접 형성되는 플라즈마 디스플레이 장치에 관한 것이다.BACKGROUND OF THE
일반적으로, 플라즈마 디스플레이 패널(Plasma Display Panel)은 방전공간에 설치된 전극들에 소정의 전압을 인가하여 방전을 일으키고 가스 방전 시 발생하는 플라즈마가 형광체를 여기 시킴으로써 문자 또는 그래픽을 포함한 화상을 표시하는 장치이다.In general, a plasma display panel is a device that displays an image including a character or a graphic by applying a predetermined voltage to electrodes installed in a discharge space to generate a discharge, and the plasma generated during gas discharge excites a phosphor. .
또한, 상기 플라즈마 디스플레이 패널은 플라즈마 발광을 이용한 단순한 구조를 갖고, 대형화면,고화질, 경량 박형으로 설치 장소 등의 제약을 받지 않는 화상 표시장치로서 널리 이용되고 있는 추세이다.In addition, the plasma display panel has a simple structure using plasma light emission, and is widely used as an image display device having a large screen, a high definition, a light weight, and being not restricted by an installation location.
상기 패널은 상부 글래스와 하부 글래스로 나누어지고, 상기 상부 글래스의 전면에는 복수의 차단막을 구비하는 전면 필터가 형성되고, 상기 상판 글래스의 하부에는 버스 전극 및 투명 전극을 포함하는 서스테인 전극 및 스캔 전극이 형성된 다.The panel is divided into an upper glass and a lower glass, and a front filter having a plurality of blocking films is formed on a front surface of the upper glass, and a sustain electrode and a scan electrode including a bus electrode and a transparent electrode are formed below the upper glass. Formed.
상기 복수의 차단막은 눈부심을 방지하는 반사방지 차단막, 근적외선 차폐 및 색을 조절하는 칼라 다이 차단막, 전자파를 차폐하는 전자파(EMI) 차폐 차단막을 포함하여 형성된다.The plurality of blocking films may include an anti-reflection blocking film to prevent glare, a color die blocking film to adjust near-infrared shielding and color, and an electromagnetic shielding (EMI) shielding film to shield electromagnetic waves.
그러나, 종래 발명에 따른 플라즈마 디스플레이 패널은 점착제 또는 접착제로 상판 글래스에 부착되는 복수의 차단막으로 전면 필터가 형성되어 제조 공정상 복잡해지고, 투명성 유리와 같은 강화 유리가 없으므로 외부의 충격에 의하여 쉽게 파손 및 제조 원가를 상승시키는 원인이 되고 있다. However, the plasma display panel according to the related art has a front filter formed with a plurality of blocking films attached to the top glass with an adhesive or an adhesive, which is complicated in the manufacturing process, and since there is no tempered glass such as transparent glass, it is easily broken and damaged by external impact. It is a cause of raising the manufacturing cost.
본 발명은 상기한 종래 기술의 문제점을 개선하기 위하여 안출된 것으로서, 상판 글래스의 전면에 단일 층(One Layer)의 투명한 재질로 전면 필터를 직접 형성하여 제조 공정, 제조 원가 및 외부 충격에도 강한 플라즈마 디스플레이 패널에 관한 것이다.The present invention has been made to improve the above-described problems of the prior art, plasma display directly resistant to the manufacturing process, manufacturing cost and external impact by directly forming the front filter with a transparent material of one layer on the front of the top glass It is about the panel.
상기한 과제를 개선하기 위한 본 발명에 따른 플라즈마 디스플레이 패널은 상판 글래스(Glass); 상기 상판 글래스의 전면에 형성되는 전면 필터를 포함하고, 상기 전면 필터는 단일 층(One Layer)의 인듐-틴-옥사이드(Indium-Tin-Oxide;IT)로 상기 상판 글래스에 직접 합착되는 것을 특징으로 한다.Plasma display panel according to the present invention for improving the above problems is a glass top; And a front filter formed on the front surface of the upper glass, wherein the front filter is directly bonded to the upper glass with indium tin oxide (IT) of a single layer. do.
또한, 본 발명에 따른 플라즈마 디스플레이 패널은 상판 글래스(Glass); 상기 상판 글래스의 전면에 형성되는 전면 필터; 및 상기 상판 글래스의 하면에 형성 되는 제 1 전극 및 제 2 전극을 포함하고, 상기 제 1, 2 전극은 인듐-틴-옥사이드(Indium-Tin-Oxide;ITO)로 형성된 투명 전극 및 버스 전극으로 형성되고, 상기 전면 필터는 단일 층(One Layer)의 상기 투명 전극과 동일한 인듐-틴-옥사이드(Indium-Tin-Oxide;ITO)로 상기 상판 글래스에 직접 합착되는 것을 특징으로 한다.In addition, the plasma display panel according to the present invention comprises a glass top; A front filter formed on the front surface of the upper glass; And a first electrode and a second electrode formed on a lower surface of the upper glass, wherein the first and second electrodes are formed of a transparent electrode and a bus electrode formed of indium tin oxide (ITO). The front filter is directly bonded to the top glass with the same Indium-Tin-Oxide (ITO) as the transparent electrode of one layer.
또한, 본 발명에 따른 플라즈마 디스플레이 패널은 상판 글래스(Glass); 상기 상판 글래스의 전면에 형성되는 전면 필터; 및 상기 상판 글래스의 하면에 형성되는 제 1 전극 및 제 2 전극을 포함하고, 상기 제 1, 2 전극 중 적어도 어느 하나는 단일 층(One Layer)으로 형성되고, 단일 층(One Layer)의 인듐-틴-옥사이드(Indium-Tin-Oxide;IT)로 상기 상판 글래스에 직접 합착되는 것을 특징으로 한다.In addition, the plasma display panel according to the present invention comprises a glass top; A front filter formed on the front surface of the upper glass; And a first electrode and a second electrode formed on the lower surface of the upper plate glass, wherein at least one of the first and second electrodes is formed of a single layer, and an indium of a single layer is formed. It is characterized in that the tin-oxide (Indium-Tin-Oxide; IT) is directly bonded to the top glass.
이하, 본 발명의 바람직한 실시예를 첨부된 도면을 참조하여 상세히 설명한다. 도 1 은 본 발명에 따른 플라즈마 디스플레이 패널에 대한 일실시예를 사시도로 도시한 것이다. 도 1 에 도시된 바와 같이, 플라즈마 디스플레이 패널은 상판 글래스(101) 상에 형성되는 유지 전극 쌍인 스캔 전극(102) 및 서스테인 전극(103), 하판 글래스(110) 상에 형성되는 어드레스 전극(22)을 포함한다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings. 1 is a perspective view showing an embodiment of a plasma display panel according to the present invention. As shown in FIG. 1, the plasma display panel includes
유지 전극 쌍(102, 103)은 통상 인듐-틴-옥사이드(Indium-Tin-Oxide;ITO)로 형성된 투명전극(102a, 103a)과 버스 전극(102b, 103b)을 포함하며, 버스 전극(102b, 103b)은 은(Ag), 크롬(Cr) 등의 금속 또는 크롬/구리/크롬(Cr/Cu/Cr)의 적층형이나 크롬/알루미늄/크롬(Cr/Al/Cr)의 적층형으로 형성될 수 있다. 버스 전극(102b, 103b)은 투명전극(102a, 103a) 상에 형성되어, 저항이 높은 투명전극(102a, 103a)에 의한 전압 강하를 줄이는 역할을 한다.The
스캔 전극(102) 및 서스테인 전극(103)의 투명전극(102a, 103a)과 버스전극(102b, 103b)의 사이에는 상판 글래스(101)의 외부에서 발생하는 외부광을 흡수하여 반사를 줄여주는 광차단의 기능과 상판 글래스(101)의 퓨리티(Purity) 및 콘트라스트를 향상시키는 기능을 하는 블랙 매트릭스(Black Matrix, BM)가 배열된다.Light between the
스캔 전극(102)과 서스테인 전극(103)이 나란하게 형성된 상판 글래스(101)에는 상부 유전체층(104)과 보호막(105)이 적층된다. 상부 유전체층(104)에는 방전에 의하여 발생된 하전입자들이 축적되고, 유지 전극 쌍(102, 103)을 보호하는 기능을 수행할 수 있다. 보호막(105)은 가스 방전시 발생된 하전입자들의 스퍼터링으로부터 상부 유전체층(104)을 보호하고, 2차 전자의 방출 효율을 높이게 된다. 또한, 보호막(105)은 통상 산화마그네슘(MgO)이 이용될 수 있고, 실리콘(Si)이 첨가된 Si-MgO가 이용될 수도 있다. 여기서, 보호막(14)에 첨가되는 실리콘(Si)의 함유량은 중량 퍼센트(wt %) 기준으로 50PPM 내지 200PPM 이 가능할 것이다.An upper
한편, 어드레스 전극(113)은 스캔 전극(102) 및 서스테인 전극(103)과 교차되는 방향으로 형성된다. 또한, 어드레스 전극(113)이 형성된 하판 글래스(110) 상에는 하부 유전체층(115)과 격벽(112)이 형성된다.The
또한, 하부 유전체층(115)과 격벽(112)의 표면에는 형광체층(114)이 형성된다. 격벽(112)은 세로격벽만을 포함하는 스트라이프 타입(Stripe Type)을 나타내고 있으나, 이에 한정되지 않고 세로격벽과 가로격벽에 의해 방전셀이 폐쇄 구조를 가지는 클로즈 타입(Close Type) 또는 세로격벽 상에 소정의 간격을 가지고 돌출부가 형성된 피쉬본(Fish Bone) 등의 구조도 가능하다.In addition, the
본 발명의 제 1 실시예에는 도 1 에 도시된 격벽(112)의 구조뿐만 아니라, 다양한 형상의 격벽(112)의 구조도 가능할 것이다. 예컨대, 세로 격벽과 가로 격벽으로 형성되는 폐쇄형 격벽 구조가 가능하며, 세로 격벽과 가로 격벽의 높이가 다른 차등형 격벽 구조, 세로 격벽 또는 가로 격벽 중 하나 이상에 배기 통로로 사용 가능한 채널(Channel)이 형성된 채널형 격벽 구조, 세로 격벽 또는 가로 격벽 중 하나 이상에 홈(Hollow)이 형성된 홈형 격벽 구조 등이 가능할 것이다. In the first embodiment of the present invention, not only the structure of the
여기서, 차등형 격벽 구조인 경우에는 가로 격벽의 높이가 높은 것이 더 바람직하고, 채널형 격벽 구조나 홈형 격벽 구조인 경우에는 가로 격벽에 채널이 형성되거나 홈이 형성되는 것이 바람직할 것이다.Here, in the case of the differential barrier rib structure, the height of the horizontal barrier rib is more preferable, and in the case of the channel barrier rib structure or the groove barrier rib structure, it is preferable that the channel is formed in the horizontal barrier rib or the groove is formed.
한편, 본 발명의 제 1 실시예에서는 R, G 및 B 방전셀 각각이 동일한 선상에 배열되는 것으로 도시 및 설명되고 있지만, 다른 형상으로 배열되는 것도 가능할 것이다. 예컨대, R, G 및 B 방전셀이 삼각형 형상으로 배열되는 델타(Delta) 타입의 배열도 가능할 것이다. 또한, 방전셀의 형상도 사각형상 뿐만 아니라, 오각형, 육각형 등의 다양한 다각 형상도 가능할 것이다.On the other hand, in the first embodiment of the present invention is shown and described that each of the R, G and B discharge cells are arranged on the same line, it may be arranged in a different shape. For example, a Delta type arrangement in which R, G, and B discharge cells are arranged in a triangular shape may be possible. In addition, the shape of the discharge cell may be not only rectangular, but also various polygonal shapes such as a pentagon and a hexagon.
또한, 형광체층(114)은 가스 방전시 발생된 자외선에 의해 발광되어 적색(R), 녹색(G) 또는 청색(B) 중 어느 하나의 가시광을 발생하게 된다. 여기서, 상부/하판 글래스(101, 110)과 격벽(113) 사이에 마련된 방전공간에는 방전을 위한 He+Xe, Ne+Xe 및 He+Ne+Xe 등의 불활성 혼합가스가 주입된다.In addition, the
도 2 는 본 발명에 따른 플라즈마 디스플레이 패널의 구조에 대한 제 2 실시예를 나타내는 사시도이다. 도 1 과 중복되는 내용은 생략한다.2 is a perspective view showing a second embodiment of the structure of the plasma display panel according to the present invention. The content overlapping with FIG. 1 is omitted.
도 2 에 도시된 바와 같이, 플라즈마 디스플레이 패널은 상판 글래스(200)의 후면에 형성되는 유지 전극 쌍인 스캔 전극(202) 및 서스테인 전극(203), 하판 글래스(210) 상에 형성되는 어드레스 전극(213)을 포함한다.As shown in FIG. 2, the plasma display panel includes a
플라즈마 디스플레이 패널 구조에 한정되지 아니한다. 예컨대, 외부에서 발생하는 외부광을 흡수하여 반사를 줄여주는 광차단의 기능과 상판 글래스(201)의 퓨리티(Purity) 및 콘트라스트를 향상시키는 기능을 하는 블랙 매트릭스(Black Matrix, BM)가 상판 글래스(201) 상에 형성될 수 있으며, 상기 블랙 매트릭스는 분리형 및 일체형 BM 구조가 모두 가능하다.It is not limited to the plasma display panel structure. For example, a black matrix (BM) that absorbs external light generated from the outside to reduce reflection and a black matrix (BM) that improves the purity and contrast of the
또한, 도 2 에 도시된 패널의 격벽 구조는 세로격벽(212)만을 포함하는 스트라이프 타입(Stripe Type)을 나타내고 있으나, 이에 한정되지 않고 세로격벽과 가로격벽에 의해 방전셀이 폐쇄 구조를 가지는 클로즈 타입(Close Type) 또는 세로격벽 상에 소정의 간격을 가지고 돌출부가 형성된 피쉬본(Fish Bone) 등의 구조도 가능하다.In addition, the barrier rib structure of the panel illustrated in FIG. 2 represents a stripe type including only the
도 3 은 상부 패널(200)의 구조에 대한 제 1 실시예를 단면도로 도시한 것이다. 도 3 에 도시된 바와 같이, 상부 유전체층(204)의 상부 기판(201)으로부터의 높이, 즉 상판 글래스(201)과 상부 유전체층(204) 표면 사이의 거리는 상부 유전체층(204)이 형성된 위치에 따라 상이한 것이 바람직하며, 상부 유전체층(204) 중 유 지 전극들(202a, 202b, 203a, 203b) 사이에 형성된 부분의 높이가 유지 전극들(202a, 202b, 203a, 203b) 상에 형성된 부분의 높이보다 낮은 것이 바람직하다.3 is a cross-sectional view illustrating a first embodiment of the structure of the
상부 기판(201)으로부터의 상부 유전체층(204) 높이는, 유지 전극들(202a, 202b, 203a, 203b) 각각의 중심부분에서 최대값(d1, d3, d3, d7)을 가지며, 유지 전극들(202a, 202b, 203a, 203b) 사이의 중점부분에서의 최소값(d2, d4, d6)을 가지는 것이 바람직하다.The height of the
상부 유전체층(204)의 최소 높이(d2, d4, d6)는 20 내지 45 ㎛인 것이 바람직하며, 최대 높이(d1, d3, d5, d7)는 23 내지 50 ㎛인 것이 바람직하다. 또한, 상부 유전체층(204)의 최대 높이(d1, d3, d5, d7)는 최소 높이(d2, d4, d6)와 3 내지 5 ㎛ 차이가 나는 것이 바람직하다. 상부 유전체층(204)의 높이를 상기와 같은 값으로 형성함으로써, 전극 간 방전 개시 전압을 감소시킬 수 있다.The minimum heights d2, d4, d6 of the
도 3 에서는 하나의 유지 전극이 두 개의 전극 라인으로 구성되었으나, 본 발명에 따른 플라즈마 디스플레이 패널은 그에 한정되지 아니하며, 하나의 유지 전극이 세 개 이상의 전극 라인으로 구성되거나 하나의 전극 라인으로 구성될 수도 있다.In FIG. 3, one sustain electrode is composed of two electrode lines, but the plasma display panel according to the present invention is not limited thereto, and one sustain electrode may be composed of three or more electrode lines or one electrode line. have.
도 4 는 플라즈마 디스플레이 패널의 전극 배치에 대한 제 1 실시예를 도시한 것으로, 플라즈마 디스플레이 패널을 구성하는 복수의 방전셀들은 도 4에 도시된 바와 같이 매트릭스 형태로 배치되는 것이 바람직하다. 복수의 방전셀들은 각각 스캔 전극 라인(Y1 내지 Ym), 서스테인 전극 라인(Z1 내지 Zm) 및 어드레스 전극 라인(X1 내지 Xn)의 교차부에 마련된다. 스캔 전극 라인(Y1 내지 Ym)은 순차적으로 구동되고, 서스테인 전극 라인(Z1 내지 Zm)은 공통적으로 구동된다. 어드레스 전극라인(X1 내지 Xn)은 기수 번째 라인들과 우수 번째 라인들로 분할되어 구동한다.FIG. 4 illustrates a first embodiment of an electrode arrangement of a plasma display panel, and a plurality of discharge cells constituting the plasma display panel is preferably arranged in a matrix form as shown in FIG. 4. The plurality of discharge cells are provided at the intersections of the scan electrode lines Y1 to Ym, the sustain electrode lines Z1 to Zm, and the address electrode lines X1 to Xn, respectively. The scan electrode lines Y1 to Ym are sequentially driven, and the sustain electrode lines Z1 to Zm are commonly driven. The address electrode lines X1 to Xn are divided into odd-numbered lines and even-numbered lines to drive.
도 4 에 도시된 전극 배치는 본 발명에 따른 플라즈마 패널의 전극 배치에 대한 제 1 실시예에 불과하므로, 본 발명은 도 4에 도시된 플라즈마 디스플레이 패널의 전극 배치 및 구동 방식에 한정되지 아니한다. 예컨데, 상기 스캔 전극 라인(Y1 내지 Ym)들 중 2 개의 스캔 전극 라인이 동시에 구동되는 듀얼 스캔(dual scan) 방식도 가능하다.Since the electrode arrangement shown in FIG. 4 is only a first embodiment of the electrode arrangement of the plasma panel according to the present invention, the present invention is not limited to the electrode arrangement and driving method of the plasma display panel shown in FIG. 4. For example, a dual scan method in which two scan electrode lines of the scan electrode lines Y1 to Ym are simultaneously driven may be possible.
도 5 는 본 발명에 따른 플라즈마 디스플레이 패널 구조에 전극 필터가 합착된 전극 구조에 대한 제 1 실시예를 나타내는 단면도로서, 도 1 에 대한 단면도를 나타낸다. 도 5 에 도시된 바와 같이, 상판 글래스(101), 상판 글래스(101)의 전면에 직접 형성되는 전면 필터(150), 상판 글래스(101)의 하면에 형성되는 유지 전극 쌍(102, 103)을 포함한다.FIG. 5 is a cross-sectional view showing a first embodiment of an electrode structure in which an electrode filter is bonded to a plasma display panel structure according to the present invention. FIG. As shown in FIG. 5, the
여기서, 유지 전극 쌍(102, 103)은 통상 인듐-틴-옥사이드(Indium-Tin-Oxide;ITO)로 형성된 투명전극(102a, 103a)과 버스 전극(102b, 103b)을 포함하며, 도 1 에서 설명한바 생략한다.Here, the sustain
또한, 전면 필터(150)는 상판 글래스(101)의 전면에 직접 형성되며, 인듐-틴-옥사이드(Indium-Tin-Oxide;이하 ITO)로 형성된다.In addition, the
또한, 전면 필터(150)는 전자파를 차단하는 EMI 차폐를 위한 격자형의 메쉬(mesh) 타입의 패턴이 형성 가능하며, 두께(A)가 0.12um 내지 10um 인 것이 바람직하다.In addition, the
여기서, 전면 필터(150)는 두께(A)는 방전에 의해 발생되는 전자파(EMI) 차폐에 대한 효율이 상승한다.In this case, the
또한, 전면 필터(150)에 형성되는 메쉬 패턴에서 서로 교차하는 두 라인의 선폭은 동일하거나 다를 수 있지만, 얼라인, EMI 차폐 효율 등을 고려하면 선폭이 동일한 것이 바람직할 것이다. 또한, EMI 차폐 효율을 보다 향상시키기 위해 두 라인의 선폭은 9um 내지 30um인 것이 바람직할 것이다.In addition, although the line widths of the two lines crossing each other in the mesh pattern formed on the
또한, 전면 필터(150)의 메쉬 패턴에서 피치(Pitch)는 250um 내지 300um인 것이 바람직하다. 여기서, 피치는 서로 교차하는 두 라인간의 거리로 정의될 수 있다.In addition, the pitch in the mesh pattern of the
여기서, 전면 필터(150)의 크기는 상판 글래스(101)와 동일하거나 작게 형성되는 것이 가능하며, 또한, 전면 필터(150)가 상판 글래스(101)에 직접 형성되도록 하는 방법으로 스퍼터(Sputter) 및 전자빔(E-beam) 등이 가능하다.Here, the size of the
또한, 플라즈마 디스플레이 패널은 제조 공정 중 투명 전극(102b, 103b)의 형성 공정에서 상판 글래스(101)의 전면, 후면에 형성가능하도록 하여, 공정이 간단해지고 시간이 단축되고 제조 비용이 감소 된다.In addition, the plasma display panel can be formed on the front and rear surfaces of the
도 6 은 본 발명에 따른 플라즈마 디스플레이 패널 구조에 전극 필터가 합착된 전극 구조에 대한 제 2 실시예를 나타내는 단면도로서, 도 2 에 대한 단면도를 나타낸다. 도 6 에 도시된 바와 같이, 상판 글래스(201), 상판 글래스(201)의 전면에 직접 형성되는 전면 필터(250), 상판 글래스(201)의 하면에 형성되는 유지 전극 쌍(202, 203)을 포함한다.FIG. 6 is a cross-sectional view illustrating a second embodiment of an electrode structure in which an electrode filter is bonded to a plasma display panel structure according to the present invention, and FIG. As shown in FIG. 6, the
여기서, 유지 전극 쌍(202, 203)은 버스 전극을 포함하며, 도 1 에서 설명한바 생략한다.Here, the sustain
또한, 전면 필터(250)는 상판 글래스(201)의 전면에 직접 형성되며, 인듐-틴-옥사이드(Indium-Tin-Oxide;이하 ITO)로 형성된다.In addition, the
또한, 전면 필터(250)는 전자파를 차단하는 EMI 차폐를 위한 격자형의 메쉬(mesh) 패턴이 형성 가능하며, 두께(A)가 0.12um 내지 10um 인 것이 바람직하다.In addition, the
여기서, 전면 필터(250)의 두께(A)는 방전에 의해 발생되는 전자파(EMI) 차폐에 대한 효율이 상승한다.Here, the thickness A of the
또한, 전면 필터(250)의 크기는 상판 글래스(201)와 동일하거나 작게 형성되는 것이 가능하며, 전면 필터(250)가 상판 글래스(201)에 직접 형성되도록 하는 방법으로 스퍼터(Sputter) 및 전자빔(E-beam) 등이 가능하다.In addition, the size of the
도 7 은 본 발명에 따른 플라즈마 디스플레이 패널의 전면 필터를 나타내는 사시도이다.7 is a perspective view illustrating a front filter of a plasma display panel according to the present invention.
도 7 에 도시된 바와 같이, 플라즈마 디스플레이 패너의 전면 필터(150, 250)는 메쉬(mesh) 타입의 패턴이 상단과 하단 중 적어도 어느 한 곳에 형성 가능하다.As illustrated in FIG. 7, the
여기서, 메쉬 타입의 패턴은 격자형으로 형성되며 필름으로 형성 가능하고, 방전에 의해 발생되는 전자파를 차폐하는 역할을 한다.Here, the mesh type pattern is formed in a lattice shape and may be formed into a film, and serves to shield electromagnetic waves generated by discharge.
도 8 은 상기한 바와 같은 구조를 가지는 본 발명에 따른 플라즈마 디스플레이 패널에 대해, 하나의 프레임(frame)을 복수의 서브필드로 나누어 시분할 구동시 키는 방법에 대한 제 1 실시예를 타이밍도로 도시한 것이다. 단위 프레임은 시분할 계조 표시를 실현하기 위하여 소정 개수 예컨대 8개의 서브필드들(SF1, ..., SF8)로 분할될 수 있다. 또한, 각 서브필드(SF1, ...SF8)는 리셋 구간(미도시)과, 어드레스 구간(A1, ..., A8)및, 서스테인 구간(S1, ..., S8)으로 분할된다.FIG. 8 is a timing diagram illustrating a first embodiment of a method for time-division driving by dividing a frame into a plurality of subfields in the plasma display panel according to the present invention having the structure as described above. will be. The unit frame may be divided into a predetermined number, for example, eight subfields SF1, ..., SF8 to realize time division gray scale display. Each subfield SF1, ... SF8 is divided into a reset section (not shown), an address section A1, ..., A8, and a sustain section S1, ..., S8.
각 어드레스 구간(A1, ..., A8)에서는, 어드레스 전극(X)에 표시 데이터 신호가 인가되고, 각 스캔 전극(Y)에 상응하는 스캔 펄스가 순차적으로 인가된다.In each address section A1, ..., A8, a display data signal is applied to the address electrode X, and scan pulses corresponding to each scan electrode Y are sequentially applied.
각 서스테인 구간(S1, ...,S8)에서는, 스캔 전극(Y)과 서스테인 전극(Z)에 서스테인 펄스가 교호하게 인가되어, 어드레스 구간(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 서스테인 방전을 일으킨다.In each of the sustain periods S1, ..., S8, a sustain pulse is alternately applied to the scan electrode Y and the sustain electrode Z to form wall charges in the address periods A1, ..., A8. Sustain discharge occurs in the discharge cells.
플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 서스테인 방전 구간(S1, ..., S8)내의 서스테인 방전 펄스 개수에 비례한다. 1 화상을 형성하는 하나의 프레임이, 8개의 서브필드와 256계조로 표현되는 경우에, 각 서브필드에는 차례대로 1, 2, 4, 8, 16, 32, 64, 128의 비율로 서로 다른 서스테인 펄스의 수가 할당될 수 있다. 만일 133계조의 휘도를 얻기 위해서는, 서브필드1 구간, 서브필드3 구간 및 서브필드8 구간 동안 셀들을 어드레싱하여 서스테인 방전하면 된다.The luminance of the plasma display panel is proportional to the number of sustain discharge pulses in the sustain discharge periods S1, ..., S8 occupied in the unit frame. When one frame forming one image is represented by eight subfields and 256 gradations, each subfield in turn has different sustains at a ratio of 1, 2, 4, 8, 16, 32, 64, and 128. The number of pulses can be assigned. In order to obtain luminance of 133 gradations, cells may be sustained by addressing the cells during the
각 서브필드에 할당되는 서스테인 방전 수는, APC(Automatic Power Control)단계에 따른 서브필드들의 가중치에 따라 가변적으로 결정될 수 있다. 즉, 도 12에서는 한 프레임을 8개의 서브필드로 분할하는 경우를 예로 들어 설명하였으나 본 발명은 그에 한정되지 아니하며, 한 프레임을 형성하는 서브필드의 수를 설계사양에 따라 다양하게 변형하는 것이 가능하다. 예를 들어, 한 프레임을 12 또는 16 서 브필드 등과 같이, 8 서브필드 이상 또는 이하로 분할하여 플라즈마 디스플레이 패널을 구동시킬 수 있다.The number of sustain discharges allocated to each subfield may be variably determined according to weights of the subfields according to the APC (Automatic Power Control) step. That is, in FIG. 12, a case in which one frame is divided into eight subfields has been described as an example. However, the present invention is not limited thereto, and the number of subfields forming one frame may be variously modified according to design specifications. . For example, the plasma display panel may be driven by dividing one frame into eight or more subfields or the like, such as 12 or 16 subfields.
또한 각 서브필드에 할당되는 서스테인 방전 수는 감마특성이나 패널특성을 고려하여 다양하게 변형하는 것이 가능하다. 예컨대, 서브필드 4에 할당된 계조도를 8에서 6으로 낮추고, 서브필드6에 할당된 계조도를 32에서 34로 높일 수 있다.The number of sustain discharges allocated to each subfield can be variously modified in consideration of gamma characteristics and panel characteristics. For example, the gray level assigned to subfield 4 may be lowered from 8 to 6, and the gray level assigned to subfield 6 may be increased from 32 to 34.
도 9 는 상기 분할된 하나의 서브필드에 대해, 상기와 같은 구조를 가지는 플라즈마 디스플레이 패널을 구동시키기 위한 구동 신호들에 대한 제 1 실시예를 타이밍도로 도시한 것이다.FIG. 9 is a timing diagram illustrating a first embodiment of driving signals for driving a plasma display panel having the above structure with respect to the divided subfield.
상기 서브필드는 스캔 전극들(Y) 상에 정극성 벽전하를 형성하고 서스테인 전극들(Z) 상에 부극성 벽전하를 형성하기 위한 프리 리셋(pre reset) 구간, 프리 리셋 구간에 의해 형성된 벽전하 분포를 이용하여 전 화면의 방전셀들을 초기화하기 위한 리셋(reset) 구간, 방전셀을 선택하기 위한 어드레스(address) 구간 및 선택된 방전셀들의 방전을 유지시키기 위한 서스테인(sustain) 구간을 포함한다.The subfield is a wall formed by a pre-reset section and a pre-reset section for forming positive wall charges on the scan electrodes Y and negative wall charges on the sustain electrodes Z. A reset section for initializing the discharge cells of the entire screen using the charge distribution, an address section for selecting the discharge cells, and a sustain section for maintaining the discharge of the selected discharge cells.
리셋 구간은 셋업(setup) 구간 및 셋 다운(setdown) 구간으로 이루어지며, 상기 셋업 구간에서는 모든 스캔 전극으로 상승 램프 파형(Ramp-up)이 동시 인가되어 모든 방전셀에서 미세 방전이 발생되고, 이에 따라 벽전하가 생성된다. 상기 셋다운 구간에는 상기 상승 램프 파형(Ramp-up)의 피크 전압보다 낮은 정극성 전압에서 하강하는 하강 램프파형(Ramp-down)이 모든 스캔 전극(Y)으로 동시에 인가되어 모든 방전셀에서 소거방전이 발생되고, 이에 따라 셋업 방전에 의해 생성된 벽전하 및 공간전하 중 불요 전하를 소거시킨다.The reset section includes a setup section and a setdown section. In the setup section, rising ramp waveforms (Ramp-up) are simultaneously applied to all scan electrodes to generate fine discharges in all discharge cells. Thus, wall charges are generated. In the set-down period, a falling ramp waveform (Ramp-down) falling at a positive voltage lower than the peak voltage of the rising ramp waveform (Ramp-up) is simultaneously applied to all the scan electrodes (Y), thereby eliminating discharge discharge in all the discharge cells. Generated, thereby eliminating unnecessary charges during wall charges and space charges generated by the setup discharges.
어드레스 구간에는 스캔 전극으로 부극성의 스캔 신호(scan)가 순차적으로 인가되고, 이와 동시에 상기 어드레스 전극(X)으로 정극성의 데이터 신호(data)가 인가된다. 이러한 상기 스캔 신호(scan)와 데이터 신호(data) 간의 전압 차와 상기 리셋 구간 동안 생성된 벽전압에 의해 어드레스 방전이 발생 되어 셀이 선택된다. 한편, 상기 셋다운 구간과 어드레스 구간 동안에 상기 서스테인 전극에는 서스테인 전압(Vs)을 유지하는 신호가 인가된다.In the address period, a negative scan signal scan is sequentially applied to the scan electrode, and at the same time, a positive data signal data is applied to the address electrode X. The address discharge is generated by the voltage difference between the scan signal and the data signal and the wall voltage generated during the reset period, thereby selecting the cell. On the other hand, a signal for maintaining a sustain voltage Vs is applied to the sustain electrode during the set down period and the address period.
상기 서스테인 구간에는 스캔 전극과 서스테인 전극에 교번적으로 서스테인 펄스가 인가되어 스캔 전극과 서스테인 전극 사이에 면방전 형태로 서스테인 방전이 발생된다.In the sustain period, a sustain pulse is alternately applied to the scan electrode and the sustain electrode to generate sustain discharge in the form of surface discharge between the scan electrode and the sustain electrode.
도 9 에 도시된 구동 파형들은 본 발명에 따른 플라즈마 디스플레이 패널을 구동시키기 위한 신호들에 대한 제 1 실시예로서, 도 9 에 도시된 파형들에 의해 본 발명은 한정되지 아니한다. 예컨데, 상기 프리 리셋 구간이 생략될 수 있으며, 상기 서스테인 방전이 완료된 후에 벽전하 소거를 위한 소거 신호가 서스테인 전극에 인가될 수도 있다. 또한, 상기 서스테인 신호가 스캔 전극(Y)과 서스테인(Z) 전극 중 어느 하나에만 인가되어 서스테인 방전을 일으키는 싱글 서스테인(single sustain) 구동도 가능하다.The driving waveforms shown in FIG. 9 are first embodiments of signals for driving the plasma display panel according to the present invention, and the present invention is not limited by the waveforms shown in FIG. For example, the pre-reset period may be omitted, and an erase signal for erasing wall charge may be applied to the sustain electrode after the sustain discharge is completed. In addition, the single sustain driving may be performed by applying the sustain signal to only one of the scan electrode (Y) and the sustain (Z) electrode to generate a sustain discharge.
이상 본 발명의 바람직한 실시예에 대해 상세히 기술하였지만, 본 발명이 속하는 기술분야에 있어서 통상의 지식을 가진 사람이라면, 첨부된 청구범위에 정의된 본 발명의 정신 및 범위에 벗어나지 않으면서 본 발명을 여러 가지로 변형 또는 변경하여 실시할 수 있음을 알 수 있을 것이다. 따라서, 본 발명의 앞으로의 실시 예들의 변경은 본 발명의 기술을 벗어날 수 없을 것이다.Although a preferred embodiment of the present invention has been described in detail above, those skilled in the art to which the present invention pertains can make various changes without departing from the spirit and scope of the invention as defined in the appended claims. It will be appreciated that modifications or variations may be made. Accordingly, modifications to future embodiments of the present invention will not depart from the technology of the present invention.
상기한 바와 같이 구성되는 본 발명에 의한 플라즈마 디스플레이 패널에 있어서, 패널이 상판 글래스의 전면에 ITO로 이루어진 단일 층(One Layer)의 전면 필터를 직접 합착시켜 플라즈마 디스플레이 패널의 제조 원가를 줄일 수 있으며, 상판 글래스가 충격에 의해 파손되는 것을 방지할 수 있으며, 전자파(EMI) 차폐 및 부가 기능에 대한 패턴이 형성 가능함으로써, 플라즈마 디스플레이 패널의 휘도 및 효율을 개선할 수 있다.In the plasma display panel according to the present invention configured as described above, the panel is directly bonded to the front surface filter of a single layer made of ITO on the front surface of the top glass to reduce the manufacturing cost of the plasma display panel, It is possible to prevent the top glass from being damaged by the impact and to form a pattern for EMI shielding and additional functions, thereby improving the brightness and efficiency of the plasma display panel.
Claims (8)
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KR1020060065882A KR100790460B1 (en) | 2006-07-13 | 2006-07-13 | Plasma display panel |
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KR20060061165A (en) * | 2004-12-01 | 2006-06-07 | 엘지전자 주식회사 | Plasma display panel |
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2006
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