KR100611216B1 - Flat Panel Display with Black Matrix and Fabrication Method thereof - Google Patents

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KR100611216B1
KR100611216B1 KR1020020005436A KR20020005436A KR100611216B1 KR 100611216 B1 KR100611216 B1 KR 100611216B1 KR 1020020005436 A KR1020020005436 A KR 1020020005436A KR 20020005436 A KR20020005436 A KR 20020005436A KR 100611216 B1 KR100611216 B1 KR 100611216B1
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박상일
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Abstract

본 발명은 투명도전막의 투과도 특성을 이용하여 공정을 단순화하고, 표면단차를 감소시킬 수 있는 블랙매트릭스를 구비한 평판표시장치 및 그의 제조방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a flat panel display device having a black matrix capable of simplifying the process by using the transmittance characteristic of the transparent conductive film and reducing the surface step, and a manufacturing method thereof.

본 발명의 평판표시장치의 제조방법은 화소전극이 형성될 제1영역과 박막 트랜지스터가 형성될 제2영역을 구비한 절연기판을 제공하는 단계와; 하프톤 마스크를 이용하여 제1영역에 화소전극을 형성하고, 제2영역에 블랙매트릭스를 형성하는 단계와; 기판전면에 절연막을 형성하는 단계와; 상기 제2영역의 절연막중 상기 블랙매트릭스에 대응하는 부분에, 상기 화소전극에 연결되는 상기 박막 트랜지스터를 형성하는 단계와; 기판 전면에 평탄화막을 형성하는 단계와; 상기 평탄화막을 식각하여 상기 화소전극의 일부분을 노출시키는 개구부를 형성하는 단계를 포함한다. According to an aspect of the present invention, there is provided a method of manufacturing a flat panel display device, comprising: providing an insulating substrate having a first region where a pixel electrode is to be formed and a second region where a thin film transistor is to be formed; Forming a pixel electrode in a first region using a halftone mask and forming a black matrix in a second region; Forming an insulating film on the front surface of the substrate; Forming the thin film transistor connected to the pixel electrode in a portion of the insulating layer of the second region corresponding to the black matrix; Forming a planarization film on the entire surface of the substrate; Etching the planarization layer to form an opening exposing a portion of the pixel electrode.

Description

블랙매트릭스를 구비한 평판표시장치 및 그의 제조방법{Flat Panel Display with Black Matrix and Fabrication Method thereof}Flat panel display with black matrix and manufacturing method thereof {Flat Panel Display with Black Matrix and Fabrication Method}

도 1은 종래의 유기전계 발광표시소자의 단면구조도,1 is a cross-sectional structure diagram of a conventional organic light emitting display device;

도 2a 내지 도 2g는 본 발명의 일실시예에 따른 유기전계 발광표시소자의 단면구조도,2A to 2G are cross-sectional structural views of an organic light emitting display device according to an embodiment of the present invention;

도 3a 내지 도 3d는 본 발명의 다른 실시예에 따른 유기전계 발광표시소자의 단면구조도,3A to 3D are cross-sectional structural views of an organic light emitting display device according to another embodiment of the present invention;

도 4는 불순물의 이온주입에 따른 투명도전막의 투과도특성을 도시한 도면,4 is a view showing the transmittance characteristics of the transparent conductive film according to the ion implantation of impurities,

*도면의 주요 부분에 대한 부호의 설명** Description of the symbols for the main parts of the drawings *

100, 300 : 절연기판 120, 310 : 투명도전막100, 300: insulation substrate 120, 310: transparent conductive film

125, 390 : 화소전극 130, 320 : 감광막 125, 390: pixel electrodes 130, 320: photosensitive film

140, 320 : 버퍼층 150, 330 : 반도체층 140 and 320 buffer layers 150 and 330 semiconductor layers

171, 351 : 게이트 151 152, 351 352 : 소오스/드레인 영역 171, 351: Gate 151 152, 351 352: Source / drain region

160, 340 : 게이트 절연막 175, 373 : 캐패시터 하부전극160, 340: gate insulating film 175, 373: capacitor lower electrode

180, 360 : 층간 절연막 181 - 183 : 콘택홀180, 360: interlayer insulating film 181-183: contact hole

250 : 하프톤 마스크 191 192, 371 372 : 소오스/드레인 전극 250: halftone mask 191 192, 371 372: source / drain electrodes

193, 373 : 캐패시터 상부전극 200 : 평탄화막 193 and 373: capacitor upper electrode 200: planarization film

본 발명은 평판표시장치에 관한 것으로서, 더욱 상세하게는 투명도전막의 투과도특성을 이용한 블랙매트릭스를 구비한 유기전계 발광표시소자 및 그의 제조방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a flat panel display device, and more particularly, to an organic light emitting display device having a black matrix using a transmittance characteristic of a transparent conductive film, and a manufacturing method thereof.

도 1은 종래의 유기전계 발광표시소자의 단면구조를 도시한 것이다. 도 1을 참조하여 종래의 유기 전계 발광 표시장치의 제조 방법을 설명하면 다음과 같다.1 shows a cross-sectional structure of a conventional organic light emitting display device. Referring to FIG. 1, a method of manufacturing a conventional organic light emitting display device is as follows.

먼저, 유리나 합성 수지 등으로 이루어진 투명한 절연 기판(10) 상에 버퍼층(11)을 형성하고, 상기 버퍼층(11)상에 폴리 실리콘막을 도포하고, 반도체층 형성용 마스크(도면상에는 도시되지 않음)를 이용하여 상기 폴리실리콘막을 패터닝하여 반도체층(13)을 형성한다.First, a buffer layer 11 is formed on a transparent insulating substrate 10 made of glass, synthetic resin, or the like, a polysilicon film is coated on the buffer layer 11, and a mask for forming a semiconductor layer (not shown in the drawing) is applied. The polysilicon film is patterned to form a semiconductor layer 13.

상기 반도체층(13)을 포함한 버퍼층(11)상에 게이트 절연막(15)을 형성하고, 상기 게이트 절연막(15)상에 게이트 메탈을 증착한다. 게이트 형성용 마스크(도면상에는 도시되지 않음)를 이용하여 상기 게이트메탈을 패터닝하여 상기 게이트 절연막(15)중 반도체층(13)에 대응되는 부분에 게이트 전극(16)을 형성한다. 게이트 전극(16)을 형성할 때 캐패시터(52)의 하부전극(17)을 동시에 형성한다. A gate insulating layer 15 is formed on the buffer layer 11 including the semiconductor layer 13, and a gate metal is deposited on the gate insulating layer 15. The gate metal is patterned by using a gate forming mask (not shown in the drawing) to form the gate electrode 16 in a portion of the gate insulating layer 15 corresponding to the semiconductor layer 13. When forming the gate electrode 16, the lower electrode 17 of the capacitor 52 is formed at the same time.

상기 반도체층(13)으로 소정도전형의 불순물, 예를 들면 N형 또는 P형 불순물을 이온주입하여 소오스/드레인영역(13-1), (13-2)을 형성한다. 이때, 반도체층(13)중 소오스/드레인 영역(13-1), (13-2)사이의 부분(13-3)은 채널층으로 작용한다. Source / drain regions 13-1 and 13-2 are implanted into the semiconductor layer 13 by implanting impurities of a predetermined conductivity type, for example, N-type or P-type impurities. At this time, the portion 13-3 between the source / drain regions 13-1 and 13-2 in the semiconductor layer 13 serves as a channel layer.

게이트 전극(16) 및 캐패시터의 하부전극(17)을 포함한 게이트 절연막(15)상에 층간 절연막(19)을 형성한다. 상기 층간 절연막(19)과 게이트 절연막(15)을 식각하여 상기 소오스/드레인 영역(13-1),(13-2)을 노출시키는 콘택홀(20-1), (20-2)을 형성한다.An interlayer insulating film 19 is formed on the gate insulating film 15 including the gate electrode 16 and the lower electrode 17 of the capacitor. The interlayer insulating layer 19 and the gate insulating layer 15 are etched to form contact holes 20-1 and 20-2 exposing the source / drain regions 13-1 and 13-2. .

계속해서, 상기 층간절연막(19)상에 소오스/드레인 메탈을 증착하고, 소오스/드레인 전극형성용 마스크(도면상에는 도시되지 않음)를 이용하여 패터닝하여 상기 소오스/드레인 영역(13-1), (13-2)과 콘택되는 소오스/드레인 전극(22-1), (22-2)을 형성함과 동시에 상기 소오스/드레인 전극(22-1), (22-2)중 하나, 예를 들면 소오스 전극(22-1)과 연결되는 캐패시터(52)의 상부전극(22-3)이 형성된다.Subsequently, a source / drain metal is deposited on the interlayer insulating film 19, and patterned using a source / drain electrode forming mask (not shown) to form the source / drain regions 13-1 and ( Source / drain electrodes 22-1 and 22-2 in contact with 13-2, and at the same time one of the source / drain electrodes 22-1 and 22-2, for example, a source The upper electrode 22-3 of the capacitor 52 connected to the electrode 22-1 is formed.

이로써, 유기전계 발광표시장치의 박막트랜지스터(51)와 캐패시터(52)가 형성된다. 이때, 층간 절연막(19)중 상기 캐패시터(52)의 상하부 전극(17), (22-3)사이에 형성된 부분은 캐패시터의 유전체 역할을 한다. As a result, the thin film transistor 51 and the capacitor 52 of the organic light emitting display device are formed. At this time, the portion of the interlayer insulating film 19 formed between the upper and lower electrodes 17 and 22-3 of the capacitor 52 serves as a dielectric of the capacitor.

소오스/드레인 전극(22-1), (22-2) 및 상부전극(22-3)을 형성한 후, 층간 절연막(19)상에 패시베이션막(25)을 형성하고, 비어홀 형성용 마스크(도면상에는 도시되지 않음)를 이용하여 상기 패시베이션막(25)을 식각하여 상기 소오스/드레인 전극(22-1), (22-2)중 하나, 예를 들면 드레인 전극(22-2)을 노출시키는 비어홀(26)을 형성한다. After the source / drain electrodes 22-1, 22-2 and the upper electrode 22-3 are formed, a passivation film 25 is formed on the interlayer insulating film 19, and a via hole forming mask (Fig. (Not shown) to etch the passivation film 25 to expose one of the source / drain electrodes 22-1 and 22-2, for example, a drain electrode 22-2. (26) is formed.

이후에, 투명도전막, 예를 들어 ITO 를 패시베이션막(25)상에 증착시킨 후에 화소전극 형성용 마스크(도면상에 도시되지 않음)를 이용하여 ITO 를 패터닝하여 애노드전극인 화소전극(27)을 형성한다. 이때, 화소전극(27)은 비어홀(26)을 통해서 드레인 전극(22-2)과 전기적으로 연결된다.Thereafter, a transparent conductive film, for example, ITO, is deposited on the passivation film 25, and then patterned ITO using a pixel electrode forming mask (not shown) to form the pixel electrode 27 serving as an anode electrode. Form. In this case, the pixel electrode 27 is electrically connected to the drain electrode 22-2 through the via hole 26.

이와 같이 애노드 전극(27)이 형성되면, 애노드 전극(27)을 포함한 패시베이션막(25)상에 평탄화막(28)을 형성하고, 개구부 형성용 마스크(도면상에 도시되지 않음)을 이용하여 평탄화막(28)중에서 애노드 전극에 대응되는 부분을 식각하여 개구부(28-1)를 형성하여 애노드 전극(27)을 노출시킨다.When the anode electrode 27 is formed in this manner, the planarization film 28 is formed on the passivation film 25 including the anode electrode 27 and planarized using an opening forming mask (not shown). A portion of the film 28 corresponding to the anode electrode is etched to form an opening 28-1 to expose the anode electrode 27.

이후에, 개구부(28-1)의 애노드전극(27)상에 유기 물질을 증착하여 전류의 흐름에 의해 적색, 녹색, 청색의 빛을 자체적으로 발산시키는 유기 EL층(29)을 형성한다. 기판전면에 캐소드 메탈을 증착시켜 캐소드전극(30)을 형성하여 유기 EL소자(53)를 형성한다.Thereafter, an organic material is deposited on the anode electrode 27 of the opening 28-1 to form an organic EL layer 29 which emits red, green, and blue light by current. The cathode electrode 30 is formed by depositing a cathode metal on the entire surface of the substrate to form the organic EL element 53.

AMOLED(Active Matrix Organic Light Emitting Device)와 같은 평판표시소자는 스위칭소자와 상기 스위칭소자에 전원을 인가하기 위한 여러 배선들로 이루어지는데, 배선용 금속물질에 의해 외부광이 반사되어 콘트라스트(contrast)가 크게 저하된다. 즉, 도 1에 화살표로 표시한 바와같이 캐패시터의 하부전극을 구성하는 금속물질, 소오스/드레인 전극 및 캐패시터의 상부전극을 구성하는 전극물질 그리고 음극을 구성하는 전극물질 등에 의해 외부광이 반사된다.A flat panel display device, such as an AMOLED (Active Matrix Organic Light Emitting Device), consists of a switching device and various wirings for applying power to the switching device, and external light is reflected by the wiring metal material so that contrast is greatly increased. Degrades. That is, as indicated by arrows in FIG. 1, external light is reflected by the metal material constituting the lower electrode of the capacitor, the electrode material constituting the source / drain electrode and the upper electrode of the capacitor, and the electrode material constituting the cathode.

종래에는 전면에 고가의 편광판을 부착하여 외부광의 반사에 의한 콘트라스트의 저하를 방지하였으나, 고가의 편광판 사용에 따른 제조 원가의 상승을 초래하할 뿐만 아니라 편광판 자체가 유기 전계발광층으로부터 방출되는 빛을 차단하여 투과도를 저하시킴으로써 휘도가 저하되는 문제점이 있었다.Conventionally, an expensive polarizing plate is attached to the front surface to prevent a decrease in contrast due to reflection of external light, but not only causes an increase in manufacturing cost due to the use of an expensive polarizing plate, but also the polarizing plate itself blocks light emitted from the organic electroluminescent layer. There is a problem that the luminance is lowered by lowering the transmittance.

한편, Cr/CrOx, 또는 유기막 등으로 된 블랙매트릭스를 화소영역을 제외한 TFT 영역, 즉 TFT와 캐패시터가 형성되는 영역에 별도로 형성하는 방법이 있는데, 이러한 방법은 블랙매트릭스를 형성하기 위해 별도의 마스크공정이 요구되는 문제점이 있을 뿐만 아니라 블랙매트릭스가 형성되는 TFT 영역과 화소영역간의 단차가 심해져 금속배선 즉, 소오스/드레인 전극과 게이트 전극간의 쇼트를 유발하는 문제점이 있었다.Meanwhile, there is a method of separately forming a black matrix made of Cr / CrOx or an organic film in a TFT region excluding a pixel region, that is, a region in which a TFT and a capacitor are formed. In this method, a separate mask is formed to form a black matrix. Not only is there a problem in that a process is required but also a step difference between the TFT region where the black matrix is formed and the pixel region is increased, causing a short circuit between the metal wiring, that is, the source / drain electrode and the gate electrode.

따라서, 본 발명은 상기한 바와같은 종래기술의 문제점을 해결하기 위한 것으로서, 공정을 단순화한 블랙매트릭스를 구비한 평판표시장치의 제조방법을 제공하는 데 그 목적이 있다.Accordingly, an object of the present invention is to provide a method of manufacturing a flat panel display device having a black matrix, which simplifies the process.

본 발명의 다른 목적은 투명도전막의 투과도변형특성을 이용하여 별도의 마스크공정없이 블랙매트릭스와 화소전극을 형성할 수 있는 평판표시장치 및 그의 제조방법을 제공하는 데 있다.Another object of the present invention is to provide a flat panel display device capable of forming a black matrix and a pixel electrode without a separate mask process by using the transmittance deformation characteristic of the transparent conductive film, and a manufacturing method thereof.

본 발명의 다른 목적은 블랙 매트릭스 형성에 따른 화소영역과 TFT영역간의 단차 발생을 방지할 수 있는 평판표시장치 및 그의 제조방법을 제공하는 데 있다.Another object of the present invention is to provide a flat panel display device and a method of manufacturing the same, which can prevent generation of steps between a pixel region and a TFT region due to the formation of a black matrix.

상기한 바와 같은 목적을 달성하기 위하여, 본 발명은 화소전극이 형성될 제1영역과 박막 트랜지스터가 형성될 제2영역을 구비한 절연기판을 제공하는 단계와; 하프톤 마스크를 이용하여 제1영역에 화소전극을 형성하고, 제2영역에 블랙매트릭스를 형성하는 단계와; 기판전면에 절연막을 형성하는 단계와; 상기 제2영역의 절연막중 상기 블랙매트릭스에 대응하는 부분에, 상기 화소전극에 연결되는 상기 박막 트랜지스터를 형성하는 단계와; 기판 전면에 평탄화막을 형성하는 단계와; 상기 평탄화막을 식각하여 상기 화소전극의 일부분을 노출시키는 개구부를 형성하는 단계를 포함하는 평판표시장치의 제조방법을 제공하는 것을 특징으로 한다.In order to achieve the above object, the present invention provides an insulating substrate having a first region in which a pixel electrode is to be formed and a second region in which a thin film transistor is to be formed; Forming a pixel electrode in a first region using a halftone mask and forming a black matrix in a second region; Forming an insulating film on the front surface of the substrate; Forming the thin film transistor connected to the pixel electrode in a portion of the insulating layer of the second region corresponding to the black matrix; Forming a planarization film on the entire surface of the substrate; And forming an opening through which the flattening layer is etched to expose a portion of the pixel electrode.

상기 화소전극과 블랙매트릭스를 형성하는 방법은 기판전면에 투명도전막을 형성하는 단계와; 상기 투명도전막상에 감광막을 도포하는 단계와; 상기 감광막을 하프톤 마스크로 패터닝하여 상기 제1영역에 제1감광막 패턴과 제2영역에 상대적으로 제1감광막 패턴보다 두께가 얇은 제2감광막 패턴을 형성하는 단계와; 상기 제1 및 제2감광막 패턴을 이용하여 투명도전막을 식각하여 제1영역에는 상기 제1패턴과 제2영역에 제2패턴을 형성하는 단계와; 제1감광막 패턴을 마스크로 하여 불순물을 이온주입하여 제2패턴의 투과도를 변형시켜 블랙매트릭스를 형성하는 단계와; 남아있는 제1감광막 패턴을 제거하여 그 하부의 제1패턴을 화소전극으로 형성하는 단계를 포함한다.The method of forming the pixel electrode and the black matrix may include forming a transparent conductive film on the entire surface of the substrate; Coating a photosensitive film on the transparent conductive film; Patterning the photoresist with a halftone mask to form a first photoresist pattern in the first region and a second photoresist pattern that is thinner than the first photoresist pattern in the second region; Etching the transparent conductive film using the first and second photoresist pattern to form a second pattern in the first pattern and the second region in the first region; Implanting impurities using the first photoresist pattern as a mask to modify the transmittance of the second pattern to form a black matrix; And removing the remaining first photoresist pattern to form a first pattern under the pixel electrode.

또한, 본 발명은 화소전극이 형성될 제1영역과 박막 트랜지스터가 형성될 제2영역을 구비한 절연기판을 제공하는 단계와; 상기 기판전면에 투명도전막을 형성하는 단계와; 상기 투명도전막중 상기 제2영역에 대응하는 부분이 노출되도록 감광막을 형성하는 단계와; 상기 감광막을 마스크로 하여 노출된 투명도전막으로 불순물을 주입하여 투과도를 변형시켜 블랙매트릭스를 형성하는 단계와; 상기 기판전면에 제1절연막을 형성하는 단계와; 상기 블랙매트릭스에 대응하는 제1절연막상에 박막 트랜지스터를 형성하는 단계와; 기판전면에 제2절연막을 형성하는 단계와; 제2절연막중 제1영역에 대응하는 부분에 상기 박막 트랜지스터와 연결되는 화소전극을 형성하는 단계와; 기판전면에 제3절연막을 형성하는 단계와; 상기 제3절연막을 식각하여 상기 화소전극의 일부분을 노출시키는 개구부를 형성하는 단계를 포함하는 평판표시장치의 제조방법을 제공하는 것을 특징으로 한다.The present invention also provides an insulating substrate having a first region where a pixel electrode is to be formed and a second region where a thin film transistor is to be formed; Forming a transparent conductive film on the entire surface of the substrate; Forming a photoresist film to expose a portion of the transparent conductive film corresponding to the second region; Forming a black matrix by injecting impurities into the exposed transparent conductive film using the photosensitive film as a mask to modify the transmittance; Forming a first insulating film on the entire surface of the substrate; Forming a thin film transistor on a first insulating film corresponding to the black matrix; Forming a second insulating film on the entire surface of the substrate; Forming a pixel electrode connected to the thin film transistor in a portion of a second insulating film corresponding to the first region; Forming a third insulating film on the front surface of the substrate; And forming an opening through which the third insulating layer is etched to expose a part of the pixel electrode.

또한, 본 발명은 화소전극이 형성된 제1영역과 박막 트랜지스터가 형성된 제2영역을 구비한 절연기판과; 상기 절연기판상에 형성된, 제1영역에서 화소전극으로 작용하는 부분과, 제2영역에서 블랙매트릭스로 작용하는 부분을 구비하는 투명도전막을 포함하는 평판표시장치를 제공하는 것을 특징으로 한다.The present invention also provides an insulating substrate including a first region in which pixel electrodes are formed and a second region in which thin film transistors are formed; A flat panel display comprising a transparent conductive film formed on the insulating substrate and having a portion serving as a pixel electrode in a first region and a portion serving as a black matrix in a second region.

상기 투명도전막중 제2영역에 형성된 부분은 불순물이온주입에 의해 그의 투과도가 변형된 부분이며, 상기 투명도전막으로의 불순물은 40 내지 100keV의 고에너지원으로 한번이상 이온주입하는 것을 특징으로 한다.The portion formed in the second region of the transparent conductive film is a portion whose permeability is modified by impurity ion implantation, and the impurity into the transparent conductive film is ion-implanted at least once with a high energy source of 40 to 100 keV.

상기 투명도전막중 화소전극으로 작용하는 부분과 블랙매트릭스로서 작용하는 부분은 서로 분리되거나, 또는 기판전면에 형성되어 화소전극으로 작용하는 부분돠 블랙매트릭스로 작용하는 부분은 서로 연결되는 것을 특징으로 한다. The portion of the transparent conductive film serving as the pixel electrode and the portion serving as the black matrix may be separated from each other, or the portion formed on the front surface of the substrate and serving as the pixel electrode may be connected to each other.

이하, 본 발명의 실시예에 따른 평판표시장치의 제조 방법을 첨부된 도면을 참조하여 설명하면 다음과 같다.Hereinafter, a method of manufacturing a flat panel display device according to an embodiment of the present invention will be described with reference to the accompanying drawings.

도 2a 내지 도 2g는 본 발명의 일 실시예에 따른 유기전계 발광표시소자의 제조방법을 설명하기 위한 공정단면도를 도시한 것이다. 2A through 2G are cross-sectional views illustrating a method of manufacturing an organic light emitting display device according to an exemplary embodiment of the present invention.

도 2a를 참조하면, TFT와 캐패시터가 형성될 TFT 영역(101)과 화소전극을 포함한 유기전계 발광소자가 형성될 화소영역(102)을 구비한 투명한 절연기판(100)이 제공된다. 상기 절연기판(100)상에 투명 도전막(120)을 형성하고, 상기 투명도전막(120)상에 감광막(130)을 도포한다. 이때, 감광막(130)으로는 포토레지스트, BCB, PI, 또는 아크릴중 하나가 사용된다.Referring to FIG. 2A, a transparent insulating substrate 100 having a TFT region 101 on which a TFT and a capacitor are to be formed and a pixel region 102 on which an organic light emitting element including a pixel electrode is to be formed is provided. A transparent conductive film 120 is formed on the insulating substrate 100, and a photosensitive film 130 is coated on the transparent conductive film 120. In this case, one of photoresist, BCB, PI, and acryl is used as the photosensitive film 130.

다음, 하프톤 마스크(250)를 이용하여 상기 감광막(130)을 패터닝한다. 이때, 하프톤 마스크(250)는 상기 TFT영역(101)의 블랙 매트릭스가 형성될 부분에 대응하는, 빛의 일부분을 투과시키는 반투과영역(251)과, 상기 화소영역(102)의 화소전극이 형성될 부분에 대응하는, 빛을 완전히 차단하기 위한 차단영역(252)을 구비한다. 그리고, 상기 반투과영역(251)과 차단영역(252)을 제외한 나머지 부분은 빛을 완전히 투과시키는 투과영역이 된다. Next, the photosensitive film 130 is patterned using a halftone mask 250. In this case, the halftone mask 250 includes a semi-transmissive region 251 for transmitting a portion of light corresponding to a portion where the black matrix of the TFT region 101 is to be formed, and a pixel electrode of the pixel region 102. And a blocking area 252 for completely blocking light, corresponding to the portion to be formed. The remaining portions except for the transflective region 251 and the blocking region 252 may be transmissive regions that completely transmit light.

하프톤 마스크(250)를 이용하여 상기 감광막(130)을 패터닝하면, 도 2b에서와 같은 감광막(130)의 패턴(131), (132)이 얻어지는데, 감광막(130)중 화소영역(102)에 형성된 패턴(132)은 감광막의 두께가 그대로 유지되고, TFT영역(101)에 형성된 패턴(131)은 상기 화소영역(102)에서의 패턴(132)보다 상대적으로 얇은 두께를 갖게 된다.When the photoresist layer 130 is patterned using the halftone mask 250, the patterns 131 and 132 of the photoresist layer 130 are obtained as shown in FIG. 2B. The pixel region 102 of the photoresist layer 130 is obtained. The pattern 132 formed on the photoresist film is maintained as it is, and the pattern 131 formed on the TFT region 101 has a thickness relatively thinner than the pattern 132 on the pixel region 102.

이어서, 상기 감광막(130)을 이용하여 그 하부의 투명도전막(120)을 패터닝하면, 도 2c에 도시된 바와 같이 TFT영역(101)에는 투명도전막만이 남아있게 되고, 화소영역(102)에서는 투명도전막상에 감광막의 패턴(132)이 존재하게 된다. Subsequently, when the transparent conductive film 120 is patterned using the photosensitive film 130, only the transparent conductive film remains in the TFT region 101 as shown in FIG. 2C, and the transparent region is transparent in the pixel region 102. The pattern 132 of the photosensitive film is present on the conductive film.

다음, 40 내지 100keV의 고에너지로 불순물을 주입하면, 화소영역(102)에서는 감광막의 패턴(132)이 이온주입용 마스크로 작용하여 그 하부의 투명도전막에는 불순물이 주입되지 않고, TFT영역(101)의 투명도전막에만 불순물이 주입된다. 이 때, 불순물 주입공정은 이온주입기를 이용하여 H, P, B, As, Ar 등의 불순물을 고에너지로 주입한다. 상기 투명도전막으로는 ITO, IZO, ZnO 등이 사용된다.Next, when an impurity is implanted at a high energy of 40 to 100 keV, in the pixel region 102, the pattern 132 of the photoresist film acts as a mask for ion implantation so that no impurity is injected into the transparent conductive film below the TFT region 101. Impurities are implanted only into the transparent conductive film of?). At this time, the impurity implantation process injects impurities such as H, P, B, As, Ar with high energy using an ion implanter. ITO, IZO, ZnO and the like are used as the transparent conductive film.

도 4를 참조하면, 투명도전막은 불순물이 주입되면 그의 투과도가 변형되는 특성이 있는 물질로서, 일반적으로 사용되는 편광판(λ/4)이 50%의 투과도를 갖음에 비하여 불순물이 이온주입된 투명도전막은 편광판의 투과도보다 낮은 투과도를 갖게 된다.Referring to FIG. 4, a transparent conductive film is a material having a property of changing its transmittance when an impurity is injected. A transparent conductive film having ion implanted therein is in contrast to a polarizing plate (λ / 4) that is generally used has a transmittance of 50%. Silver has a transmittance lower than that of the polarizing plate.

즉, B2H6 가스를 이용하여 보론을 이온주입하는 경우, 1.5x1016 ions/㎠의 도우즈 량으로 이온주입하면 30%의 투과도를 갖음을 알 수 있다. 따라서, 투명도전막에 본 발명에서와 같이 고에너지원으로 소정의 불순물을 이온주입하면 그의 투과도가 변형되어 블랙매트릭스로서의 역할을 할 수 있게 됨을 알 수 있다.That is, in the case of ion implantation of boron using B2H6 gas, it can be seen that the ion implantation with a dose amount of 1.5x10 16 ions / cm 2 has a transmittance of 30%. Therefore, it can be seen that when a predetermined impurity is implanted into the transparent conductive film with a high energy source as in the present invention, its permeability is modified to serve as a black matrix.

상기에서는 한번의 이온주입공정에 의해 투명도전막으로 불순물을 이온주입하였으나, 서로 다른 가속전압으로 2번이상 이온주입하게 되면 그의 투과도는 더욱 더 저하되게 된다. 다수 회 이온주입을 실시하는 경우, 주입되는 불순물의 총 도우즈량은 같다. In the above, the ion is implanted into the transparent conductive film by a single ion implantation process, but when the ion implantation is performed two or more times at different acceleration voltages, its permeability is further lowered. In the case where ion implantation is performed a plurality of times, the total dose of impurities to be implanted is the same.

따라서, 불순물이 도핑되지 않은 투명도전막(125)은 화소전극으로 작용하고, 불순물이 이온주입되어 그의 투과도가 저하된 투명도전막(121)은 블랙매트릭스로서 작용한다. 이때, 블랙매트릭스용 투명도전막의 패턴(121)은 화소영역을 제외한 전영역에 걸쳐 형성할 수 있다. 그러므로, 본 발명의 일실시예에서는 불순물 이온주입에 따른 투명도전막의 투과도 변형특성을 이용함으로써, 1매의 하프톤 마스크를 이용하여 화소전극과 블랙매트릭스를 동시에 형성할 수 있다.Therefore, the transparent conductive film 125 which is not doped with impurities serves as a pixel electrode, and the transparent conductive film 121 whose impurity is ion implanted to reduce its transmittance serves as a black matrix. In this case, the pattern 121 of the black matrix transparent conductive film may be formed over the entire area except the pixel area. Therefore, in one embodiment of the present invention, the pixel electrode and the black matrix can be simultaneously formed by using one halftone mask by using the transmittance deformation characteristic of the transparent conductive film caused by impurity ion implantation.

도 2d에 도시된 바와같이, 화소전극(125)과 블랙매트릭스(121)를 구비한 기판(100)상에 버퍼층(140)을 형성하고, TFT영역(101)의 상기 버퍼층(140)상에 폴리실리콘막으로 된 반도체층(150)을 형성한다. 상기 반도체층(150)을 포함한 버퍼층(140)상에 게이트 절연막(160)을 형성한다.As shown in FIG. 2D, a buffer layer 140 is formed on a substrate 100 having a pixel electrode 125 and a black matrix 121, and a poly layer is formed on the buffer layer 140 of the TFT region 101. A semiconductor layer 150 made of a silicon film is formed. The gate insulating layer 160 is formed on the buffer layer 140 including the semiconductor layer 150.

도 2e와 같이, 상기 반도체층(150)상부의 게이트 절연막(160)상에 게이트(171)를 형성함과 동시에 캐패시터의 하부전극(175)을 형성한다. 상기 게이트(171)를 마스크로 하여 상기 반도체층(150)으로 소정 도전형, 예를 들면 n형 또는 p형의 불순물을 이온주입하여 소오스/드레인 영역(151), (152)을 형성한다. 이때, 반도체층(150)중 소오스/드레인 영역(151), (152) 사이의 부분(153)은 채널영역으로 작용한다.As shown in FIG. 2E, the gate 171 is formed on the gate insulating layer 160 on the semiconductor layer 150, and the lower electrode 175 of the capacitor is formed. Source / drain regions 151 and 152 are formed by ion implanting a predetermined conductivity type, for example, n-type or p-type impurities, into the semiconductor layer 150 using the gate 171 as a mask. In this case, the portion 153 between the source / drain regions 151 and 152 of the semiconductor layer 150 serves as a channel region.

도 2f와 같이, 상기 게이트(171) 및 캐패시터 하부전극(175)을 포함한 게이트 절연막(160)상에 층간 절연막(180)을 형성하고, 상기 소오스/드레인 영역(151), (152) 그리고 화소전극(125)을 각각 노출시키는 제1 내지 제3콘택홀(181 - 183)을 형성한다. 상기 콘택홀(181-183)을 포함한 층간 절연막(180)상에 소오스/드레인 전극물질을 증착한 다음 패터닝한다.As shown in FIG. 2F, an interlayer insulating layer 180 is formed on the gate insulating layer 160 including the gate 171 and the capacitor lower electrode 175, and the source / drain regions 151 and 152 and the pixel electrode are formed. First to third contact holes 181 to 183 are formed to expose 125, respectively. A source / drain electrode material is deposited on the interlayer insulating layer 180 including the contact holes 181 to 183 and then patterned.

따라서, 상기 제1콘택홀(181)을 통해 소오스영역(151)과 콘택되는 소오스전극(191)과, 상기 제2콘택홀(182)을 통해 상기 드레인 영역(152) 그리고 제3콘택홀(183)을 통해 화소전극에 콘택되는 드레인 전극(192)을 형성한다. 이와 동시에 상기 소오스전극(191)과 연결되어 상기 캐패시터 하부전극(175)과 오버랩되 도록 형성되는 캐패시터 상부전극(193)을 형성한다.Accordingly, the source electrode 191 contacts the source region 151 through the first contact hole 181, and the drain region 152 and the third contact hole 183 through the second contact hole 182. ) To form a drain electrode 192 that is in contact with the pixel electrode. At the same time, the capacitor upper electrode 193 is formed to be connected to the source electrode 191 so as to overlap with the capacitor lower electrode 175.

상기한 바와같은 본 발명의 일 실시예에 따르면, 화소전극(125)이 기판상에 바로 형성되어 후속공정에서 형성되는 제3콘택홀(183)을 통해 드레인 전극(192)에 연결되므로, 도 1에 도시된 종래의 소자와는 달리 소오스/드레인 전극과 화소전극간에 보호막을 형성하는 공정이 배제될 뿐만 아니라, 소오스/드레인 전극과 화소전극을 형성하기 위한 콘택홀 형성공정이 배제되어 마스크공정이 배제되는 효과가 있다.According to one embodiment of the present invention as described above, since the pixel electrode 125 is directly formed on the substrate and connected to the drain electrode 192 through a third contact hole 183 formed in a subsequent process, FIG. 1 Unlike the conventional device shown in FIG. 5, not only the process of forming a protective film between the source / drain electrode and the pixel electrode is excluded, but the process of forming a contact hole for forming the source / drain electrode and the pixel electrode is excluded, thereby eliminating the mask process. It is effective.

도 2g를 참조하면, 기판 전면에 평탄화막(200)을 증착한 다음 상기 화소전극(125)의 일부분을 노출시키는 개구부(210)를 형성한다. 도면에 도시되지는 않았지만 상기 개구부(210)를 포함한 유기전계 발광층을 형성하고 그위에 음극을 형성하면 본 발명의 일실시예에 따른 유기전계 발광표시소자가 얻어진다.Referring to FIG. 2G, an opening 210 for exposing a portion of the pixel electrode 125 is formed after depositing the planarization film 200 on the entire surface of the substrate. Although not shown in the drawing, when the organic light emitting layer including the opening 210 is formed and a cathode is formed thereon, an organic light emitting display device according to an exemplary embodiment of the present invention is obtained.

상기한 바와같은 본 발명의 일실시예에 따르면, 블랙매트릭스를 형성하면서도 6매의 마스크공정, 즉 화소전극과 블랙매트릭스를 형성하기 위한 공정, 반도체층 형성공정, 게이트 형성공정, 콘택홀 형성공정, 소오스/드레인 전극 형성공정, 개구부 형성공정의 6매의 마스크공정이 요구되므로, 공정을 단순화할 수 있다. 또한, 화소전극이 기판상에 형성되어 종래의 빛이 다층의 절연막을 통과함에 따른 휘도저하를 방지할 수 있을 뿐만 아니라 화소부를 제외한 전영역에 블랙매트릭스를 형성함으로써 콘트라스트의 저하를 방지할 수 있다.According to one embodiment of the present invention as described above, while forming a black matrix, six mask processes, that is, a process for forming a pixel electrode and a black matrix, a semiconductor layer forming process, a gate forming process, a contact hole forming process, Since six mask processes of a source / drain electrode forming process and an opening forming process are required, the process can be simplified. In addition, the pixel electrode is formed on the substrate to prevent the decrease in luminance due to the conventional light passing through the multilayer insulating film, and to prevent the degradation of the contrast by forming the black matrix in all regions except the pixel portion.

또한, 본 발명의 일실시예에서는 투명도전막을 하프톤 마스크를 이용하여 패터닝하였으나, EL 영역에 대응하는 부분을 제외한 전면이 차단영역이 되도록 하프 톤 마스크를 형성하게 되면 후속의 감광막 패터닝공정에서 EL 영역에서만 감광막이 존재하게 되고 나머지 영역에서는 감광막이 그대로 남아있게 된다. 따라서, 투명도전막중 투과도가 변형된 부분은 블랙매트릭스로서 화소영역에 존재하게 되고, 투과도가 변형되지 않은 부분은 화소전극으로서 기판전면에 존재하게 된다.In addition, in the exemplary embodiment of the present invention, the transparent conductive film is patterned using a halftone mask. However, when the halftone mask is formed so that the entire surface except the portion corresponding to the EL region is a blocking region, the EL region is subjected to the subsequent photoresist patterning process. Only the photoresist film is present and the photoresist film remains intact in the remaining areas. Therefore, a portion of the transparent conductive film whose transmittance is deformed is present in the pixel region as a black matrix, and a portion of which the transmittance is not deformed is present on the front surface of the substrate as the pixel electrode.

도 3a 내지 도 3d는 본 발명의 다른 실시예에 따른 유기전계 발광표시소자의 제조방법을 설명하기 위한 단면구조를 도시한 것이다.3A to 3D illustrate a cross-sectional structure for explaining a method of manufacturing an organic light emitting display device according to another embodiment of the present invention.

도 3a를 참조하면, TFT 와 캐패시터가 형성될 TFT 영역(301)과 화소전극을 포함한 유기전계 발광소자가 형성될 화소영역(302)을 구비한 투명 절연기판(300)을 제공한다. 상기 절연기판(300)상에 투명도전막(310)을 증착한다.Referring to FIG. 3A, a transparent insulating substrate 300 having a TFT region 301 on which a TFT and a capacitor are to be formed and a pixel region 302 on which an organic light emitting device including a pixel electrode is to be formed are provided. The transparent conductive film 310 is deposited on the insulating substrate 300.

도 3b를 참조하면, 투명도전막(310)상에 감광막(320)을 도포한 다음 패터닝하여 화소영역(302)에만 남겨둔다. 상기 감광막(320)을 마스크로 이용하여 고에너지로 불순물을 TFT영역(301)의 투명도전막으로 이온주입한다. 이로써, 불순물이 주입된 부분(311)은 투과도가 변형되어 블랙매트릭스로 작용하고, 감광막(320) 하부의 부분(315)은 투과도가 변형되지 않아, 후속공정에서 형성되는 유기 EL 층으로부터 발광된 빛을 기판으로 투과시키게 된다. Referring to FIG. 3B, the photosensitive film 320 is coated on the transparent conductive film 310 and then patterned to be left only in the pixel region 302. By using the photosensitive film 320 as a mask, impurities are implanted into the transparent conductive film of the TFT region 301 with high energy. As a result, the portion 311 into which the impurity is injected is modified to transmit the black matrix, and the portion 315 of the lower portion of the photoresist layer 320 is not modified to transmit light, thereby emitting light emitted from the organic EL layer formed in a subsequent process. Is transmitted to the substrate.

이때, 제2실시예에 따른 투명도전막의 투과도 특성변형을 위한 불순물의 이온주입공정은 제1실시예에 따른 투명도전막의 투과도 특성변형을 위한 불순물의 이온주입공정과 동일하게 진행한다.In this case, the ion implantation process of impurities for modifying the permeability characteristics of the transparent conductive film according to the second embodiment is performed in the same manner as the ion implantation process of impurities for modifying the permeability characteristics of the transparent conductive film according to the first embodiment.

상기 감광막은 포토레지스트, BCB, PI, 또는 아크릴중 하나가 사용되고, 불순물 주입공정은 이온주입기를 이용하여 H, P, B, As, Ar 등의 불순물을 고에너지 로 주입한다. 상기 투명도전막으로는 ITO, IZO, ZnO 등이 사용된다.The photoresist film is one of photoresist, BCB, PI, or acrylic, and the impurity implantation process injects impurities such as H, P, B, As, Ar with high energy using an ion implanter. ITO, IZO, ZnO and the like are used as the transparent conductive film.

도 3c에 도시된 바와같이 상기 감광막(320)을 제거한 다음, 도 3d에 도시된 바와같이, 기판전면에 버퍼층(320)을 형성하고, 상기 TFT영역(301)상의 버퍼층(320)상에 폴리실리콘막으로 된 반도체층(330)을 형성한다. 상기 반도체층(330)을 포함한 버퍼층(320)상에 게이트 절연막(340)을 증착하고, 상기 반도체층(330)상부의 게이트 절연막(340)상에 게이트 전극(351)을 형성함과 동시에 상기 게이트 전극(351)과 이격된 캐패시터 하부전극(355)을 형성한다. 상기 게이트 전극(351)을 마스크로 소정 도전형, 예를 들면 n형 또는 p형의 불순물을 기판으로 이온주입하여 소오스/드레인 영역(351), (352)을 형성한다.After removing the photoresist layer 320 as shown in FIG. 3C, as shown in FIG. 3D, a buffer layer 320 is formed on the entire surface of the substrate, and polysilicon is formed on the buffer layer 320 on the TFT region 301. A semiconductor layer 330 is formed of a film. The gate insulating layer 340 is deposited on the buffer layer 320 including the semiconductor layer 330, and the gate electrode 351 is formed on the gate insulating layer 340 on the semiconductor layer 330. The capacitor lower electrode 355 spaced apart from the electrode 351 is formed. Source / drain regions 351 and 352 are formed by ion implanting impurities of a predetermined conductivity type, for example, n-type or p-type, into the substrate using the gate electrode 351 as a mask.

상기 게이트전극(351) 및 캐패시터 하부전극(355)을 포함한 게이트 절연막(340)상에 층간 절연막(360)을 증착한 다음, 상기 게이트 절연막(340)과 층간 절연막(360)을 식각하여 상기 소오스/드레인 영역(351), (352)을 노출시키는 콘택홀(361), (362)을 형성한다.After the interlayer insulating film 360 is deposited on the gate insulating film 340 including the gate electrode 351 and the capacitor lower electrode 355, the gate insulating film 340 and the interlayer insulating film 360 are etched to form the source / Contact holes 361 and 362 exposing the drain regions 351 and 352 are formed.

상기 콘택홀(361), (362)을 포함한 층간 절연막(360)상에 소오스/드레인 전극물질을 증착한 다음 패터닝하여 상기 콘택홀(361), (362)을 통해 상기 소오스/드레인 영역(351), (352)과 콘택되는 소오스/드레인 전극(371), (372)을 형성함과 동시에 상기 소오스/드레인 전극(371), (372)중 하나, 예를들면 소오스전극(371)과 연결되어 상기 캐패시터 하부전극(355)과 오버랩되도록 캐패시터 상부전극(373)을 형성한다.The source / drain electrode material is deposited on the interlayer insulating layer 360 including the contact holes 361 and 362 and then patterned to form the source / drain regions 351 through the contact holes 361 and 362. And source / drain electrodes 371 and 372 in contact with 352, and connected to one of the source / drain electrodes 371 and 372, for example, source electrode 371. The capacitor upper electrode 373 is formed to overlap the capacitor lower electrode 355.

이어서, 상기 소오스/드레인 전극(371), (372)을 포함한 상기 층간 절연막(360)상에 보호막(380)을 증착한 다음, 상기 소오스/드레인 전극중 하나, 예를 들면 드레인 전극(372)을 노출시키는 비어홀(381)을 형성한다. 상기 비어홀(381)을 포함한 보호막(380)상에 투명도전막을 증착한 다음 패터닝하여 화소전극(390)을 형성한다.Subsequently, a passivation layer 380 is deposited on the interlayer insulating layer 360 including the source / drain electrodes 371 and 372, and then one of the source / drain electrodes, for example, the drain electrode 372 is deposited. The via hole 381 which exposes is formed. A transparent conductive film is deposited on the passivation layer 380 including the via hole 381 and then patterned to form a pixel electrode 390.

다음, 상기 화소전극(390)을 포함한 보호막(380)상에 평탄화막(400)을 형성하고, 상기 화소전극(390)의 일부분을 노출시키는 개구부(401)를 형성한다. 상기 개구부(401)상에 유기 EL 층(410)과 음극(420)을 형성하여 본 발명의 유기전계 발광표시소자를 제조한다.Next, a planarization film 400 is formed on the passivation layer 380 including the pixel electrode 390, and an opening 401 exposing a portion of the pixel electrode 390 is formed. An organic EL layer 410 and a cathode 420 are formed on the opening 401 to manufacture the organic light emitting display device of the present invention.

상기한 바와같은 본 발명의 다른 실시예에 따르면, 블랙매트릭스를 형성한 다음 버퍼층을 형성하였으나, 버퍼층을 형성한 다음 블랙매트릭스를 형성할 수도 있다. 또한, 블랙매트릭스를 형성하기 위한 투명도전막을 패터닝하지 않고 화소영역을 제외한 전면에 블랙매트릭스를 형성하여 줌으로써 단차의 발생을 방지할 수 있는 이점이 있다.According to another embodiment of the present invention as described above, the black matrix is formed and then the buffer layer is formed, but the black matrix may be formed after the buffer layer is formed. In addition, by forming the black matrix on the entire surface except the pixel region without patterning the transparent conductive film for forming the black matrix, there is an advantage that the generation of the step can be prevented.

상기한 바와같은 본 발명에 따르면, 투명도전막에 선택적으로 불순물을 이온주입하여 그의 투과도를 변형시켜 1매의 마스크공정으로 화소전극과 블랙매트릭스를 동시에 형성할 수 있으므로 1매의 마스크공정을 생략할 수 있으며, 또한 화소전극과 소오스/드레인 전극을 형성하기 위한 비어홀 공정이 생략되어 1매의 마스크공정을 생략할 수 있다. 따라서, 공정을 단순화하고 수율을 향상시킬 수 있는 이점이 있다. According to the present invention as described above, by selectively implanting impurities into the transparent conductive film to modify its transmittance, the pixel electrode and the black matrix can be simultaneously formed in one mask process, so that one mask process can be omitted. In addition, the via hole process for forming the pixel electrode and the source / drain electrodes may be omitted, and thus, one mask process may be omitted. Therefore, there is an advantage that can simplify the process and improve the yield.                     

또한, 고가의 편광판을 사용하지 않고 외부광에 의한 반사를 방지하여 투과도를 향상시켜 휘도를 향상시킬 수 있는 이점이 있다. 게다가, 블랙매트릭스형성에 따른 화소영역과 TFT 영역간의 단차의 발생을 방지하여 배선간의 쇼트의 발생을 발지할 수 있는 이점이 있다.In addition, there is an advantage that the luminance can be improved by improving the transmittance by preventing reflection by external light without using an expensive polarizing plate. In addition, there is an advantage that a short circuit between wirings can be generated by preventing the generation of a step between the pixel region and the TFT region due to the formation of the black matrix.

Claims (9)

화소전극이 형성될 제1영역과 박막 트랜지스터가 형성될 제2영역을 구비한 절연기판을 제공하는 단계와;Providing an insulating substrate having a first region where a pixel electrode is to be formed and a second region where a thin film transistor is to be formed; 하프톤 마스크를 이용하여 제1영역에 화소전극을 형성하고, 제2영역에 블랙매트릭스를 형성하는 단계와;Forming a pixel electrode in a first region using a halftone mask and forming a black matrix in a second region; 기판전면에 절연막을 형성하는 단계와;Forming an insulating film on the front surface of the substrate; 상기 제2영역의 절연막중 상기 블랙매트릭스에 대응하는 부분에, 상기 화소전극에 연결되는 상기 박막 트랜지스터를 형성하는 단계와;Forming the thin film transistor connected to the pixel electrode in a portion of the insulating layer of the second region corresponding to the black matrix; 기판 전면에 평탄화막을 형성하는 단계와;Forming a planarization film on the entire surface of the substrate; 상기 평탄화막을 식각하여 상기 화소전극의 일부분을 노출시키는 개구부를 형성하는 단계를 포함하는 것을 특징으로 하는 평판표시장치의 제조방법.And forming an opening to expose a portion of the pixel electrode by etching the planarization layer. 제 1 항에 있어서, 상기 화소전극과 블랙매트릭스를 형성하는 방법은The method of claim 1, wherein the pixel electrode and the black matrix are formed. 기판전면에 투명도전막을 형성하는 단계와;Forming a transparent conductive film on the entire surface of the substrate; 상기 투명도전막상에 감광막을 도포하는 단계와;Coating a photosensitive film on the transparent conductive film; 상기 감광막을 하프톤 마스크로 패터닝하여 상기 제1영역에 제1감광막 패턴과 제2영역에 상대적으로 제1감광막 패턴보다 두께가 얇은 제2감광막 패턴을 형성하는 단계와;Patterning the photoresist with a halftone mask to form a first photoresist pattern in the first region and a second photoresist pattern that is thinner than the first photoresist pattern in the second region; 상기 제1 및 제2감광막 패턴을 이용하여 투명도전막을 식각하여 제1영역에는 상기 제1패턴과 제2영역에 제2패턴을 형성하는 단계와;Etching the transparent conductive film using the first and second photoresist pattern to form a second pattern in the first pattern and the second region in the first region; 제1감광막 패턴을 마스크로 하여 불순물을 이온주입하여 제2패턴의 투과도를 변형시켜 블랙매트릭스를 형성하는 단계와;Implanting impurities using the first photoresist pattern as a mask to modify the transmittance of the second pattern to form a black matrix; 남아있는 제1감광막 패턴을 제거하여 그 하부의 제1패턴을 화소전극으로 형성하는 단계를 포함하는 것을 특징으로 하는 평판표시장치의 제조방법.And removing the remaining first photoresist pattern to form a first pattern thereunder as a pixel electrode. 제 2 항에 있어서, 상기 불순물 주입은 40 내지 100keV의 고에너지원으로 한번이상 주입하는 것을 특징으로 하는 평판표시장치의 제조방법.The method of claim 2, wherein the impurity implantation is performed at least once with a high energy source of 40 to 100 keV. 화소전극이 형성될 제1영역과 박막 트랜지스터가 형성될 제2영역을 구비한 절연기판을 제공하는 단계와;Providing an insulating substrate having a first region where a pixel electrode is to be formed and a second region where a thin film transistor is to be formed; 상기 기판전면에 투명도전막을 형성하는 단계와;Forming a transparent conductive film on the entire surface of the substrate; 상기 투명도전막중 상기 제2영역에 대응하는 부분이 노출되도록 감광막을 형성하는 단계와;Forming a photoresist film to expose a portion of the transparent conductive film corresponding to the second region; 상기 감광막을 마스크로 하여 노출된 투명도전막으로 불순물을 주입하여 투과도를 변형시켜 블랙매트릭스를 형성하는 단계와;Forming a black matrix by injecting impurities into the exposed transparent conductive film using the photosensitive film as a mask to modify the transmittance; 상기 기판전면에 제1절연막을 형성하는 단계와;Forming a first insulating film on the entire surface of the substrate; 상기 블랙매트릭스에 대응하는 제1절연막상에 박막 트랜지스터를 형성하는 단계와; Forming a thin film transistor on a first insulating film corresponding to the black matrix; 기판전면에 제2절연막을 형성하는 단계와;Forming a second insulating film on the entire surface of the substrate; 제2절연막중 제1영역에 대응하는 부분에 상기 박막 트랜지스터와 연결되는 화소전극을 형성하는 단계와;Forming a pixel electrode connected to the thin film transistor in a portion of a second insulating film corresponding to the first region; 기판전면에 제3절연막을 형성하는 단계와;Forming a third insulating film on the front surface of the substrate; 상기 제3절연막을 식각하여 상기 화소전극의 일부분을 노출시키는 개구부를 형성하는 단계를 포함하는 것을 특징으로 하는 평판표시장치의 제조방법.And forming an opening through which the third insulating layer is etched to expose a portion of the pixel electrode. 제 4 항에 있어서, 상기 불순물 주입은 40 내지 100keV의 고에너지원으로 한번이상 주입하는 것을 특징으로 하는 평판표시장치의 제조방법.The method of claim 4, wherein the impurity is injected at least once into a high energy source of 40 to 100 keV. 화소전극이 형성된 제1영역과 박막 트랜지스터가 형성된 제2영역을 구비한 절연기판과;An insulating substrate having a first region in which pixel electrodes are formed and a second region in which thin film transistors are formed; 상기 절연기판상에 형성된, 제1영역에서 화소전극으로 작용하는 부분과, 제2영역에서 블랙매트릭스로 작용하는 부분을 구비하는 투명도전막을 포함하는 것을 특징으로 하는 평판표시장치.And a transparent conductive film formed on the insulating substrate and having a portion serving as a pixel electrode in a first region and a portion serving as a black matrix in a second region. 제 6 항에 있어서, 상기 투명도전막중 제2영역에 형성된 부분은 불순물이온주입에 의해 그의 투과도가 변형된 것을 특징으로 하는 평판표시장치,The flat panel display of claim 6, wherein a portion of the transparent conductive film formed in the second region is modified by impurity ion implantation. 제 6 항에 있어서, 상기 투명도전막중 화소전극으로 작용하는 부분과 블랙매트릭스로서 작용하는 부분은 서로 분리된 것을 특징으로 평판표시장치.The flat panel display of claim 6, wherein a portion of the transparent conductive layer serving as a pixel electrode and a portion serving as a black matrix are separated from each other. 제 6 항에 있어서, 상기 투명도전막은 기판전면에 형성되어, 화소전극으로 작용하는 부분과 블랙매트릭스로 작용하는 부분은 서로 연결되는 것을 특징으로 하는 평판표시장치. The flat panel display of claim 6, wherein the transparent conductive film is formed on the front surface of the substrate, and a portion serving as a pixel electrode and a portion serving as a black matrix are connected to each other.
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