KR100598702B1 - 수신데이터의 수신감도 측정 시스템 - Google Patents
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Abstract
Description
Claims (5)
- 외부에서 전달되는 디지털화된 샘플 데이터를 입력받아 디지털 값의 대수 연산을 통해 신호 처리 기능을 수행하는 프로세서와, 상기 프로세서를 통해 전달되는 디지털 신호를 아날로그 신호로 변환하는 동시에 상기 아날로그 신호를 오버 샘플링(over sampling)하는 신호보간필터가 내장된 디지털/아날로그 변환기와, 상기 디지털/아날로그 변환기와 프로세서 사이 설치되어 데이터 인터페이스 기능을 수행하는 디지털 제어 논리부와, 상기 디지털/아날로그 변환기로부터 전달되는 아날로그 신호를 통해 최초 이미지(Image)를 추출함과 동시에 이미지 제거 기능을 수행하여 신호 재생 기능을 수행하는 복구필터를 포함하여 구성된 것을 특징으로 하는 수신데이터의 수신감도 측정 시스템.
- 제 1 항에 있어서,상기 디지털 제어 논리부는 프로세서의 병렬 버스(BUS)에 연결되는 동시에 입/출력 포트를 이용하여 디지털/아날로그 변환기에 접속되는 래치부와, 상기 래치부의 접속 주기를 결정하기 위해 클록신호를 생성하여 상기 프로세서와 디지털/아날로그 변환기에 출력시키는 클록신호 발생부로 구성된 것을 특징으로 하는 수신데이터의 수신감도 측정 시스템.
- 제 2 항에 있어서,상기 클록신호 발생부는 프로세서에서 수신되는 샘플 데이터의 수신 데이터 샘플률(Sample rate)과 동일한 주파수의 신호를 생성하여 상기 프로세서에 인터럽트 신호로, 상기 디지털/아날로그 변환기에 클록신호로 형태로 출력시키는 것을 특징으로 하는 수신데이터의 수신감도 측정 시스템.
- 제 1 항에 있어서,상기 디지털 제어 논리부는 프로세서의 직렬 포트와 디지털/아날로그 변환기에 각각 연결되어 데이터 인터페이스 기능을 수행하는 제1 및 제2 레지스터와, 상기 제1 레지스터와 프로세서, 상기 제2 레지스터와 프로세서, 디지털/아날로그 변환기에 서로 다른 제1 내지 제3 클록신호를 생성 출력시키는 클록신호 발생부로 구성된 것을 특징으로 하는 수신데이터의 수신감도 측정 시스템.
- 제 4 항에 있어서,상기 클록신호 발생부는 상기 제1 레지스터 및 프로세서에 프로세서에서 수신되는 샘플 데이터의 수신 데이터 샘플률(Sample rate)의 수십 배에 해당되는 주파수의 제1 클록신호를 공급하고, 상기 제2 레지스터 및 프로세서에 상기 수신 데이터 샘플률과 동일한 주파수의 제2 클록신호를 공급하며, 상기 디지털/아날로그 변환기에 상기 제2 클록신호에 비해 일정량 지연된 제3 클록신호를 공급하는 것을 특징으로 하는 수신데이터의 수신감도 측정 시스템.
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