KR100569271B1 - 박막 트랜지스터 액정표시장치 - Google Patents
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Abstract
Description
Claims (2)
- 투명성 절연기판; 상기 투명성 절연기판 상에 게이트 절연막의 개재하에 서로 교차하도록 배열된 수 개의 게이트 라인 및 데이터 라인; 상기 게이트 라인과 데이터 라인에 의해 한정된 화소영역 내에 배치된 화소전극; 및 상기 게이트 라인과 데이터 라인의 교차부에 배치되며, 상기 게이트 라인으로부터 화소영역의 내측으로 연장된 게이트 전극과, 상기 게이트 전극 상에 형성되는 채널층, 상기 데이터 라인으로부터 연장되어 상기 채널층의 일측 상부면과 오버랩되게 배치된 드레인 전극, 및 상기 채널층의 타측 상부면과 오버랩되면서 상기 화소전극과 콘택되게 배치된 소오스 전극을 포함하는 박막 트랜지스터를 포함하여 이루어진 박막 트랜지스터 액정표시장치에 있어서,상기 게이트 라인은, 모 게이트 라인과 상기 모 게이트 라인으로부터 평행하게 분기된 제1 및 제2 자 게이트 라인을 포함하며, 상기 모 게이트 라인은 게이트 신호의 입력단으로서 기능하고, 상기 제1 자 게이트 라인은 실질적인 게이트 라인으로서 기능하며, 상기 제2 자 게이트 라인은 스토리지 전극들을 연결하는 스토리지 전극 라인으로서 기능하는 것을 특징으로 하는 박막 트랜지스터 액정표시장치.
- 제 1 항에 있어서, 상기 박막 트랜지스터의 게이트 전극은,상기 제1 자 게이트 라인으로부터 화소영역의 내측으로 연장된 것을 특징으로 하는 박막 트랜지스터 액정표시장치.
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Application Number | Priority Date | Filing Date | Title |
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KR1019990061703A KR100569271B1 (ko) | 1999-12-24 | 1999-12-24 | 박막 트랜지스터 액정표시장치 |
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Family Applications (1)
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