KR100359010B1 - 전압조절기 - Google Patents

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톰슨 콘슈머 일렉트로닉스, 인코포레이티드
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Abstract

본 발명은 직렬 통과 트랜지스터와 증폭 트랜지스터가 상보형으로 이루어진 전압 조절기에 관한 것이다. 공급 전류는 DC 공급 전원으로부터 직렬 통과 트랜지스터의 에미터-콜렉터 경로를 거쳐 부하로 흐른다. 이 전류량은 조절된 출력 전압으로부터 증폭 트랜지스터의 베이스 전극에 결합된 네거티브 피드백 제어 신호에 의해 제어되며 이것은 직력 통과 트랜지스터의 베이스를 차례로 구동시킨다. 증폭 트랜지스터의 에미터 전극은 조절된 DC 출력 전압보다 낮은 전압에 결합되어 있어서 트랜지스터 쌍에 필요한 구동이 감소된다.

Description

전압 조절기
본 발명은 전압 조절기에 관한 것이며 특히 조절기의 성능이 개선된 전압 조절기에 관한 것이다.
본 발명은 현재 계류중이고 발명의 명칭이 "폴드백 전류 제한을 갖는 이중의 전압 전압 조절기"인 특허출원번호 제 87,004 호에 관한 것이다.
도 1은 본 발명의 관점에 따른 조절기의 개략도이다.
도 2는 도 1의 조절기의 일부에 대한 변형도이다.
본 전압 조절기는 위성으로부터 신호를 수신하도록 위성을 향해 겨낭될 수 있는 실외 마이크로웨이브 안테나를 포함하는 직접 방송위성 수신기 시스템에 사용된다. 위성으로부터 수신된 신호는 안테나에 매우 가까운 곳에 또는 안테나 위에 장착된 "낮은 노이즈 블록 변환기"(LNB)에 의해 증폭된다.
LNB로부터의 출력 신호는 동축 케이블을 통해 실내 수신기로 이동된다. 실내 수신기로부터 LNB로 전원을 공급하기 위해 또한 LNB의 분극화를 제어하기 위해 동축 케이블의 중심 도체에 DC 전압을 멀티플렉스한다. LNB의 회로들은 낮은 전원 전압이나 또는 높은 전원 전압에서 기능하도록 설계되어 있으며 이중의 공급 전압이 LNB의 분극화 세팅, 즉 낮은 전압 선택 우측 회로 분극화(RHCP) 및 높은 전압 선택 좌측 회로 분극화(LHCP)를 제어하는데 사용된다. LNB의 전류 드레인은 조절된 전원전압들 중의 어느 하나로 일정하게 된다.
부하에 결합된 조절된 출력 전압을 유지하기 위해 제어가능한 직렬 임피던스 장치를 사용하는 전압 조절기들은 조절기의 출력 단자들에 단락 또는 다른 결함이 가해지면 쉽게 손상된다. 그러한 손상은 종종 직렬 임피던스 장치가 과도한 열을 소모하거나 직렬 장치의 전류 속도가 과도하면 생긴다. 이러한 이유로 조절기에 상기 손상이 생기는 것을 방지하기 위해 통상적으로 과부하 보호(overload protection)가 제공된다.
과부하 보호의 한가지 형태는 "폴드백(foldback)" 전압 조절기로 알려진 것에서의 전류 제한(current limiting)이며 상기 조절기는 이스터의 미국특허 제 3,445,751 호에 기재되어 있다. 그러한 조절기는 과부하 전류 임계가 도달될 때까지 출력 전압 조절(output voltage regulation)을 변환 부하(changing load)에 제공한다. 이 임계 이상의 부하 전류에 있어서, 유용가능한 출력 전류는 상기 부하가 증가함에 따라 감소하고 대응하여 출력 전압도 감소한다. 단락 전류(short-circuit current)는 전체 부하 전류 중 조그만 부분이 되도록 조정될 수 있으며 그래서 직렬 통과 트랜지스터에서 소모가 최소화된다. 본 발명의 전압 조절기는 그러한 "폴드백" 전압 조절기이다.
공급 전류는 DC 전원으로부터 상기 직렬 통과 트랜지스터의 애미터-콜렉터 경로를 거쳐 상기 부하로 흐른다. 이 전류량은 출력 전압으로부터 증폭 트랜지스터와 다른 회로들로 이루어진 네거티브 피드백 회로 구성을 거쳐 직렬 통과 트랜지스터의 베이스 전극에 결합된 제어 신호에 의해 제어된다. 이 방법에서, 직렬 통과트랜지스터의 에미터-콜렉터 경로 양단의 전압 강하는 조절된 출력 전압을 유지하도록 조정된다.
상기 직렬 통과 트랜지스터는 완전한 부하(full load)에서 전압 강하를 발생하며, 따라서 그 조절 기능의 일부에 의해 전원을 소모한다. 직렬 통과 트랜지스터의 신뢰성을 개선하고, 관련 열 싱크(associated heat sinks)와 함께 상기 직렬 통과 트랜지스터의 비용을 줄이며, 또한 조절되지 않은 입력전압과 조절된 출력 전압 사이의 전압차를 최소화함으로써 최대 출력 전압에서 조절의 효과를 향상시키기 위해서는 이 전원 소모를 최소로 줄여야 한다.
간단하게 설명하면, 본 발명은 직렬 통과 트랜지스터와 증폭 트랜지스터가 상보형으로 구성된 전압 조절기에 관한 것이다. 공급 전류는 DC 전원으로부터 직렬 통과 트랜지스터의 에미티-콜렉터 경로를 거쳐 부하로 흐른다. 이 전류량은 조절된 출력 전압으로부터 증폭 트랜지스터의 베이스 전극으로 결합된 네거티브 피드백 제어 신호에 의해 제어되며, 이것은 직렬 통과 트랜지스터의 베이스를 차례로 구동시킨다. 상기 증폭 트랜지스터의 에미터 전극은 조절된 DC 출력 전압보다 낮은 전압에 결합되며 그래서 트랜지스터 쌍의 구동 요구는 줄어든다.
도 1을 참조하면, 본 발명의 관점에 따른 전압 조절기(10)가 도시되어 있다.전압 조절기(10)는 높게 조절된 DC 출력 전압 모드와 낮게 조절된 DC 출력 전압 모드 사이에서 스위치가능하다.
조절되지 않은 직류 전원(도시되지 않음)이 단자(12)와 기준 전위점(11)(예를 들어, 접지) 사이에 접속되어 있다. 직류 통과 트랜지스터 Q1의 에미터 전극(14)은 단자(12)에 결합되어 있다. 트랜지스터 Q1의 콜렉터 전극(16)은 저항(20)을 통해 출력 단자(18)에 접속되어 있다. 출력 단자(18)와 기준점(11)(도시되지 않음) 사이에 부하(LNB)가 결합되어 있다. 트랜지스터 Q1의 베이스 전극은 NPN 증폭 트랜지스터 Q2의 콜렉터 전극에 접속되어 있으며 또한 저항(22)을 통해 입력 단자(12)에도 접속되어 있다. 트랜지스터 Q2의 에미터 전극은 저항(24)을 통해 출력 단자(18)에 접속되어 있으며 저항(30)에 의해 기준점(11)에도 접속되어 있다. 트랜지스터 Q2의 베이스 전극은 제어 신호를 수신하도록 결합되어 있으며 이에 대해서는 상세히 후술된다.
공급 전류는 단자(12)에 결합된 DC 전원으로부터 트랜지스터 Q1의 에미터-콜렉터 경로와 저항(20)을 거쳐 출력 단자(18)와 부하로 흐른다. 이 전류량은 라인(26)을 거처 트랜지스터 Q2의 베이스 전극에 결합된 제어 신호에 의해 제어되며 트랜지스터 Q1 양단의 전압 강하는 단자(18)에서 조절된 출력전압을 유지하도록 조정된다. 트랜지스터 Q1이 완전히 컷-오프되었을지라도 트랜지스터 Q1의 에미터와 콜렉터 전극 사이에 결합된 저항(32)은 약간의 전류를 부하에 계속해서 공급한다. 트랜지스터 Q1의 에미터 전극과 베이스 전극 사이에 결합된 저항(22)은 트랜지스터 Q1에서 베이스 누설 전류에 대한 콜렉터 전류를 감소시킨다.
트랜지스터 Q1, Q2의 상보 장치는 트랜지스터 Q2의 콜렉터 전극이 트랜지스터 Q1의 베이스 전극에 결합되어 있고 직렬 통과 장치의 출력이 트랜지스터 Q1의 콜렉터 전극(16)으로부터 취해지기 때문애 전압 이득과 전류 이득 둘 다를 제공한다. 그래서 트랜지스터 Q1, Q2는 루프 이득을 갖는 피드백 루프 내에서 증폭기로서 배열되어 있으며 상기 루프 이득은 출력 단자(18)에서부터 트랜지스티 Q2의 에미터 전극으로 결합된 저항(24)과 접지된 저항(30)으로 구성된 피드백 네트워크에 의해 결정된다.
부가적으로, 트랜지스터 Q1, Q2와 저항들(24, 30)로 이루어진 배열은 추가의 이점이 있는데, 조절기(10)에 의해 성능을 향상시킬 수 있고 중(heavy)부하 조건 하에서 전원 소모를 줄일 수 있으며 트랜지스터 Q1, Q2 에 필요한 구동을 줄일 수 있다. 도 2는 저항들(24, 30)로 이루어진 저항 분할기가 없는 직렬 통과 장치의 일부를 나타낸다(저항 24는 단자 회로로 대체되었으며 저항 30은 개방 회로로 대체되었다). 이 장치에서, 트랜지스터 Q2의 베이스 전압(라인 26)은 출력 단자(18)에서의 전압 Vo보다 높은 0.7 볼트가 되고, 트랜지스터 Q1, Q2에서 베이스-에미터 전압 강하 때문에 Vo는 단자(12)에서 입력 전압 Vin보다 낮은 1.4 볼트가 된다. 이것은 조절되지 않은 입력전압과 관련하여 조절된 최대 출력 전압에 상한(upper limit)을 둔다. 또한, 트랜지스터 Q1의 양단의 1.4 볼트의 전압 강하는 트랜지스터 Q1에서 전원을 소모한다.
조절기가 입력 전압 VIN과 출력 전압 V0사이의 낮은 전압차로 동작되도록하기 위해 또한 트랜지스터 Q1에서의 전원 소모를 줄이기 위해서는 트랜지스터 Q1이 높은 전압 모드의 가장 높은 출력 전압들에서 포화되는 것이 바람직하다. 분압 저항들(24, 30)은 직렬 통과 회로의 효율성을 향상시켜 이들 속성을 달성한다.
도 1로 돌아가서, 라인 26에서 전압 V26은 다음과 같이 수학적으로 표현된다.
V26 = Q2의 Vbe + V0(저항 30 / (저항 30 + 저항 24))
Q2의 Vbe 가 0.7 이고 저항(24)의 값이 저항(30)의 값과 같으면,
V26 = 0.7 볼트 + V0/ 2
이 장치는 트랜지스티 Q2의 에미터에서의 전압을 전압 V0보다 실질적으로 낮게 하기 때문에, Q2를 더욱 쉽게 구동하는 것이 가능하며, 전압 V26은 낮은 전압이 될 수 있으므로 트랜지스터 Q2를 활성 비-포화 상태(non-saturating state)에서 계속 유지하는 동반 트랜지스터 Q1은 보다 용이하게 포화될 수 있다. 그래서 분압기 저항들(24, 30)에서 직렬 통과 트랜지스터 Q1은 적어도 1.4 볼트 대신에 위에서 언급한 바와 같이 V0= VIN- 0.2 볼트(트랜지스터 Q1의 통상적인 포화 전압)로 구동될 수 있다. 그래서 상기 조절기는 입력 전압 VIN과 출력 전압 V0사이의 낮은 전압차로 동작할 수 있으며 또한 이에 따라 트랜지스터 Q1이 완전하게 구동할 때 트랜지스터 Q1의 전원 소모가 줄어든다.
입력 전압과 출력 전압 사이의 낮은 전압차는 전압 VIN의 최대값이 제한되기때문에 높은 출력 전압 모드에서는 특히 중요하다. 부가적으로, 리드(26)에 인가된 제어 전압은 B+보다 현저하게 낮기 때문에 상세히 후술될 바와 같이 제어 신호 V26을 제공하는 연산 증폭기(46)는 트랜지스터 Q1의 포화되도록 트랜지스터 Q2를 구동하기 위해 B+값 근처의 출력 전압에서 동작될 필요가 없다.
트랜지스터 Q1의 에미터 전극(14)과 트랜지스터 Q2의 에미터 전극 사이에 저항(28)이 결합되어 상기 출력이 단락될 때 Q2의 에미터 전극이 낮게 떨어지는 것을 방지함으로써, 연산 증폭기(operational amplifier)(46)는 트랜지스터 Q1을 컷-오프시키기 위해 트랜지스터 Q2의 베이스-에미터 접합부를 역바이어스시킬 수 없다. 트랜지스터 Q1을 컷-오프시키는 능력은 전류 제한(current limiting)에 있어서 중요하며 이에 대해서는 상세히 후술한다.
입력 단자(12)와 접지 사이에 직렬 접속된 저항(34)과 제너 다이오드(36)에 의해 기준 전압이 제공되며 상기 기준 전압은 캐패시타(38)에 의해 필터링 된다. 상기 기준 전압은 연산 증폭기(46)의 비반전(ni) 입력 판자 46ni에 결합되어 있으며 증폭기에서 기준 전압은 반전(i) 입력 단자 46i에 결합된 V0의 분할된 다운 버전(divided down version)과 비교된다. V0의 상기 분할된 다운 버전은 출력 단자(18)와 접지(11) 사이에 결합된 직렬 분압기 저항들(42, 44)의 접합에 있는 탭으로부터 유도된다. 증폭기(46)의 출력 신호는 절연 저항(50)을 거쳐 라인(26)에서 제어 신호 V26을 제공한다. 이 장치는 조절된 출력 전압 V0에 각각 증가 또는 감소가 있다면 상기 구동을 감소 또는 증가시키는 네거티브 피드백을 트랜지스터 Q1에제공한다. 증폭기(46)의 출력과 단자 46i 사이에 결합된 캐패시터(49)는 발진을 억압한다.
낮은 출력 전압 모드와 높은 출력 전압 모드 사이의 스위칭은 트랜지스터 Q3에 의해 가능해지며, 트랜지스터 Q3는 분할 저항들(51, 52)을 거쳐 마이크로프로세서와 같은 제어 유닛(도시되지 않음)으로부터 Q3의 베이스 전극에 결합된 제어 신호에 의해 포화될 수 있다. 트랜지스터 Q3의 콜렉터 전극은 저항(54)에 의해 단자 46i에 결합되며, 트랜지스터 Q3이 포화될 때, 저항(54)은 분할 저항(44)과 병렬로 결합되며, 그래서 저항들(42, 44)의 전압 분할비는 변형된다. 결과적으로 비교기 증폭기(46)가 제공하는 V26에서의 변화로 인해 단자(18)에서의 출력 전압은 LNB에 의해 LHCP에 필요한 더 높은 전압으로 스위치된다.
이제 본 발명의 관점에 따른 폴드백 전류 제한(foldback current limiting)으로 관심을 돌려보면, 직렬 저항들(60, 62, 64)을 포함하는 분압기(58)는 트랜지스터 Q1의 콜렉터(16)와 접지 사이에 결합되어 있으며 저항들(62, 64)의 접합부에서의 탭은 연산 증폭기(66)의 반전 입력 단자 66i 에 결합되어 있다. 직렬 저항들(70, 72)을 포함하는 분압기(68)는 출력 단자(18)와 접지 사이에 결합되어 있으며 저항들(70, 72)의 접합부에서의 탭은 증폭기(66)의 비반전(ni) 입력 단자 66ni 에 결합되어 있다. 증폭기(66)의 출력 단자(74)는 다이오드(76)의 캐소드에 결합되어 있으며 다이오드(76)의 애노드는 제어 리드(26)에 결합되어 있다. 다이오드(76)는 연산 증폭기(66)가 정상 동작동안 V26을 유효하게 하는 것을 방지하며 이에 대해서는 상세히 후술한다. 출력 단자(74)와 단자 66i 사이에 결합된캐패시터(79)는 발진을 억압한다. 저항(72) 양단에 결합된 캐패시터(80)는 LNB 부하로부터 수신된 임의의 AC 신호가 증폭기(66)를 유효하게 하는 것을 방지한다. 분압기들(58, 68)에 있는 저항들의 성분값들은 다음과 같다.
저항 60 = 1K 오옴 저항 62 = 3K 오옴
저항 64 = 12K 오음 저항 70 = 2.8K 오옴
저항 72 = 12K 오옴
저항(20)(3.2 오옴)은 출력 전류에 비례해서 그 양단에 전방을 생성한다. 그래서 분압기들(58, 68) 양단의 전압들은 약간 상이하며 상기 두 개의 분압기의 탭들에서의 전압들은 약간 상이하도록 배열된다. 저항(20)을 통해 유도된 전류가 임계 폴드백 전류보다 낮을 때, 전압 분압기들(58, 68)은, 단자 66ni에서의 전압이 단자 66i에서의 전압보다 더 포지티브가 되도록 동작하고 또한 단자(74)에서의 출력 전압이 B+ 전압에 또는 근처에 있도록 동작한다. 이것은 다이오드(76)를 역으로 바이어스시키고 증폭기(66)의 출력으로 하여금 정상 동작 하에서 라인(26)에서의 구동과 간섭하지 않게 한다. 그래서 회로가 전류 제한 모드에 있지 않으면, 라인(26)의 정상 제어가 증폭기(46)에 의해 제공된다. 그렇지만, 저항(20)을 통해 유도된 전류가 폴드백 임계 전류를 초과하면, 저항(20) 양단의 전압 강하로 인해 단자 66ni에서의 전압은 단자 66ni에서의 전압보다 약간 더 낮게 된다. 이것은 연산 증폭기(66)의 큰 이득으로 인하여 단자(74)에서의 출력 전압을 강제로 낮아지게 한다. 이로 인해 다이오드(76)는 순방향 바이어스되고 증폭기(46)의 동작은 겹쳐져서 라인(26)상의 상기 제어 전압이 거의 제로 볼트로 줄어든다. 결과적으로,단자(18)에서의 출력전류는 거의 제로로 감소되고 출력 전압 V0는 거의 제로 볼트로 줄어든다. 이 방법에서, 상기 출력이 단락되거나 또는 부하에서 폴트(fault)가 발생할때, 상기 출력 전류는 정상 동작동안 부하에 제공되는 정상 출력 전류로부터 "폴드 백(folded back)"된다. 예를 들어, 출력 전류는 350 밀리암페어의 정상값에서 약 10 밀리암페어로 폴드 백될 수 있다. 그래서 트랜지스터 Q1은 부하 폴트로 인한 과도한 열적 소모나 과전류 상태의 영향으로부터 보호받을 수 있다. 상기 부하 폴트가 제거되면 전압 조절기(10)는 회복되어 정상 동작으로 복귀한다.
전압 조절기(10)는 이중의 전압 전압 조절기이다. 출력 전압 V0이 더 높은 전압으로 변하면, 전류 제한이 시작되는 폴드백 임계 전류도 또한 변한다. 전류 감지 저항(20) 양단의 전압 강하가 어느 특정 전류에 대해 동일하게 남아 있기 때문에 폴드백 임계 전류에서의 변화가 생기지만, 분압기(58, 68)양단의 전압에서의 증가로 인한 입력 단자 66ni 및 66i 에 결합된 전압의 차 때문에 생기기도 한다. 이것은 트랜지스터 Q1 및 부하에 대한 보호가 감소되기 때문에 바람직하지 않다.
본 실시예에서 높은 전압 모드에서 동일한 전류 제한 임계를 유지하기 위해 분압기(58)의 전압 분할은 저항(60) 양단에 결합된 다이오드(78)에 의해 변한다. 저항(60) 양단의 전압 강하는 낮은 출력 전압 모드에서 다이오드(78)의 순방향 도전의 임계보다 더 낮아지도록 선택된다. 그렇지만, 조절기(10)가 높은 전압 모드로 스위치되면, 저항(60) 양단의 높은 전압 강하는 다이오드(78)로 하여금 그 순방향으로 도전되도록 하기에 충분하며 그래서 분압기(58)의 전압 분할과 단자들 66i 및66ni 에 인가된 차 전압의 관계가 변하게 된다. 분압기(58)의 이 변화는 낮은 전압 출력 모드에서처럼 높은 전압 출력 모드에서 실질적으로 동일한 폴드백 임계 전류를 유지한다. 예를 들어 전압 분할기(58)에서의 변화가 없을 때, 낮게 조절된 출력 전압에서의 전류 제한 임계는 예시적 실시예에서 약 350 ma가 되며, 높게 조절된 출력 전압에서의 전류 제한 임계는 약 600 ma가 된다. 분압기(58)에서 변화가 있을 때는 전류 제한 임계가 이중의 출력 전압들 각각에 대해 약 350 ma가 된다.
양호한 실시예에서 다이오드(78)는 상당히 날카로운 "니(knee)"를 갖는 1N914 다이오드이다. 도전 니(conduction knee)의 날카로움(sharpness)을 줄이기를 원한다면, 즉시 다이오드(78)에 직렬로 저항(도시도지 않음)을 접속시킬 수 있다. 대안적으로, 다이오드(78)는 복수의 직렬 접속 다이오드로 대체될 수 있다. 또한 게르마늄 다이오드, LED' s, 전압 의존 저항, 또는 제너 다이오드와 같은 다른 전압 감지 장치가 사용될 수 있다. LED의 경우에, 다이오드 자체가 조절기의 동작 모드에 대해 가시 지시기(visual indicator)가 될 수도 있다. 부가적으로 중계기(relay) 또는 스위칭 트랜지스터가 다이오드(78) 대신에 사용될 수 있다. 그러한 경우에, 예를 들어 단자(64)에서 유용가능한, 마이크로프로세서 신호의 있음 또는 없음은 동일한 마이크로프로세서 신호가 출력 전압에서 변화를 일으킬 때 분할 저항들을 스위칭시키는데 사용될 수 있다. 또한, 다른 경우에 전압 감지 장치가 상기 분압기들 중 한 분압기에 접속될 수 있다.
예시적 실시예에서, 연산 증폭기(46, 66)는 미국의 National Semiconductor에서 제조한 LM358 연산 증폭기이다. 이들 증폭기들은 입력 단자에서의 전압들이 매우 낮을 때 증폭기가 계속해서 동작될 수 있게 해주는 PNP 입력 회로를 갖는다. 그렇지만, NPN 입력 회로를 갖는 연산 증폭기는 통상적으로 입력 단자에서의 전압이 약 1 볼트보다 낮은 때는 동작되지 않는다. 그러한 NPN 입력 회로 연산 증폭기가 사용되면, 증폭기(66)는 폴드백 전류 제한 모드에서 래치를 하며, 즉 출력 단자(74)는 제로 출력 볼트로 래치되며 출력 단자(18)에서 폴트가 제거되었을 때 정상 동작 모드로 복귀되지 않는다. 그렇지만, "실패-안전(fail-safe)"에서의 이 래칭은 바람직한 것이 될 수 있는 상황이 될 수 있다.

Claims (4)

  1. 조절되지 않은 DC 전압을 수신하는 입력 포인트(12);
    조절된 DC 전압을 제공하는 출력 포인트(18);
    상기 조절된 DC 전압(VO)의 버전과 기준 전압의 비교에 응답해서 제어신호를 발생하는 수단(46,66);
    상기 입력 포인트(12)와 상기 출력 포인트(18) 사이에 결합되며, 상기 제어 신호에 응답하는 조절 수단(Q1,Q2)을 포함하며,
    상기 조절 수단(Q1,Q2)은, 제1 전극(16) 및 제어 전극(베이스)을 구비하는 제1 형의 제1 트랜지스터(Q1)와, 상기 제1 트랜지스터(Q1)와 상보형이며, 제1 전극(콜렉터), 제2 전극(에미터), 및 제어 전극(베이스)을 구비하는 제2 트랜지스터(Q2)를 포함하며,
    상기 제2 트랜지스터(Q2)의 상기 제어 전극(베이스)은 상기 제어 신호 발생 수단(46,66)으로부터 상기 제어 신호를 수신하며,
    상기 제2 트랜지스터(Q2)의 상기 제1 전극(콜렉터)은 상기 제어 신호의 증폭된 버전을 상기 제1 트랜지스터(Q1)의 상기 제어 전극(콜렉터)에 제공하는, 전압 조절기에 있어서,
    상기 제2 트랜지스터(Q2)의 상기 제 2 전극(에미터)과 상기 출력 포인트(18) 사이에 접속되며, 상기 제 2 트랜지스터(Q2)의 상기 제 2 전극(에미터)에, 상기 출력 포인트(18)에서의 상기 조절된 DC 전압의 감소된 전압 버전을 제공하는 피드백네트워크(24,30)를 포함하는 것을 특징으로 하는, 전압 조절기.
  2. 제 1 항에 있어서, 상기 제2 트랜지스터(Q2)의 상기 제 2 전극(에미터)과 상기 출력 포인트(18) 사이에 결합된 상기 피드백 네트워크(24,30)는 전압 분압기(24,30)를 포함하며, 상기 전압 분압기는 상기 출력 포인트(18)와 기준 전위 사이에 결합된 제1 저항(24) 및 제2 저항(30)을 포함하며, 상기 제2 트랜지스터(Q2)의 상기 제2 전극(에미터)은 상기 제1 저항(24) 및 제2 저항(30)의 접합점에 결합되어 있는 것을 특징으로 하는, 전압 조절기.
  3. 제 1 항에 있어서, 상기 제1 트랜지스터(Q1)의 상기 제1 전극은 콜렉터 전극이며,
    상기 제1 트랜지스터(Q1)의 상기 제어 전극은 베이스 전극이며,
    상기 제2 트랜지스터(Q2)의 상기 제1 전극은 콜렉터 전극이며,
    상기 제2 트랜지스터(Q2)의 상기 제2 전극은 에미터 전극이며,
    상기 제2 트랜지스터(Q2)의 상기 제어 전극은 베이스 전극인 것을 특징으로 하는, 전압 조절기.
  4. 제 1 항에 있어서, 상기 제1 트랜지스터(Q1)는 PNP형 트랜지스터이며, 상기 제2 트랜지스터(Q2)는 NPN형 트랜지스터인 것을 특징으로 하는 전압 조절기.
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