KR100271122B1 - 레이크 수신기 - Google Patents

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KR100271122B1
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고지 오노
세이죠 오노에
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다치카와 게이지
가부시키가이샤 엔.티.티.도코모
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Abstract

본 발명에 의하면, 직접 시퀀스 확산 스펙트럼 통신 시스템에 이용되고, 다중경로 신호들을 효율적으로 수신할 수 있는 레이크(RAKE) 수신기가 제공된다. 경로 검색기는 각 경로의 크기를 측정하고, 크기의 내림 차순으로 더 큰 진폭을 가진 N개의 경로를 선택하며, 여기서 N은 역확산기의 수이고, 경로들의 신호들을 역확산시키기 위해 선택된 경로에 역확산기들을 할당한다. 큰 진폭을 가진 경로 및 작은 진폭을 가진 경로가 인접 역확산기들에 할당되어 동일한 검파전 합성기에 입력되도록 경로에 대한 역확산기의 할당이 이루어진다. 역확산기들의 출력들은 검파전 합성기에 의해 합성되고 검파기들에 의해 검파되며 검파기들의 출력들이 검파후 합성기에 의해 레이크 합성이 된다.

Description

레이크 수신기{RAKE RECEIVER}
본 발명은 직접 시퀀스 확산 스펙트럼 통신 시스템에 이용되고, 다중경로 신호를 효율적으로 수신할 수 있는 레이크(RAKE) 수신기에 관한 것이다.
확산 스펙트럼 통신 방식은 송신되는 신호와 송신측에서 수배 내지 수만배의 대역폭인 신호의 대역폭을 가진 확산 코드를 곱셈하고, 이것을 광대역 신호로서 전송하며, 송신측에서 확산을 위해 이용된 확산 코드와 동기적으로 수신측에서 역확산 코드를 발생시켜 수신된 신호와 역확산 코드를 곱셈함으로써 협대역 정보를 복원하는 통신 방법이다.
최근에, CDMA(코드 분할 다중 접근)는 확산 스펙트럼 통신 방식을 이동 무선 시스템의 다중 접근에 적용시키려는 관심을 끌어왔다. 확산 스펙트럼 통신 방법은 잡음 및 간섭에 대한 저항과 정보의 은폐에 있어서 특성화되어 있다.
다중 전파의 역확산 처리에서 다중경로를 확산 코드 길이에 대응하는 분해능(resolution)으로 분리하는 것이 가능하다. 다중경로 신호는 다른 경로를 통해 도착하기 때문에, 다중경로 신호의 진폭 및 위상은 수신 시점에 따라 독립적으로 변경된다. 특히, 채널의 특성이 이동국의 움직임에 따라 변동하기 때문에 페이딩(fading)은 이동 채널에서 발생한다. 그러나, 다중경로들이 독립적으로 변동하기 때문에, 경로 다이버서티 효과(diversity effect)는 적절히 다중경로 신호를 합성함으로써 획득될 수 있다.
이러한 방식은 레이크 수신으로 언급된다.
도1은 종래의 레이크 수신기의 구성을 도시한다. 도1에서, 참조번호 "10"은 다중경로중 하나에 각각 대응하는 역확산기((1)~(n))를 나타내고, 또한 참조번호 "12"는 다중경로의 타이밍을 검파하기 위한 경로 검색기를 나타내며 역확산기(10)에 타이밍을 제공하고 또한 참조번호"16"은 경로의 검파를 완성하기 위한 검파기((1)~(n))를 나타내며 참조번호"18"은 검파기들의 출력들을 합성하기 위한 합성기를 나타낸다.
일반적으로, 경로 검색기(12)는 연속적으로 역확산의 타이밍을 슬라이딩시킬 수 있는 슬라이딩 상관기 또는 확산 코드를 정합하는 정합 필터 등으로 이루어져 있다.
도1에서 도시된 레이크 수신기의 동작이 설명될 것이다. 먼저, 경로 검색기(12)는 채널의 다중경로 상태를 측정한다. 경로들을 검파하는 경로 검색기(12)는 순차적으로 경로들의 검파된 타이밍으로 역확산기(10(1)~10(n))를 동작시킨다. 다른 말로, 역확산기(10(1)~10(n))는 각각 다른 다중경로들을 수신한다. 다중경로 신호들이 위상 회전 및 진폭 변동을 겪기 때문에, 검파기(16(1)~16(n))는 위상 및 진폭을 보상한다.
역확산기(10(1)~10(n)), 및 검파기(16(1)~16(n))의 각 쌍은 레이크 핑거(RAKE finger)로 언급된다. 합성된 출력이 다중 경로를 통과하는 신호의 총합레이크 핑거들의 출력은 합성기(18)에 의해 합성된다. 다중경로들을 통과하는 신호의 총합이 되는 합성된 출력이 획득됨으로써 수신된 신호에 페이딩으로 인해 왜곡을 감소시킨 것을 제공하기 때문에 합성기(18)는 단일 경로를 통과하는 신호를 단지 수신하는 것보다 더 효율적인 수신을 획득할 수 있다.
그래서, 레이크 시스템은 유입되는 전력 수신의 효율성을 개선하고 경로 다이버서티 효과를 제공하는 다중경로 수신을 획득할 수 있다.
그러나, 도1과 관련하여 전술한 바와 같은 레이크 수신기는 도2a에 도시된 바와 같이 잡음에 의해 감추어진 다중경로를 통과하는 신호를 합성할 경우 수신 품질 저하를 초래할 것이다.
도2a는 잡음 레벨 및 다중경로에서의 수신된 신호의 역확산 출력사이의 관계를 도시하고 각 검파기에 대한 역확산 출력들의 입력을 도시한다.
레이크 수신은 종종 검파 방법으로써 동기 검파(coherent detection)를 이용한다. 이상적으로 동작할 경우 이것은 특별한 평균 비트 에러율을 획득하기 위한 최소 신호대 잡음비(S/N비)를 요구하기 때문이다.
그러나, 동기 검파는 절대 위상의 추정 에러 때문에 도2a에 도시된 바와 같이 잡음하에 감추어진 경로에 적용될 경우 특성을 급속히 저하시킨다.
또한, 효율적인 수신 전력 합성은 도2b에 도시된 바와 같은 레이크 핑거수를 초과할 경우 취득될 수 없다. 그러나, 레이크 핑거수의 증가는 잡음하에 감추어진 경로들의 합성을 야기시킬 것이다.
도2a와 마찬가지로 도2b는 잡음 레벨 및 경로와 결합이 수신된 신호의 역확산 출력사이의 관계를 도시하고 각 검파기에 공급된 역확산 출력을 도시한다. 여기서, 검파기에 접속되지 않은 출력들은 대응하는 레이크 핑거들을 가지고 있지 않음을 나타낸다.
따라서, 본 발명의 목적은 비록 잡음하에 감추어진 경로들이 존재하지만 수신된 전력을 효율적으로 이용하여 레이크 합성을 취득할 수 있고 잡음으로 인한 왜곡을 감소시켜 고품질의 수신을 구현할 수 있는 레이크 수신기를 제공하는데 그 목적이 있다.
도1은 종래의 레이크(RAKE) 수신기를 도시하는 블록도.
도2a 및 도2b는 다중경로, 잡음 레벨 및 레이크 핑거의 관계를 도시하는 다이아그램.
도3은 본 발명에 따른 레이크 수신기의 제1 실시예를 도시하는 블록도.
도4는 본 발명에 따른 레이크 수신기의 제2 실시예를 도시하는 블록도.
도5a 및 도5b는 경로 선택 및 합성을 도시하는 다이아그램.
도6a 및 도6b는 본 발명에 따른 레이크 수신기를 세부적으로 도시하는 블록도.
도7은 정격화된 페이딩 주파수(fDT)에 대해 10-3의 평균 비트 에러율(Bit Error Rate : BER)을 획득하기 위해 요구되는 비트당 에너지대 잡음 스펙트럼 밀도(Eb/No)를 도시하는 그래프.
*도면의 주요부분에 대한 부호의 설명
10 : 역확산기(1)~(n) 12, 22 : 경로 검색기
14 : 검파전 합성기(1)~(m) 16 : 검파기(1)~(m)
18 : 검파후 합성기 19 : 신호 처리기
본 발명에 따르면, 레이크 수신기는 채널의 다중경로중에 하나의 경로에 각각 대응하고 상기 경로의 수신된 신호를 역확산하는 다수의 역확산기; 상기 역확산기로부터 전송된 적어도 2개의 신호를 합성하는 다수의 검파전 합성기; 상기 검파전 합성기의 출력 또는 상기 역확산기의 출력을 검파하기 위한 다수의 검파기; 상기 검파기에서의 신호 출력을 합성하기 위한 검파후 합성기; 및 상기 다중경로를 식별하고 상기 역확산기를 상기 경로에 할당하기 위한 경로 검색기를 포함한다.
여기서, 상기 역확산기들의 출력들을 상기 검파전 합성기중 원하는 검파전 합성기들에 접속하고 상기 역확산기들의 출력들을 검파기들의 입력들에 접속하기 위한 스위치를 더 포함하며, 레이크 수신기는 상기 경로 검색기가 스위치의 접속상태를 제어한다.
상기 경로 검색기는 상기 다중경로의 식별결과에 응답하여 상기 스위치의 상기 접속상태를 동적으로 변경한다.
상기 검파전 합성기들중 최소 하나는 소정값보다 더 큰 신호 레벨을 가진 경로와 소정값보다 더 작은 신호 레벨을 가진 또다른 경로를 합성한다.
상기 검파전 합성기는 평균 신호 레벨들이 특정 한계값보다 더 작은 다수의 경로를 합성하고, 상기 검파후 합성기는 평균 신호 레벨들이 상기 한계값보다 더 큰 경로를 합성한다.
상기 검파전 합성기들은 신호 레벨들이 제1 한계 레벨과 상기 제1 한계 레벨보다 더 낮은 제2 한계 레벨사이에 있는 상기 경로들을 합성하고, 상기 검파후 합성기는 신호 레벨들이 상기 제1 한계 레벨이상인 상기 경로들을 합성하며, 신호 레벨들이 상기 제2 한계 레벨이하인 상기 경로들은 합성없이 취소된다.
상기 경로 검색기는 레이크 합성이 되는 각 입력의 평균 레벨들의 합이 실질적으로 동일하도록 상기 경로들의 합성들을 결정한다.
상기 검파후 합성기는 평균 신호 레벨에서 가장 큰 것에서 시작하는 상기 평균 신호 레벨의 크기의 내림 차순으로 선택된 N개의 경로들을 합성하며, -여기서, N은 소정의 자연수임- 상기 검파전 합성기들은 평균 신호 레벨들이 상기 N개의 경로보다 더 작은 잔류 경로들을 합성한다.
본 발명의 상기 목적과 다른 목적, 효과, 특징 및 장점은 첨부된 도면들을 참조하여 실시예의 하기 설명으로 더 분명해질 것이다.
이하, 본 발명은 첨부된 도면을 참조하여 설명될 것이다.
실시예 1
도3은 본 발명에 따른 레이크 수신기의 제1 실시예를 도시한다.
도3에서, 참조번호"10"은 n개의 역확산기((1)~(n))를 나타내고, 참조번호"12"는 경로 검색기를 나타내며, 참조번호"14"는 m개의 검파전 합성기((1)~(m))를 나타내고, 참조번호"16"은 m개의 검파기((1)~(m))를 나타낸다. 일반적으로 말하자면, 경로 검색기(12)는 역확산 타이밍의 연속적인 슬라이딩을 구현 가능한 슬라이딩 상관기들 또는 확산 코드에 정합된 정합 필터들로 이루어져 있다. 또한, 다중경로들의 신호들의 진폭들과 지연시간들을 측정하기 위한 기능을 가지고 있다. 또한, 경로 검색기(12)는 역확산기(10(1)~10(n))에 역확산을 위해 타이밍을 설정할 수 있어 경로들을 정합시킨다. 검파전 합성기(14(1)~14(m))는 각각 단순한 가산기로 이루어질 수 있다. 검파기(16)는 페이딩으로 인한 위상 회전 또는 송신기와 수신기 사이의 주파수 오차(deviation)에 대해 각 경로를 보상함으로써, 적합한 레이크 합성이 획득될 수 있게 한다. 검파후 합성기(18)는 최대 비율 합성을 획득하기 위해 경로 신호들과 가중치들을 합성하는 레이크 합성기이다. 역확산기(10(1)~10(n))의 일부는 직접적으로 검파기(16)들중 수개에 접속될 수 있다.
본 발명의 레이크 수신기는 역확산기(10)와 검파기(16)사이에 삽입된 검파전 합성기(14)를 포함하고 있다는 점에서 도1에 도시된 종래의 레이크 수신기와 상당히 다르다. 검파전 합성기(14)는 역확산기들의 출력들을 합성하여 검파기들에 공급한다. 도3에 도시된 실시예에서, 각 검파전 합성기는 확산 신호를 검파하기전에 경로들의 쌍으로부터의 신호들을 합성한다. 따라서, 역확산기의 수 n 및 검파기의 수 m의 관계는 m=n/2이다.
이하, 도3에 도시된 레이크 수신기의 동작이 설명될 것이다. 먼저, 경로 검색기(12)는 각 경로들을 위해 수신된 신호에 응답하여 다중경로들의 신호들의 진폭 및 지연 시간들을 측정한다. 계속해서, 경로 검색기(12)는 최대 진폭을 가진 경로에서 시작하는 진폭 크기의 내림 차순으로 n개의 경로들을 선택하고, 여기서 n은 역확산기 수이며, 역확산기(10(1)~10(n))에 타이밍을 설정함으로써 다중경로 신호를 역확산시키기 위해 경로들에 역확산기(10(1)~10(n))를 할당한다.
역확산기(10)의 할당은 큰 진폭을 가진 경로와 작은 진폭을 가진 경로가 인접 역확산기들에 할당되는 유형으로 본 실시예에서 이루어지고 역확산기들의 출력들은 동일한 검파전 합성기에 입력된다.
그래서, 역확산기(10(1)~10(n))의 출력은 큰 진폭 경로가 작은 진폭 경로와 쌍이 되게 검파전 합성기(14(1)~14(n))에 의해 합성되고, 검파기(16(1)~16(m))에 의해 검파된다. 이 때, 역확산의 연산은 선형의 연산이기 때문에, 가산 후의 신호는 다중경로의 성분이 단순히 가산된 하나의 신호를 역확산시킨 것과 동일한 결과를 얻는다. 그리고 검파기(16(1)~16(m))에서는 입력된 신호의 위상과 진폭을 검파하는데, 입력신호의 전력은 진폭의 제곱으로 표현되므로, 검파기 내에서는 위상 보정 후, 상기 전력값을 승산하는 것에 의해 가중한 신호를 생성하여 검파후 합성기(18)로 출력한다. 마지막으로 검파후 합성기(18)에서는 검파기로부터의 입력된 값들을 합성, 즉 단순 가산하여 레이크 효과를 구현한다.
큰 진폭 경로 및 작은 진폭 경로의 사전 합성은 비록 다중경로 신호들이 잡음하에 감추어져 있지만 다중경로의 전력이 효율적으로 이용될 수 있게 한다.
비록 2개의 경로들이 각각 전술한 실시예에서 합성되지만, 또한 3개 또는 그 이상의 역확산 출력들을 합성한다는 것이 가능하다. 이러한 경우에, 하나의 큰 진폭 경로와 2개 또는 그 이상의 작은 진폭 경로들을 합성한다는 것이 가능할 수 있다. 검파전 합성에 종속되는 역확산기의 수와 경로의 수는 사용중에 있는 전파 경로의 다중경로 상태를 측정함으로써 사전에 결정될 수 있고, 장비에 이용가능한 역확산기의 수도 결정될 수 있다.
실시예 2
도4는 본 발명에 따른 레이크 수신기의 제2 실시예를 도시한다.
도4에서, 참조번호"10"은 각각의 경로들에 대응하는 역확산기((1)~(n))를 나타내고, 참조번호"22"는 경로 검색기를 나타내며, 참조번호"23"은 스위치를 나타내고, 참조번호"14"는 검파전 합성기((1)~(m))를 나타내며, 참조번호"16"은 검파기((1)~(m))를 나타내고, 또한 참조번호"18"은 검파후 합성기를 나타낸다. 이러한 레이크 수신기는 역확산기(10)와 검파전 합성기(14)사이에 삽입된 스위치(23)를 포함하고 있다는 점에서 도3에 도시된 것과 다르다. 경로 검색기(22)의 제어하에서 스위치(23)는 원하는 합성들에서 역확산기(10(1)~10(n))의 출력들을 합성할 수 있어 출력들을 검파전 합성기(14(1)~14(m))에 공급할 수 있다. 또한, 역확산기(10(1)~10(n))의 원하는 출력들은 검파전 합성기들을 삽입시키지 않고 검파기(16(1)~16(m))의 입력들에 직접적으로 접속될 수 있다.
이하, 도4에 도시된 레이크 수신기의 동작이 설명될 것이다. 경로 검색기(22)는 다중경로를 검파하여 측정하고, 이용되는 역확산기(10)의 수를 결정하며 다중경로 수와 진폭들에 따른 검파전 합성기들의 합성들의 수를 결정하고 스위치(23) 및 역확산기(10)의 타이밍을 설정한다.
하나의 예는 역확산기(10)의 수와 검파전 합성기들의 합성들의 수를 결정하는 것에 관하여 설명될 것이며, 이것은 경로 검색기(22)에 의해 이루어진다.
(1) 각 경로와 다중경로들에서 최대 진폭을 가진 경로를 비교하고, 진폭들이 한계 레벨(예를 들어, -6dB)을 초과하는 경로들의 수 N을 획득한다.
(2) 2N개의 역확산기(10)를 선택하고 역확산기(10)에 타이밍을 설정함으로써 경로들에 역확산기(10)를 할당한다.
(3) 진폭들이 -6dB을 초과하는 N개 각각의 출력과 진폭들이 -6dB이하인 N개의 경로들의 출력중 하나를 합성함으로써 N개의 합성들을 형성하며, 출력들이 역확산기(10)에서 공급되고, N개의 합성들이 검파전 합성기(14)에 입력되기 위해 스위치(23)를 설정한다.
그래서, 큰 진폭과 작은 진폭을 가진 경로들의 신호의 쌍을 수신하는 검파전 합성기(14) 각각은 신호쌍들을 합성한다. 계속해서, 검파전 합성기(14)들의 출력들은 검파기(16)에 의해 검파되고 검파후 합성기(18)에 의해 N개의 경로들의 레이크 합성을 겪는다.
이러한 구성을 가진 스위치(23)는 역확산기(10(1)~10(n))의 출력들의 합성들을 동적으로 변경시켜 검파전 합성기(14(1)~14(m))로 합성들을 입력한다. 전파경로의 다중경로들의 일시적인 변동에도 불구하고, 이것은 합성된 전력을 감소시키는 합성 또는 많은 잡음을 포함하는 경로들의 합성을 억제할 수 잇는 최적의 레이크 합성을 획득 가능하게 한다.
경로들의 합성 방법에는 예를 들어 다음과 같은 여러개의 합성방법들이 있다.
(1) 큰 평균 신호 레벨의 경로와 작은 평균 신호 레벨의 경로를 합성하는(전술된) 방법.
(2) 평균 신호 레벨들이 검파전에 소정의 한계 레벨보다 더 작은 경로들을 합성하지만 평균 신호 레벨이 검파후에 소정의 한계 레벨보다 더 큰 경로들을 합성하는 방법.
(3) 그것들이 잡음과 구분이 될 수 없기 때문에 진폭들이 더 작은 제2 한계레벨보다 작은 경로들이 합성없이 취소되고, 진폭들이 제1 및 제2 한계 레벨사이에 있는 경로들이 검파전에 합성되며, 그리고 진폭들이 더 큰 제1 한계 레벨을 초과하는 경로들은 검파후에 다른 경로들과 합성되는 평균 신호 레벨을 위한 2개의 한계레벨들을 설정하는 방법.
(4) 레이크 합성기에 대해 각 입력들의 평균 레벨들이 최대 효과를 획득하기 위해 레이크 합성과 동일하게 되도록 경로들을 합성하는 방법.
(5) 가장 큰 것부터 시작하는 평균 레벨 크기의 내림 차순으로 선택되는 검파후에 N개의 경로들을 합성하지만, 검파전에 잔류하는 경로들을 합성하는 방법.
전술한 항목(4)의 합성 방법은 도5a 및 도5b를 참조하여 더 세부적으로 설명될 것이다. 전술한 바와 같이, 레이크 합성은 레이크 합성기에 대해 각 입력들의 평균 레벨들이 동일할 경우 최대 효과를 획득할 수 잇다. 이것은 다수의 안테나를 이용하여 구현된 공간 다이버서티(space diversity)와 유사하며, 여기서 다이버서티 효과는 안테나와 평균 수신 레벨의 이득이 서로 다르다면(이득이 동일하지 않으면) 감소할 것이다.
비록 레이크 합성에 대해 입력들을 정합하기 위한 수개의 합성 방법들이 존재하지만, 방법중 하나의 방법이 도5a 및 도5b를 참조하여 설명될 것이다. 먼저, 경로들의 평균 레벨들이 획득된다. 이것은 도5a에서 도시되며, 여기서 x 축은 경로들을 나타내고 y 축은 평균 레벨들을 나타낸다. 취득된 평균 레벨들은 크기의 내림차순으로 선별된다. 이것은 도5b에서 도시된다. 그래서, 평균 레벨에 관하여 선별된 경로들은 스위치(23)를 이용하여 크기의 내림 차순으로 합성기(14(1))에서 시작되는 검파전 합성기(14)에 할당된다. n번째 경로가 합성기(14(n))에 할당될 경우, 평균 레벨의 크기에서 (n+1)번째 경로에서 시작하는 잔류 경로들은 합성기(14(n))에서 시작하는 내림 차순으로 합성기(14)에 차례로 할당되어 합성기(14(1))에서 종료된다. 이러한 프로세서는 전체 경로들이 도5B에서 화살표로 도시된 바와 같이 합성기(14)에 할당될 때까지 반복된다. 할당된 경로들을 합성하는 합성기(14)는 레벨들에서 대략 동일한 출력들을 생성한다. 이들 출력들은 검파기(16)에 의해 검파되고나서 레이크 합성기(검파후 합성기)(18)에 입력된다. 그래서 배치된 시스템은 레이크 합성기(18)에 대략 동일한 입력을 제공하여 가장 효율적인 레이크 합성을 취득한다.
도6은 도4에 도시된 레이크 합성 시스템이 내장되어 있는 수신기를 도시하는 블록도이다. 도6에서, 안테나(41)에서 공급된 수신된 신호는 무선 주파수단(42)에 의해 기저대역 신호로 변환되고 아날로그/디지털 변환기(43)에 의해 디지털 신호로 변환된다. 디지털 신호는 역확산기(10) 및 경로 검색기(22)에 공급된다. 경로 검색기(22)에 대한 신호 입력은 타이밍 슬라이딩으로 코드 발생기(53)에 의해 발생된 코드 시퀀스와 상관기(52)에 의해 서로 연관되어 있고, 상관 결정부(54)는 상관이 설정되었는지 결정한다. 상관의 설정은 경로가 식별되었음을 의미한다. 그래서, 식별된 경로들의 타이밍은 순차적으로 역확산기(10)에서 코드 발생기(45(1)~45(n))에 할당된다. 코드 발생기(45) 및 상관기(44)를 이용하여 이들 타이밍에서 역확산 한다는 것은 경로들이 경로 핑거들에 할당 가능하게 한다.
각 경로의 평균 레벨을 획득하기 위해, 경로의 상관값들은 각 경로를 위한 영역을 포함하는 상관 메모리(55)에 누적된다. 그래서, 평균 레벨은 각 경로에 대해 획득되며, 이것은 전술한 바와 같이 평균 레벨들을 이용하여 합성이 가능하게 한다. 그 다음에, 최초 전송된 신호는 신호 처리기(19)에 의해 합성된 신호를 복호화함으로써 복원된다.
도7은 정격화된 주파수(fDT)에 대해 10-3의 평균 비트 에러율(Bit Error Rate : BER)을 획득하기 위해 요구되는 비트당 에너지대 잡음 스펙트럼 밀도(Eb/No)를 도시한다. 4개의 다중경로가 있고, 4개의 경로들은 종래기술에서 직접적으로 레이크 합성이 되어 있으며, 또한 각각 큰 진폭을 가진 경로 및 작은 진폭을 가진 경로를 포함하는 2개의 경로쌍들은 본 발명에 따라 시스템에서 레이크 합성이 되어 있다고 가정한다.
이러한 그래프에서 보는 바와 같이, 본 발명의 적용은 공간 다이버서티가 없을 경우 비트당 에너지대 잡음 스펙트럼 밀도에서 약 0~0.5dB의 개선을 취득할 수 있으며, 공간 다이버서티가 있을 경우 약 0.3~0.5dB의 개선을 획득할 수 잇다.
본 발명은 바람직한 실시예에 관하여 상세하게 기술되었고, 특히 변형 및 변경이 더 폭넓은 관점으로 본 발명의 범위를 벗어나지 않고 이루어질 수 있음을 본 발명이 속한 기술분야에서 통상의 지식을 가진 자에게 전술한 바에서 자명할 것이다. 그러므로 본 발명의 특허청구범위는 진정한 사상내에 있는 모든 변형 및 변경들을 포함하기 위해 의도되어진 것이다.
따라서, 본 발명은 비록 잡음하에 감추어진 경로들이 존재하지만 수신된 전력을 효율적으로 이용하여 레이크 합성을 취득할 수 있고 잡음으로 인한 왜곡을 감소시켜 고품질의 수신을 구현할 수 있는 효과가 있다.

Claims (8)

  1. 채널의 다중경로중에 하나의 경로에 대응하고 상기 경로의 수신된 신호를 역확산하는 다수의 역확산기;
    상기 역확산기로부터 전송된 적어도 2개의 신호를 합성하는 다수의 검파전 합성기;
    상기 검파전 합성기의 출력 또는 상기 역확산기의 출력을 검파하기 위한 다수의 검파기;
    상기 검파기에서의 신호 출력을 합성하기 위한 검파후 합성기; 및
    상기 다중경로를 식별하고 상기 역확산기를 상기 경로에 할당하기 위한 경로 검색기
    를 포함하여 이루어진 레이크 수신기.
  2. 제 1 항에 있어서,
    상기 역확산기들의 출력들을 상기 검파전 합성기중 원하는 검파전 합성기들에 접속하고 상기 역확산기들의 출력들을 검파기들의 입력들에 접속하기 위한 스위치를 더 포함하며, 상기 경로 검색기가 접속상태를 제어하는 레이크 수신기.
  3. 제 2 항에 있어서,
    상기 경로 검색기는 상기 다중경로의 식별결과에 응답하여 상기 스위치의 상기 접속상태를 동적으로 변경하는 레이크 수신기.
  4. 제 1 항에 있어서,
    상기 검파전 합성기들중 적어도 하나가 소정값보다 더 큰 신호 레벨을 가진 경로와 소정값보다 더 작은 신호 레벨을 가진 또다른 경로를 합성하는 레이크 수신기.
  5. 제 1 항에 있어서,
    상기 검파전 합성기는 평균 신호 레벨들이 특정 한계값보다 더 작은 다수의 경로를 합성하고, 상기 검파후 합성기는 평균 신호 레벨들이 상기 한계값보다 더 큰 경로를 합성하는 레이크 수신기.
  6. 제 1 항에 있어서,
    상기 검파전 합성기들은 신호 레벨들이 제1 한계 레벨과 상기 제1 한계 레벨보다 더 낮은 제2 한계 레벨사이에 있는 상기 경로들을 합성하고, 상기 검파후 합성기는 신호 레벨들이 상기 제1 한계 레벨이상인 상기 경로들을 합성하며, 신호 레벨들이 상기 제2 한계 레벨이하인 상기 경로들은 합성없이 취소되는 레이크 수신기.
  7. 제 1 항에 있어서,
    상기 경로 검색기는 레이크 합성이 되는 각 입력의 평균 레벨들의 합이 실질적으로 동일하도록 상기 경로들의 합성들을 결정하는 레이크 수신기.
  8. 제 1 항에 있어서,
    상기 검파후 합성기는 평균 신호 레벨에서 가장 큰 것에서 시작하는 상기 평균 신호 레벨의 크기의 내림 차순으로 선택된 N개의 경로들을 합성하며, -여기서, N은 소정의 자연수임-, 상기 검파전 합성기들은 평균 신호 레벨들이 상기 N개의 경로보다 더 작은 잔류 경로들을 합성하는 레이크 수신기.
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