KR100264450B1 - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

플라즈마 디스플레이 패널의 구동방법 Download PDF

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Abstract

본 발명은 전체화면을 수개의 블록으로 나누어 구동펄스를 인가하는 플라즈마 디스플레이 패널의 구동방법에 관한 것으로써, 종래 어드레스/유지방전 분리 방식의 문제점으로 지적된 순차적인 어드레스 방전으로 인한 벽전하 생성시간과 상기 벽전하를 이용하는 어드레스 방전시간과의 시간적 차이로 발생되는 벽전하량의 차이로 발생되는 어드레스방전의 오방전과 오동작을 제거하기 위해 전체 화면을 수개의 블록으로 나누고 그 각각의 블록별로 구동회로를 갖춤으로써 리셋기간에 생성된 벽전하를 어드레스 방전에 이용할 때 각 라인별로 생성된 벽전하량의 차이를 최소화하여, 어드레스방전 중에 오방전 등의 오동작을 줄이고 어드레스 전압을 낮출 수 있는 효과가 있고, 어드레스 방전 전에 균일한 벽전하량을 유지시켜 발광하는 셀의 콘트래스트(CONTRAST)를 향상시킬 수 있는 효과가 있다.

Description

플라즈마 디스플레이 패널의 구동방법
본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로써, 특히 전체화면을 다수의 블록으로 나누어 구동펄스를 공급하여 화면의 첫 라인과 마지막 라인 사이에 벽전하를 형성시킬 때 그 시간차이로 인해 발생되는 첫 라인과 마지막 라인사이의 벽전하의 전하량 차이를 제거하여 안정적인 어드레싱이 이루어지도록 하는 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
현대는 정보화 사회라고 불려지고 있는 만큼 정보 처리 시스템의 발전과 보급 증가에 따라 디스플레이의 중요성이 증대되고, 그 종류도 점차 다양화되고 있다.
이전부터 디스플레이로 가장 많이 이용되어 오던 CRT(Cathode Ray Tube)는 사이즈가 크고, 동작 전압이 높으며, 표시 일그러짐이 발생하는 등 여러 가지 문제점을 가지고 있어 화면의 대형화, 평면화를 목표로 하는 최근의 추세에 적합하지 않아 최근에는 매트릭스 구조를 가지는 각종 평면 디스플레이의 연구 개발이 활발히 진행되고 있다.
상기 평면 디스플레이 중 차세대 대화면 평면 디스플레이로 각광받고 있는 것이 PDP(Plasma Display Panel)이다. 상기 PDP는 화면이 크고 두께가 얇아 벽걸이 텔레비전, 가정 극장용(home theater) 디스플레이, 각종 모니터 등에 응용되고 있다.
제1도에는 가장 많이 사용되고 있는 PDP중 하나인 3전극 면방전 PDP의 전체 전극 구조도가 도시되어 있다.
상기 3전극 면방전 PDP는 제1도에 도시된 바와 같이 교대로 하나씩 상호 평행하게 배열된 N개의 제1유지 전극(Y1~YN) 및 N개의 제2유지 전극(X1~XN)과, 상기 제1유지 전극들(Y1~YN) 및 제2유지 전극들(X1~XN)과 소정 공간을 사이에 두고 직교하도록 배열된 M개의 어드레스 전극(A1~AM)의 각 교차점마다 셀이 형성되어 전체 화면이 매트릭스 형태의 M×N개 셀로 구성되어 있다.
상기 3전극 면방전 PDP의 각 셀의 구성을 제2도에 도시된 i번째 행과 j번째 열의 셀을 예로 들어 설명하면 다음과 같다.
먼저, 상호 평행한 i번째 제1유지 전극(Yi)과 i번째 제2유지 전극(Xi)이 화상의 표시면인 전면 기판(11)의 일면에 형성되어 있고, 상기 제1유지 전극(Yi)과 제2유지 전극(Xi) 위에 방전시 방전 전류를 제한하고 벽전하의 생성을 용이하게 하는 제1유전체층(12)이 형성되어 있고, 상기 제1유전체층(12) 위에 방전시 일어나는 스퍼터링(sputtering)으로부터 상기 제1유지 전극(Yi)과 제2유지전극(Xi)과 제1유전체층(12)을 보호하는 산화마그네슘(MgO) 보호막(13)이 형성되어 있다.
또한, j번째 어드레스 전극(Aj)이 전면 기판(11)과 소정 거리를 사이에 두고 평행하게 위치한 배면 기판(14) 중 상기 전면 기판(11)과의 대향면에 형성되어 있고, 상기 어드레스 전극(Aj)위에 방전시 방전 전류를 제한하고 벽전하의 생성을 용이하게 하는 제2유전체층(15)이 형성되어 있고, 상기 전면 기판(11)과 배면 기판(14) 사이에는 셀간 혼색을 방지하고 방전공간을 확보하는 제1,2격벽(16a,16b)이 배열 형성되어 있고, 상기 제2유전체층(15) 위와 제1,2격벽(16a,16b)의 일부에 형광체(17)가 도포되어 있으며, 방전공간 내부에는 방전가스가 주입되어 있다.
상기와 같이 구성된 3전극 면방전 PDP의 각 셀의 기본 구동 원리는 제1유지 전극(Yi)과 어드레스 전극(Aj) 간에 방전을 일으켜 방전공간 내부에 하전입자를 생성시켜 각각의 전극 표면에 최적의 벽전하를 생성시키고, 제1유지 전극(Yi)과 제2유지 전극(Xi)간의 연속적인 방전으로 발생되는 진공 자외선에 의해 형광체(17)를 여기시켜 가시광의 발생을 유지시키는 것이다.
한편, 상기와 같이 구성된 3전극 면방전 PDP의 각 셀의 계조 구현은 방전의 강약 조정이 난이한 관계로 단위 시간당 방전횟수를 통해 구현하고, 매 프레임(frame)마다 각 셀의 방전횟수를 0~2X-1회로 나누어 방전시키면 1프레임 동안의 방전횟수에 따라 각 셀의 밝기가 달라져서 결국 전체 화면에 2X계조의 화상 즉, 각 셀마다 0~2X-1 레벨(level) 중 한가지 레벨의 화상이 표시된다.
상기와 같은 개념을 토대로 한 계조 구현 방법 중 하나가 ADS 서브필드 방식으로서, 상기 ADS 서브필드 방식은 각 셀이 온(on), 오프(off)의 두 가지 상태로 작동하는 것과 2X계조를 구현하는 것에 근거를 둔 2진수 X비트 체계를 이용하여 1프레임을 방전 횟수(즉, 방전 유지 기간)가 서로 다른 X개의 서브필드로 분할 구동한다.
다음에서는 종래 기술의 ADS 서브필드 방식 중 하나를 예로 들어 그에 따른 계조 화상의 표시 과정을 보다 구체적으로 설명한다.
제3도에는 종래 기술의 ADS 서브필드 방식에 따른 256(28) 계조 구현시 1 프레임의 세부 구성도가 도시되어 있다.
먼저, 28계조 구현을 위하여 1프레임은 8개의 서브필드(SF1~SF8)로 분할 구동되고, 각 서브필드(SF1~SF8)는 리셋 기간과 어드레스 기간과 방전 유지 기간으로 분할 구동된다.
상기에서 각 서브필드(SF1~SF8)의 리셋 기간에는 전체 제1유지 전극들(Y1~YN)과 제2유지 전극들(X1~XN) 사이에 방전개시전압보다 높은 전압의 써넣기 펄스(writing pulse)를 인가하여 모든 셀의 방전 공간 내부에서 써넣기 방전이 일어나 그 내부에 벽전하가 생성되도록 하고, 그 후 전체 제1유지 전극들(Y1~YN)과 제2유지 전극들(X1~XN) 사이에 방전개시전압보다 낮은 전압이고 바로 전의 전면 써넣기 기간에서 생성된 벽전하와 동일 극성인 소거 펄스(erase pulse)를 인가하여 모든 셀의 방전 공간 내부에서 소거 방전이 일어나 각 셀의 내부 벽전하가 소거되도록 한다.
각 서브필드(SF1~SF8)의 어드레스 기간에는 각 셀에 해당되는 디지털 화상 신호에 따라 N개의 제1유지 전극(Y1~YN)에 순차적으로 하나씩 스캔 펄스(scan pulse)를 인가하는 동시에 상기 스캔 펄스와 동기화된 화상 펄스(image pulse)를 전체 어드레스 전극들(A1~AM)에 선택적으로 인가하여 제1유지 전극과 어드레스 전극 사이에 방전개시전압보다 낮은 전압의 어드레스 펄스(address pulse)가 인가된 셀의 방전 공간 내부에서 어드레스 방전이 일어나 그 내부에 벽전하가 생성되어 온되도록 하고, 방전 유지 기간에는 전체 제1유지 전극들(Y1~YN)과 제2유지 전극들(X1~XN)에 방전개시전압보다 낮은 전압의 교번하는 서스테인 펄스(sustain pulse)를 각각 인가하여 제1유지 전극들(Y1~YN)과 제2유지 전극들(X1~XN) 사이에서 서스테인 방전이 일어나 바로 전의 어드레스 기간에서 온된 셀의 방전 및 발광이 유지되도록 한다.
상기에서 각 서브필드(SF1~SF8)의 어드레스 기간동안 어드레스 전극들(A1~AM)에 인가되는 화상 펄스는 각 셀에 해당되는 8비트의 디지털 화상 신호(최하위비트 B1~최상위 비트 B8) 중 1개 비트값에 해당되며, 보다 구체적으로는 제1서브필드(SF1)의 어드레스 기간동안 B1이, 제2서브필드(SF2)의 어드레스 기간동안 B2가, …, 제8서브필드(SF8)의 어드레스 기간동안 B8이 각각 인가된다.
아울러, 상기 각 서브필드의(SF1~SF8) 방전 유지 기간동안 전체 제1유지전극들(Y1~YN)과 제2유지전극들(X1~XN)에 인가되는 서스테인 펄스 개수의 상대비는 보통 SF1:SF2:SF3:SF4:SF5:SF6:SF7:SF8=1:2:4:8:16:32:64:128이 되어 256 계조 구현을 가능하게 한다.
결과적으로 상기에서 설명된 세부 과정을 거쳐 1프레임 구동시간 동안 제1 내지 8 서브필드 화면을 차례대로 구성하면 3전극 면방전 PDP 상에 1프레임의 256 계조 화상이 표시된다.
제4도는 종래 ADS방식에 의한 시간 대비 파형분포도이다. 이를 참조하면, 리셋기간에 프라이밍 펄스(PRIMING PULSE)를 전체 셀에 공급해서 공간내의 벽전하를 고르게 분포시켜 어드레싱(ADDRESSING) 동작에 기여하고 있으나, 상기 프라이밍 펄스가 셀의 라인에 상관 없이 동일한 시간에 동시에 공급되어 전체화면 중 첫 번째 라인과 마지막 라인은 그 어드레스 시간의 차이(t2-t1)에 의해 그 프라이밍 효과도 다르게 나타난다. 이는 상기 리셋기간에 형성된 벽전하를 이용하는 어드레스기간에 영향을 주어 어드레스 방전의 오동작을 유발하는 문제점이 있었다.
본 발명은 상기한 문제점을 해결하기 위해 안출된 것으로써, 리셋기간중에 공급하는 프라이밍 펄스를 스캔라인의 위치에 따라 시간의 차이를 두어 공급함으로써 어드레스시간의 차이로 인한 벽전하량의 변화를 줄여 어드레싱의 오동작을 방지하고, 어드레싱의 동작전압을 낮출 수 있는 플라즈마 디스플레이 패널의 구동방법을 제공하는데 그 목적이 있다.
제1도는 3전극 면방전 PDP의 전체 전극 구조도.
제2도는 3전극 면방전 PDP의 각 셀의 구성을 나타낸 도면.
제3도는 종래 ADS 서브필드 방식에 따른 256(28) 계조 구현시 1프레임의 세부 구성도.
제4도는 종래 ADS방식의 시간 대비 파형 분포도.
제5도는 본 발명에 의한 수평표시라인이 480라인인 플라즈마 디스플레이 패널의 구동 시스템의 구성도.
제6도는 본 발명에 의한 플라즈마 디스플레이 패널의 구동시스템의 각 전극에 인가되는 구동펄스를 도시한 파형도.
제7도는 본 발명에 의한 시간 대비 파형 분포도.
제8도는 본 발명의 다른 실시예에 따른 시간 대비 파형 분포도.
* 도면의 주요부분에 대한 부호의 설명
400 : PDP의 표시화면 400a : PDP 표시화면의 상부 블록
400b : PDP의 표시화면의 하부 블록 410a,410b : 스캔전극구동IC
420a,420b : 서스테인전극구동부 430a,430b : 어드레스전극구동부
440 : 스캔전극구동IC 선택부 450 : 타이밍 제어부
상기한 목적을 이루기 위한 본 발명의 특징은, 플라즈마 디스플레이 패널(이하, PDP라고 함)의 전체화면을 표시할 셀을 선택하는 어드레스 기간과, 상기 선택된 셀을 표시 유지하는 유지 기간으로 분리 구동하는 플라즈마 디스플레이 패널의 구동 방법에 있어서, 상기 어드레스 기간은 전체 패널의 수평 표시라인을 2개 이상의 블록으로 나누어 상위 블록부터 하위 블록으로 차례로 구동되며, 각 블록에서는 해당 블록의 수평표시라인 전체에 동시 방전을 일으키는 리셋 방전과, 해당 블록의 수평표시라인을 차례로 주사하여 데이터를 쓰는 쓰기 방전을 일으키는 어드레싱 방전으로 이루어진 것을 특징으로 한다.
또한, 본 발명은 상기 PDP의 수평표시라인은 PDP의 첫 번째 표시라인부터 중간표시라인까지의 상위 블록과 중간 표시라인부터 마지막 표시라인까지의 하위 블록의 2블록으로 구분되어 구동되는 것이 바람직하다.
이하 첨부도면을 참조하여 발명의 바람직한 일 실시예를 설명한다.
제5도는 본 발명에 의한 수평표시라인이 480라인인 플라즈마 디스플레이 패널의 구동 시스템을 도시한 도면이다. 이를 참조하면, 전체화면(400)의 수평표시라인을 240라인씩 상, 하부 두 블록(400a,400b)으로 나누고, 각 블록에 포함되는 수평표시라인의 스캔전극(Y1~Y240, Y241~480)에 소정의 구동펄스를 공급하기 위해 그 출력단이 각 블록의 수평표시라인의 최상위 라인부터 순차적으로 연결된 스캔전극구동IC(410a,410b)와; 상기 스캔전극구동IC(410a,410b)를 제어하여 수행할 동작에 관한 제어신호를 발령하는 스캔드라이버 제어부(411a,411b)와; 상기 각 블록(400a,400b)에 포함되는 수평표시라인의 서스테인전극(Z1~Z240, Z241~Z480)에 소정의 구동펄스를 공급하기 위해 각 블록의 서스테인전극에 공통으로 그 출력단이 연결된 서스테인전극구동부(420a,420b)와; 수직표시라인의 각 어드레스전극에 소정의 구동펄스를 공급하는 어드레스전극구동부(430a,430b)와; 상기 상,하부 블록(400a,400b)마다 구비된 스캔전극구동IC들(410a,410b) 중에서 하나의 스캔전극구동IC만이 동작하도록 각 스캔드라이버 제어부(411a,411b)에 선택 제어신호를 발령하는 스캔전극구동IC선택부(440)와; 상기 스캔전극구동IC(410a,410b), 서스테인전극구동부(420a,420b), 어드레스전극구동부(430a,430b) 및 스캔전극구동IC선택부(440)의 동작을 동기시키도록 동기 제어신호를 발령하는 타이밍 제어부(450)를 포함한다.
상기한 바와 같이 구성된 플라즈마 디스플레이 패널의 동작과 구동방법은 다음과 같다.
플라즈마 디스플레이 패널을 구동시킴에 있어 가장 기본되는 개념은 어드레스/유지방전 기간을 분리하는 ADS방식에 의해 디스플레이 시키는 것이다.
ADS방식은 발광시킬 셀들에게만 선택적으로 소정의 벽전하를 생성시킨 후 전체셀에 방전을 일으킬 때, 상기 벽전하가 생성된 셀만이 발광하게 된다. 상기와 같은 ADS방식을 도입하는 이유는 셀들을 발광시키기 전에 벽전하를 형성시킴으로써 유지전압을 낮출 수 있는 이점이 있기 때문이다.
상,하 두 블록으로 나누어 그 각각의 블록에 상기한 ADS방식을 적용시키기 위해, 상기 타이밍 제어부(450)에 입력신호가 입력되면 타이밍 제어부(450)에서는 프라이밍 펄스가 상,하부 블록에 동시에 공급되지 않도록 하는 제어신호를 상부 블록의 스캔드라이버 제어부(411a)와 서스테인전극구동부(420a)와 스캔전극구동IC선택부(440)에 발령하여, 상부 블록의 스캔전극들(Y1~Y240)과 서스테인전극들(Z1~Z240)에 소정의 구동펄스가 공급되어 프라이밍 방전(PRIMING DISCHARGE)을 일으켜 벽전하를 형성시키는 제1리셋기간과, 상기 제1리셋기간 경과 후 상부 블록의 어드레스구동부(430a)와 스캔전극구동IC(410a)부로부터 소정의 구동펄스를 인가받아 상부 블록에 속하는 셀들을 선택적으로 방전시키는 제1어드레스기간을 통해 상부 블록의 셀들을 선택적으로 온시킨다.
타이밍 제어부(450)의 제어신호에 의해 스캔전극구동IC선택부(440)와 하부블록(400b)의 스캔드라이버 제어부(411b)로부터 발령된 제어신호에 의해 하부 블록(400b)의 스캔전극구동IC(410b)로부터 구동펄스를 인가받은 스캔전극들(Y241~Y480)과; 타이밍 제어부(450)의 제어신호에 의해 하부 블록의 서스테인전극구동부(420b)로부터 구동펄스를 인가받는 하부 블록(400b)의 서스테인전극들(Z241~Z480)사이에 프라이밍 방전(PRIMING DISCHARGE)이 일어나서 벽전하가 형성되는 되는 제2리셋기간과, 상기 제2리셋기간의 경과 후 하부 블록의 어드레스구동부(430b)와 스캔전극구동IC(410b)로부터 소정의 구동펄스를 인가받아 하부 블록(400b)에 속하는 셀들을 선택적으로 방전시키는 제2어드레스기간을 통해 하부 블록(400b)의 셀들을 선택적으로 온시킨다.
타이밍 제어부(450)의 제어신호에 의해 상기 제1리셋기간, 제1어드레스기간, 제2리셋기간 및 제2어드레스기간 경과 후 상기 과정에서 형성된 각 셀의 벽전하를 이용하여 셀을 발광시키기 위해 상부 블록(400a)의 스캔전극구동IC(410a)와 서스테인전극구동부(420a) 하부 블록의 스캔전극구동IC(410b)와 서스테인전극구동부(420b)는 상부 블록(400a)의 스캔전극들(Y1~Y240)과 서스테인전극들(Z1~Z240)과 하부 블록(400b)의 스캔전극들(Y241~Y480)과 서스테인전극들(Z241~Z480)에 소정의 펄스를 인가하여 유지방전이 일어나게 한다.
한편, 스캔전극구동IC(410a,410b)의 인에이블(ENABLE)단자를 제어하여 상부 블록을 스캔할 때 하부 블록은 스캔되지 않고, 하부 블록을 스캔할 때 상부 블록은 스캔되지 않도록 제어할 수 있다.
제6도는 안정적인 어드레싱을 위한 플라즈마 디스플레이 패널의 구동시스템의 각 전극에 인가되는 펄스를 도시한 파형도이다. 이를 참조하면, 제1리셋기간에 상부 블록의 각 스캔전극(Y1~Y240)과 서스테인전극(Z1~Z240)에 프라이밍 펄스를 인가하여 상부 블록에 해당되는 모든 셀에 벽전하가 생성되도록 한다. 이때, 어드레스전극에는 상기 스캔전극(Y1~Y240)과 서스테인전극(Z1~Z240)에 비해 중성이 유지되도록
Figure kpo00001
가 인가된다.
제1어드레스기간에는 상부 블록에 해당되는 화상정보에 따라 스캔전극(Y1~Y240)들에 순차적으로 하나씩 스캔펄스(S1 내지 S240)가 인가되는 동시에 상기 스캔펄스와 동기화된 화상펄스(Va)를 상부 블록의 어드레스전극들에 선택적으로 인가하여 상기 어드레스펄스가 인가된 셀의 방전 공간 내부에서 어드레스방전이 일어나 그 내부에 벽전하가 생성되어 그 셀이 온되도록 한다.
제1어드레스기간이 끝나면 어드레스전극의 데이터도 약간의 공백시간(BLANK TIME)(500)이 지난 후 다시 제2의 어드레스펄스를 내보내고 Y241~Y480도 이 시간에 동기되어 어드레스방전이 일어난다.
제2리셋기간에는 하부 블록의 각 스캔전극(Y241~Y480)과 서스테인전극(Z241~Z480)에 프라이밍 펄스를 인가하여 하부 블록에 해당되는 모든 셀에 벽전하가 생성되도록 한다. 이때, 어드레스전극에는 상기 스캔전극(Y1~Y240)과 서스테인전극(Z1~Z240)에 비해 중성이 유지되도록 소정의 펄스가 인가된다.
제2어드레스기간에는 하부 블록에 해당되는 화상정보에 따라 스캔전극(Y241~Y480)들에 순차적으로 하나씩 스캔펄스(S241 내지 S480)가 인가되는 동시에 상기 스캔펄스와 동기화된 화상펄스(Va)를 상부 블록의 어드레스전극들에 선택적으로 인가하여 상기 어드레스펄스가 인가된 셀의 방전 공간 내부에서 어드레스방전이 일어나 그 내부에 벽전하가 생성되어 그 셀이 온되도록 한다.
방전유지기간에는 전체 스캔전극(Y1~Y480)과 서스테인전극(Z1~Z480)에 서로 교대로 서스테인펄스(Vs)를 인가하여 상기에서 온된 셀의 방전 및 발광이 유지되도록 한다.
제7도는 본 발명에 의한 플라즈마 디스플레이 패널의 시간 대비 파형 분포도이다. 이를 참조하면, 제1리셋 기간에 생성된 벽전하의 생성시간으로부터 상기 벽전하를 이용하는 어드레스기간까지의 시간적 차이(t10,t11)가 종래 보다 적어진다. 따라서 그 시간적 차이에서 오는 벽전하량의 감소로 인한 오방전, 오동작을 방지할 수 있다.
제8도는 본 발명의 다른 실시예에 따른 시간 대비 파형 분포도이다. 이를 참조하면, 본 발명의 또 다른 실시예는 상기 전체화면을 4개의 블록으로 나누어 각 블록별로 구동부를 두는 플라즈마 디스플레이 패널의 구동시스템과 그 구동방법에 관한 것이다.
수평표시라인이 480라인인 경우 첫 번째 블록(Y1~Y120)에서 제1리셋기간과 제1어드레스기간을 통해 첫 번째 블록의 셀들에 선택적으로 벽전하를 생성시키고, 그 후 두 번째 블록(Y121~Y240)에서 제2리셋기간과 제2어드레스기간을 통해 두 번째 블록의 셀들에 선택적으로 벽전하를 생성시키고, 그 후 세 번째 블록(Y241~Y360)에서 제3리셋시간과, 제3어드레스기간을 통해 세 번째 블록의 셀들에 선택적으로 벽전하를 생성시키고, 그 후 네 번째 블록(Y361~Y480)에서도 제4리셋기간과 제4어드레스기간을 통해 네 번째 블록의 셀들에 선택적으로 벽전하를 생성시킨다.
상기 과정을 통해 전체 화면에는 벽전하가 생성되어 온된 셀들이 화상정보에 따라 분포하게 된다.
이때, 전체 스캔전극과 서스테인전극에 교대로 Vs를 인가하면, 상기 과정에서 온된 셀들만이 발광하게 된다.
특히, 각 리셋기간의 벽전하 생성시간과 상기 벽전하를 이용하는 어드레스방전시간의 차이가 상기 제1실시예보다 더 줄어들어 어드레싱 동작의 오동작 또는 오방전이 일어날 확률이 적어진다.
본 발명에 의하면, 프라이밍 펄스의 위치를 블록에 따라 다르게 공급함으로써 어드레스 방전 중에 오방전 등의 오동작을 줄이고 어드레스 전압을 낮출 수 있는 효과가 있고, 어드레스 방전 전에 균일한 벽전하량을 유지시켜 발광하는 셀의 콘트래스트(CONTRAST)를 향상시킬 수 있는 효과가 있다.

Claims (2)

  1. 플라즈마 디스플레이 패널(이하, PDP라고 함)의 전체화면을 표시할 셀을 선택하는 어드레스 기간과, 상기 선택된 셀을 표시 유지하는 유지 기간으로 분리 구동하는 플라즈마 디스플레이 패널의 구동 방법에 있어서, 상기 어드레스 기간은 전체 패널의 수평 표시라인을 2개 이상의 블록으로 나누어 상위 블록부터 하위 블록으로 차례로 구동되며, 각 블록에서는 해당 블록의 수평표시라인 전체에 동시 방전을 일으키는 리셋 방전과, 해당 블록의 수평표시라인을 차례로 주사하여 데이터를 쓰는 쓰기 방전을 일으키는 어드레싱 방전으로 이루어진 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제1항에 있어서, 상기 PDP의 수평표시라인은 PDP의 첫 번째 표시라인부터 중간표시라인까지의 상위 블록과 중간 표시라인부터 마지막 표시라인까지의 하위 블록의 2블록으로 구분되어 구동되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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