KR100240649B1 - 삼원계 확산 방지막 형성 방법 - Google Patents
삼원계 확산 방지막 형성 방법 Download PDFInfo
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- 238000009792 diffusion process Methods 0.000 title claims abstract description 60
- 238000000034 method Methods 0.000 title claims abstract description 47
- 230000002265 prevention Effects 0.000 title abstract 2
- 230000004888 barrier function Effects 0.000 claims abstract description 41
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims abstract description 40
- 229910052710 silicon Inorganic materials 0.000 claims abstract description 39
- 239000010703 silicon Substances 0.000 claims abstract description 39
- 239000002184 metal Substances 0.000 claims abstract description 31
- 229910052751 metal Inorganic materials 0.000 claims abstract description 30
- 238000010438 heat treatment Methods 0.000 claims abstract description 24
- 230000008569 process Effects 0.000 claims abstract description 20
- 150000001875 compounds Chemical class 0.000 claims abstract description 17
- 239000003870 refractory metal Substances 0.000 claims description 51
- 150000004767 nitrides Chemical class 0.000 claims description 41
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 claims description 26
- 229910021332 silicide Inorganic materials 0.000 claims description 24
- 238000000151 deposition Methods 0.000 claims description 21
- 239000000758 substrate Substances 0.000 claims description 17
- 239000010949 copper Substances 0.000 claims description 11
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 10
- 229910007991 Si-N Inorganic materials 0.000 claims description 10
- 229910006294 Si—N Inorganic materials 0.000 claims description 10
- 229910052802 copper Inorganic materials 0.000 claims description 10
- 229910052782 aluminium Inorganic materials 0.000 claims description 6
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 claims description 6
- 238000006243 chemical reaction Methods 0.000 claims description 5
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 claims description 4
- 239000012299 nitrogen atmosphere Substances 0.000 claims description 4
- 229910052715 tantalum Inorganic materials 0.000 claims description 4
- 229910052719 titanium Inorganic materials 0.000 claims description 3
- 229910052721 tungsten Inorganic materials 0.000 claims description 3
- 239000010408 film Substances 0.000 description 16
- 230000008021 deposition Effects 0.000 description 7
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 6
- 238000005229 chemical vapour deposition Methods 0.000 description 5
- 239000000203 mixture Substances 0.000 description 5
- 229910052757 nitrogen Inorganic materials 0.000 description 5
- 239000010409 thin film Substances 0.000 description 5
- 230000006872 improvement Effects 0.000 description 4
- 239000000463 material Substances 0.000 description 4
- 229910004339 Ti-Si Inorganic materials 0.000 description 3
- 229910010978 Ti—Si Inorganic materials 0.000 description 3
- 230000015572 biosynthetic process Effects 0.000 description 3
- 230000003405 preventing effect Effects 0.000 description 3
- -1 Ta-Si Chemical class 0.000 description 2
- 238000002425 crystallisation Methods 0.000 description 2
- 230000008025 crystallization Effects 0.000 description 2
- 230000007423 decrease Effects 0.000 description 2
- 239000007789 gas Substances 0.000 description 2
- 238000005546 reactive sputtering Methods 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- 229910004298 SiO 2 Inorganic materials 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 229910011208 Ti—N Inorganic materials 0.000 description 1
- 229910008938 W—Si Inorganic materials 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 238000002347 injection Methods 0.000 description 1
- 239000007924 injection Substances 0.000 description 1
- 239000012705 liquid precursor Substances 0.000 description 1
- 229910021645 metal ion Inorganic materials 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 125000002524 organometallic group Chemical group 0.000 description 1
- 230000003389 potentiating effect Effects 0.000 description 1
- 239000002243 precursor Substances 0.000 description 1
- 239000002994 raw material Substances 0.000 description 1
- 230000009257 reactivity Effects 0.000 description 1
- 229910052814 silicon oxide Inorganic materials 0.000 description 1
- 229910052723 transition metal Inorganic materials 0.000 description 1
- 150000003624 transition metals Chemical class 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76853—Barrier, adhesion or liner layers characterized by particular after-treatment steps
- H01L21/76855—After-treatment introducing at least one additional element into the layer
- H01L21/76856—After-treatment introducing at least one additional element into the layer by treatment in plasmas or gaseous environments, e.g. nitriding a refractory metal liner
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/22—Diffusion of impurity materials, e.g. doping materials, electrode materials, into or out of a semiconductor body, or between semiconductor regions; Interactions between two or more impurities; Redistribution of impurities
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/283—Deposition of conductive or insulating materials for electrodes conducting electric current
- H01L21/285—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation
- H01L21/28506—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers
- H01L21/28512—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic System
- H01L21/28568—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic System the conductive layers comprising transition metals
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- H—ELECTRICITY
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
-
- H—ELECTRICITY
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- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76853—Barrier, adhesion or liner layers characterized by particular after-treatment steps
- H01L21/76855—After-treatment introducing at least one additional element into the layer
Abstract
배선 금속의 특성 개선을 위한 열처리 공정에 의해 배선 금속의 확산 방지막 내부로의 확산 속도와 실리콘의 확산 방지막 내부로의 확산 속도가 상이한 점을 이용하여 상부의 배선 금속이 확산 방지막 내부를 완전히 관통하여 하부의 실리콘층에 도달하기 전에 확산 방지막 내부에 침투한 실리콘과 이원계 확산 방지막간에 화합물을 형성하게 함으로써 확산 방지 특성이 우수한 삼원계 확산 방지막 형성 방법이 개시된다.
Description
본 발명은 반도체 배선용 확산 방지막 형성 방법에 관한 것으로, 특히 내화금속의 질화물 또는 내화 금속과 질소의 화합물을 원재료로 하는 삼원계 확산 방지막의 형성 방법에 관한 것이다.
반도체 금속 배선 공정에서 이상적인 확산 방지막은 하부층과의 낮은 반응성(reactivity)에 의해 금속과 실리콘 또는 금속과 실리콘 산화막(SiO2)과의 계면에서 물리화학적으로 안정하여야 하고, 고온에서의 결정립계(grain boundary)를 통한 확산을 방지하기 위해 비정질 구조를 가져야 한다. 특히, 비교적 낮은 온도에서 쉽게 확산을 시작하는 구리(Cu)용 확산 방지막으로의 사용을 위해서 현재까지 Ta-Si, Ti-Si, Ta-N, Ti-N 등의 비정질 형태 이원계 화합물 또는 Ti-Si-N, Ta-Si-N, W-Si-N 등의 삼원계 화합물이 유력한 확산 방지막으로 거론되고 있다. 또한, 이원계 화합물은 다결정 구조에 의해 낮은 확산 방지 온도 특성(실리콘 및 구리와의 반응온도: Ti ; 200℃, Ta; 500℃)을 갖는 단일원 천이 금속(single transition metal)의 단점을 보완하기 위해 실리콘의 추가에 의해 결정립계를 최소화 하는 Ta74Si26등 비정질 형태의 화합물을 형성하고 있다. 그러나, 이원계 화합물의 결정화 온도(crystallization temperature)가 구리와의 접합(contact) 형성시 급격히 감소하여 확산 방지 특성의 열화를 가져오게 된다. 예를 들어, Ta74Si26의 경우 850℃에서 650℃로 감소한다. 따라서, 이원계 확산 방지막의 특성 개선을 위해서는 질소 등의 다른 원소의 첨가에 의해 높은 결정화 온도를 갖는 비정질 형태의 삼원계 화합물의 형성이 요구된다.
종래 삼원계 박막 형성 방법은 다음과 같이 크게 세가지 방법에 의해 형성할 수 있다.
첫째, 원하는 조성비로 삼원계 물질(Ti-Si-N, Ta-Si-N, W-Si-N)의 타겟을 제작하고, 상기 타겟을 스퍼터링하여 증착한다.
둘째, 원하는 조성비로 이원계 물질(Ta-Si, Ti-Si, W-Si)의 타겟을 제작하고, 상기 타겟을 질소 분위기에서 반응성 스퍼터링하여 증착한다. 이때, 상기 이원계 물질과 질소가 반응하여 삼원계 물질이 형성된다.
셋째, 삼원계 화합물의 원소가 포함된 가스 또는 액체 전구체(precursor)를 사용하여 화학 기상 증착법(CVD; Chemical Vapour Deposition)으로 증착한다.
일반적인 삼원계 박막의 형성 방법중 스퍼터링에 의한 증착은 균일한 조성비의 타겟을 제작하여야 하고, 반응성 스퍼터링의 경우는 박막 조성 제어를 위한 질소 분위기의 정밀한 조절이 필요하다. 또한, 화학 증착에 의한 경우도 정확한 조성비의 박막 증착을 위해서는 원료 기체의 주입이 정밀하게 제어 되어야 하고, 유기 금속 화학 증착법에 의한 경우는 우수한 증착 특성을 가진 전구체의 제작과 증착의 재현성 확보가 매우 어렵다.
따라서, 본 발명은 기존의 스퍼터링 방법 및 화학 증착법의 문제점을 극복하고 공정의 단순화를 이루기 위해 초기에 이원계 화합물을 증착하고 열처리에 의한 실리콘의 외향 확산(out-diffusion)으로 삼원계 화합물을 형성하는 방법을 제공하는데 그 목적이 있다.
상술한 목적을 달성하기 위한 본 발명의 제1실시예는 실리콘 기판 상부에 실리사이드를 증착하는 단계와, 상기 실리사이드 상부에 내화 금속 질화물을 증착하는 단계와, 상기 내화금속 질화물 상부에 배선 금속을 증착하는 단계와, 열처리 공정을 수행하여 상기 실리사이드 및 내화 금속 질화물 사이에 삼원계 확산 방지막을 형성하는 단계로 이루어진 것을 특징으로 한다.
상술한 목적을 달성하기 위한 본 발명에 따른 제2실시예는 실리콘 기판 상부에 내화 금속 질화물을 증착하는 단계와, 상기 내화 금속 질화물 상부에 배선 금속을 저온 증착하는 단계와, 상기 실리콘 기판 상부에 실리사이드가 형성됨과 동시에 상기 내화 금속 질화물 및 상기 실리사이드 사이에 삼원계 확산 방지막이 형성되도록 열처리 공정을 실시하는 단계로 이루어진 것을 특징으로 한다.
또한, 상술한 목적을 달성하기 위한 본 발명에 따른 제3실시예는 실리콘 기판 상부에 내화 금속을 증착하는 단계와, 상기 내화 금속을 열변환하여 실리콘 기판 상부에 실리사이드와 내화 금속 질화물을 동시에 형성하는 단계와, 상기 내화 금속 질화물 상부에 배선 금속을 저온 증착하는 단계와, 열처리 공정을 실시하여 상기 실리사이드 및 내화 금속 질화물 사이에 삼원계 확산 방지막을 형성하는 단계로 이루어진 것을 특징으로 한다.
제1(a)도 내지 제1(d)도는 본 발명의 제1실시예에 따른 삼원계 확산 방지막 형성 방법을 순서적으로 도시한 단면도.
제2(a)도 내지 제2(c)도는 본 발명의 제2실시예에 따른 삼원계 확산 방지막 형성 방법을 순서적으로 도시한 단면도.
제3(a)도 내지 제3(d)도는 본 발명의 제3실시예에 따른 삼원계 확산 방지막 형성 방법을 순서적으로 도시한 단면도.
* 도면의 주요부분에 대한 부호의 설명
1 : 실리콘 기판 2 : 실리사이드
3 : 내화 금속 질화물 4 : 배선 금속
5 : 삼원계 확산 방지막 6 : 내화 금속
첨부된 도면을 참조하여 본 발명을 상세히 설명하기로 한다.
제1(a)도 내지 제1(d)도는 본 발명의 제1실시예에 따른 삼원계 확산 방지막 형성 방법을 순서적으로 도시한 단면도이다.
제1(a)도는 실리콘 기판(1) 상부에 접촉 저항을 낮추기 위해 내화 금속계의 실리사이드(2)를 증착한 단면도이다.
제1(b)도는 실리사이드(2) 상부에 TiN, TaN, WN 등의 내화 금속 질화물(3)을 증착한 단면도이다.
제1(c)도는 내화 금속 질화물(3) 상부에 알루미늄,구리 등의 배선 금속(4)을 저온 증착한 단면도이다.
제1(d)도는 열처리 공정에 의해 배선 금속(4)의 특성 개선과 더블어 실리콘을 외향 확산시키므로써 실리콘의 확산으로 내화 금속 질화물(3)에 주입된 실리콘과 내화 금속 질화물(3)간의 반응에 의하여 삼원계 확산 방지막(5)을 형성한 단면도이다. 상기에서 삼원계 확산 방지막(5)은 열처리공정 동안 이원계 물질인 TiN, TaN, WN 등의 내화 금속 질화물(3)과 실리사이드(2) 내의 Si와 반응하여 실리사이드(2)와 내화금속 질화물(3)과의 계면 부분에 Ti-Si-N, Ta-Si-N, W-SiN와 같은 삼원계 화합물로 이루어진다.
제2(a)도 내지 제2(c)도는 본 발명의 제2실시예에 따른 삼원계 확산 방지막 형성 방법을 순서적으로 도시한 단면도이다.
제2(a)도는 실리콘 기판(1) 상부에 TiN, TaN, WN 등의 내화 금속 질화물(3)을 증착한 단면도이다.
제2(b)도는 내화 금속 질화물(3) 상부에 알루미늄, 구리 등의 배선 금속(4)을 저온 증착한 단면도이다.
제2(c)도를 참조하면, 배선 금속(4)의 특성 개선과 더불어 실리콘을 외향 확산 시키기 위해 열처리 공정을 실시한다. 그 결과 내화 금속 질화물(3) 내의 금속 이온과 실리콘 기판(1) 내의 실리콘과 반응하여 실리콘 기판(1)과 내화 금속 질화물(3) 계면에 실리사이드(2)가 형성됨과 동시에 내화 금속 질화물(3)로 실리콘이 확산되어 삼원계 확산 방지막(5)이 형성되고 반응하지 않은 내화 금속 질화물(3)은 잔존하게 된다.
제3(a)도 내지 제3(d)도는 본 발명의 제3실시예에 따른 삼원계 확산 방지막 형성 방법을 순서적으로 도시한 단면도이다.
제3(a)도는 실리콘 기판(1) 상부에 Ti, Ta, W 등의 내화 금속(6)을 증착한 단면도이다.
제3(b)도는 내화 금속(6)을 질소 분위기에서 열변환하여 내화 금속 질화물(3)과 실리사이드(2)를 동시에 형성한 단면도이다.
제3(c)도는 내화 금속을 열변환하여 형성된 내화 금속 질화물(3) 상부에 알루미늄, 구리 등의 배선 금속(4)을 저온 증착한 단면도이다.
제3(d)도는 열처리 공정에 의해 배선 금속(4)의 특성 개선과 더불어 실리콘을 외향 확산시키므로써 실리콘의 확산으로 내화 금속 질화물(3)에 주입된 실리콘과 내화 금속 질화물(3)간의 반응에 의하여 삼원계 확산 방지막(5)을 형성한 단면도이다.
본 발명에 따른 제1, 제2 및 제3실시예에서 언급한 실리콘의 확산을 위한 열처리는 배선 금속의 특성 개선을 위한 열처리와 동시에 실시하는 것으로 별도의 열처리 공정을 필요로 하지 않는다. 배선 금속의 특성 개선을 위한 열처리는 기존의 배선 공정에서도 필수적으로 사용되고 있는 것으로, 특히 구리 배선의 경우 비저항 등의 특성 개선이 뚜렷하게 나타나는 것으로 알려져 있다. 따라서, 박막의 열처리에 의해 배선 금속의 특성 개선과 더불어 하부 실리콘의 외향 확산과 배선 금속의 확산 방지막 영역으로의 확산이 동시에 일어난다. 이때 배선 금속의 확산 방지막 내부로의 확산 속도에 비해 실리콘의 확산 방지막으로의 확산 속도가 훨씬 빠르다. 이러한 확산 속도의 상이함을 이용하여 상부의 배선 금속이 확산 방자막 내부를 완전히 관통하여 하부의 실리콘 층에도 달하기 전에 확산 방지막 내부에 침투한 실리콘과 이원계 확산 방지막 간의 화합물을 형성함으로써 확산 방지 특성이 우수한 삼원계 화합물을 제조할 수 있다. 그러므로, 위의 방법에 의해 하부로부터 점진적으로 형성되는 삼원계 확산 방지막을 이용하여 배선 금속의 확산을 효율적으로 방지할 수 있다.
상술한 바와 같이 본 발명은 Ti, Ta, W 등의 내화 금속을 증착한 후 열처리에 의해 실리콘 기판 또는 실리사이드 내의 실리콘의 외향 확산에 의해 원하는 삼원계 화합물을 형성한다. 따라서, 상기 열처리 공정은 확산된 실리콘과 이원계 화합물 결합에 충분한 에너지를 공급하게 되어 고품위의 삼원계 확산 방지막을 효과적으로 형성할 수 있도록 한다. 또한, 상기 열처리 공정은 배선 금속의 특성 개선을 위한 열처리와 동시에 실시하므로 별도의 열처리 공정을 필요로 하지 않는다.
즉, 부가적인 열처리 공정 없이 배선 금속의 열처리에 의한 특성 개선과 동시에 확산 특성이 우수한 삼원계 확산 방지막을 형성할 수 있어 공정의 단순화를 이룰 수 있다.
Claims (10)
- 실리콘 기판 상부에 실리사이드를 증착하는 단계와, 상기 실리사이드 상부에 내화 금속 질화물을 증착하는 단계와, 상기 내화 금속 질화물 상부에 배선 금속을 증착하는 단계와, 열처리 공정을 실시하여 상기 실리사이드 및 내화 금속 질화물 사이에 삼원계 확산 방지막을 형성하는 단계로 이루어진 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
- 제1항에 있어서, 상기 실리사이드는 내화 금속계인 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
- 제1항에 있어서, 상기 내화 금속 질화물은 TiN, TaN 및 WN 중 어느 하나로 이루어지며,상기 삼원계 확산 방지막은 내화 금속 질화물과 실리사이드 내의 Si와 반응하여 Ti-Si-N, Ta-Si-N 및 W-Si-N와 같은 삼원계 화합물로 이루어진 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
- 제1항에 있어서, 상기 배선 금속은 알루미늄 및 구리 중 어느 하나로 이루어진 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
- 실리콘 기판 상부에 내화 금속 질화물을 증착하는 단계와, 상기 내화 금속 질화물 상부에 배선 금속을 저온 증착하는 단계와, 상기 실리콘 기판 상부에 실리사이드가 형성됨과 동시에 상기 내화 금속 질화물 및 상기 실리사이드 사이에 삼원계 확산 방지막이 형성되도록 열처리 공정을 실시하는 단계로 이루어진 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
- 제5항에 있어서, 상기 배선 금속은 알루미늄 및 구리 중 어느 하나로 이루어진 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
- 실리콘 기판 상부에 내화 금속을 증착하는 단계와, 상기 내화 금속을 열변환하여 실리콘 기판 상부에 실리사이드와 내화 금속 질화물을 동시에 형성하는 단계와, 상기 내화 금속 질화물 상부에 배선 금속을 저온 증착하는 단계와, 열처리 공정을 실시하여 상기 실리사이드 및 내화 금속 질화물 사이에 삼원계 확산 방지막을 형성하는 단계로 이루어진 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
- 제7항에 있어서, 상기 내화 금속은 Ti, Ta, W 중 어느 하나로 이루어진 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
- 제7항에 있어서, 상기 열변환은 질소 분위기에서 수행하는 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
- 제7항에 있어서, 상기 배선 금속은 알루미늄 및 구리 중 어느 하나로 이루어진 것을 특징으로 하는 삼원계 확산 방지막 형성 방법.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019960052620A KR100240649B1 (ko) | 1996-11-07 | 1996-11-07 | 삼원계 확산 방지막 형성 방법 |
US08/959,095 US6066554A (en) | 1996-07-11 | 1997-10-28 | Method of manufacturing three elemental diffusion barrier layer |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019960052620A KR100240649B1 (ko) | 1996-11-07 | 1996-11-07 | 삼원계 확산 방지막 형성 방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR19980034537A KR19980034537A (ko) | 1998-08-05 |
KR100240649B1 true KR100240649B1 (ko) | 2000-02-01 |
Family
ID=19481082
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019960052620A KR100240649B1 (ko) | 1996-07-11 | 1996-11-07 | 삼원계 확산 방지막 형성 방법 |
Country Status (2)
Country | Link |
---|---|
US (1) | US6066554A (ko) |
KR (1) | KR100240649B1 (ko) |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6194310B1 (en) * | 2000-06-01 | 2001-02-27 | Sharp Laboratories Of America, Inc. | Method of forming amorphous conducting diffusion barriers |
CZ20032169A3 (cs) * | 2001-02-12 | 2004-03-17 | H. C. Starck Inc. | Tantal-křemíkové a niob-křemíkové substráty pro anody kondenzátorů |
US6846727B2 (en) * | 2001-05-21 | 2005-01-25 | International Business Machines Corporation | Patterned SOI by oxygen implantation and annealing |
US6855436B2 (en) * | 2003-05-30 | 2005-02-15 | International Business Machines Corporation | Formation of silicon-germanium-on-insulator (SGOI) by an integral high temperature SIMOX-Ge interdiffusion anneal |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4855798A (en) * | 1986-12-19 | 1989-08-08 | Texas Instruments Incorporated | Semiconductor and process of fabrication thereof |
KR0162673B1 (ko) * | 1994-01-11 | 1998-12-01 | 문정환 | 반도체 도전층 및 반도체소자의 제조방법 |
-
1996
- 1996-11-07 KR KR1019960052620A patent/KR100240649B1/ko not_active IP Right Cessation
-
1997
- 1997-10-28 US US08/959,095 patent/US6066554A/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
US6066554A (en) | 2000-05-23 |
KR19980034537A (ko) | 1998-08-05 |
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