KR100189553B1 - 정보저장장치와 컴퓨터 시스템간에 데이타를 인터페이싱하기위한회로 - Google Patents

정보저장장치와 컴퓨터 시스템간에 데이타를 인터페이싱하기위한회로 Download PDF

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Abstract

1. 청구 범위에 기재된 발명이 속한 기술분야 :
정보저장장치와 컴퓨터 시스템간에 데이타를 인터페이싱하기 위한 회로에 관한 것이다.
2. 발명이 해결하려고 하는 기술적 과제 :
컴퓨터 시스템을 통하여 정보저장장치를 억세스하기 위해 필요한 하드웨어와 포트 할당을 줄일 수 있는 회로를 제공함에 있다.
3. 발명의 해결방법의 요지 :
컴팩트 디스크등과 같은 기록 매체를 가지는 정보저장장치와 컴퓨터 시스템간에 통신되어지는 데이타를 인터페이싱하기 위한 회로는 상기 컴퓨터 시스템의 정보 관련 포트들과 연결된 오버레이 인터페이스 포트부와; 상기 정보저장장치에 제1포트그룹이 연결되고, 상기 오버레이 인터페이스 포트부의 어드레스 및 데이타버스에 제2포트그룹의 일부 포트가 연결되며, 데이타의 억세스가 양방향에서 가능한 메모리부와; 직접적으로 상기 메모리부를 억세스하기 위해, 상기 오버레이 인터페이스 포트부와 상기 제2포트그룹의 나머지 포트들간에 연결되며, 상기 오버레이 인터페이스 포트부로 부터 인가되는 선택신호들 및 억세스 인에이블신호를 변환하여 상기 나머지 포트들에 제공하고 상기 메모리부의 비지 신호를 상기 오버레이 인터페이스 포트부에 응답신호로서 출력하는 인터페이스 신호 변환부를 가짐을 특징으로 한다.
4. 발명의 중요한 용도 :
정보저장장치와 컴퓨터 시스템간에 데이타를 인터페이싱하기 위한 회로에 적합하게 사용된다.

Description

정보저장장치와 컴퓨터 시스템간에 데이타를 인터페이싱하기 위한 회로
제1도는 본 발명에 따라 컴퓨터 시스템과 정보저장장치간에 데이타를 인터페이싱하는 회로의 블럭도.
제2a도와 제2b도는 제1도에 도시된 오버레이 인터페이스 포트의 리드 및 라이트 타이밍도.
제3a도~제3c도는 제1도에 도시된 듀얼 스태틱램의 리드, 라이트 및 비지신호에 대한 타이밍도.
제4도는 본 발명의 실시예에 따라 구성된 인터페이스신호 변환부의 회로도.
본 발명은 정보저장장치와 컴퓨터 시스템간에 데이타를 인터페이싱하기 위한 회로에 관한 것이다.
컴퓨터-정보저장처리(PC-CDI)시스템에서는 듀얼 스태틱램(SRAM)을 이용하여 컴팩트 디스크등과 같은 기록 매체를 가지는 정보저장장치와 퍼스널 컴퓨터간에 통신을 한다. 상기 듀얼 스태틱램(Dual SRAM)은 스태틱램(SRAM)상에 두개의 인터페이스 포트가 있으며 각각의 포트는 스태틱램을 억세스할 수 있도록 되어 있다. 이 두개의 인터페이스 포트를 한쪽은 상기 컴퓨터 시스템에서 다른 한쪽은 정보저장장치에서 억세스함으로써 데이타를 주고받게 되는 것이다. 그러나 이런 듀얼 스태틱램을 컴퓨터 시스템에서 억세스하기 위해서는 문제들이 발생한다. 상기 문제들은 컴퓨터 시스템상에서 듀얼 포트의 메모리 크기 만큼의 입출력 포트 또는 메모리 번지를 할당해야하며, 이것을 할당하기 위해서는 많은 하드웨어가 이루어져야 하기 때문이다. 즉, 상기 정보저장장치와 컴퓨터 시스템사이에서 상기 컴퓨터 시스템을 통하여 사용자가 직접 듀얼 포트(Dual port)를 억세스하려면, 많은 하드웨어와 인터페이스 포트들이 필요하게 된다. 또한 스태틱램(SRAM) 메모리에 할당되는 많은 컴퓨터 시스템의 입출력 포트 또는 메모리 포트가 할당되어야 한다.
따라서, 본 발명의 목적은 컴퓨터 시스템을 통하여 정보저장장치를 억세스하기 위해 필요한 하드웨어와 포트 할당을 줄일 수 있는 회로를 제공함에 있다.
본 발명의 다른 목적은 오버레이 인터페이스 포트에서 제공하는 인터페이스들중의 하나를 이용하여 컴퓨터 시스템에서 정보저장장치를 인터페이싱할 수 있는 회로를 제공함에 있다.
상기한 목적들을 달성하기 위한 본 발명의 기술적 사상에 따른면, 컴팩트 디스크등과 같은 기록 매체를 가지는 정보저장장치와 컴퓨터 시스템간에 통신되어지는 데이타를 인터페이싱하기 위한 회로는 상기 컴퓨터 시스템의 정보 관련 포트들과 연결된 오버레이 인터페이스 포트부와; 상기 정보저장장치에 제1포트 그룹이 연결되고, 상기 오버레이 인터페이스 포트부의 어드레스 및 데이타버스에 제2포트그룹의 일부 포트가 연결되며, 데이타의 억세스가 양방향에서 가능한 메모리부와; 직접적으로 상기 메모리부를 억세스하기 위해, 상기 오버레이 인터페이스 포트부와 상기 제2포트그룹의 나머지 포트들간에 연결되며, 상기 오버레이 인터페이스 포트부로 부터 인가되는 선택신호들 및 억세스 인에이블신호를 변환하여 상기 나머지 포트들에 제공하고 상기 메모리부의 비지신호를 상기 오버레이 인터페이스 포트부에 응답신호로서 출력하는 인터페이스신호 변환부를 가짐을 특징으로 한다.
이하 본 발명의 바람직한 실시예들의 상세한 설명이 첨부된 도면들을 참조하여 설명된다.
도면들중 동일한 구성요소 및 부분들은 가능한한 어느곳에서든지 동일한 부호들을 나타내고 있음을 유의하여야 한다.
제1도는 본 발명에 따라 컴퓨터 시스템에서 정보저장장치를 인터페이싱하기 위해 구성된 회로 블럭도이고, 제2a도 및 제2b도는 제1도에 도시된 오버레이 인터페이스 포트의 리드 및 라이트 타이밍도이고, 제3a도~제3c도는 제1도에 도시된 듀얼 스태틱램의 리드, 라이트 및 비지신호에 대한 타이밍도이다.
제1도~제3도를 참조하여 설명하면, 컴퓨터 시스템(101)과 정보저장장치(105)사이의 통신은 오버레이 인터페이스 포트(102)와 듀얼 스태택램(104)사이에 연결된 인터페이스신호 변환부(103)에 의해 이루어진다. 오버레이 인터페이스 포트(102)는 인터페이스단 IF을 통하여 상기 컴퓨터시스템(101)과 통신을 하며, 이러한 통신은 오버레이 인터페이스 포트(102)의 외부 입출력 인터페이스단을 통하여 듀얼 스태틱램(104)과 통신을 한다. 이때 오버레이 인터페이스 포트(102)의 외부 입출력 인터페이스단의 신호들에 대한 수정이 필요하며, 이 수정부분이 인터페이스신호 변환부(103)이다. 인터페이스신호 변환부(103)의 회로도는 제4도와 같으며, 이것은 제2도와 제3도에서의 오버레이 인터페이스 포트(102)와 듀얼 스태틱램(104)의 인터페이스신호들이 요구하는 타이밍과 핸드세이크(Handshake)를 맞추기 위한 것이다. 그리고 상기 정보저장장치(105)에서 출력되는 비디오를 모니터상에 디스플레이(Display)하기 위해 사용하는 오버레이 인터페이스 포트(102)는 컴퓨터 시스템(101)과의 인터페이스단 IF에 추가해서 다른 외부장치에 대한 할당된 입출력 맵(Map)를 가지고 있다.
한편, 제3c도의 비지(Busy)신호는 듀얼 스태틱램의 두 인터페이스 포트 IF가 메모리의 같은 번지를 억세스할 경우에 나타내는 신호이며, 이때는 억세스를 하지 않도록 되어 있다.
제2a도는 오버레이 인터페이스 포트(102)의 리드시 타이밍도로써, 어드레스 선택신호와 데이타 선택신호가 인에이블되면, 리드 및 라이트신호 즉 억세스신호 R/가 하이레벨로 천이한 상태에서, 데이타신호 DATA를 상기 오버레이 인터페이스 포트(102)에서 인식신호 DTACK에 의해 읽게 된다.
제2b도는 오버레이 인터페이스 포트(102)의 라이트시 타이밍도로써, 제2a도에서 설명된 동작과 동일한데, 다른점은 상기 억세스신호 R/가 로우레벨로 천이한 상태에서 동작한다는 것이다.
제3도의 타이밍관계도 제2도에서와 유사하게 동작한다는 것을 도면을 통해 알 수 있다.
제4도에 도시된 상기 인터페이스신호 변환부(103)을 참조하면, 상기 어드레스 선택신호를 클럭신호 CLOCK에 응답하여 지연하는 지연플립플롭(402, 403)과, 상기 지연된 신호와 상기 어드레스 선택신호를 입력으로 하는 앤드게이트(404)와, 상기 데이타 선택신호를 인버터(405)를 통하여 반전시킨 신호와 상기 억세스신호 R/를 입력으로 하여 출력인에이블신호를 출력하는 낸드게이트(406)와, 상기 앤드게이트(404)의 출력신호인 칩 인에이블신호와 상기 데이타 선택신호에 응답하여 동작하는 노아게이트(407)와, 상기 노아게이트(407)의 출력과 상기 비지신호를 입력으로 하여 상기 인식신호 DTACK를 출력하는 낸드게이트(408)로 구성되어 있다.
상기한 바와 같이 본 발명에 따르면, 컴퓨터 시스템을 통하여 정보저장장치를 억세스하기 위해 필요한 하드웨어와 포트 할당을 줄일 수 있는 이점을 가진다. 또한 본 발명은 오버레이 인터페이스 포트에서 제공하는 인터페이스들중의 하나를 이용하여 컴퓨터 시스템에서 정보저장장치를 인터페이싱할 수 있는 이점을 가진다.
상기한 본 발명은 도면을 중심으로 예를들어 한정되었지만, 그 동일한 것은 본 발명의 기술적 사상을 벗어나지 않는 범위내에서 여러가지 변화와 변형이 가능함이 본 분야의 숙련된 자에게 있어 명백할 것이다.

Claims (5)

  1. 컴팩트 디스크등과 같은 기록 매체를 가지는 정보저장장치와 컴퓨터 시스템간에 통신되어지는 데이타를 인터페이싱하기 위한 회로에 있어서: 상기 컴퓨터 시스템의 정보 관련 포트들과 연결된 오버레이 인터페이스 포트부와; 상기 정보저장장치에 제1포트그룹이 연결되고, 상기 오버레이 인터페이스 포트부의 어드레스 및 데이타버스에 제2포트그룹 일부 포트가 연결되며, 데이타의 억세스가 양방향에서 가능한 메모리부와; 직접적으로 상기 메모리부를 억세스하기 위해, 상기 오버레이 인터페이스 포트부와 상기 제2포트그룹의 나머지 포트들간에 연결되며, 상기 오버레이 인터페이스 포트부로 부터 인가되는 선택신호들 및 억세스 인에이블신호를 변환하여 상기 나머지 포트들에 제공하고 상기 메모리부의 비지신호를 상기 오버레이 인터페이스 포트부에 응답신호로서 출력하는 인터페이스신호 변환부를 가짐을 특징으로 하는 회로.
  2. 제1항에 있어서, 상기 인터페이스신호 변환부는 상기 선택신호들중 어드레스 선택신호에 응답하여 칩 인에이블신호를 활성화시키기 위한 제1제어수단과, 상기 선택신호들중 데이타선택신호와 상기 억세스 인에이블신호에 응답하여 출력인에이블신호를 활성화시키기 위한 제2제어수단과, 상기 칩 인에이블신호와 상기 비지신호에 응답하여 상기 응답신호를 제공하기 위한 제3제어수단을 가짐을 특징으로 하는 회로.
  3. 제2항에 있어서, 상기 제1제어수단은 상기 어드레스선택신호를 외부로 부터 제공되는 클럭신호에 따라 지연하는 지연플립플롭과, 상기 지연플립플롭의 출력과 상기 어드레스선택신호를 입력으로 하는 앤드게이트로 구성됨을 특징으로 하는 회로.
  4. 제2항에 있어서, 상기 제2제어수단은 상기 데이타선택신호 반전시킨 신호와 상기 억세스신호를 입력으로 하는 낸드게이트로 구성됨을 특징으로 하는 회로.
  5. 제2항에 있어서, 상기 제3제어수단은 상기 데이타선택신호와 상기 칩 인에이블신호를 입력으로 하는 노아게이트와, 상기 노아게이트의 출력과 상기 비지신호를 입력으로 하는 낸드게이트로 구성됨을 특징으로 하는 회로.
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