KR0157862B1 - 이중화구조 시스템의 통신라인 장애방지회로 - Google Patents
이중화구조 시스템의 통신라인 장애방지회로 Download PDFInfo
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Abstract
본 발명은 이중화구조 시스템의 통신라인 장애방지회로에 관한 것으로, 종래 이중화구조 시스템에서 듀티와 스탠바이가 자기상태를 확인한 후 상대방의 상태를 체크하여 송신을 인에이블 또는 디스에이블을 결정함에 있어, 상태라인을 통해 이 상태라인의 상태가 왜곡되면 듀티와 스탠바이 모두 송신을 하던지 서로가 스탠바이 상태로 알고 있어 입출력에 대한 응답을 하지 못하는 경우가 발생될 문제점이 있다.
따라서 종래의 문제점을 해결하기 위하여 본 발명은 처음 시스템이 듀티와 스탠바이가 결정되어진 후 듀티와 입출력 콘트롤러가 통신을 하고 있는 동안에 서로 상대방의 시스템 이상유무를 상태라인 및 사건신호(event signal)발생과 상대방에서 이 사건카운트갯수를 확인하여 이상을 확인하고 자기자신 시스템 뿐만 아니라 상대방의 시스템에서 제어되도록 한 효과가 있다.
Description
제1도는 종래 이중화구조 시스템의 통신라인 회로도.
제2도는 본 발명 이중화구조 시스템의 통신라인 장애방지회로도.
제3도는 제2도에 대한 이중화구조 시스템의 통신라인 장애방지방법에 대한 제어흐름도.
* 도면의 주요부분에 대한 부호의 설명
1 : 입출력 콘트롤러 2 : 시스템1
3 : 시스템2 4 : 데이타 송수신부
5 : 입출력 구동부 6,7 : 구동부
ND1,ND2 : 낸드게이트 dri1-dri6 : 라인드라이버
본 발명은 이중화구조 시스템의 통신라인 장애방지회로에 관한 것으로, 특히 이중화구조를 가진 시스템에서 듀티(duty)와 스탠바이(standby) 통신라인 및 다른 입출력 콘트롤러간의 통신이 이루어질때 듀티와 스탠바이가 동시에 통신을 하고자 하는 것을 방지하도록 한 이중화구조 시스템의 통신라인 장애방지회로에 관한 것이다.
종래 이중화구조 시스템의 통신라인회로도로서 이에 도시된 바와 같이 입출력 콘트롤러(1)와 데이타를 주고받는 통신을 하기 위한 시스템1(2) 및 시스템2(3)과, 상기 시스템1,2(2)(3)과 입출력 콘트롤러(1)의 송수신이 가능하도록 통신라인을 구동하는 데이타 송수신부(4)와, 상기 입출력 콘트롤러(1)와 상대 시스템이 통신을 하고 있는지 아닌지를 감지하기 위해 상기 시스템1(2)과 시스템2(3) 사이에 연결된 상태라인(Ls)으로 구성된다.
이와 같이 구성된 기술에 있어서, 이중화구조 시스템이란 똑같은 기능을 가진 시스템이 두개가 있어 한쪽을 듀티(duty), 다른 한쪽을 스탠바이(standby)라고 한다. 상기 듀티와 스탠바이의 기능은 똑같고 단지 입출력 콘트롤러와 통신을 하는 것은 듀티가 된다.
듀티인 시스템1(2)에서 입출력 콘트롤러(1)와 통신을 하기 위해 데이타 송수신부(4)의 라인드라이버(dri1)(dri2)를 통해 송신신호(Tx)를 입출력 콘트롤러(1)의 수신단자(Rx1)로 보낸다. 이때 입출력 콘트롤러(1)가 통신가능한 상태를 그의 송신단자(Tx1)를 통해 수신가능한 신호를 시스템1(2)의 수신단자(Rx2)로 보내오면, 상기 시스템1(2)은 송신데이타를 입출력 콘트롤러(1)로 송출한다.
이때 스탠바이인 시스템2(3)의 송신인에이블신호는 디스에이블상태가 된다.
그리고 시스템1(2)과 시스템2(3)는 서로의 상태를 감시하는 시스템2(3)가 액티브(ACTIVE)상태이면 신호레벨을 하이상태로 유지한다. 따라서 이 신호를 상대방이 체크하여 기능이상유무를 판단하여 듀티인 시스템1(2)에 이상이 있으면 시스템이 절체되며, 스탠바이인 시스템2(3)가 듀티시퀀스 프로세스(duty sequence process)를 계속 수행한다.
그러나 이와 같은 종래 이중화구조 시스템에서 듀티와 스탠바이가 자기 상태를 확인한 후 상대방의 상태를 체크하여 송신을 인에이블 또는 디스에이블을 결정함에 있어, 상태라인을 통해 이 상태라인의 상태가 왜곡되면 듀티와 스탠바이 모두 송신을 하던지 서로가 스탠바이 상태로 알고 있어 입출력에 대한 응답을 하지 못하는 경우가 발생될 문제점이 있다.
따라서 종래의 문제점을 해결하기 위하여 본 발명은 처음 시스템이 듀티와 스탠바이가 결정되어진 후 듀티와 입출력 콘트롤러가 통신을 하고 있는 동안에 서로 상대방의 시스템 이상유무를 상태라인 및 사건신호(event signal)발생과 상대방에서 이 사건카운트갯수를 확인하여 이상을 확인하고 자기자신 시스템 뿐만 아니라 상대방의 시스템에서 제어되도록 하여 신뢰성이 향상된 이중화구조 시스템의 통신라인 장애방지회로를 창안한 것으로, 이하 첨부한 도면을 참조하여 상세히 설명하면 다음과 같다.
제2도는 본 발명 이중화구조 시스템의 통신라인 장애방지회로도로서, 이에 도시한 바와 같이, 입출력 콘트롤러(1)와 데이타를 주고받는 통신을 하기 위한 시스템1,2(2)(3)와, 통신라인을 통해 상기 시스템1,2(2)(3) 및 입출력 콘트롤러(1)간의 송신 및 수신이 가능하도록 데이타 송수신부(4)와, 상대방 시스템의 상태를 체크함과 아울러 사건(event)발생을 체크하는 입출력 구동부(5)와, 상기 입출력 구동부(5)를 인에이블 및 디스에이블하도록 하는 낸드게이트(ND1)(ND2)로 구성한다.
이와 같이 구성된 본 발명의 작용 및 효과에 대하여 상세히 설명하면 다음과 같다.
시스템에서 듀티와 스탠바이가 결정되면 듀티만이 입출력 콘트롤러(1)와 통신을 하게 되는데, 이때 통신은 듀티, 스탠바이에서는 수신이 둘다 가능하고, 송신은 오직 한쪽(듀티)에서만 가능해야 정상적인 통신을 할 수 있다. 그렇지 않은 경우에는 통신 장애가 된다.
가령 듀티를 시스템1(2)라고 하고, 스탠바이를 시스템2(3)라고 가정한 상태에서, 듀티인 시스템1(2)이 입출력 콘트롤러(1)와 통신을 하기 위해 송신인에이블신호(Txen)를 낸드게이트(ND1)에 인가하면 낸드조합된 로우신호가 데이타 송수신부(4)의 라인드라이버(dri1)의 반전단자(-)로 인가함에 따라 상기 라인드라이버(dri1)가 구동한다.
이때 시스템1(2)이 그의 송신단자(Tx2)를 통해 라인드라이버(dri1)(dri5)에 데이타가 출력하면, 상기 라인드라이버(dri1)(dri5)를 통해 송신신호(Tx)를 상기 입출력 콘트롤러(1)의 수신단자(Rx1)로 출력한다.
상기 입출력 콘트롤러(1)가 수신가능함을 알리기 위해 그의 송신단자(Tx1)로 수신가능함을 알리는 신호를 출력하면 데이타 송수신부(4)의 라인드라이버(dri6)(dri2)를 거쳐 시스템1(2)의 수신단자(Rx2)로 입력한다. 이에 따라 시스템1(2)과 입출력 콘트롤러(1)는 통신을 행한다.
이때 스탠바이인 시스템2(3)의 송신인에이블신호는 디스에이블상태로 낸드게이트(ND2)로 입력하면 그 신호는 낸드조합된 하이신호가 라인드라이버(dri3)의 반전단자(-)로 입력함에 따라 구동되지 않는다.
이중화를 위해서는 서로가 상대방의 시스템을 감시해야 하는데 이런 상황을 체크하는 방법은 첫째, 시스템1(2) 또는 시스템2(3)에서 그의 입출력포트를 통해 펌웨어(firmware)에서 연속적 사건(event)을 발생한다. 그러면 반대로 상대방 시스템인 시스템2(3) 또는 시스템1(2)에서는 그의 입출력포트를 통해 일정시간동안 입력되는 사건펄스를 카운트한다.
이렇게 시스템의 펌웨어에서 사건펄스의 카운트갯수를 기준카운트갯수와 비교하여 상대방의 이상유무를 확인한다.
둘째, 상대방의 상태라인(status line)의 레벨(정상적인 경우 레벨이 로우상태임)을 체크하여 레벨이상시 상대방시스템의 이상유무를 확인한다.
대기중인 시스템2(3)가 시스템1(2)의 상태라인과 사건발생카운트갯수를 비교하여 둘다 이상이 발견되면, 상기 시스템2(3)는 그의 입출력포트를 통해 상대방 인에이블신호를 디스에이블(로우상태)시켜 낸드게이트(ND1)로 출력한다. 이에 따라 라인드라이버(dri1)는 구동하지 않는다.
이것으로 인해 시스템이 절체가 되어 스탠바이였던 시스템2(3)가 듀티가 되어 통신주도권을 가지고 입출력 콘트롤러(1)와 통신을 하게 된다. 그리고 시스템1(2)과 시스템2(3)는 서로의 상태를 감시한다.
상기에서 설명한 과정에 대해서는 제3도에 도시한 바와 같다.
이상에서 설명한 바와 같이 본 발명은 이중화시스템 구조에서의 통신라인 장애방지를 위하여 사건발생 및 상대방의 송신라인을 체크하여 자신의 시스템뿐만 아니라 상대방이 시스템에서 콘트롤할 수 있도록 한 효과가 있다.
Claims (1)
- 입출력 콘트롤러(1)와 데이타 통신을 하기 위한 시스템1,2(2)(3)와, 상기 시스템1,2(2)(3)과 입출력 콘트롤러(1)간의 듀티와 스탠바이가 절체되면 데이타를 송신 및 수신가능하도록 한 데이타 송수신부(4)와, 상대방 시스템의 송신인에이블상태 및 사건발생을 체크하여 상대방 및 자신의 시스템을 콘트롤할 수 있도록 한 입출력 구동부(5)와, 상기 입출력 구동부(5)의 구동신호에 따라 상기 데이타 송수신부(4)의 동작을 제어하는 낸드게이트(ND1)(ND2)로 구성된 이중화구조 시스템의 통신라인 장애방지회로.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019930021624A KR0157862B1 (ko) | 1993-10-18 | 1993-10-18 | 이중화구조 시스템의 통신라인 장애방지회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019930021624A KR0157862B1 (ko) | 1993-10-18 | 1993-10-18 | 이중화구조 시스템의 통신라인 장애방지회로 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR950012224A KR950012224A (ko) | 1995-05-16 |
| KR0157862B1 true KR0157862B1 (ko) | 1998-12-15 |
Family
ID=19366063
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019930021624A KR0157862B1 (ko) | 1993-10-18 | 1993-10-18 | 이중화구조 시스템의 통신라인 장애방지회로 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR0157862B1 (ko) |
-
1993
- 1993-10-18 KR KR1019930021624A patent/KR0157862B1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR950012224A (ko) | 1995-05-16 |
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