KR0125941B1 - 변환 콘덕턴스형 전력 증폭기를 사용한 병렬동작된 자율전류나 전압 레귤레이터와 함께 사용하는 오차 증폭기 - Google Patents
변환 콘덕턴스형 전력 증폭기를 사용한 병렬동작된 자율전류나 전압 레귤레이터와 함께 사용하는 오차 증폭기Info
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Abstract
본 특허에 기재된 발명은 변환 콘덕턴스형 전력 증폭기를 지닌 병렬동작된 다수개의 전류나 전압 레귤레이터와 함께 사용하는 오차 증폭기 시스템이다. 상기 오차 증폭기는 예를들면 선형 전압 레귤레이터나, 또는 dc/dc 변환기와 함께 사용될 수 있다.
상기 시스템은 복수개의 오차 증폭기를 포함한다. 상기 오차 증폭기 각각은 출력수단, 상기 출력 수단 각각을 그와 같은 다른 모든 출력 수단에 전기적으로 연결시키는 수단 및 상기 출력 수단 각각에 대해 비대칭 전류 능력을 설정하는 수단을 지닌다.
상기 비대칭 전류 능력은 공급 전류나, 또는 소비 전류나 싱크(sink) 전류능력보다 큰 전류 공급이나 전류발생 능력을 지닌다.
더우기, 각각의 증폭기는 상기 증폭기가 선형 범위의 싱크측, 외측에서 포화되어 동작하여 기준 입력에 걸린 전압을 소량만큼 변환하는 경우에 감지하도록 내부 감지 회로를 지니므로 산출 피드백(feed back)이 양(+)인 결과로해서 상기 증폭기의 활성 및 비활성 상태 사이에서 자유 발진 전이를 확실하게 하도록 작은 히스테리시스(hysteresis)를 만들어 낸다.
Description
제1도는 변환 콘덕턴스형 전력 증폭기를 사용한 전압 레귤레이터 셀의 도시도.
제2도는 선행기술의 블록 다이어그램.
제3도는 본 발명의 블록 다이어그램.
제4도 및 제5도는 본 발명의 오차 증폭기에 대한 제1 및 제2 변형회로의 도시도.
동일 부호는 이해를 용이하게 하도록 여러 도면 및 이 도면의 회로에 도시된 동일요소로서 사용됨.
[발명의 분야]
본 발명은 변환 콘덕턴스형 전력 증폭기를 지닌 병렬동작된 자율 전류나 전압 레귤레이터(regulator), 예를들면, 전류 모드 제어 DC/DC 전압 변환기(converter)와 함께 사용하는 오차 증폭기 분야에 관한 것이다. 특히나, 본 발명은 모듈(module)에 관계하여 증가된 전류 능력을 위해 그리고 높은 신뢰도를 위해 병렬 동작된 시스템이 전적으로 용장(冗長) 및 자율 제어 능력을 지니도록 모두 연동(連動)되는 비대칭 출력 전류능력을 지닌 오차 증폭기에 관한 것이다.
[발명의 배경]
전류 모드 제어 DC/DC 전압 변환기의 설계자 사이에 일반적으로 보급된 실시에는 병렬동작된 전력셀을 지닌 모듈 시스템을 설계하는 것이다. 이때, 사양적인 응용에 적합한 시스템을 개발하기 위해서는, 설계자는 바람직한 전력 레벨을 이루도록 적합한 수의 이들 셀을 모두 연동하지 않으면 안된다.
제1도는 전압 레귤레이터로서 사용된 변환 콘덕턴스형 전력 증폭기를 지니는 변환기 셀을 도시한 것이다. 전압 공급원(Vs)은 변환 콘덕터스형 전력 증폭기(2)에 전력을 제공하도록 입력 노드(1)에 연결되어 있다. 오차 증폭기(3)는 기준 전압(Vref)(4)을 출력 전압(Vout)(10)의 분할 전압(Vfrac)(9)과 비교한 다음 상기 변환 콘덕턴스형 전력 증폭기(2)의 제어단자(8)에서 상기 비교된 전압을 제어하여 출력전류(11)가 레지스터부하(7)에서 필요한 출력 전압(Vout)(10)을 발생시킨다.
전형적으로, Vref는 대략적으로 Vfrac와 동일하다. 상기 출력 전압(Vout)(10)의 분할 전압(Vfrac)(9)은 전형적으로 상기 변환 콘덕턴스형 전력 증폭기(2)의 출력 및 접지사이에 연결되어있는 한쌍의 레지스터(R1, R2) 양단에 형성된 전압 분할용 희로망에 의해 발생된다.
제2도는 다수개가 병렬로 연결된 선행기술의 변환 콘덕턴스셀을 도시한 것으로, 상기 변환 콘덕턴스 셀은 이와같은 시스템의 출력 전류능력을 증가시키는데 사용된다. 제2도의 시스템은 3개의 변환기 셀(30a, 30b, 30c)로 구성되어 있으나, 물론 다소간에, 그와같은 셀은 적정 갯수로서 사용될 수 있다.
상기 셀(30a, 30b, 30c) 각각은 변환 콘덕턴스형 전력 증폭기(DC 변환기)(32) 오차 증폭기(34) 및 기준 전압 공급원(Vref)(36)으로 이루어져 있다. 각각이 셀 요소에 대한 각각의 동일 부호는 적정한 것으로 a, b, 또는 c라는 첨자로써 도시되어 있다. 셀 요소 알파벳 수정자를 지니지 않는 것으로 이용된 경우에는, 각각의 셀에 있는 모든 유사 요소가 도시되어 있다고 이해하기로 한다.
변환될 전압 공급원은 각각의 DC 변화기(32) 입력에 전기적으로 연결되어 있는 DC 입력단자(38)에 인가된다. DC 변환기 출력(42)은 노드(44)에서 모두 전기적으로 연결되어 있다.
또한, 상기 노드(44)는 전압 분할용 레지스터(46), 부하(50) 및 출력노드(52)에 연결되어 있다. 상기 노드(48)는 전압 분할용 레지스터(54)에 연결되어 있다. 상기 전압 분할용 레지스터(54) 및 부하(50)는 각기 접지에 연결되어 있다.
상기 노드(48)는 오차 증폭기 입력(56a)에 연결되어 있다. 상기 오차 증폭기 입력(56a)에서의 전압은 오차가 발생되었는지를 결정하도록 기준 전압(Vref)(36a)과 비교된다. 노드(44)에 걸린 DC 전압의 어떠한 오차라도 오차 증폭기(34a)에 의해 증폭되어 오차 증폭기 출력(58a)에 인가된다.
상기 오차 증폭기 출력(58a)에 걸린 전압은 각각의 변환 콘덕턴스형 전력 증폭기(32)의 각 입력(64)에 인가된다. 제어 입력(64)에 인가된 신호는 상기 변환 콘덕턴스형 전력 증폭기(32)의 출력 전류(Iout)(43)를 구동하여 부하(50)에서 필요한 출력 전압을 발생시키므로 감지 전압(56a)이 항상 기준 전압(62a)과 대략적으로 동일하다. 상기 개별적인 셀의 출력 전류(43) 합은 시스텝 출력전류(45)를 산출시킨다. 각각의 셀(30)에 있는 변환 콘덕턴스형 전력 증폭기(32)의 변환 콘덕턴스가 상호간에 거의 동일한 경우, 이때, 상기 셀은 제어 전압(64)이 각각의 셀에 대하여 공통 전압이기 때문에 출력 전류(45)를 대략 동일하게 분할한다. 각 셀의 출력 전류가 허용 전력 소비에 의해 Imax로 한정된 경우, n개의 셀 시스템의 전체 출력 전류는 n * Imzx가 된다. 이 경우에 있어서, 3개의 셀에 대하여는 n=3이 된다.
이러한 시스템의 한 단점은 오차 증폭기중 한 오차 증폭기만을 사용한다는 점이다. 활성 오차 증폭기(34a)를 지닌 셀은 전체의 시스템을 제어하므로 보통 마스터(master)라고 지칭한다.
상기 마스터 오차 증폭기(34a)가 고장난 경우에는, 전체 시스템이 고장나는데, 즉, 상기 시스템이 전적으로 용장되지 않는다.
상기 시스템의 다른 단점은 셀당 2개의 제어 연결지점(또는 집적 시스템의 경우에 핀)이 병렬동작(64, 58)을 이루는데 필요하다.
본 발명의 목적은 높은 신뢰도를 전적인 용장 마스터없는 모듈 응용을 사용하도록 오차 증폭기를 제공하는 것이다.
본 발명의 다른 목적은 모듈당 단 한개의 제어 호출로써 그와 같은 형태를 제공하는 것이다.
이러한 형태 및 다른 형태가 하기의 바람직한 실시예에 대하여 이루어지며 기술된다.
[바람직한 실시예의 상세한 설명]
제3도에 도시된 바람직한 실시예의 블록 다이어그램은 다음에 열거할 아이템(item)을 제외하고, 제2도에 도시된 선행기술의 블록다이어그램과 유사하다. 전압 분할용 레지스터(46, 54) 및 오차 증폭기 입력(56a) 사이에 연결되어 있는 노드(48)는 또한 오차 증폭기 입력(56b, 56c)에 연결되어 있다. 오차 증폭기(58) 출력은 변환 콘덕턴스형 전력 증폭기(32)의 제어 입력(64)에 내부적으로 접속되어 있다. 각각의 오차 증폭기(58a, 58b, 58c)는 공통 제어 노드(78)를 형성하도록 상호간에 연결된다. 레지스터(72)는 오차 증폭기 전류 제어 노드(74)와 함께 기준 전압회로와 직렬로 포함된다.
본 발명의 오차 증폭기(34a, 34b, 34c) 각각은 한 오차 증폭기만이 어느 주어진 시간에 동작하도록 설계된다.
기준 입력(62)에 걸린 최고 전압을 지니는 오차 증폭기만이 활성적이다. 다른 모든 증폭기는 비활성적이므로, 이들 최대 싱크 전류를 싱크한다. 상기 오차 증폭기의 비대칭 출력 전류 능력은 활성 오차 증폭기 하나만을 이네이블하여 상기 모든 불활성 증폭기의 합보다 큰 전류를 발생시킴으로써 노드(78)에 걸린 전압을 제어하고 이 전압을 통해 전체 시스템의 출력 전류 및 전압을 제어한다.
각각의 오차 증폭기는 이 오차 증폭기가 불활성일 경우에 감지하도록 내부 감지 회로를 지닌다. 전류 제어 노드(74)는 상기 증폭기가 불활성 상태일 경우에 소량의 전류를 싱크한다.
노드(74)에 걸린 전류는 레지스터(72)에서 작은 전압 강하를 야기시키며 이러한 전압 강하는 상기 불활성 오차 증폭기의 기준 입력(62) 전위를 낮추어서, 상기 불활성 오차 증폭기의 유한 출력 임피던스, 잡음 및 드리프트로 인한 상기 활성 오차 증폭기 출력상의 부하 효과를 포함하는 2차적인 효과로 인해 불활성 증폭기가 턴온하는지 턴오프한는지를 확실하게 한다.
제4도에 도시된 회로는 오차 증폭기 회로의 한 변형예이다. 제4도의 오차 증폭기는 전류 제한 회로와 트랜지스터(150)를 제외하고는 종래의 설계이다. 이러한 회로는 전압 공급원 노드(81) 및 접지 노드(82)를 지닌다. 상기 회로의 입력단은 차동 증폭기(91)로 이루어져 있다. 상기 차동 증폭기(91)는 PNP 트랜지스터(86)의 베이스에 연결된 반전입력(84) 및 PNP 트랜지스터(90)의 베이스에 연결된 비반전 기준입력(88)을 지닌다. 트랜지스터(86, 90)의 콜렉터는 두개의 NPN 트랜지스터 전류미러구조(93)의 콜렉터로 연결된다. PNP 트랜지스터(86)의 콜렉터는 NPN 트랜지스터(92)의 콜렉터에 연결된다.
PNP 트랜지스터(90)의 콜렉터는 NPN 트랜지스터(94)의 콜렉터에 연결된다. 트랜지스터(92, 94)의 베이스는 상호간에 연결되어 있으며 또한 트랜지스터(92)의 콜렉터에 연결된다.
트랜지스터(92, 94)의 에미러는 접지(82)에 연결된다.
트랜지스터(86)의 에미러는 레지스터(96)에 연결된다.
트랜지스터(90)에 에미러는 또다른 레지스터(98)에 연결된다. 레지스터(96, 98)는 각기 트랜지스터(100)의 콜렉터에 연결된다. 트랜지스터(100, 102)는 차동증폭기(91)를 바이어스하도록 사용된 전류 미러형 PNP 트랜지스터쌍(101)이다. 트랜지스터(100, 102)의 베이스는 상호간에 연결된다. 트랜지스터(102)의 에미러는 레지스터(104)를 거쳐 전압 공급원(81)에 연결된다.
트랜지스터(100)의 에미러는 레지스터(106)를 거쳐 전압 공급원(81)에 연결된다. 트랜지스터(102)의 콜렉터는 트랜지스터(100, 102)의 베이스에 연결되며 또한 레지스터(108)에 연결된다. 상기 레지스터(108)는 또한 접지(82)의 에미러는 싱크측 전류를 제한하는 역활을 한다. 트랜지스터(100)의 에미러는 NPN 트랜지스터(110)의 콜렉터에 연결된다.
트랜지스터(110)의 에미러는 접지(82)에 연결된다. 트랜지스터(110)의 베이스는 NPN 트랜지스터(112)의 베이스 및 콜렉터에 연결된다.
트랜지스터(112)의 에미러는 접지(82)에 연결된다.
또한, 트랜지스터(112)의 콜렉터는 싱크 전류 감지 레지스터(114)에 그리고 NPN 트랜지스터(116)의 콜렉터에 연결된다.
상기 싱크전류 감지 레지스터(R 싱크)(114)는 또한 접지에 연결된다. 트랜지스터(116)의 에미러는 상기 오차 증폭기의 출력(118)에 연결된다. 또한, 트랜지스터(102)의 베이스는 PNP 트랜지스터(120)의 베이스를 구동시킨다. 트랜지스터(120)의 에미러는 레지스터(122)에 연결된다. 레지스터(122)는 또한 NPN 트랜지스터(124)의 콜렉터 및 베이스에 연결되며 출력용 고(high) 레벨 구동 트랜지스터(126)의 베이스에 연결된다.
트랜지스터(94)의 콜렉터는 트랜지스터(128)의 베이스, 커패시터(130) 및 다이오드(132)의 양(+) 전압 공급원(81)에 연결된다. 트랜지스터(128)의 에미러는 트랜지스터(134)의 베이스에 연결되며 레지스터에 연결된다. 또한, 상기 레지스터(136)는 접지(82)에 연결된다. 트랜지스터(134)의 콜렉터는 다이오드(132)의 음(-) 단자, 트랜지스터(138)의 베이스에 연결되며 커패시터(130)의 제2단자에 연결된다. 트랜지스터(134)의 에미러는 레지스터(140)에 연결된다. 상기 레지스터(140)의 다른 단자는 접지(82)에 연결된다.
PNP 트랜지스터(138)의 콜렉터는 트랜지스터(138)의 베이스에 연결되며 트랜지스터(134)의 콜렉터 및 트랜지스터(116)의 베이스에 연결된다. 트랜지스터(138)의 에미러는 PNP 트랜지스터(124)의 에미러에 연결된다. 트랜지스터(126)의 콜렉터는 PNP 트랜지스터(142)의 베이스에 연결되며 전류발생 감지 레지스터(144)에 연결된다. 또한, 상기 전류 발생 감지 레지스터(144)는 전압공급원(81)에 연결된다. 트랜지스터(142)의 콜렉터는 트랜지스터(146)의 클렉터 및 베이스에 연결되며 트랜지스터(148)의 베이스에 연결된다. 트랜지스터(146, 148)의 에미러는 접지(82)에 연결된다. 트랜지스터(148)의 콜렉터는 트랜지스터(120)의 에미러에 연결된다.
NPN 트랜지스터(150)의 베이스는 트랜지스터(110, 112)의 베이스에 연결되며, 상기 NPN 트랜지스터(150)의 에미러는 접지(82)에 연결되고, 상기 NPN 트랜지스터(150)의 콜렉터는 상기 증폭기의 비반전 입력(88)에 연결된다.
싱크측 전류제한은 다음과 같이 동작한다. 싱크방향 부하전류는 감지 레지스터(R 싱크)(114)를 거쳐 흐른다. 이러한 레지스터에 걸린 전압강하가 VBE(상온에서 700mV 이하)보다 낮은 동안에는, 트랜지스터(110, 150)가 오프되므로, 이들 트랜지스터(110, 150)의 콜렉터 전류는 대략적으로 0이 된다. 상기 증폭기에 의해 싱크된 전류가 증가함에 따라, 트랜지스터(110) 양단에 걸린 전압강하가 Vbe를 초과하여 트랜지스터(100)의 에미러를 턴온한 다음 풀다운 시킨다. 이는 차동 증폭기(1010) 트랜지스터(86, 90)의 바이어스 전류를 감소시키며, 메인(main)증폭기 트랜지스터(128, 134)의 사용가능한 베이스 전류를 감소시키고, 궁극적으로는, 출력 트랜지스터(116)의 사용가능한 베이스 전류를 감소시켜, 실제로 사용가능한 출력 싱크전류를 제한한다.
싱크 전류 제한 루프 이득은 트랜지스터(110, 112)의 에미러 영역 비율에 의해 영향을 받을 수 있다. 상기 싱크 전류제한이 활성화되는 경우, 트랜지스터(110)는 전류를 도통시키며, 또한 트랜지스터(150)도 전류를 도통시키는데, 그 이유는 상기 트랜지스터(150)의 베이스-에미터 다이오드가 트랜지스터(110)의 한측과 병렬로 접속되어 있기 때문이다. 이러한 경우에, 트랜지스터(150)의 콜렉터에 의해 싱크되는 전류는 노드(88)로 흐르고 제3도와 연관해서 기술한 바와 같이, 이러한 노드에 외부적으로 접속된 어느 레지스터에서 전압강하를 발생시킨다.
발생원측 전류제한에 대한 트리거 레벨은 병렬동작된 시스템의 최대수에 대한 최대 싱크 전류 합보다 커야한다.
상기 회로는 저 레벨측 제한과 같이 유사하게 동작한다.
전류발생 감지 레지스터인 레지스터(144)에 걸린 전압강하가 1VBE 전압 강하를 초과하는 경우, 트랜지스터(142)는 턴온되고, 상기 턴온된 트랜지스터(142)의 전류는 전류미러의 트랜지스터(146, 148)에 의해 순회되고, 트랜지스터(120)의 에미터가 풀다운됨으로써, 상기 트랜지스터(120)의 콜렉터 전류 및 출력 트랜지스터인 트랜지스터(126)의 콜렉터 전류가 제한된다.
제5도는 오차 증폭기의 있을수 있는 또다른 변형예를 도시한 것이다. 비대칭 출력 전류능력은 에미터-풀로워 출력단의 고유 특성인데, 최대 싱크 전류가 풀다운 전류원(222)에 의해 제한되는데 비하여 최대 전류발생은 출력 트랜지스터(220)의 이득을 (β)로 승산된 풀업 전류원(218)에 의해 제한된다.
출력단이 최대 전류를 싱크하는 경우, 메인 증폭기 트랜지스터(214)는 거의 포화상태에 있으며 트랜지스터(216)가 턴온되어 소량의 전류가 노드(226)(상기 증폭기의 비반전 입력)로 부터 싱크됨으로써 양(+) 피드백이 만들어진다. 전류량은 레지스터(228)에 의해 제한된다.
Claims (11)
- 변환 콘덕턴스형 전력 증폭기와 함께 사용하는 오차 증폭기 시스템으로서, a. 출력수단을 각기 지니는 복수개의 오차 증폭기, b. 다른 모든 출력수단에 상기 출력수단 각각을 전기적으로 연결시키는 수단, c. 상기 출력수단 각각에 대해 전류 싱크 능력보다 큰 전류발생 능력을 지니는 비대칭 전류 능력을 설정하는 수단을 포함하는 오차 증폭기 시스템.
- 제1항에 있어서, 상기 복수개의 오차 증폭기중 각각의 오차 증폭기는 a. 기준 전압 공급원, b. 상기 기준 전압 공급원에 연결된 제1 증폭기 입력, c. 시스템에 있는 다른 모든 증폭기의 제2 증폭기 입력에 연결된 제2 증폭기 입력, d. 최대 싱크 출력 전류 레벨을 지니는 비대칭 제한 출력 전류, e. 최대 싱크 출력 전류 레벨에서 상기 증폭기의 동작을 감지하여 신호를 형성하는 감지회로, f. 상기 신호에 응답하여 기준전압 공급원을 변화시키는 양(+) 피드백 수단을 포함하는 오차 증폭기 시스템.
- 제2항에 있어서, 상기 전류발생 능력은 상기 전류 싱크 능력을 모두 합한 능력보다 큰 오차 증폭기 시스템.
- 제3항에 있어서, 상기 오차 증포기는 연산 증폭기를 포함하는 오차 증폭기 시스템.
- 제4항에 있어서, 상기 변환 콘덕턴스형 전력 증폭기는 상호간에 전기적으로 연결된 복수개의 공급단을 포함하는 오차 증폭기 시스템.
- 제5항에 있어서, 상기 공급단 각각은 오차 증폭기를 포함하는 오차 증폭기 시스템.
- 제6항에 있어서, 상기 변환 콘덕턴스형 전력 증폭기가 dc/dc 변환기인 오차 증폭기 시스템.
- 제6항에 있어서, 상기 변환 콘덕턴스형 전력 증폭기가 선형 전압 레귤레이터(regulator)인 오차 증폭기 시스템.
- dc 전압/dc 전압 변환기와 함께 사용하는 오차 증폭기 시스템으로서, a. 증가된 전류 능력에 대해 전기적으로 연결된 복수개의 dc 변환기단, b. 연산증폭기를 각기 포함하는 복수개의 오차 증폭기, c. 상기 오차 증폭기중 한 오차 증폭기를 지니는 각각의 dc 변환기단, d. (1) 전류발생 수단, (2) 전류 싱크 수단, (3) 상기 전류발생 수단에 연결되며 상기 전류 싱크 수단에 연결된 출력 수단을 지니는 각각의 오차 증폭기,e. 다른 모든 출력수단에 상기 출력수단 각각을 전기적으로 연결시키는 수단, f. 상기 오차 증폭기 각각에 대해, 상기 싱크 전류 수단에 대한 제2전류 전달 능력보다 큰 상기 전류원 수단에 대한 제1전류 전달능력을 지닌 비대칭 전류제한을 설정하는 단계를 포함하여, 상기 오차 증폭기 각각에 대한 제1 전류전달 능력이 상기 제2 전류전달 능력을 모두 조합한 값보다 큰 것을 특징으로 하는 오차 증폭기 시스템.
- a. (1) 다른 모든 제1 입력에 각기 연결된 제1 입력,(2) 다른 모든 제2 입력에 각기 연결된 제2 입력, (3) 다른 모든 출력에 각기 연결된 출력,(4) 출력 전류발생 능력,(5) 출력 싱크 전류 능력,(6) 비대칭 출력 전류 능력을 각기 지니는 복수개의 차동 증폭기,b. 상기 제2 입력에 연결된 기준 전압을 포함하여, 상기 전류발생 능력 각각이 상기 싱크 전류 능력을 모두 합한 능력을 발생시킬 수 있는 것을 특징으로 하는 오차 증폭기.
- 제10항에 있어서, 상기 증포기 각각은a. 최대 싱크 전류 출력 레벨,b. 상기 증폭기가 최대 싱크 전류 출력 레벨에서 동작하는 지를 감지하는 감지회로,c. 상기 증폭기가 최대 싱크 전류 출력 레벨에서 동작하는 것을 상기 감지회로가 감지한 경우에 신호를 발생시키는 응답수단,d. 양(+) 피드백에서 산출되는 상기 신호에 응답하여 상기 기준 전압을 변환시키는 수단을 포함하는 오차 증폭기.
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