JPWO2008120325A1 - スイッチおよび情報処理装置 - Google Patents
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Abstract
Description
10 CPU
11 ホストOS
12 ハイパーバイザ
13a〜13c ゲストOS
20 メモリ制御装置
30 メモリ
40 入出力制御装置
41 アドレス変換表
50、60a、60b スイッチ
70a〜70d 入出力デバイス
80a 入出力デバイス
81a アドレス変換表
90a、90b スイッチ
91a アドレス変換表
910 アドレス変換支援部
911 アドレス変換表編集部
912 アドレス変換表管理部
913 アドレス変換表応答部
914 アドレス変換部
915 アドレス検証部
920 記憶部
930 スイッチ部
10 CPU
11 ホストOS
12 ハイパーバイザ
13a〜13c ゲストOS
20 メモリ制御装置
30 メモリ
40 入出力制御装置
41 アドレス変換表
50、60a、60b スイッチ
70a〜70d 入出力デバイス
80a 入出力デバイス
81a アドレス変換表
90a、90b スイッチ
91a アドレス変換表
910 アドレス変換支援部
911 アドレス変換表編集部
912 アドレス変換表管理部
913 アドレス変換表応答部
914 アドレス変換部
915 アドレス検証部
920 記憶部
930 スイッチ部
Claims (19)
- 入出力制御装置と入出力デバイスの間を接続するスイッチであって、
前記入出力デバイスがゲストOSによってDMAの転送先として指定された仮想計算機上の物理アドレスを実計算機上の物理アドレスへ変換するための変換表を記憶する記憶手段と、
前記入出力デバイスが発行したDMA要求に含まれるアドレスを、前記変換表を参照して実計算機上の物理アドレスへ変換するアドレス変換手段と
を備えたことを特徴とするスイッチ。 - 前記入出力デバイスが前記入出力制御装置に転送を要求した前記変換表を前記記憶手段に記憶させるアドレス変換表管理手段をさらに備えたことを特徴とする請求項1に記載のスイッチ。
- 前記アドレス変換表管理手段は、前記入出力制御装置に前記変換表の転送を要求し、転送された前記変換表を前記記憶手段に記憶させることを特徴とする請求項2に記載のスイッチ。
- 前記アドレス変換表管理手段は、前記記憶手段から前記変換表を削除する場合に、削除対象の部分を記憶している入出力デバイスに該当部分の削除を依頼することを特徴とする請求項2に記載のスイッチ。
- 前記アドレス変換表管理手段は、前記入出力制御装置が前記入出力デバイスへ前記変換表を無効化すべき指示を送信した場合に、前記記憶手段に記憶している変換表の該当部分を無効化することを特徴とする請求項2に記載のスイッチ。
- 前記記憶手段に記憶されている前記変換表を編集するアドレス変換表編集手段をさらに備えたことを特徴とする請求項1に記載のスイッチ。
- 前記入出力デバイスが前記入出力制御装置に転送を要求した前記変換表が前記記憶手段に記憶されている場合に、前記入出力制御装置に代わって、前記記憶手段に記憶されている前記変換表を前記入出力デバイスへ応答するアドレス変換表応答手段をさらに備えたことを特徴とする請求項1に記載のスイッチ。
- 前記入出力デバイスが発行したDMA要求に含まれるアドレスが、前記入出力デバイスによって実計算機上の物理アドレスへ変換したものである場合に、前記変換表を参照して該アドレスの正当性を検証するアドレス検証手段をさらに備えたことを特徴とする請求項1に記載のスイッチ。
- 前記入出力デバイスが記憶する前記変換表における変換後のアドレスの一覧を前記記憶手段に記憶し、
前記入出力デバイスが発行したDMA要求に含まれるアドレスが、前記入出力デバイスによって実計算機上の物理アドレスへ変換したものである場合に、前記一覧を参照して該アドレスの正当性を検証するアドレス検証手段をさらに備えたことを特徴とする請求項1に記載のスイッチ。 - 入出力制御装置と入出力デバイスの間を接続するスイッチを有する情報処理装置であって、
前記スイッチは、
前記入出力デバイスがゲストOSによってDMAの転送先として指定された仮想計算機上の物理アドレスを実計算機上の物理アドレスへ変換するための変換表を記憶する記憶手段と、
前記入出力デバイスが発行したDMA要求に含まれるアドレスを、前記変換表を参照して実計算機上の物理アドレスへ変換するアドレス変換手段と
を備えたことを特徴とする情報処理装置。 - 前記スイッチは、
前記入出力デバイスが前記入出力制御装置に転送を要求した前記変換表を前記記憶手段に記憶させるアドレス変換表管理手段を
さらに備えたことを特徴とする請求項10に記載の情報処理装置。 - 前記アドレス変換表管理手段は、前記入出力制御装置に前記変換表の転送を要求し、転送された前記変換表を前記記憶手段に記憶させることを特徴とする請求項11に記載の情報処理装置。
- 前記アドレス変換表管理手段は、前記記憶手段から前記変換表を削除する場合に、削除対象の部分を記憶している入出力デバイスに該当部分の削除を依頼することを特徴とする請求項11に記載の情報処理装置。
- 前記アドレス変換表管理手段は、前記入出力制御装置が前記入出力デバイスへ前記変換表を無効化すべき指示を送信した場合に、前記記憶手段に記憶している変換表の該当部分を無効化することを特徴とする請求項11に記載の情報処理装置。
- 前記スイッチは、
前記記憶手段に記憶されている前記変換表を編集するアドレス変換表編集手段を
さらに備えたことを特徴とする請求項10に記載の情報処理装置。 - 前記スイッチは、
前記入出力デバイスが前記入出力制御装置に転送を要求した前記変換表が前記記憶手段に記憶されている場合に、前記入出力制御装置に代わって、前記記憶手段に記憶されている前記変換表を前記入出力デバイスへ応答するアドレス変換表応答手段を
さらに備えたことを特徴とする請求項10に記載の情報処理装置。 - 前記スイッチは、
前記入出力デバイスが発行したDMA要求に含まれるアドレスが、前記入出力デバイスによって実計算機上の物理アドレスへ変換したものである場合に、前記変換表を参照して該アドレスの正当性を検証するアドレス検証手段を
さらに備えたことを特徴とする請求項10に記載の情報処理装置。 - 前記スイッチは、
前記入出力デバイスが記憶する前記変換表における変換後のアドレスの一覧を前記記憶手段に記憶し、
前記入出力デバイスが発行したDMA要求に含まれるアドレスが、前記入出力デバイスによって実計算機上の物理アドレスへ変換したものである場合に、前記一覧を参照して該アドレスの正当性を検証するアドレス検証手段を
さらに備えたことを特徴とする請求項10に記載の情報処理装置。 - 入出力制御装置と入出力デバイスの間を接続するスイッチが行うアドレス変換方法であって、
前記入出力デバイスがゲストOSによってDMAの転送先として指定された仮想計算機上の物理アドレスを実計算機上の物理アドレスへ変換するための変換表を記憶手段に記憶させる記憶工程と、
前記入出力デバイスが発行したDMA要求に含まれるアドレスを、前記変換表を参照して実計算機上の物理アドレスへ変換するアドレス変換工程と
を含んだことを特徴とするアドレス変換方法。
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JPH05250251A (ja) * | 1992-03-04 | 1993-09-28 | Nec Corp | 情報処理装置 |
JPH086893A (ja) * | 1994-06-20 | 1996-01-12 | Internatl Business Mach Corp <Ibm> | マルチプル・バス情報処理システム及びブリッジ回路 |
JP2002304364A (ja) * | 2001-03-01 | 2002-10-18 | Internatl Business Mach Corp <Ibm> | Pci入出力スロットの論理分割を実施する方法および装置 |
JP2004302922A (ja) * | 2003-03-31 | 2004-10-28 | Toshiba Corp | 情報機器およびトランザクション制御方法 |
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- 2007-03-28 JP JP2009507317A patent/JP5056845B2/ja not_active Expired - Fee Related
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2009
- 2009-09-08 US US12/555,343 patent/US8707010B2/en active Active
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