JPS6399434U - - Google Patents

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JPS6399434U
JPS6399434U JP19475086U JP19475086U JPS6399434U JP S6399434 U JPS6399434 U JP S6399434U JP 19475086 U JP19475086 U JP 19475086U JP 19475086 U JP19475086 U JP 19475086U JP S6399434 U JPS6399434 U JP S6399434U
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shift
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Description

【図面の簡単な説明】
第１図は本考案の実施例を示すブロツク図、第
２図は積分されるパルス例を作成するデータを示
す図、第３図は第１図に示された実施例の動作を
示すタイミング図、第４図は８ビツトのデータを
示す図である。 １…データバス、２…シフトレジスタ、３…Ｄ
―ＦＦ、４…出力バツフア、５…入力バツフア、
６…シフト制御回路、７…積分回路、８…データ
設定手段。

Claims (1)

    【実用新案登録請求の範囲】
  1. データバスにパラレル入力が接続されたシフト
    レジスタと、動作の開始を指示する制御信号によ
    り、前記シフトレジスタのシフト動作を制御する
    シフトクロツクを前記シフトレジスタの段数と等
    しい数だけ計数し、前記シフトクロツクの発生を
    停止すると共にシフトレジスタのシフト動作終了
    を示す終了信号を出力するシフトレジスタ制御手
    段と、前記シフトレジスタから送出されるデータ
    が印加された積分回路と、前記データバスと接続
    され、前記終了信号に基いて前記シフトレジスタ
    に所定のデータをプリセツトするデータ設定手段
    とを備えたことを特徴とするＤ／Ａ変換回路。
JP1986194750U 1986-12-18 1986-12-18 Ｄ／ａ変換回路 Expired - Lifetime JP2509464Y2 (ja)

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JPS6399434U true JPS6399434U (ja) 1988-06-28
JP2509464Y2 JP2509464Y2 (ja) 1996-09-04

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ID=31152011

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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50137665A (ja) * 1974-04-22 1975-10-31
JPS56117424A (en) * 1980-02-21 1981-09-14 M Syst Giken:Kk Time-division type d-a converter
JPS5883393A (ja) * 1981-11-09 1983-05-19 Yokogawa Hokushin Electric Corp シフトレジスタ

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50137665A (ja) * 1974-04-22 1975-10-31
JPS56117424A (en) * 1980-02-21 1981-09-14 M Syst Giken:Kk Time-division type d-a converter
JPS5883393A (ja) * 1981-11-09 1983-05-19 Yokogawa Hokushin Electric Corp シフトレジスタ

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JP2509464Y2 (ja) 1996-09-04

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