JPS61149825U - - Google Patents

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JPS61149825U
JPS61149825U JP3349085U JP3349085U JPS61149825U JP S61149825 U JPS61149825 U JP S61149825U JP 3349085 U JP3349085 U JP 3349085U JP 3349085 U JP3349085 U JP 3349085U JP S61149825 U JPS61149825 U JP S61149825U
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shift
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Description

【図面の簡単な説明】
第1図aは本考案による印字制御回路の構成を
示すブロツク図、第1図bはその動作波形、第2
図は本考案の実施例による印字制御回路の構成を
示すブロツク図、及び第3図は第2図による回路
の変形例を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 1ラインのドツト印字素子及びその各素子にシ
    フト位置の逐次増加するレジスタ段が順に接続し
    ているシフトレジスタを内蔵するドツト印字ヘツ
    ドに対して、1ラインの印字ごとにシフトレジス
    タに入力するシフトクロツクに同期動作して印字
    すべきアナログ信号のレベルに対応したシフト位
    置のレジスタ段に印字データをロードさせる印字
    制御回路において、入力する印字すべきアナログ
    信号が基準アナログ信号を越えると出力信号を発
    するコンパレータと、1ラインの印字ごとに前記
    シフトクロツクの各クロツクごとにレベルアツプ
    する前記基準アナログ信号を発生する基準アナロ
    グ信号発生回路と、前記コンパレータの出力信号
    発生時から所定時間だけ前記シフトレジスタのデ
    ータ入力信号としてデータパルスを発生するデー
    タパルス発生回路とを備えたことを特徴とするド
    ツト印字ヘツドの印字制御回路。
JP3349085U 1985-03-11 1985-03-11 Expired - Lifetime JPH0524183Y2 (ja)

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JP3349085U JPH0524183Y2 (ja) 1985-03-11 1985-03-11

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JP3349085U JPH0524183Y2 (ja) 1985-03-11 1985-03-11

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Publication Number Publication Date
JPS61149825U true JPS61149825U (ja) 1986-09-16
JPH0524183Y2 JPH0524183Y2 (ja) 1993-06-21

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ID=30535991

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JP3349085U Expired - Lifetime JPH0524183Y2 (ja) 1985-03-11 1985-03-11

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JPH0524183Y2 (ja) 1993-06-21

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