JPS5847927U - 初期リセツト回路 - Google Patents

初期リセツト回路

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JPS5847927U
JPS5847927U JP14467581U JP14467581U JPS5847927U JP S5847927 U JPS5847927 U JP S5847927U JP 14467581 U JP14467581 U JP 14467581U JP 14467581 U JP14467581 U JP 14467581U JP S5847927 U JPS5847927 U JP S5847927U
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JP
Japan
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circuit
initial reset
schmitt
reset circuit
integration
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Pending
Application number
JP14467581U
Other languages
English (en)
Inventor
繁幸 荒木
Original Assignee
株式会社リコー
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図及び第２図はシステムユニットとプリンタとを接
続した装置の一部を示すブロック図、第３図はシステム
ユニットの出力回路例を示す回路図、第４図は従来の初
期リセット、回路を示す回路図、第５図は上記装置を説
明するための図、第６図は本考案の一実施例を示す回路
図、第７図は同実施例を説明するための波形図である。 Ｄ２・・・レベルシフト用ダイオード、Ｒ６・・・抵抗
。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電源波形を積分するＣＲ積分回路と、このＣＲ積分回路
    の出力が入力されて電源投入時にリセットパルスを出力
    するシュミット回路とを有する初期リセット回路におい
    て、前記ＣＲ積分回路と前記シュミツし１回路との間に
    設けられたレベルシフト用素子と、前記シュミット回路
    の入省子と接地点との間に接続された抵抗とを具備する
    ことを特徴゛　　とする初期リセット回路。
JP14467581U 1981-09-29 1981-09-29 初期リセツト回路 Pending JPS5847927U (ja)

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JPS5847927U true JPS5847927U (ja) 1983-03-31

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