JPS6365199U - - Google Patents
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- Publication number
- JPS6365199U JPS6365199U JP16035686U JP16035686U JPS6365199U JP S6365199 U JPS6365199 U JP S6365199U JP 16035686 U JP16035686 U JP 16035686U JP 16035686 U JP16035686 U JP 16035686U JP S6365199 U JPS6365199 U JP S6365199U
- Authority
- JP
- Japan
- Prior art keywords
- line
- memory cell
- word line
- data
- mosfets
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000004065 semiconductor Substances 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Static Random-Access Memory (AREA)
Description
第1図は本考案の一実施例を示す略示回路図、
第2図は夫々メモリセルを示す回路図、第3図は
従来例を示す略示回路図である。 10,101,102,103,104……メ
モリセル、20,20′……データ線、21……
ワード線、30……第1のMOSFET、31…
…第2のMOSFET、32……第3のMOSF
ET、33……第4のMOSFET、40……カ
ラム線。
第2図は夫々メモリセルを示す回路図、第3図は
従来例を示す略示回路図である。 10,101,102,103,104……メ
モリセル、20,20′……データ線、21……
ワード線、30……第1のMOSFET、31…
…第2のMOSFET、32……第3のMOSF
ET、33……第4のMOSFET、40……カ
ラム線。
Claims (1)
- メモリセルが結合される一対のデータ線と、該
データ線と交叉するワード線とを備えた半導体メ
モリ装置に於いて、メモリセルの一方の出力点を
直列に接続した第1および第2のMOSFETを
介して一方のデータ線に結合し、且つメモリセル
の他方の出力点を直列に接続した第3および第4
のMOSFETを介して結合すると共に、前記第
1および第3のMOSFETのゲートを前記ワー
ド線に接続し、前記第2および第4のゲートをデ
ータ線とは別に設けられたメモリセル選択用カラ
ム線に接続してなる半導体メモリ装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16035686U JPS6365199U (ja) | 1986-10-20 | 1986-10-20 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16035686U JPS6365199U (ja) | 1986-10-20 | 1986-10-20 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6365199U true JPS6365199U (ja) | 1988-04-28 |
Family
ID=31085662
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16035686U Pending JPS6365199U (ja) | 1986-10-20 | 1986-10-20 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6365199U (ja) |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5434726A (en) * | 1977-08-24 | 1979-03-14 | Hitachi Ltd | Mis-type semiconductor memory unit |
JPS56107388A (en) * | 1980-01-08 | 1981-08-26 | Harari Eliyahou | Individually addessible ram |
JPS61104494A (ja) * | 1984-10-24 | 1986-05-22 | Nec Corp | スタテイツク型半導体記憶素子及びスタテイツク型半導体記憶回路 |
-
1986
- 1986-10-20 JP JP16035686U patent/JPS6365199U/ja active Pending
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5434726A (en) * | 1977-08-24 | 1979-03-14 | Hitachi Ltd | Mis-type semiconductor memory unit |
JPS56107388A (en) * | 1980-01-08 | 1981-08-26 | Harari Eliyahou | Individually addessible ram |
JPS61104494A (ja) * | 1984-10-24 | 1986-05-22 | Nec Corp | スタテイツク型半導体記憶素子及びスタテイツク型半導体記憶回路 |
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