JPS635239Y2 - - Google Patents

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JPS635239Y2
JPS635239Y2 JP1982018360U JP1836082U JPS635239Y2 JP S635239 Y2 JPS635239 Y2 JP S635239Y2 JP 1982018360 U JP1982018360 U JP 1982018360U JP 1836082 U JP1836082 U JP 1836082U JP S635239 Y2 JPS635239 Y2 JP S635239Y2
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JP
Japan
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lead piece
semiconductor chip
lead
resin
present
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JP1982018360U
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JPS58122457U (ja
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item

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  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)

Description

【考案の詳細な説明】 本考案は1又は複数個の半導体チツプを組込ん
だ樹脂封止型の半導体装置の構造に関するもので
ある。半導体装置のパツケージングの種類として
は金属容器、樹脂モールド、セラミツク容器につ
き数多くの構造が提案されている。しかし、いづ
れも容器からリード線が外部に飛び出した構造が
一般的であり、機器内への自動実装取扱上におい
て困難性があつた。即ち、テープキヤリアの使
用、機械治具の工夫など実装上の問題解決の為、
種々の努力を必要とした。又抵抗、コンデンサな
どの部品とも形状統一がとりにくい構造であり、
取扱上に欠点があつた。本考案は前記の問題点を
解決し、磁器への実装、その他の取扱を容易と
し、且つ、放熱効果にすぐれ、小型化を達成する
樹脂封止型の半導体装置を提供する。以下、本考
案を実施例により詳述する。
第1図a,bは本考案をトランジスタに実施し
た構造斜視図及び側面図である。1は樹脂部、2
は半導体チツプ固着部、3はコネクタ接続部4は
半導体チツプ、5はコネクタ線、E,B,Cはリ
ード片で、E及びBはコネクタ接続部3を有する
リード片、Cは半導体チツプ固着部2を有するリ
ード片である。半導体チツプ固着部2及びコネク
タ接続部3はリード片E,B,C夫々折曲げて凹
部を形成している。リード片Cの半導体チツプ固
着部2に半導体チツプ4を固着し、又、リード片
E,B,Cを並列配置して、コネクタ線5により
半導体チツプ4及びコネクタ接続部門を電気接続
する。更に樹脂部1により、相隣るリード片間を
一体に結合すると共に半導体チツプ固着部2及び
コネクタ接続部3を含んで封止し全体の形状をほ
ぼ直方体とする。この直方体は各辺に夫々リード
片の一部が露出し夫々水平面を形成しているが該
リード片の露出部は直方体の上面、下面又は左右
側面等少くとも2辺部に露出せしめればよい。又
直方体について「ほぼ等しく」と述べたが、半導
体装置の取扱上、不都合のない程度の寸法上の差
異は本考案の効果を何らそこなうものではなく、
従つて本考案の範囲に含まれるものである。
次いで、本考案半導体装置の製造工程図を第2
図a〜dにより例示する。第2図aはトランジス
タのリード片E,B,Cを形成するリードフレー
ムの1区分をしめす。製造時はA方向に複数区分
連らなつている。第2図bのように1区分のリー
ドフレームにプレスなどで折り曲げて凹部を形成
し、2は半導体チツプ固着部、3はコネクタ接続
部とする。第2図cのごとく半導体チツプ4を2
に固着し、コネクタ線5により4及び3間を夫々
電気接続する。次いで、第2図dのように樹脂モ
ールドし樹脂部1を形成する。その後リードフレ
ームの不要部分を切断、分離して第1図のごとき
完成装置を得る。第1図及び第2図はトランジス
タをしめし、Eはエミツタ、Bはベース、Cはコ
レクタのリード片として適用される。本考案をダ
イオードに用いるときはリード片は2本でよい。
複数チツプや集積回路の構成にも適している。又
コネクタ線5はワイヤーに限らず板状コネクタを
用いてもよい。
本考案は放熱特性に優れ、小型で組立容易な半
導体装置を得ることができ、又、組立工程後の捺
印、測定などの工程は勿論、機器への実装、プリ
ント基板への装着において、リード片が上面及び
下面に露出し夫々同一電極を形成しているため、
該リード片の長さ方向への回転によつては極性が
変化せず、取扱いが容易となり又、配線インダク
タンスが少く高周波特性に優れ更に樹脂部はリー
ド片の一面及び他面に跨つて形成されているため
に該樹脂部の保持が強固でありこのため耐落下等
のシヨツクに強い等の利点がある。以上のごと
く、トランジスタ、ダイオード、サイリスタ、複
合素子、集積回路などの半導体装置として、特に
高密度実装用として効果が大きい。
【図面の簡単な説明】
第1図a,bは本考案半導体装置の構造斜視図
及び側面図第2図a〜dは本考案半導体装置の製
造工程図である。 1は樹脂部、2は半導体チツプ固着部、3はコ
ネクタ接続部、4は半導体チツプ、5はコネクタ
線、E,B,Cはリード片をしめす。

Claims (1)

    【実用新案登録請求の範囲】
  1. 半導体チツプ固着部を有するリード片及びコネ
    クタ接続部を有するリード片と該リード片の夫々
    一面及び他面を含んで封止する樹脂部とでほぼ直
    方体を形成すると共に、該直方体の上面及び下面
    に該リード片の一部を露出せしめて夫々同一電極
    となし、且つ該露出面が樹脂部と平面を形成する
    ようにしたことを特徴とする半導体装置。
JP1836082U 1982-02-12 1982-02-12 半導体装置 Granted JPS58122457U (ja)

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JP1836082U JPS58122457U (ja) 1982-02-12 1982-02-12 半導体装置

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JP1836082U JPS58122457U (ja) 1982-02-12 1982-02-12 半導体装置

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Publication Number Publication Date
JPS58122457U JPS58122457U (ja) 1983-08-20
JPS635239Y2 true JPS635239Y2 (ja) 1988-02-12

Family

ID=30030615

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JP1836082U Granted JPS58122457U (ja) 1982-02-12 1982-02-12 半導体装置

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Families Citing this family (2)

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JP2532821B2 (ja) * 1994-07-11 1996-09-11 松下電子工業株式会社 半導体装置
KR100735325B1 (ko) * 2006-04-17 2007-07-04 삼성전기주식회사 발광다이오드 패키지 및 그 제조방법

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5414659B2 (ja) * 1974-12-04 1979-06-08
JPS5572065A (en) * 1978-11-25 1980-05-30 Mitsubishi Electric Corp Plastic-molded type semiconductor device

Family Cites Families (1)

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Publication number Priority date Publication date Assignee Title
JPS6116702Y2 (ja) * 1977-07-01 1986-05-22

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JPS58122457U (ja) 1983-08-20

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