JPS6337395A - 電子楽器 - Google Patents
電子楽器Info
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- JPS6337395A JPS6337395A JP61181116A JP18111686A JPS6337395A JP S6337395 A JPS6337395 A JP S6337395A JP 61181116 A JP61181116 A JP 61181116A JP 18111686 A JP18111686 A JP 18111686A JP S6337395 A JPS6337395 A JP S6337395A
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- 238000000034 method Methods 0.000 description 6
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- 238000012545 processing Methods 0.000 description 3
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- 230000007704 transition Effects 0.000 description 1
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- Electrophonic Musical Instruments (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、楽音設定情報、演奏情報、動作パラメータ設
定情報等を所定の形式の通信信号によって相互に通信す
ることが可能な電子楽器に関するものである。
定情報等を所定の形式の通信信号によって相互に通信す
ることが可能な電子楽器に関するものである。
従来、複数の電子楽器の間で楽音設定情報、′ＯＸ奏情
報、動作パラメータ設定情報等を交換するために、種々
の情報通信方式が考案されてきた０例えばＭＩＤＩ （
Ｍｒｂｓｔａａｌ Ｉｓａｔｒｕｍｔｔｎｔａ Ｄｉｇ
ｉｔａｌ Ｉｎｔａｒ−ｆａｃｇ ）と呼ばれる通信形
式におい【は、シリアル信号として上記の種々の情報を
転送するものであるが、単一方向の通信信号であシ、か
つ情報転送速度が遅いなどの欠点があった。また、一般
に音源モジュールと呼ばれるような、制御信号を受信し
て楽音信号を発生するような電子楽器においては、パラ
レル信号として直接に高速の制御情報を受信することも
可能であるが、単一方向信号であるため、逆に音源モジ
ュールの内部状態情報を制御機器に返送するのＬ困難で
あった。また、ＧＰ−ＩＢ （Ｇｔｔｎｅｒａｌ Ｐｕ
ｒｐｏｓｅ Ｉｎｔａｒｆａｃｅ Ｂｕｓ ）と呼ばれ
る双方向パラレル信号の通信形式のような方式を用いる
電子楽器においては、パラレル信号線以外のハンドシェ
ーク制御信号線が多数必要であ夛、全体としては信号線
が多くなる欠点があった。
報、動作パラメータ設定情報等を交換するために、種々
の情報通信方式が考案されてきた０例えばＭＩＤＩ （
Ｍｒｂｓｔａａｌ Ｉｓａｔｒｕｍｔｔｎｔａ Ｄｉｇ
ｉｔａｌ Ｉｎｔａｒ−ｆａｃｇ ）と呼ばれる通信形
式におい【は、シリアル信号として上記の種々の情報を
転送するものであるが、単一方向の通信信号であシ、か
つ情報転送速度が遅いなどの欠点があった。また、一般
に音源モジュールと呼ばれるような、制御信号を受信し
て楽音信号を発生するような電子楽器においては、パラ
レル信号として直接に高速の制御情報を受信することも
可能であるが、単一方向信号であるため、逆に音源モジ
ュールの内部状態情報を制御機器に返送するのＬ困難で
あった。また、ＧＰ−ＩＢ （Ｇｔｔｎｅｒａｌ Ｐｕ
ｒｐｏｓｅ Ｉｎｔａｒｆａｃｅ Ｂｕｓ ）と呼ばれ
る双方向パラレル信号の通信形式のような方式を用いる
電子楽器においては、パラレル信号線以外のハンドシェ
ーク制御信号線が多数必要であ夛、全体としては信号線
が多くなる欠点があった。
本発明者は簡単な構成の制（ａ１信号線を用い特別な制
御信号がきた時のみ反対方向への返送をインターフェー
ス回路で行なわせ、上記の問題点を解決することを考え
た。
御信号がきた時のみ反対方向への返送をインターフェー
ス回路で行なわせ、上記の問題点を解決することを考え
た。
本発明の目的は、簡単な構成の制御信号線上を双方向に
楽音関連情報を通信することが可能な電子楽器を提供す
ることにある。
楽音関連情報を通信することが可能な電子楽器を提供す
ることにある。
前記目的を達成するため、本発明におい【は、外部から
の制御信号線に接続されるインターフェース回路と、楽
音信号を発生する音源回路と、音源回路の楽音発生およ
び演奏情報を制御する音源制御回路とによって構成され
、前記インターフェース回路が通常の動作においては制
御信号線によって与えられる制御信号に応じ【音源回路
よυ楽音を発生するとともに、制御１６号線によって与
えられる特別の制御信号に対しては、この制御信号線を
介して前記音源制御回路の動作情報を返送できるように
したものである。
の制御信号線に接続されるインターフェース回路と、楽
音信号を発生する音源回路と、音源回路の楽音発生およ
び演奏情報を制御する音源制御回路とによって構成され
、前記インターフェース回路が通常の動作においては制
御信号線によって与えられる制御信号に応じ【音源回路
よυ楽音を発生するとともに、制御１６号線によって与
えられる特別の制御信号に対しては、この制御信号線を
介して前記音源制御回路の動作情報を返送できるように
したものである。
通常の動作では、制［＋信号線を通し制御信号を与えら
れて楽音発生しているとともに、たとえば「オール１」
の制御信号がきた時は返送要求・ｉＫ号であり、同じ制
御信号線を通して動作情報が返送され、その間は４１号
が競合しないようにタイミングがとられる。これにより
双方向の情報通信が可能となる。
れて楽音発生しているとともに、たとえば「オール１」
の制御信号がきた時は返送要求・ｉＫ号であり、同じ制
御信号線を通して動作情報が返送され、その間は４１号
が競合しないようにタイミングがとられる。これにより
双方向の情報通信が可能となる。
以下、本発明の実施例を図面を参照し詳細に説明する。
第１図は、本発明による電子楽器の実施例の概略説明図
であり、１はインターフェース回路、２は音源制御回路
、３は音源回路、４．改サウンドシステム、５は制御信
号線、６は鍵盤である。
であり、１はインターフェース回路、２は音源制御回路
、３は音源回路、４．改サウンドシステム、５は制御信
号線、６は鍵盤である。
すなわち第１図において、外部からの制御信号線５によ
る演奏情報信号または音源制御情報は所定の通信形式に
よってインターフェース回路１を介して音源制御回路２
に供給される。音源制御回路２においては必要に応じて
鍵盤６の情報をも取シ込んで、所定の動作として必要な
楽音情報を音源回路３に供給する。音源回路３によって
発生された楽音信号は、ライン出力、ヘッドフオン出力
。
る演奏情報信号または音源制御情報は所定の通信形式に
よってインターフェース回路１を介して音源制御回路２
に供給される。音源制御回路２においては必要に応じて
鍵盤６の情報をも取シ込んで、所定の動作として必要な
楽音情報を音源回路３に供給する。音源回路３によって
発生された楽音信号は、ライン出力、ヘッドフオン出力
。
あるいはアンプ、スピーカー等を含むサウンドシステム
４によって音響に変換される。
４によって音響に変換される。
第２図は、第１図におけろ、本発明の要部であるインタ
ーフェース回路１のへ体的構成例である。
ーフェース回路１のへ体的構成例である。
すなわち第２図の例においては、第１図の制御信号線５
としては４ビツトのパラレル信号を、Ｐｌ。
としては４ビツトのパラレル信号を、Ｐｌ。
Ｐ２．Ｐ５．Ｐ４の４本として説明する。
なお、このピット数とし【は４ビツトに限るものではな
く、音源制御回路にＣＰＵを使用するような場合には、
そのＣＰＵのビット数や情報の必要度等によって任意に
設定できるのは明らかでちる。
く、音源制御回路にＣＰＵを使用するような場合には、
そのＣＰＵのビット数や情報の必要度等によって任意に
設定できるのは明らかでちる。
第２図の例の場合、４つのビットのそれぞれに同等の回
路が設定されているので、例えばビット１のゲート１５
１と、ビット２のゲート１３１との働きは同等であるの
で、以下の説明では添え字の数字が１のものを用いて説
明する。各ビットに対して設けられている回路としては
、制御（ＩＮ４＋Ｐ１を正論理゛電圧にプルアップする
ためのプルアップ抵抗１１１、制御信号Ｐ１を入力して
全ビット共通のコントロール信号Ｔαによって内部デー
タバスＤ１に接続するためのスリースチートゲ−）１３
１、内部データバスＤ１に乗った信号Ｄ″Ｉｋ全ビット
共通の２ツテパルスＴｂによってラッチするだめのラツ
子回路１４１．７ツチ回路１４１によって保持されてい
る信号Ｑを制御信号Ｐ１に出力するだめのオープンコレ
クタゲート（またはオープンドレインゲートでも同様）
１２１、とがちり、データバスＤＩ。
路が設定されているので、例えばビット１のゲート１５
１と、ビット２のゲート１３１との働きは同等であるの
で、以下の説明では添え字の数字が１のものを用いて説
明する。各ビットに対して設けられている回路としては
、制御（ＩＮ４＋Ｐ１を正論理゛電圧にプルアップする
ためのプルアップ抵抗１１１、制御信号Ｐ１を入力して
全ビット共通のコントロール信号Ｔαによって内部デー
タバスＤ１に接続するためのスリースチートゲ−）１３
１、内部データバスＤ１に乗った信号Ｄ″Ｉｋ全ビット
共通の２ツテパルスＴｂによってラッチするだめのラツ
子回路１４１．７ツチ回路１４１によって保持されてい
る信号Ｑを制御信号Ｐ１に出力するだめのオープンコレ
クタゲート（またはオープンドレインゲートでも同様）
１２１、とがちり、データバスＤＩ。
Ｄ２．Ｄ３．Ｄ４としては例えば音源制御回路に使用し
ているＣＰＵのデータバスへ接続し、全ピットに共通の
Ｔａ、Ｔｂの２本の制御信号は例えば音源制御回路２に
使用しているＣＰＨの出力ポートの一部として供給する
。
ているＣＰＵのデータバスへ接続し、全ピットに共通の
Ｔａ、Ｔｂの２本の制御信号は例えば音源制御回路２に
使用しているＣＰＨの出力ポートの一部として供給する
。
第３図は、第２図に示す、本発明の要部であるインター
フェース回路１の動作説明図でちる。すなわち、第３図
のＰ １１ Ｐ２１ ＰＳＩ Ｐ４１Ｔｈ、Ｔａはそれ
ぞれ第２図の同名の信号の動作例となっており、２値を
とるディジタル状態として＜Ｈ＞、＜Ｌ＞とじて説明す
ることにする。ここでまず、本発明にかかる電子楽器の
通信形態としては、初期状態とし【データバスＤ１〜Ｄ
４に論理＜Ｈ＞を与えるとともに全ラッチ１４１〜１４
４に共通のラッチパルスＴ６をタイミングｔ１４のよう
に与える。その結果ラッチ１４１〜１４４の出力として
は論理＜Ｈ＞がオープンコレクタゲート１２１〜１２４
から出力され、制御信号ｌＰ１〜Ｐ４はタイミングｔｘ
ｏ””ｉｔｓのようにレベル＜Ｈ＞と設定される。なお
、一般にオープンコレクタゲート単体は通常のバイポー
ラ素子がワイヤードオア形式で接続されるゲートで６４
）、出力状態が負論＠を示すインバータであるが、ここ
では簡単のために、論理＜Ｈ＞からレベル＜Ｈ＞が出力
されているものとしているので、実際にはもう一段イン
パータが挿入されたもの、として考えればよいことにな
る。このような初期状態を設定すると、制御信号線の状
態としてはプルアンプ抵抗（Ｒ１） １１．〜（Ｒ４）
１１４によってレベル＜Ｈ＞にプルアップされ【いるの
みで、外部からこの電子楽器を制御する機器の出力も同
様のオープンコレクタ回路になっていれば、外部機器の
出力レベルがそのままこの制御信号線の状態として設定
されることになル、出力ポート同志の衝突状態は発生し
ない。これ以降、音源制御回路２は任意の間隔で全ビッ
ト共通のスリーステートゲート１３１〜１５４コントロ
ール用信号Ｔαによって、タイミングｔ１９＃ｔ２ｏ、
ら、・・・のようにＰ１〜Ｐ４の状態を入力し、変化が
あれば対応した処理を実行する。ここでの例では、タイ
ミングｔｔｓのＴｏによって、ＰＩＦ２Ｐ！１Ｐ４＝＜
ＬＨＬＨ＞ という状態がスリーステートゲート１３１〜１′５４
を経由してデータバスＤ１〜Ｄ４に取り込まれ、音源制
御回路２ではこの＜ＬＨＬＨ＞と定義されたコマンドに
対応した音源制御処理を実行する。さらに続いてタイミ
ング１．のＴｏによって、Ｐ１Ｐ２Ｐ５Ｐ４＝＜ＬＨＬ
Ｈ＞ という状態がスリーステートゲート１６！〜１３４を経
由してデータバスＤ１〜Ｄ４に取シ込まれるが、これは
前回のタイミング２１９ の状態と同一であるため、何
も実行せずにさらに次に進む。このように音源制御回路
２がコントロール信号Ｔ８によって制御信号線Ｐ１〜Ｐ
４を監視する間隔としては、データの取シこぼしのない
ように一定の時間以内の間隔である必要がある。さらに
続けてこの例を追うと、外部からの制御信号はタイミン
グｈｔ〜ｔ２４の時点で変化しておシ、この状態はタイ
ミング１゜のＴｏによって、 ＰＩＰ２Ｐ３Ｐ４冨（：ＨＩ、ＬＨ＞ という状態がスリーステートゲート１３１〜１３４ヲ経
由し【データバスＤ１〜Ｄ４に取シ込まれ、さらに次の
状態変化もタイミングｔｓｏのＴａによって、ＰＩＦ２
Ｐ３Ｐ４＝＜ＬＨＬＬ＞ という状態がスリーステートゲート１６１〜１３４ を
経由してデータバスＤ１〜Ｄ４に取〕込まれる。
フェース回路１の動作説明図でちる。すなわち、第３図
のＰ １１ Ｐ２１ ＰＳＩ Ｐ４１Ｔｈ、Ｔａはそれ
ぞれ第２図の同名の信号の動作例となっており、２値を
とるディジタル状態として＜Ｈ＞、＜Ｌ＞とじて説明す
ることにする。ここでまず、本発明にかかる電子楽器の
通信形態としては、初期状態とし【データバスＤ１〜Ｄ
４に論理＜Ｈ＞を与えるとともに全ラッチ１４１〜１４
４に共通のラッチパルスＴ６をタイミングｔ１４のよう
に与える。その結果ラッチ１４１〜１４４の出力として
は論理＜Ｈ＞がオープンコレクタゲート１２１〜１２４
から出力され、制御信号ｌＰ１〜Ｐ４はタイミングｔｘ
ｏ””ｉｔｓのようにレベル＜Ｈ＞と設定される。なお
、一般にオープンコレクタゲート単体は通常のバイポー
ラ素子がワイヤードオア形式で接続されるゲートで６４
）、出力状態が負論＠を示すインバータであるが、ここ
では簡単のために、論理＜Ｈ＞からレベル＜Ｈ＞が出力
されているものとしているので、実際にはもう一段イン
パータが挿入されたもの、として考えればよいことにな
る。このような初期状態を設定すると、制御信号線の状
態としてはプルアンプ抵抗（Ｒ１） １１．〜（Ｒ４）
１１４によってレベル＜Ｈ＞にプルアップされ【いるの
みで、外部からこの電子楽器を制御する機器の出力も同
様のオープンコレクタ回路になっていれば、外部機器の
出力レベルがそのままこの制御信号線の状態として設定
されることになル、出力ポート同志の衝突状態は発生し
ない。これ以降、音源制御回路２は任意の間隔で全ビッ
ト共通のスリーステートゲート１３１〜１５４コントロ
ール用信号Ｔαによって、タイミングｔ１９＃ｔ２ｏ、
ら、・・・のようにＰ１〜Ｐ４の状態を入力し、変化が
あれば対応した処理を実行する。ここでの例では、タイ
ミングｔｔｓのＴｏによって、ＰＩＦ２Ｐ！１Ｐ４＝＜
ＬＨＬＨ＞ という状態がスリーステートゲート１３１〜１′５４
を経由してデータバスＤ１〜Ｄ４に取り込まれ、音源制
御回路２ではこの＜ＬＨＬＨ＞と定義されたコマンドに
対応した音源制御処理を実行する。さらに続いてタイミ
ング１．のＴｏによって、Ｐ１Ｐ２Ｐ５Ｐ４＝＜ＬＨＬ
Ｈ＞ という状態がスリーステートゲート１６！〜１３４を経
由してデータバスＤ１〜Ｄ４に取シ込まれるが、これは
前回のタイミング２１９ の状態と同一であるため、何
も実行せずにさらに次に進む。このように音源制御回路
２がコントロール信号Ｔ８によって制御信号線Ｐ１〜Ｐ
４を監視する間隔としては、データの取シこぼしのない
ように一定の時間以内の間隔である必要がある。さらに
続けてこの例を追うと、外部からの制御信号はタイミン
グｈｔ〜ｔ２４の時点で変化しておシ、この状態はタイ
ミング１゜のＴｏによって、 ＰＩＰ２Ｐ３Ｐ４冨（：ＨＩ、ＬＨ＞ という状態がスリーステートゲート１３１〜１３４ヲ経
由し【データバスＤ１〜Ｄ４に取シ込まれ、さらに次の
状態変化もタイミングｔｓｏのＴａによって、ＰＩＦ２
Ｐ３Ｐ４＝＜ＬＨＬＬ＞ という状態がスリーステートゲート１６１〜１３４ を
経由してデータバスＤ１〜Ｄ４に取〕込まれる。
このようにして外部からの制御信号を時々監視しながら
、音源回路６の動作制御を実行し、さらには鍵盤状態の
監視、自動演奏などの処理を実行するのであるが、これ
はＣＰＵのソフトウェアによって容易に実現できるもの
である。ここでの例では、次のタイミングｔｓｓのＴａ
によって、ＰＩＰ２Ｐ３Ｐ４＝＜ＨＨＨＨ＞ という状態がスリーステートゲート１６！〜１６４ヲ経
由してデータバスＤ１〜Ｄ４に取シ込まれる。
、音源回路６の動作制御を実行し、さらには鍵盤状態の
監視、自動演奏などの処理を実行するのであるが、これ
はＣＰＵのソフトウェアによって容易に実現できるもの
である。ここでの例では、次のタイミングｔｓｓのＴａ
によって、ＰＩＰ２Ｐ３Ｐ４＝＜ＨＨＨＨ＞ という状態がスリーステートゲート１６！〜１６４ヲ経
由してデータバスＤ１〜Ｄ４に取シ込まれる。
この信号はここでは特殊な意味をもつものであって、音
源制御回路２の動作が変わる。すなわち、コマンド＜Ｈ
ＨＨＨ＞は「所定の情報を返送せよ」、という意味を持
つものである。この時、外部からこの電子楽器を制御し
ている機器の出力ポートとし【は、この電子楽器と同様
のオープンコレクタ出力がレベル（Ｈ＞になっているの
でアシ、この電子楽器の出力ポートがレベルくＬ〉、す
なわち電流を吸い込む状態になっても信号の衝突とはな
らず、同じ制御１６号ＭＰ１〜Ｐ４をこの電子楽器と同
様の入力ポートによって入力監視していれば、情報の返
送を受信することが可能となる。ここで音源制御回路２
はデータバスＤ１〜Ｄ４に返送情報信号を与えるととも
に全ラッチ１４１〜１４４に共通のラッチパルスＴ６を
タイミングｔｓａのように与える。その結果ラッチ１４
１〜１４４の出力がオープンコレクタゲート１２１〜１
２４から出力され、制御信号線Ｐ１〜Ｐ４はタイミング
ｔｓｔ〜ｔ４０のように、Ｐ１Ｐ２Ｐ５Ｐ４＝＜ＬＬＨ
Ｌ＞ という状態として返送される。外部からこの電子楽器を
制御している機器の方では返送要求コマンド＜ＨＨＨＨ
＞を送信するとともに、この制御信号線Ｐ１〜Ｐ４の状
態が変化するのを入力監視しているので、この電子楽器
の方では返送情報信号を出力してから一定の時間をおい
て、再び通常の入力状態に移行する。ここでは初期状態
の設定の時と同様に、データバスＤ１〜Ｄ４に論理＜Ｈ
＞を与えるとともに全ラッチ１４１〜１４４に共通の２
ソチパルスＴｂをタイミングｔ４１のように与える。
源制御回路２の動作が変わる。すなわち、コマンド＜Ｈ
ＨＨＨ＞は「所定の情報を返送せよ」、という意味を持
つものである。この時、外部からこの電子楽器を制御し
ている機器の出力ポートとし【は、この電子楽器と同様
のオープンコレクタ出力がレベル（Ｈ＞になっているの
でアシ、この電子楽器の出力ポートがレベルくＬ〉、す
なわち電流を吸い込む状態になっても信号の衝突とはな
らず、同じ制御１６号ＭＰ１〜Ｐ４をこの電子楽器と同
様の入力ポートによって入力監視していれば、情報の返
送を受信することが可能となる。ここで音源制御回路２
はデータバスＤ１〜Ｄ４に返送情報信号を与えるととも
に全ラッチ１４１〜１４４に共通のラッチパルスＴ６を
タイミングｔｓａのように与える。その結果ラッチ１４
１〜１４４の出力がオープンコレクタゲート１２１〜１
２４から出力され、制御信号線Ｐ１〜Ｐ４はタイミング
ｔｓｔ〜ｔ４０のように、Ｐ１Ｐ２Ｐ５Ｐ４＝＜ＬＬＨ
Ｌ＞ という状態として返送される。外部からこの電子楽器を
制御している機器の方では返送要求コマンド＜ＨＨＨＨ
＞を送信するとともに、この制御信号線Ｐ１〜Ｐ４の状
態が変化するのを入力監視しているので、この電子楽器
の方では返送情報信号を出力してから一定の時間をおい
て、再び通常の入力状態に移行する。ここでは初期状態
の設定の時と同様に、データバスＤ１〜Ｄ４に論理＜Ｈ
＞を与えるとともに全ラッチ１４１〜１４４に共通の２
ソチパルスＴｂをタイミングｔ４１のように与える。
その結果ラッチ１４１〜１４４の出力としては論理くＨ
〉がオープンコレクタゲート１２１〜１２４から出力さ
れ、制御信号線Ｐ１〜Ｐ４はタイミングｔ４！〜１４５
のようにレベル＜Ｈ＞と設定される。以降は前述と同様
の動作となる。
〉がオープンコレクタゲート１２１〜１２４から出力さ
れ、制御信号線Ｐ１〜Ｐ４はタイミングｔ４！〜１４５
のようにレベル＜Ｈ＞と設定される。以降は前述と同様
の動作となる。
第２図および第３図に示すような動作によれば、制御信
号線としては任意のビット数のパラレル通信として、シ
リアル方式に比べて非常に高速の情報転送が可能であ夛
、また情報の双方向通信であルなから余分な信号線を必
要とせず、簡単な構成によって高度の動作制御が可能と
なる。、また、さらに１本のステータス監視信号線を別
に設ければ、情報の変更のある時に限って割夛込み方式
で情報を転送できるので、さらに通信効率が向上する。
号線としては任意のビット数のパラレル通信として、シ
リアル方式に比べて非常に高速の情報転送が可能であ夛
、また情報の双方向通信であルなから余分な信号線を必
要とせず、簡単な構成によって高度の動作制御が可能と
なる。、また、さらに１本のステータス監視信号線を別
に設ければ、情報の変更のある時に限って割夛込み方式
で情報を転送できるので、さらに通信効率が向上する。
なお、ここでの例では４ビツトの制御信号線によって高
々１６種類の情報しか転送できないように一見思われが
ちであるが、以下の例のようにコマンド体系を定義すれ
ば、はるかに多くの情報を転送でさる。例えば、 コマンド データブロック数 ＜ＬＬＬＬ＞ ２ ＜ＬＬＬＨ＞ １ ＜ＬＬＨＬ＞ ３ というような定ａを設定している場合、コマンド＜ＬＬ
ＬＬ＞を受信した場合は、それに続くもう１ブロツク（
ここでは４ピット）と合わせて、計８ピットの情報とし
て動作制御に反映される。またコマンド＜ｔ、ＬＬｌｉ
＞を受信すると、その時点でこの情報は兄結しているの
で１即時に処理に移行するため、早い反応の必要な処理
はこのような形式に定義する。さらにあまシ速度の重要
でない情報は、コマンド＜ＬＬＨＬ＞に続く２ブロツク
と合わせた計１２ビットとして転送する。受信する音源
制御回路の側では、個々のコマンドに対応した所定のブ
ロック数を受信するまではそのコマンドのグループであ
る、と解釈することで、例えば上記の例で＜ＬＬＬＬ＞
の次に入力した＜ＨＨＨＨ＞は「情報返送要求」とは解
釈せず、データ（ＬＬＬＬ＋ＨＨＨＨ＞として動作する
ようにすればよい。このような方式をとることによって
、ビット数が少ない制御信号線を用いても多種の動作制
御が可能となる。
々１６種類の情報しか転送できないように一見思われが
ちであるが、以下の例のようにコマンド体系を定義すれ
ば、はるかに多くの情報を転送でさる。例えば、 コマンド データブロック数 ＜ＬＬＬＬ＞ ２ ＜ＬＬＬＨ＞ １ ＜ＬＬＨＬ＞ ３ というような定ａを設定している場合、コマンド＜ＬＬ
ＬＬ＞を受信した場合は、それに続くもう１ブロツク（
ここでは４ピット）と合わせて、計８ピットの情報とし
て動作制御に反映される。またコマンド＜ｔ、ＬＬｌｉ
＞を受信すると、その時点でこの情報は兄結しているの
で１即時に処理に移行するため、早い反応の必要な処理
はこのような形式に定義する。さらにあまシ速度の重要
でない情報は、コマンド＜ＬＬＨＬ＞に続く２ブロツク
と合わせた計１２ビットとして転送する。受信する音源
制御回路の側では、個々のコマンドに対応した所定のブ
ロック数を受信するまではそのコマンドのグループであ
る、と解釈することで、例えば上記の例で＜ＬＬＬＬ＞
の次に入力した＜ＨＨＨＨ＞は「情報返送要求」とは解
釈せず、データ（ＬＬＬＬ＋ＨＨＨＨ＞として動作する
ようにすればよい。このような方式をとることによって
、ビット数が少ない制御信号線を用いても多種の動作制
御が可能となる。
上記実施例では出力ポートにバイボー２素子をワイヤー
ドオア形式で用いるオープンコレクタゲートを用いたが
、バイポーラ素子の代りに電界効果素子等管用いたオー
プンドレインゲートの場合も同様に適用できる。
ドオア形式で用いるオープンコレクタゲートを用いたが
、バイポーラ素子の代りに電界効果素子等管用いたオー
プンドレインゲートの場合も同様に適用できる。
以上説明したように、本発明にかかる電子楽器によれば
、簡単な構成の制御信号線を通して制御信号が受信され
楽音発生する通常動作の外、特別な制御１ご号がきた時
は返送要求信号とし【音源制御回路より所定の動作情報
が返送される。これにより簡単な制御（１１号線で双方
向の楽音関連情報の転送が可能となシ、良質な楽音を実
現するのに役立つところが大きい。
、簡単な構成の制御信号線を通して制御信号が受信され
楽音発生する通常動作の外、特別な制御１ご号がきた時
は返送要求信号とし【音源制御回路より所定の動作情報
が返送される。これにより簡単な制御（１１号線で双方
向の楽音関連情報の転送が可能となシ、良質な楽音を実
現するのに役立つところが大きい。
第１図は本発明の実施例の概略説明図、第２図は実施例
の要部の構成説明図、第５図は実施例の要部の動作説明
図であシ、図中、１はインターフェース回路、２は音源
制御回路、３は音源回路、４はサウンドシステム、５は
制御信号線、６は鍵盤、１１１〜１１４はプルアップ抵
抗、１２１〜１２４はオープンコレクタゲート、１３１
〜１３４はスリーステートゲート、１４１〜１４４はラ
ッチ回路、Ｐ１〜Ｐ４は入力制御信号、Ｄ１〜Ｄ４はデ
ータバス、Ｔａはゲートコントロール信号、Ｔａはラッ
チパルスを示す。 特許出願人 株式会社河合楽器製作所 代理人 弁理士 １）坂 善 重 実施例の要部の構成説明図 第 ２ 図
の要部の構成説明図、第５図は実施例の要部の動作説明
図であシ、図中、１はインターフェース回路、２は音源
制御回路、３は音源回路、４はサウンドシステム、５は
制御信号線、６は鍵盤、１１１〜１１４はプルアップ抵
抗、１２１〜１２４はオープンコレクタゲート、１３１
〜１３４はスリーステートゲート、１４１〜１４４はラ
ッチ回路、Ｐ１〜Ｐ４は入力制御信号、Ｄ１〜Ｄ４はデ
ータバス、Ｔａはゲートコントロール信号、Ｔａはラッ
チパルスを示す。 特許出願人 株式会社河合楽器製作所 代理人 弁理士 １）坂 善 重 実施例の要部の構成説明図 第 ２ 図
Claims (2)
- （１）外部からの制御信号線に接続されたインターフェ
ース回路と、楽音信号を発生する音源回路と、音源回路
の楽音発生および演奏情報を制御する音源制御回路とを
具備し、 前記インターフェース回路が、通常の動作においては前
記制御信号線によつて与えられる制御信号に応じて音源
回路より楽音を発生するとともに、前記制御信号線によ
つて与えられる特別の制御信号に対しては、前記制御信
号線を介して前記音源制御回路の動作情報を返送できる
ようにしたことを特徴とする電子楽器。 - （２）前記インターフェース回路の前記制御信号線には
、この信号を受信する入力ポートと、出力状態が負論理
となるワイアードオア形式の出力ポートと、この信号線
が無入力状態の時には所定の正論理状態に設定する回路
とが接続され、 前記動作情報の返送要求信号としては前記制御信号線の
全てを所定の正論理状態に設定するような信号形式とす
ることにより、 前記制御信号線上での信号の競合状態を回避できるよう
にしたことを特徴とする、特許請求の範囲第１項記載の
電子楽器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61181116A JPS6337395A (ja) | 1986-07-31 | 1986-07-31 | 電子楽器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61181116A JPS6337395A (ja) | 1986-07-31 | 1986-07-31 | 電子楽器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6337395A true JPS6337395A (ja) | 1988-02-18 |
| JPH0560877B2 JPH0560877B2 (ja) | 1993-09-03 |
Family
ID=16095127
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61181116A Granted JPS6337395A (ja) | 1986-07-31 | 1986-07-31 | 電子楽器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6337395A (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4991486A (en) * | 1987-12-30 | 1991-02-12 | Yamaha Corporation | Electronic musical instrument having a rhythm performance function |
| US5276270A (en) * | 1991-11-13 | 1994-01-04 | Kabushiki Kaisha Kawai Gakki Seisakusho | Solenoid drive system for an automatic performing apparatus |
| US5321199A (en) * | 1991-06-26 | 1994-06-14 | Kabushiki Kaisha Kawai Gakki Seisakusho | Method and device for preventing imbalance of sound emissions in an automatic performing piano |
| US5324883A (en) * | 1991-06-26 | 1994-06-28 | Kabushiki Kaisha Kawai Gakki Seisakusho | Method and device for preventing imbalance of sound emissions in an automatic performing piano |
| JPH06222769A (ja) * | 1993-06-25 | 1994-08-12 | Casio Comput Co Ltd | 電子打楽器 |
| US5420934A (en) * | 1992-03-26 | 1995-05-30 | Kabushiki Kaisha Kawai Gakki Seisakusho | Electronic sound processing system |
| US5535224A (en) * | 1991-12-09 | 1996-07-09 | Kabushiki Kaisha Kawai Gakki Seisakusho | Automatic performing system capable of detection and correction of errors in performance information |
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| Publication number | Priority date | Publication date | Assignee | Title |
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| JPS59204889A (ja) * | 1983-05-10 | 1984-11-20 | カシオ計算機株式会社 | 電子楽器 |
| JPS6094692U (ja) * | 1983-12-02 | 1985-06-27 | ロ−ランド株式会社 | 電子楽器制御装置 |
-
1986
- 1986-07-31 JP JP61181116A patent/JPS6337395A/ja active Granted
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Also Published As
| Publication number | Publication date |
|---|---|
| JPH0560877B2 (ja) | 1993-09-03 |
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