JPS6333717B2 - - Google Patents
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- Publication number
- JPS6333717B2 JPS6333717B2 JP55168605A JP16860580A JPS6333717B2 JP S6333717 B2 JPS6333717 B2 JP S6333717B2 JP 55168605 A JP55168605 A JP 55168605A JP 16860580 A JP16860580 A JP 16860580A JP S6333717 B2 JPS6333717 B2 JP S6333717B2
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- Japan
- Prior art keywords
- liquid crystal
- crystal display
- data
- driver
- output
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- Expired
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- 239000004973 liquid crystal related substance Substances 0.000 claims description 33
- 230000003068 static effect Effects 0.000 claims description 7
- 238000000034 method Methods 0.000 description 5
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
Description
【発明の詳細な説明】
本発明は液晶表示器を１チツプCPUで駆動す
る液晶表示装置に関する。
る液晶表示装置に関する。
１チツプCPU（中央処理装置）を利用してスタ
テイツク型液晶表示器LCDを駆動する場合、従
来はラツチ付きデコーダLCDドライバを設けて
駆動するか、あるいはCPU内でソフト的に信号
をコントロールしてCPUから直接LCDを駆動す
る２通りの方法が用いられている。しかしながら
後者の方法では、CPUの入出力端子数がかなり
不足し、前者の方法であつても１チツプCPUの
端子数は種々の理由で制限されることから、使用
するLCDの種類によつてなおCPUの入出力端子
数が不足するといつた問題がある。
テイツク型液晶表示器LCDを駆動する場合、従
来はラツチ付きデコーダLCDドライバを設けて
駆動するか、あるいはCPU内でソフト的に信号
をコントロールしてCPUから直接LCDを駆動す
る２通りの方法が用いられている。しかしながら
後者の方法では、CPUの入出力端子数がかなり
不足し、前者の方法であつても１チツプCPUの
端子数は種々の理由で制限されることから、使用
するLCDの種類によつてなおCPUの入出力端子
数が不足するといつた問題がある。
本発明は上記の事情に鑑みてなされたもので、
液晶表示器の応答速度が遅い事を利用し、１チツ
プCPUから時分割で出力されるドライバ用デー
タを液晶駆動回路に入力してラツチし、この駆動
回路の出力および上記CPUから時分割で出力さ
れる直接駆動用データにより液晶表示器を駆動す
る回路構成とすることによつて、１チツプCPU
の入出力端子数が不足することなく所望の液晶表
示を可能とし得る液晶表示装置を提供することを
目的とする。
液晶表示器の応答速度が遅い事を利用し、１チツ
プCPUから時分割で出力されるドライバ用デー
タを液晶駆動回路に入力してラツチし、この駆動
回路の出力および上記CPUから時分割で出力さ
れる直接駆動用データにより液晶表示器を駆動す
る回路構成とすることによつて、１チツプCPU
の入出力端子数が不足することなく所望の液晶表
示を可能とし得る液晶表示装置を提供することを
目的とする。
以下、図面を参照して本発明の一実施例を詳細
に説明する。第１図は本発明の液晶表示装置を示
しており、１１は１チツプCPUで、この１チツ
プCPU１１には割込信号ａを受けて割込タイミ
ングを検出し、スタテイツク液晶表示器用の所定
周波数のコモン信号ｂをポートＩ／OP0から出力
する手段、および上記コモン信号ｂの各周期内で
ドライバー用データd1と液晶表示器を直接駆動す
るための直接駆動用データd2を順次時分割で発生
し、これらのデータd1，d2をそれぞれ共通のポー
トＩ／OP1〜Ｉ／OPnから出力する手段とを備え
ている。１２は上記コモン信号ｂを受けてラツチ
ストローブ信号ｃを出力するモノステーブルマル
チバイブレータ（モノマルチ）、１３はこのモノ
マルチ１２からのラツチストローブ信号ｃによつ
て上記ドライバー用データd1をラツチするラツチ
回路、１４はこのラツチ回路１３によりラツチさ
れたデータd1をデコードするデコーダ、１５はこ
のデコーダ１４からのデコード出力が導かれ、前
記コモン信号ｂの位相に応じた論理レベルに設定
して出力する例えば排他的論理和回路で構成され
るドライバである。これらラツチ回路１３、デコ
ーダ１４、ドライバ１５はラツチ付きデコーダド
ライバ１６1を構成し、このデコーダドライバ１
６1は液晶表示桁の桁数に応じて任意の数ｎ個設
けられている。１７はこのドライバ１６1からの
出力データおよび前記１チツプCPU１１からの
直接駆動用データd2が互いに異なる表示入力端子
に導かれ、前記コモン信号ｂがコモン端子
（COM）に導かれ、所定のデータを液晶表示する
スタテイツク液晶表示器である。
に説明する。第１図は本発明の液晶表示装置を示
しており、１１は１チツプCPUで、この１チツ
プCPU１１には割込信号ａを受けて割込タイミ
ングを検出し、スタテイツク液晶表示器用の所定
周波数のコモン信号ｂをポートＩ／OP0から出力
する手段、および上記コモン信号ｂの各周期内で
ドライバー用データd1と液晶表示器を直接駆動す
るための直接駆動用データd2を順次時分割で発生
し、これらのデータd1，d2をそれぞれ共通のポー
トＩ／OP1〜Ｉ／OPnから出力する手段とを備え
ている。１２は上記コモン信号ｂを受けてラツチ
ストローブ信号ｃを出力するモノステーブルマル
チバイブレータ（モノマルチ）、１３はこのモノ
マルチ１２からのラツチストローブ信号ｃによつ
て上記ドライバー用データd1をラツチするラツチ
回路、１４はこのラツチ回路１３によりラツチさ
れたデータd1をデコードするデコーダ、１５はこ
のデコーダ１４からのデコード出力が導かれ、前
記コモン信号ｂの位相に応じた論理レベルに設定
して出力する例えば排他的論理和回路で構成され
るドライバである。これらラツチ回路１３、デコ
ーダ１４、ドライバ１５はラツチ付きデコーダド
ライバ１６1を構成し、このデコーダドライバ１
６1は液晶表示桁の桁数に応じて任意の数ｎ個設
けられている。１７はこのドライバ１６1からの
出力データおよび前記１チツプCPU１１からの
直接駆動用データd2が互いに異なる表示入力端子
に導かれ、前記コモン信号ｂがコモン端子
（COM）に導かれ、所定のデータを液晶表示する
スタテイツク液晶表示器である。
次に、上記のように構成された液晶表示装置の
動作を第２図のタイムチヤートを参照して説明す
る。上記スタテイツク液晶表示器１７を駆動する
場合、コモン端子（COM）には通常30〜60Hzの
矩形波が用いられている。本実施例では60Hzを使
用しているが、この矩形波のコモン信号を得るた
めにCPU１１の割り込み機能を利用している。
すなわち、第２図ａに示すように割込信号ａとし
ては、コモン信号ｂのｎ倍（本実施例では２倍の
120Hz）の速度の周波数の矩形波をCPU１１に入
力する。CPU１１はこの割込信号ａを受けて割
込みタイミング処理を実行し、割込みルーチンに
入るとポートＩ／OP0から割込信号ａの1/2の周
波数のパルスであるコモン信号ｂを第２図ｂに示
すように出力する。一方、CPU１１は割込み処
理ルーチンに入ると、第２図ｄに示すような表示
器１７を駆動するためのデータ、すなわちドライ
バ用データd1と前記コモン信号ｂに対して逆論理
レベルの直接駆動用データd2とを時分割で共通ポ
ートＩ／OP1から出力する。また、前記モノマル
チ１２はコモン信号ｂを受けてその信号の立下り
で動作し、第４図ｃに示すような所定パルス幅の
ラツチストローブ信号ｃを出力する。ラツチ回路
１３は、このラツチストローブ信号ｃによつて
CPU１１から送出されてくるドライバ用データ
d1をラツチする。このラツチ回路１３でラツチさ
れたデータd1はデコーダ１４にてデコードされ、
ドライバ１５に送出される。したがつてドライバ
１５は、このデコーダ１４の出力を上記コモン信
号ｂの論理レベルとは逆の論理レベルに設定して
出力する。すなわち、このドライバ１５はドライ
バ用データd1を液晶点灯時にはコモン信号ｂとは
逆相に、液晶消灯時にはコモン信号ｂと同相にし
て出力する。したがつて液晶表示器１７は、コモ
ン信号ｂおよびドライバ１６1出力データ、直接
駆動データが共通電極とセグメント電極に印加さ
れ、所定の液晶表示を行なう。
動作を第２図のタイムチヤートを参照して説明す
る。上記スタテイツク液晶表示器１７を駆動する
場合、コモン端子（COM）には通常30〜60Hzの
矩形波が用いられている。本実施例では60Hzを使
用しているが、この矩形波のコモン信号を得るた
めにCPU１１の割り込み機能を利用している。
すなわち、第２図ａに示すように割込信号ａとし
ては、コモン信号ｂのｎ倍（本実施例では２倍の
120Hz）の速度の周波数の矩形波をCPU１１に入
力する。CPU１１はこの割込信号ａを受けて割
込みタイミング処理を実行し、割込みルーチンに
入るとポートＩ／OP0から割込信号ａの1/2の周
波数のパルスであるコモン信号ｂを第２図ｂに示
すように出力する。一方、CPU１１は割込み処
理ルーチンに入ると、第２図ｄに示すような表示
器１７を駆動するためのデータ、すなわちドライ
バ用データd1と前記コモン信号ｂに対して逆論理
レベルの直接駆動用データd2とを時分割で共通ポ
ートＩ／OP1から出力する。また、前記モノマル
チ１２はコモン信号ｂを受けてその信号の立下り
で動作し、第４図ｃに示すような所定パルス幅の
ラツチストローブ信号ｃを出力する。ラツチ回路
１３は、このラツチストローブ信号ｃによつて
CPU１１から送出されてくるドライバ用データ
d1をラツチする。このラツチ回路１３でラツチさ
れたデータd1はデコーダ１４にてデコードされ、
ドライバ１５に送出される。したがつてドライバ
１５は、このデコーダ１４の出力を上記コモン信
号ｂの論理レベルとは逆の論理レベルに設定して
出力する。すなわち、このドライバ１５はドライ
バ用データd1を液晶点灯時にはコモン信号ｂとは
逆相に、液晶消灯時にはコモン信号ｂと同相にし
て出力する。したがつて液晶表示器１７は、コモ
ン信号ｂおよびドライバ１６1出力データ、直接
駆動データが共通電極とセグメント電極に印加さ
れ、所定の液晶表示を行なう。
なお、ドライバ用データd1が出力されている期
間は、液晶表示器１７の応答速度以内に納まるよ
うに処理設定する必要がある。例えば、データ信
号がコモン信号に対して100μsecの遅れあるいは
進みがある時、表示ににじみ等が生じる様な表示
器の時には、CPU１１の処理速度（サイクルタ
イム）が10μsecであれば、10ステツプ（100μsec）
以内に時間設定しなければならない。また上記実
施例では、前の割込み処理終了後、次の割込み処
理を実行する時点では、ドライバ用データd1の変
更は出来ない。従つて、例えば本実施例では、コ
モン信号ｂの周波数を60Hzとしているので約15ｍ
secの間にデータ変更を行なうような場合には利
用できないことになる。しかしながら、表示する
データがそれほど早く変化しない表示用データに
利用すれば、本装置は十分に適用できるものであ
る。
間は、液晶表示器１７の応答速度以内に納まるよ
うに処理設定する必要がある。例えば、データ信
号がコモン信号に対して100μsecの遅れあるいは
進みがある時、表示ににじみ等が生じる様な表示
器の時には、CPU１１の処理速度（サイクルタ
イム）が10μsecであれば、10ステツプ（100μsec）
以内に時間設定しなければならない。また上記実
施例では、前の割込み処理終了後、次の割込み処
理を実行する時点では、ドライバ用データd1の変
更は出来ない。従つて、例えば本実施例では、コ
モン信号ｂの周波数を60Hzとしているので約15ｍ
secの間にデータ変更を行なうような場合には利
用できないことになる。しかしながら、表示する
データがそれほど早く変化しない表示用データに
利用すれば、本装置は十分に適用できるものであ
る。
上記液晶表示装置によれば、ドライバ用データ
と直接駆動用データとの両データを用いて液晶駆
動するようにしているので、使用する１チツプ
CPUの入出力端子数が少なくて済み、CPUの入
出力端子数が不足するといつた従来の問題点を解
消することができる。即ち第１図のＩ／OP1の１
種の端子をつかつて、直接駆動用（d2）とデコー
ダドライバ用（d1）の２種の表示が行なえるもの
である。
と直接駆動用データとの両データを用いて液晶駆
動するようにしているので、使用する１チツプ
CPUの入出力端子数が少なくて済み、CPUの入
出力端子数が不足するといつた従来の問題点を解
消することができる。即ち第１図のＩ／OP1の１
種の端子をつかつて、直接駆動用（d2）とデコー
ダドライバ用（d1）の２種の表示が行なえるもの
である。
以上説明したように本発明によれば、液晶表示
器の応答速度が遅い事を利用し、１チツプCPU
から時分割で出力されるドライバ用データを液晶
駆動回路に入力してラツチし、この駆動回路の出
力および上記CPUから時分割で出力される直接
駆動用データにより液晶表示器を駆動する回路構
成とすることによつて、１チツプCPUの入出力
端子数が不足することなく、所望の液晶表示を可
能とし得る液晶表示装置が提供できる。
器の応答速度が遅い事を利用し、１チツプCPU
から時分割で出力されるドライバ用データを液晶
駆動回路に入力してラツチし、この駆動回路の出
力および上記CPUから時分割で出力される直接
駆動用データにより液晶表示器を駆動する回路構
成とすることによつて、１チツプCPUの入出力
端子数が不足することなく、所望の液晶表示を可
能とし得る液晶表示装置が提供できる。
第１図は本発明の一実施例に係る液晶表示装置
の回路構成図、第２図は第１図の回路動作を説明
するためのタイムチヤートである。 １１……１チツプCPU、１２……モノマルチ、
１３……ラツチ回路、１４……デコーダ、１５…
…ドライバ、１６1〜１６ｎ……デコーダドライ
バ、１７……液晶表示器、ａ……割込み信号、ｂ
……コモン信号、ｃ……ラツチストローブ信号、
d1……ドライバ用データ、d2……直接駆動用デー
タ、Ｉ／OP0，Ｉ／OP1〜Ｉ／OPn……ポート。
の回路構成図、第２図は第１図の回路動作を説明
するためのタイムチヤートである。 １１……１チツプCPU、１２……モノマルチ、
１３……ラツチ回路、１４……デコーダ、１５…
…ドライバ、１６1〜１６ｎ……デコーダドライ
バ、１７……液晶表示器、ａ……割込み信号、ｂ
……コモン信号、ｃ……ラツチストローブ信号、
d1……ドライバ用データ、d2……直接駆動用デー
タ、Ｉ／OP0，Ｉ／OP1〜Ｉ／OPn……ポート。
Claims (1)
- １ １チツプCPUに備えられ、割込タイミング
を検知しスタテイツク液晶表示器用の所定周波数
のコモン信号を１個のポートから出力する手段お
よび上記コモン信号の各周期内でデコーダドライ
バ用データと液晶表示器直接駆動用データを順に
時分割で発生しそれぞれ共通のポートから出力す
る手段と、前記コモン信号出力を受けてラツチス
トローブ信号を発生する手段と、前記デコーダド
ライバに設けられデコーダドライバ用データ入力
を上記ラツチストローブ信号によりラツチする手
段およびこの手段によりラツチされたデータをデ
コードする手段およびこの手段から導かれるデコ
ード出力を前記コモン信号の論理レベルに応じて
所定論理レベルに設定して出力するドライバと、
このドライバの出力データおよび前記１チツプ
CPUからの直接駆動用データが互いに異なる表
示入力端子に導かれ前記コモン信号がコモン端子
に導かれるスタテイツク液晶表示器とを具備する
ことを特微とする液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16860580A JPS5792390A (en) | 1980-11-29 | 1980-11-29 | Liquid crystal display |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16860580A JPS5792390A (en) | 1980-11-29 | 1980-11-29 | Liquid crystal display |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5792390A JPS5792390A (en) | 1982-06-08 |
| JPS6333717B2 true JPS6333717B2 (ja) | 1988-07-06 |
Family
ID=15871151
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16860580A Granted JPS5792390A (en) | 1980-11-29 | 1980-11-29 | Liquid crystal display |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5792390A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01180415U (ja) * | 1988-06-08 | 1989-12-26 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5189348A (ja) * | 1975-02-04 | 1976-08-05 |
-
1980
- 1980-11-29 JP JP16860580A patent/JPS5792390A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5189348A (ja) * | 1975-02-04 | 1976-08-05 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01180415U (ja) * | 1988-06-08 | 1989-12-26 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5792390A (en) | 1982-06-08 |
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