JPS6326948B2 - - Google Patents

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JPS6326948B2
JPS6326948B2 JP56052313A JP5231381A JPS6326948B2 JP S6326948 B2 JPS6326948 B2 JP S6326948B2 JP 56052313 A JP56052313 A JP 56052313A JP 5231381 A JP5231381 A JP 5231381A JP S6326948 B2 JPS6326948 B2 JP S6326948B2
Authority
JP
Japan
Prior art keywords
signal
video signal
clamp
virs
video
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP56052313A
Other languages
English (en)
Other versions
JPS56161780A (en
Inventor
Jeimuzu Joogensen Deibitsudo
Ansonii Marin Rojaa
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Tektronix Inc
Original Assignee
Tektronix Inc
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Filing date
Publication date
Application filed by Tektronix Inc filed Critical Tektronix Inc
Publication of JPS56161780A publication Critical patent/JPS56161780A/ja
Publication of JPS6326948B2 publication Critical patent/JPS6326948B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00Details of television systems
    • H04N5/14Picture signal circuitry for video frequency region
    • H04N5/16Circuitry for reinsertion of dc and slowly varying components of signal; Circuitry for preservation of black or white level

Landscapes

  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Picture Signal Circuits (AREA)
  • Studio Circuits (AREA)
  • Testing, Inspecting, Measuring Of Stereoscopic Televisions And Televisions (AREA)
  • Television Systems (AREA)

Description

【発明の詳細な説明】 本発明はクランプ装置、特に映像増幅回路にお
ける残留クランプ誤差を補償する回路に関する。
本発明は垂直帰線期間基準信号(以下VIRS)を
映像信号の特定ライン中に挿入する場合に特に有
用であるが、勿論これに限定するものではない。
最新のテレビジヨン(以下TVという)放送規
格によると、映像利得、同期振幅、バースト振
幅、色/輝度信号利得比、セツトアツプレベル及
びバースト位相等は所定規格内に納めなければな
らないこととなつている。何年か前まではTV放
送局のアイドリング期間中にテストパターンを伝
送して確認していたが、これでは上述の要求を満
足するには不十分であることが判つた。そこで、
TV放送局及び回線は通常のTV映像信号と共に
上述したVIRSを伝送し始めた。このVIRSはそ
のチヤンネルが現に稼動中に伝送されるのであ
る。
伝統的にVIRSを使用してチヤンネルの伝送特
性を評価し、例えばあるチヤンネルが所定の品質
基準に合致するか否かを決定していた。よつて、
あるネットワークのプログラムを電話線で送り、
且つ電話会社が所定値以下の歪とすることを約束
すると、このVIRSはこの要件を満足しているか
否かの指標を与えてくれる。伝送チヤンネルの受
信端において不所望の歪が発見された場合には、
その端で歪補正の為の所定の調整をする。
VIRS又はその他の適当な信号をプログラム映
像信号中に挿入するときは、両信号のブランキン
グレベルが完全に一致することが好ましい。これ
を行う為に、従来はプログラム映像信号をVIRS
のブランキング基準電圧と等しい基準電圧にクラ
ンプしていた。しかし、従来のクランプ回路は、
プログラム映像信号中に度々現われる低周波歪の
すべてを完全に除去できないことが判つた。この
歪はTV管面上にしま又は線として現われる。
従つて、本発明の主目的は、挿入する映像信号
をプログラム映像信号に完全にマツチングさせる
クランプ装置を提供することである。
本発明の他の目的は、挿入した映像信号に残留
クランプノイズを加える挿入映像信号のプログラ
ム映像信号へのマツチング手段を提供することで
ある。
本発明のクランプ装置によると、挿入される信
号のブランキングレベルはプログラム映像信号の
ブランキングレベルに完全にマツチングされる。
ここではVIRS挿入装置の一例につき説明してい
る。このブランキングレベルのマツチングはプロ
グラムチヤンネルにおける低速クランプの残留ク
ランプ誤差をサンプリングして、それを挿入され
るチヤンネルに加算(尚、ここで加算とは減算も
含む)することにより行つている。
本発明は構成、動作方法及びその他の目的並び
に作用効果につき、同様素子には類似参照符号を
附す添付図を参照して行う以下の説明により充分
に理解できよう。
添付図、特に本発明の簡略ブロツク図を示す第
1図を参照する。以下の説明では、VIRS挿入装
置につき説明するが、本発明は何ら斯る実施例に
限定するものではなく、前述した通り任意の2映
像信号のブランキングレベルのマツチングに使用
し得るものである。
プログラム映像信号20を先ずクランプ回路1
00に供給する。プログラム映像信号20は典型
的には任意の合成カラー映像信号である。クラン
プ回路100は慣用のクランプ回路であつてもよ
いが、業界で一般に低速クランプと呼ばれている
型式のものが最も効果的であることが判つた。こ
のクランプの詳細については後述することとす
る。VIRS30を増幅器40の反転入力端に供給
する。VIRS30は第3図に示し、図示せずも慣
用のVIRS発生器により発生する。このような
VIRS発生器は当業者に周知であるので、ここで
は詳細説明を省略する。
クランプ回路100はプログラム映像信号のブ
ランキングレベルを予定の基準レベル例えば
VIRS30のブランキングレベルである接地レベ
ルにクランプすべく動作する。このクランプ回路
100はクランプした映像信号60を出力すると
共に、この出力信号のブランキングレベルと基準
レベルとの差であるクランプの残留誤差50もサ
ンプリングして出力する。この誤差電圧50は、
増幅器40の非反転入力端に入力してVIRS30
と加算される。この増幅器40の出力信号は補償
済VIRS70である。このVIRS70はスイツチ
75に加えて、VIRS70とクランプしたプログ
ラム映像信号60間の切換えを行う。このスイツ
チ75は電子スイツチであるのが好ましく、通常
はクランプしたプログラム映像信号60を出力端
子80に伝達するが、TV信号の垂直帰線期間中
の所望ライン(例えば19番目)には、図示せずも
挿入ロジツク回路からの制御信号65によりスイ
ツチ75をVIRS70側へ接続して、このVIRS
出力信号70を出力端子80へ伝達する。
次に第2図につき説明する。同図は本発明によ
るクランプ装置の詳細回路図である。プログラム
映像信号20を第1図より詳細に示すクランプ回
路100に供給する。上述の通り、クランプ回路
100は低速クランプ回路であつて、当業者には
周知である。低速クランプ回路は、例えばクラン
プ回路100のように帰還路を使用しており、
K.R.ウエンド及びW.K.スカイヤによる1954年3
月22乃至25日のIRE会議レコードパート7第79〜
84頁「フイードバツクを用いる改良テレビジヨン
クランプ回路」に開示されている。この帰還型ク
ランプ回路を使用するのが好適であるが、任意の
低速クランプを使用し得る。この好適実施例に使
用のクランプ回路は、増幅器110,120及び
130及びサンプルホールド回路S/H200を
使用する。プログラム映像信号20は先ず反転増
幅器である増幅器110に供給し、この反転した
プログラム映像信号のブランキングレベルをS/
H200によりサンプリングする。
S/H200はサンプリングゲート140と記
憶素子145を有する。これら素子はいずれも当
業者に周知のものであるを可とする。図示しない
クランプパルス発生器は反転したプログラム映像
信号のバツクポーチ期間中にクランプパルス95
を発生して、ゲート140を閉じる。この実施例
ではコンデンサである記憶素子145はサンプル
相互間即ちゲート140が開いている期間中この
基準点を記憶する。このサンプリングされた誤差
信号は、増幅器130及び120により増幅及び
積分して増幅器110の入力側に戻し、そこでプ
ログラム映像信号20と加算される。次に、この
クランプ回路100の動作を説明する。このクラ
ンプ回路はプログラム映像信号のブランキングレ
ベルの例えば接地レベルである基準レベルとの誤
差をサンプリングゲート140でサンプリングす
る。この誤差を増幅器130,120で増幅積分
して増幅器110の入力端のDCレベルを制御し
て、増幅器90の非反転入力端子に印加されるプ
ログラム映像信号出力60のブランキングレベル
が上記基準レベルとなるように補正する。勿論、
映像入力信号がノイズ等により急激に変化した場
合には、このクランプ回路は迅速に応答し得ない
ので、記憶素子145の両端にはクランプ誤差電
圧50が現れる。この補正手法により、S/Hの
時定数は短く、帰還ループの時定数は誤差信号の
積分が行えるようにする。よつて、ノイズの多い
プログラム映像信号であつても良好な動作が可能
であり、円滑且つ緩かな補正ができる。
クランプされたプログラム映像信号60を差動
増幅器90の非反転入力端に印加し、その出力を
スイツチ75の入力端の一方に加える。S/H2
00の出力信号を差動増幅器40の非反転入力端
に印加する。プログラム映像信号に挿入したい
VIRS30又はその他任意の信号を差動増幅器4
0の反転入力に印加する。このVIRS30は上述
したVIRS発生器等から得る。この増幅器40の
作用は、誤差信号50をVIRSのブランキングレ
ベルに加算することである。そこで、クランプし
たプログラム映像信号60及び増幅器40からの
補償済VIRS70は共に正確にマツチングしたブ
ランキングレベルを有し、普通プログラム映像信
号60のDCレベルに加算されるノイズはVIRS
に加算されることとなる。挿入した映像信号に挿
入されたノイズはTV管面には見えない。更に、
挿入した映像信号は、ノイズを平均化する慣用の
映像補正器に使用してもよい。
上述した通り、スイツチ75は電子スイツチで
あるのが好ましく、クランプしたプログラム映像
信号60を、TV信号の所望垂直帰線期間中に補
償済VIRS70が挿入される期間を除き出力端子
80へ伝達する。このスイツチ75は図示せずも
挿入ロジツク回路からの制御信号65により制御
される。
上述の説明から明らかなように、本明細書では
特定回路構成、タイミング等の詳細は省略した
が、これらについては当業者には容易に理解でき
るものと考える。それらの詳細につき必要あれ
ば、本願出願人の刊行物であるG.A.イーストマ
ン著「テレビジヨン波形処理回路」(1968年)
及び「垂直帰線期間基準信号」(1973年)を参
照されたい。
以上は本発明の好適実施例に基づきクランプ装
置を説明したが、必要に応じて本発明の要旨を逸
脱することなく各種変更変形がなし得ること当業
者に明白である。よつて、本発明の技術的範囲に
は当然これら変更変形をも包含するものと解すべ
きである。
本発明のクランプ装置によるとブランキングレ
ベルが変化するプログラム映像入力信号(第1映
像入力信号)に予め定めた一定ブランキングレベ
ルを有するVIRSの如き他の映像信号(第2映像
入力信号)を挿入する際に、最終的に得られる第
1映像及び第2映像の合成(挿入)出力信号のブ
ランキングレベルは、仮えプログラム映像入力信
号に急激な変化があつても円滑且つマツチングし
て変化するので、TV管面上に目障りなしま等が
現れることはない。また、回路構成も簡単である
ので、TV放送機器に容易に実施できる。
【図面の簡単な説明】
第1図は本発明の好適実施例の簡略ブロツク
図、第2図は本発明のクランプ装置の一実施例の
詳細回路図、第3図はVIRSのパラメータをIRE
単位でプロツトした図である。 20は第1映像入力信号、30は第2映像入力
信号、40は加算手段、50は誤差信号、60は
第1映像出力信号、70は第2映像出力信号、7
5はスイツチ手段、100はクランプ手段であ
る。

Claims (1)

    【特許請求の範囲】
  1. 1 ブランキングレベルの変化する第1映像入力
    信号の特定部分に既知のブランキングレベルを有
    する第2映像入力信号を挿入するに際し、上記第
    1映像入力信号のブランキングレベルを上記第2
    映像入力信号のブランキングレベルに対応するレ
    ベルにクランプするクランプ手段と、該クランプ
    手段でクランプされた第1映像出力信号の上記ブ
    ランキングレベルのクランプ残留誤差を検出して
    上記第2映像入力信号に加算して第2映像出力信
    号を得る加算手段と、上記第1映像出力信号及び
    上記第2映像出力信号を選択的に出力するスイツ
    チ手段とを具え、該スイツチ手段から得られる上
    記第1及び第2映像出力信号のブランキングレベ
    ルをマツチングさせることを特徴とするクランプ
    装置。
JP5231381A 1980-04-14 1981-04-07 Clamping circuit Granted JPS56161780A (en)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
US06/140,379 US4301474A (en) 1980-04-14 1980-04-14 Residual clamp error compensation circuit

Publications (2)

Publication Number Publication Date
JPS56161780A JPS56161780A (en) 1981-12-12
JPS6326948B2 true JPS6326948B2 (ja) 1988-06-01

Family

ID=22490973

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5231381A Granted JPS56161780A (en) 1980-04-14 1981-04-07 Clamping circuit

Country Status (3)

Country Link
US (1) US4301474A (ja)
JP (1) JPS56161780A (ja)
CA (1) CA1168748A (ja)

Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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Publication number Publication date
JPS56161780A (en) 1981-12-12
US4301474A (en) 1981-11-17
CA1168748A (en) 1984-06-05

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