JPS6320623U - - Google Patents

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JPS6320623U
JPS6320623U JP11429686U JP11429686U JPS6320623U JP S6320623 U JPS6320623 U JP S6320623U JP 11429686 U JP11429686 U JP 11429686U JP 11429686 U JP11429686 U JP 11429686U JP S6320623 U JPS6320623 U JP S6320623U
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JP
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flop
flip
counter
width modulation
pulse width
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JP11429686U
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Description

【図面の簡単な説明】
第1図はこの考案の一実施例によるパルス幅変
調回路のブロツク図、第2図はこの考案の一実施
例によるパルス幅変調回路の動作を示すタイミン
グ図、第3図は従来の一実施例によるパルス幅変
調回路のブロツク図、第4図は従来の一実施例に
よるパルス幅変調回路の動作を示すタイミング図
である。 図において、6はフリツプフロツプ、8はカウ
ンタ、10は周期パルス発生器、13はラツチ回
路である。なお、図中、同一符号は同一、又は相
当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. フリツプフロツプと、上記フリツプフロツプを
    リセツトするためのカウンタと、上記フリツプフ
    ロツプ及びカウンタをセツトするための周期パル
    ス発生器と、上記カウンタにセツトされるデータ
    を保持するためのラツチ回路とで構成したことを
    特徴とするパルス幅変調回路。
JP11429686U 1986-07-25 1986-07-25 Pending JPS6320623U (ja)

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JP11429686U JPS6320623U (ja) 1986-07-25 1986-07-25

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JP11429686U JPS6320623U (ja) 1986-07-25 1986-07-25

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JPS6320623U true JPS6320623U (ja) 1988-02-10

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JP11429686U Pending JPS6320623U (ja) 1986-07-25 1986-07-25

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