JPS6320623U - - Google Patents
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- Publication number
- JPS6320623U JPS6320623U JP11429686U JP11429686U JPS6320623U JP S6320623 U JPS6320623 U JP S6320623U JP 11429686 U JP11429686 U JP 11429686U JP 11429686 U JP11429686 U JP 11429686U JP S6320623 U JPS6320623 U JP S6320623U
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- JP
- Japan
- Prior art keywords
- flop
- flip
- counter
- width modulation
- pulse width
- Prior art date
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- Pending
Links
- 230000000737 periodic effect Effects 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 2
Description
第１図はこの考案の一実施例によるパルス幅変
調回路のブロツク図、第２図はこの考案の一実施
例によるパルス幅変調回路の動作を示すタイミン
グ図、第３図は従来の一実施例によるパルス幅変
調回路のブロツク図、第４図は従来の一実施例に
よるパルス幅変調回路の動作を示すタイミング図
である。 図において、６はフリツプフロツプ、８はカウ
ンタ、１０は周期パルス発生器、１３はラツチ回
路である。なお、図中、同一符号は同一、又は相
当部分を示す。
調回路のブロツク図、第２図はこの考案の一実施
例によるパルス幅変調回路の動作を示すタイミン
グ図、第３図は従来の一実施例によるパルス幅変
調回路のブロツク図、第４図は従来の一実施例に
よるパルス幅変調回路の動作を示すタイミング図
である。 図において、６はフリツプフロツプ、８はカウ
ンタ、１０は周期パルス発生器、１３はラツチ回
路である。なお、図中、同一符号は同一、又は相
当部分を示す。
Claims (1)
- フリツプフロツプと、上記フリツプフロツプを
リセツトするためのカウンタと、上記フリツプフ
ロツプ及びカウンタをセツトするための周期パル
ス発生器と、上記カウンタにセツトされるデータ
を保持するためのラツチ回路とで構成したことを
特徴とするパルス幅変調回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11429686U JPS6320623U (ja) | 1986-07-25 | 1986-07-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11429686U JPS6320623U (ja) | 1986-07-25 | 1986-07-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6320623U true JPS6320623U (ja) | 1988-02-10 |
Family
ID=30996905
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11429686U Pending JPS6320623U (ja) | 1986-07-25 | 1986-07-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6320623U (ja) |
-
1986
- 1986-07-25 JP JP11429686U patent/JPS6320623U/ja active Pending
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