JPS6193031U - - Google Patents
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- Publication number
- JPS6193031U JPS6193031U JP17648584U JP17648584U JPS6193031U JP S6193031 U JPS6193031 U JP S6193031U JP 17648584 U JP17648584 U JP 17648584U JP 17648584 U JP17648584 U JP 17648584U JP S6193031 U JPS6193031 U JP S6193031U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- generation circuit
- signal generation
- flop
- flip
- Prior art date
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- Pending
Links
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 6
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Electronic Switches (AREA)
Description
第1図は本考案におけるタイマー回路の1実施
例を示すブロツク図、第2図は本実施例の各部の
動作を説明するためのタイミングチヤート、第3
図は従来例を示すブロツク図、第4図は従来例の
各部の動作を説明するためのタイミングチヤート
である。 1…カウンター回路、2…基準信号発生回路、
3…ロード信号発生回路、4…プリセツトデータ
発生回路、5…クリア信号発生回路。
例を示すブロツク図、第2図は本実施例の各部の
動作を説明するためのタイミングチヤート、第3
図は従来例を示すブロツク図、第4図は従来例の
各部の動作を説明するためのタイミングチヤート
である。 1…カウンター回路、2…基準信号発生回路、
3…ロード信号発生回路、4…プリセツトデータ
発生回路、5…クリア信号発生回路。
Claims (1)
- カウンター回路とフリツプフロツプと基準信号
発生回路とを備えたタイマー回路において、該基
準信号発生回路からのクロツクをカウントするプ
リセツト可能なカウンター回路と、該カウンター
回路のプリセツト信号を発生するプリセツトデー
タ発生回路と、前記フリツプフロツプをクリアす
るクリア信号発生回路とを設けたことを特徴とす
るタイマー回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17648584U JPS6193031U (ja) | 1984-11-20 | 1984-11-20 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17648584U JPS6193031U (ja) | 1984-11-20 | 1984-11-20 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6193031U true JPS6193031U (ja) | 1986-06-16 |
Family
ID=30734081
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP17648584U Pending JPS6193031U (ja) | 1984-11-20 | 1984-11-20 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6193031U (ja) |
-
1984
- 1984-11-20 JP JP17648584U patent/JPS6193031U/ja active Pending
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