JPS63169719U - - Google Patents

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JPS63169719U
JPS63169719U JP6100387U JP6100387U JPS63169719U JP S63169719 U JPS63169719 U JP S63169719U JP 6100387 U JP6100387 U JP 6100387U JP 6100387 U JP6100387 U JP 6100387U JP S63169719 U JPS63169719 U JP S63169719U
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transistor
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mos transistor
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Description

【図面の簡単な説明】
第１図は本考案のカレントミラー回路の一実施
例の回路図、第２図は第１図のカレントミラー回
路が半導体チツプ内に集積されたＩＣの全体構成
を説明するための図、第３図は本考案の他の実施
例の回路図、第４図は第３図の回路が半導体チツ
プ内に集積されたＩＣの全体構成を説明するため
の図、第５図はカレントミラー回路の従来例の回
路図、第６図は第５図の回路を集積した半導体集
積回路装置におけるトランジスタＱ２のデバイス
構造を示す断面図である。 １，１３……定電流源、９……ＭＯＳロジツク
回路、１０……バイポーラリニア回路、１１，１
７……カレントミラー回路、１２，１８……半導
体チツプ、１４……バイアス電源、１５……低耐
圧ＭＯＳロジツク回路、１６……高耐圧バイポー
ラ回路、Ｉ３……入力電流、Ｉ１，Ｉ２，Ｉ４，
Ｉ５……出力電流、Ｑ７〜Ｑ９……バイポーラト
ランジスタ、Ｍ１〜Ｍ３……ＭＯＳトランジスタ
、Ｖ１，Ｖ２……オン・オフ制御信号、Ｌ２〜Ｌ
５……電源ライン。

Claims (1)

  1. 【実用新案登録請求の範囲】 入力電流に対応したゲート・ソース間電圧を発
    生する第１のＭＯＳトランジスタと、 第１のＭＯＳトランジスタのゲート・ソース間
    電圧でゲート・ソース間がバイアスされ、前記入
    力電流に対応した出力電流を出力する第２のＭＯ
    Ｓトランジスタと第２のＭＯＳトランジスタの出
    力電流経路に設けられ、前記出力電流をオン、オ
    フする制御用バイポーラトランジスタとよりなる
    、少なくとも一つの出力回路を有するカレントミ
    ラー回路。
JP1987061003U 1987-04-21 1987-04-21 Expired - Lifetime JPH0535624Y2 (ja)

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JPS63169719U true JPS63169719U (ja) 1988-11-04
JPH0535624Y2 JPH0535624Y2 (ja) 1993-09-09

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05235662A (ja) * 1992-02-19 1993-09-10 Nec Corp 定電流発生回路
WO2005093702A1 (ja) * 2004-03-29 2005-10-06 Rohm Co., Ltd 有機ｅｌ駆動回路および有機ｅｌ表示装置

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JPS54133061A (en) * 1978-04-07 1979-10-16 Nec Corp Current switch circuit

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JPH0535624Y2 (ja) 1993-09-09

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