JPS63159427U - - Google Patents

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JPS63159427U
JPS63159427U JP5241187U JP5241187U JPS63159427U JP S63159427 U JPS63159427 U JP S63159427U JP 5241187 U JP5241187 U JP 5241187U JP 5241187 U JP5241187 U JP 5241187U JP S63159427 U JPS63159427 U JP S63159427U
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JP
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signal line
line group
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central processing
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JP5241187U
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【図面の簡単な説明】
第1図は本考案の一実施例を示すブロツク図、
第2図はマトリクススイツチを示す回路図、第3
図は他の実施例を示す要部のブロツク図、第4図
は従来例を示すブロツク図である。 1……中央演算処理ユニツト(CPU)、2…
…並列入出力インタフエース(PIO)、3……
データバス、7……出力ポート、8……マトリク
ススイツチ、9……3ステートバツフア、Xi…
…列信号線(第1信号線群)、Yj……行信号線
(第2信号線群)。

Claims (1)

    【実用新案登録請求の範囲】
  1. 中央演算処理ユニツトと、この中央演算処理ユ
    ニツトへデータを入出力する並列入出力インタフ
    エースと、互いに交差する第1信号線群と第2信
    号線群から成り、前記第1信号線群を前記並列入
    出力インタフエースの出力ポートに接続するマト
    リクススイツチと、前記第2信号線群を接続して
    前記マトリクススイツチのオン・オフデータを前
    記中央演算処理ユニツトのデータバスに入力する
    複数の3ステートバツフアとを備えたことを特徴
    とするデータ入力回路。
JP5241187U 1987-04-06 1987-04-06 Pending JPS63159427U (ja)

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JP5241187U JPS63159427U (ja) 1987-04-06 1987-04-06

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JP5241187U JPS63159427U (ja) 1987-04-06 1987-04-06

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JPS63159427U true JPS63159427U (ja) 1988-10-19

Family

ID=30877559

Family Applications (1)

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JP5241187U Pending JPS63159427U (ja) 1987-04-06 1987-04-06

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JP (1) JPS63159427U (ja)

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5366123A (en) * 1976-11-25 1978-06-13 Nec Corp Keyboard
JPS5771038A (en) * 1980-10-22 1982-05-01 Nec Home Electronics Ltd Key switch scanning system
JPS58181139A (ja) * 1982-04-16 1983-10-22 Tokyo Electric Co Ltd 電子式タイプライタのキ−ボ−ド入力制御装置

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5366123A (en) * 1976-11-25 1978-06-13 Nec Corp Keyboard
JPS5771038A (en) * 1980-10-22 1982-05-01 Nec Home Electronics Ltd Key switch scanning system
JPS58181139A (ja) * 1982-04-16 1983-10-22 Tokyo Electric Co Ltd 電子式タイプライタのキ−ボ−ド入力制御装置

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