JPS6313605B2 - - Google Patents
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- Publication number
- JPS6313605B2 JPS6313605B2 JP55178372A JP17837280A JPS6313605B2 JP S6313605 B2 JPS6313605 B2 JP S6313605B2 JP 55178372 A JP55178372 A JP 55178372A JP 17837280 A JP17837280 A JP 17837280A JP S6313605 B2 JPS6313605 B2 JP S6313605B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- signal
- prediction
- differentiator
- weighting
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000013139 quantization Methods 0.000 claims description 14
- 238000005070 sampling Methods 0.000 claims description 12
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 5
- 238000004364 calculation method Methods 0.000 description 10
- 238000010586 diagram Methods 0.000 description 5
- 230000005540 biological transmission Effects 0.000 description 3
- 230000006835 compression Effects 0.000 description 1
- 238000007906 compression Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000005236 sound signal Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M3/00—Conversion of analogue values to or from differential modulation
- H03M3/04—Differential modulation with several bits, e.g. differential pulse code modulation [DPCM]
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Description
【発明の詳細な説明】
本発明は差分パルス符号変調信号発生回路に係
り、画像入力や音声入力などを帯域圧縮符号化し
て伝送するために、差分パルス符号変調信号
（DPCM信号）を発生する回路に関する。
り、画像入力や音声入力などを帯域圧縮符号化し
て伝送するために、差分パルス符号変調信号
（DPCM信号）を発生する回路に関する。
第１図は従来のDPCM信号発生回路の一例の
ブロツク系統図を示す。同図中、１は入力端子
で、テレビジヨン信号や音声信号などのアナログ
信号を所定の標本化周波数で標本化して得た信号
（標本化信号）が入来し、これを差分器２に供給
する。差分器２は後述する重み付け回路６よりの
予測信号と入力標本化信号との差分とり、その差
分信号を量子化回路３へ供給する。量子化回路３
は差分信号をPCM符号化してDPCM信号を出力
する。
ブロツク系統図を示す。同図中、１は入力端子
で、テレビジヨン信号や音声信号などのアナログ
信号を所定の標本化周波数で標本化して得た信号
（標本化信号）が入来し、これを差分器２に供給
する。差分器２は後述する重み付け回路６よりの
予測信号と入力標本化信号との差分とり、その差
分信号を量子化回路３へ供給する。量子化回路３
は差分信号をPCM符号化してDPCM信号を出力
する。
DPCM信号は加算器４に供給され、ここで重
み付け回路６よりの予測信号と加算された後、予
測回路５へ供給される。予測回路５はｎ標本化時
間前の加算器４の出力信号と現時刻の加算器４の
出力信号とより、現時刻より所定標本化時間後に
入来する標本化信号の予測信号を生成し、これを
重み付け回路６を通して差分器２及び加算器４に
夫々供給する。重み付け回路６は予測信号に伝送
路符号誤りに対処するためのリーク係数αを乗ず
る回路で、０＜α＜１である。このようにして、
量子化回路３より取り出されたDPCM信号は出
力端子７より伝送路へ送信される。
み付け回路６よりの予測信号と加算された後、予
測回路５へ供給される。予測回路５はｎ標本化時
間前の加算器４の出力信号と現時刻の加算器４の
出力信号とより、現時刻より所定標本化時間後に
入来する標本化信号の予測信号を生成し、これを
重み付け回路６を通して差分器２及び加算器４に
夫々供給する。重み付け回路６は予測信号に伝送
路符号誤りに対処するためのリーク係数αを乗ず
る回路で、０＜α＜１である。このようにして、
量子化回路３より取り出されたDPCM信号は出
力端子７より伝送路へ送信される。
ここで、上記従来のDPCM信号発生回路は、
予測回路５，重み付け回路６，差分器２，量子化
回路３及び加算器４よりなる閉ループが最長の演
算時間を要するが、この演算時間は１標本化時間
より小でなければならない。しかし、上記従来回
路の演算時間は比較的長く、標本化時間の短縮化
や画像処理回路の高速処理化に制限を与えてい
た。
予測回路５，重み付け回路６，差分器２，量子化
回路３及び加算器４よりなる閉ループが最長の演
算時間を要するが、この演算時間は１標本化時間
より小でなければならない。しかし、上記従来回
路の演算時間は比較的長く、標本化時間の短縮化
や画像処理回路の高速処理化に制限を与えてい
た。
本発明の目的は、予測回路の出力端より差分器
の入力端に至る伝送路に設けられる重み付け回路
を省略することにより、演算時間の短縮化を実現
し得るDPCM信号発生回路を提供するにある。
の入力端に至る伝送路に設けられる重み付け回路
を省略することにより、演算時間の短縮化を実現
し得るDPCM信号発生回路を提供するにある。
本発明はアナログ信号を標本化して得た標本化
信号と、予測回路よりの予測信号の差分を差分器
によりとり、 その差分信号を量子化回路により量子化して差
分パルス符号変調信号を発生する回路において、 上記予測回路の予測出力信号に所定のリーク係
数を乗ずる重み付け回路の入力端と上記差分器の
入力端とを接続して、該予測回路の予測出力信号
を直接該差分器に入力するとともに、 上記標本化信号に該リーク係数の逆数を乗じて
該差分器に入力し、 該重み付け回路の出力信号と該上記差分パルス
符号変調信号とを夫々加算器により加算して該予
測回路に入力するよう構成することにより、前記
従来回路の欠点を除去したものであり、以下第２
図と共にその一実施例につき説明する。
信号と、予測回路よりの予測信号の差分を差分器
によりとり、 その差分信号を量子化回路により量子化して差
分パルス符号変調信号を発生する回路において、 上記予測回路の予測出力信号に所定のリーク係
数を乗ずる重み付け回路の入力端と上記差分器の
入力端とを接続して、該予測回路の予測出力信号
を直接該差分器に入力するとともに、 上記標本化信号に該リーク係数の逆数を乗じて
該差分器に入力し、 該重み付け回路の出力信号と該上記差分パルス
符号変調信号とを夫々加算器により加算して該予
測回路に入力するよう構成することにより、前記
従来回路の欠点を除去したものであり、以下第２
図と共にその一実施例につき説明する。
第２図は本発明になるDPCM信号発生回路の
一実施例のブロツク系統図を示す。本実施例は、
予測回路１３の出力予測信号が重み付け回路１４
を通すことなく直接に差分器１０に供給される点
に特徴を有する。第２図において、入力端子８に
入来した標本化信号は、重み付け回路９に供給さ
れ、ここで、重み付け回路１４のリーク係数αの
逆数である１／αと乗算された後、差分器１０に供 給される。
一実施例のブロツク系統図を示す。本実施例は、
予測回路１３の出力予測信号が重み付け回路１４
を通すことなく直接に差分器１０に供給される点
に特徴を有する。第２図において、入力端子８に
入来した標本化信号は、重み付け回路９に供給さ
れ、ここで、重み付け回路１４のリーク係数αの
逆数である１／αと乗算された後、差分器１０に供 給される。
差分器１０は１／αと乗算された標本化信号から
予測回路１３より予測信号を差し引いて差分信号
を得、この差分信号を量子化回路１１に供給す
る。量子化回路１１はこの差分信号をα倍した信
号のPCM符号化を行なつてDPCM信号を生成し、
これを出力端子１５及び加算器１２へ夫々出力す
る。加算器１２はこのDPCM信号と、重み付け
回路１４により予測回路１３の出力予測信号をα
倍して得た信号とを夫々加算して予測回路１３へ
供給する。この予測回路１３は従来の予測回路５
と同一構成でよい。
を得、この差分信号を量子化回路１１に供給す
る。量子化回路１１はこの差分信号をα倍した信
号のPCM符号化を行なつてDPCM信号を生成し、
これを出力端子１５及び加算器１２へ夫々出力す
る。加算器１２はこのDPCM信号と、重み付け
回路１４により予測回路１３の出力予測信号をα
倍して得た信号とを夫々加算して予測回路１３へ
供給する。この予測回路１３は従来の予測回路５
と同一構成でよい。
ここで、第２図に示す回路は、差分器１０、量
子化回路１１、加算器１２、予測回路１３よりな
る第１の閉ループと、予測回路１３、重み付け回
路１４及び加算器１２よりなる第２の閉ループと
より構成されるが、演算時間は第１の閉ループの
方が長く、よつて第１の閉ループの演算時間が１
標本化時間内でなければならない。
子化回路１１、加算器１２、予測回路１３よりな
る第１の閉ループと、予測回路１３、重み付け回
路１４及び加算器１２よりなる第２の閉ループと
より構成されるが、演算時間は第１の閉ループの
方が長く、よつて第１の閉ループの演算時間が１
標本化時間内でなければならない。
この第１の閉ループの演算時間を、第１図に示
す従来回路のそれと比較すると、重み付け回路１
４が第１の閉ループに存しない分だけ第１の閉ル
ープの演算時間の方が短かくて済む。ここで、量
子化回路１１は差分信号をα倍してそれを量子化
するのに対し、従来の量子化回路３は差分信号を
直接量子化するものであるが、両者はいずれもリ
ード・オンリ・メモリ（ROM）などにより構成
されるものであり、量子化回路１１において予め
差分信号をα倍した差分信号の量子化を行なうよ
うな値を記憶しておけば、量子化回路３と同一の
演算時間で量子化を行なうことができる。
す従来回路のそれと比較すると、重み付け回路１
４が第１の閉ループに存しない分だけ第１の閉ル
ープの演算時間の方が短かくて済む。ここで、量
子化回路１１は差分信号をα倍してそれを量子化
するのに対し、従来の量子化回路３は差分信号を
直接量子化するものであるが、両者はいずれもリ
ード・オンリ・メモリ（ROM）などにより構成
されるものであり、量子化回路１１において予め
差分信号をα倍した差分信号の量子化を行なうよ
うな値を記憶しておけば、量子化回路３と同一の
演算時間で量子化を行なうことができる。
このようにして、本実施例によれば、短かい演
算時間で従来と同様のDPCM信号を発生して出
力端子１５より出力することができる。従つて、
DPCM信号の復号器は第３図に示す如く従来と
同一構成でよく、これを変更する必要はない。す
なわち、第３図において、入力端子１６に入来し
たDPCM信号は加算器１７で重み付け回路１９
により係数αが乗算された予測信号と加算された
後、予測回路１８及び低域フイルタ２０に供給さ
れる。低域フイルタ２０より元のアナログ信号が
出力端子２１より出力される。
算時間で従来と同様のDPCM信号を発生して出
力端子１５より出力することができる。従つて、
DPCM信号の復号器は第３図に示す如く従来と
同一構成でよく、これを変更する必要はない。す
なわち、第３図において、入力端子１６に入来し
たDPCM信号は加算器１７で重み付け回路１９
により係数αが乗算された予測信号と加算された
後、予測回路１８及び低域フイルタ２０に供給さ
れる。低域フイルタ２０より元のアナログ信号が
出力端子２１より出力される。
なお、上記実施例において、重み付け回路９を
設ける代りに入力アナログ信号をレベル減算させ
た後標本化して、重み付け回路９の出力標本化信
号と等価な標本化信号を得るようにしてもよい。
設ける代りに入力アナログ信号をレベル減算させ
た後標本化して、重み付け回路９の出力標本化信
号と等価な標本化信号を得るようにしてもよい。
上述の如く、本発明によれば、予測信号を重み
付け回路を通すことなく直接に差分器に供給する
ようにしたので、予測信号を重み付け回路を通し
て差分器に供給する従来回路に比し、演算時間を
短縮することができ、従つて従来に比し標本化時
間を短かくでき、また画像処理回路等の高速な処
理回路によるより高速動作を可能にすることがで
きる。
付け回路を通すことなく直接に差分器に供給する
ようにしたので、予測信号を重み付け回路を通し
て差分器に供給する従来回路に比し、演算時間を
短縮することができ、従つて従来に比し標本化時
間を短かくでき、また画像処理回路等の高速な処
理回路によるより高速動作を可能にすることがで
きる。
第１図は従来回路の一例を示すブロツク系統
図、第２図は本発明回路の一実施例を示すブロツ
ク系統図、第３図はDPCM信号復号器の一例を
示すブロツク系統図である。 １，８…標本化信号入力端子、２，１０…差分
器、３，１１…量子化回路、４，１２…加算器、
５，１３…予測回路、６，１４…重み付け回路、
７，１５…DPCM信号出力端子。
図、第２図は本発明回路の一実施例を示すブロツ
ク系統図、第３図はDPCM信号復号器の一例を
示すブロツク系統図である。 １，８…標本化信号入力端子、２，１０…差分
器、３，１１…量子化回路、４，１２…加算器、
５，１３…予測回路、６，１４…重み付け回路、
７，１５…DPCM信号出力端子。
Claims (1)
- 【特許請求の範囲】 １ アナログ信号を標本化して得た標本化信号
と、 予測回路よりの予測信号の差分を差分器により
とり、 その差分信号を量子化回路により量子化して差
分パルス符号変調信号を発生する回路において、 上記予測回路の予測出力信号に所定のリーク係
数を乗ずる重み付け回路の入力端と上記差分器の
入力端とを接続して、該予測回路の予測出力信号
を直接該差分器に入力するとともに、 上記標本化信号に該リーク係数の逆数を乗じて
該差分器に入力し、 該重み付け回路の出力信号と該上記差分パルス
符号変調信号とを夫々加算器により加算して該予
測回路に入力するよう構成したことを特徴とする
差分パルス符号変調信号発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17837280A JPS57101421A (en) | 1980-12-17 | 1980-12-17 | Generating circuit for differential pulse code modulation signal |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17837280A JPS57101421A (en) | 1980-12-17 | 1980-12-17 | Generating circuit for differential pulse code modulation signal |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57101421A JPS57101421A (en) | 1982-06-24 |
| JPS6313605B2 true JPS6313605B2 (ja) | 1988-03-26 |
Family
ID=16047332
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17837280A Granted JPS57101421A (en) | 1980-12-17 | 1980-12-17 | Generating circuit for differential pulse code modulation signal |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57101421A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3239841A1 (de) * | 1982-10-27 | 1984-05-03 | Siemens AG, 1000 Berlin und 8000 München | Schneller dpcm-codierer |
| EP0173983B1 (en) * | 1984-08-30 | 1992-12-30 | Fujitsu Limited | Differential coding circuit |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5326560A (en) * | 1976-08-25 | 1978-03-11 | Fujitsu Ltd | High speed leak integrating circuit |
-
1980
- 1980-12-17 JP JP17837280A patent/JPS57101421A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5326560A (en) * | 1976-08-25 | 1978-03-11 | Fujitsu Ltd | High speed leak integrating circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57101421A (en) | 1982-06-24 |
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