JPS63135436U - - Google Patents
Info
- Publication number
- JPS63135436U JPS63135436U JP2840187U JP2840187U JPS63135436U JP S63135436 U JPS63135436 U JP S63135436U JP 2840187 U JP2840187 U JP 2840187U JP 2840187 U JP2840187 U JP 2840187U JP S63135436 U JPS63135436 U JP S63135436U
- Authority
- JP
- Japan
- Prior art keywords
- error detection
- detection signal
- processing device
- memory error
- memory
- Prior art date
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 11
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Techniques For Improving Reliability Of Storages (AREA)
Description
第１図は本考案の一実施例を示す構成図、第２
図は従来のメモリエラー検出装置の構成を示す構
成図である。 １……メモリ回路、２……エラー検出回路、３
……ゲート回路、４……ローカル処理装置（ロー
カルＣＰＵ）、６……ホスト処理装置（ホストＣ
ＰＵ）。
図は従来のメモリエラー検出装置の構成を示す構
成図である。 １……メモリ回路、２……エラー検出回路、３
……ゲート回路、４……ローカル処理装置（ロー
カルＣＰＵ）、６……ホスト処理装置（ホストＣ
ＰＵ）。
Claims (1)
- 【実用新案登録請求の範囲】 システムバスに接続された装置がメモリエラー
を起こした時、このメモリエラーをエラー検出回
路によつて検出し、検出した結果得られた検出信
号をエラー検出信号線を介してローカル処理装置
に伝えるメモリエラー検出装置において、 ホスト処理装置からの制御信号に基づき上記検
出信号を上記ローカル処理装置に伝えるか否か制
御するゲート回路を上記エラー検出信号線の途中
に介在させたことを特徴とするメモリエラー検出
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2840187U JPS63135436U (ja) | 1987-02-27 | 1987-02-27 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2840187U JPS63135436U (ja) | 1987-02-27 | 1987-02-27 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63135436U true JPS63135436U (ja) | 1988-09-06 |
Family
ID=30831326
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2840187U Pending JPS63135436U (ja) | 1987-02-27 | 1987-02-27 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63135436U (ja) |
-
1987
- 1987-02-27 JP JP2840187U patent/JPS63135436U/ja active Pending