JPH0187401U - - Google Patents

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JPH0187401U
JPH0187401U JP18491587U JP18491587U JPH0187401U JP H0187401 U JPH0187401 U JP H0187401U JP 18491587 U JP18491587 U JP 18491587U JP 18491587 U JP18491587 U JP 18491587U JP H0187401 U JPH0187401 U JP H0187401U
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【図面の簡単な説明】
第1図は本考案の一実施例の回路構成を表すブ
ロツク図、第2図は本考案の他の実施例の構成図
、第3図は従来例の説明図である。 1……中央処理装置(CPU)、2……メモリ
、3……出力回路、4……リセツト回路、5……
電源、6……スイツチ回路、7……電源ライン、
8……リセツト指令、9……D/Aコンバータ、
10……他の機器からのデータ。

Claims (1)

  1. 【実用新案登録請求の範囲】 リセツト時には安定した値を持つとともに、動
    作時にはソフトウエアにて制御可能な出力ピンを
    少なくとも1つ有するCPUと、 そのCPUをリセツトするリセツト回路と、 CPUからのデータを被制御機器へ送出する出
    力回路と、 この出力回路の電源と を持つ出力装置において、 電源投入時及びリセツト時にリセツト回路から
    設定時間送出されるリセツト出力と、リセツト出
    力を導入したCPUが導出するCPU信号を受け
    入れ、そのいずれかが入つているときは電源を出
    力回路に接続せず、いずれもが入つていないとき
    に電源を接続するスイツチ回路を電源と出力回路
    との間に介挿接続するとともに、 電源投入時及びリセツト時はリセツト出力が直
    ちに出力し、かつリセツト出力が消滅する前にC
    PU信号が出力し、CPUは出力が0となるデー
    タを送つた後にCPU信号を切り、通常の動作に
    移行する ことを特徴とする出力装置。
JP18491587U 1987-12-03 1987-12-03 Pending JPH0187401U (ja)

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JPH0187401U true JPH0187401U (ja) 1989-06-09

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JP18491587U Pending JPH0187401U (ja) 1987-12-03 1987-12-03

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JP (1) JPH0187401U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014183431A (ja) * 2013-03-19 2014-09-29 Mitsubishi Electric Corp アナログ出力装置

Cited By (1)

* Cited by examiner, † Cited by third party
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