JPS63133731A - フレ−ム同期回路 - Google Patents
フレ−ム同期回路Info
- Publication number
- JPS63133731A JPS63133731A JP61279649A JP27964986A JPS63133731A JP S63133731 A JPS63133731 A JP S63133731A JP 61279649 A JP61279649 A JP 61279649A JP 27964986 A JP27964986 A JP 27964986A JP S63133731 A JPS63133731 A JP S63133731A
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- JP
- Japan
- Prior art keywords
- frame
- pulse
- circuit
- output
- synchronization
- Prior art date
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims abstract description 10
- 230000001360 synchronised effect Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 239000003112 inhibitor Substances 0.000 description 1
- 230000005764 inhibitory process Effects 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はフレームパルスを含むディジタル信号よりフレ
ーム同期を行うフレーム同期回路に関する。
ーム同期を行うフレーム同期回路に関する。
従来、この種のフレーム同期回路は、第2図に示すとお
り、フレームパルスを含む受信符号列1とパルスパター
ン発生回路4より出力されるフレームパターン及びフレ
ーム位置パルスとによす、フレームパルス位置でのフレ
ームパルスの一致をフレームパルス−数構出回路3で検
出し、フレームパルス−数構出回路3から出力サレルフ
レームパルス一致/不一致パルスをシフトレジスタ6を
介して前方保護回路7.後方保護回路8に入力し、フレ
ームパルスがm回連続して不一致となったとき、前方保
護回路7によりフレーム非同期と判定し、n回連続して
一致となったとき、後方保護回路8により、フレーム同
期と判定する。フレーム非同期と判定された場合は、前
記パルスパターン発生回路4に入力するクロック2をイ
ンヒビット回路5において1ピツトインヒピノトし、フ
レームパルスをハ/テングする構成が一般的であった。
り、フレームパルスを含む受信符号列1とパルスパター
ン発生回路4より出力されるフレームパターン及びフレ
ーム位置パルスとによす、フレームパルス位置でのフレ
ームパルスの一致をフレームパルス−数構出回路3で検
出し、フレームパルス−数構出回路3から出力サレルフ
レームパルス一致/不一致パルスをシフトレジスタ6を
介して前方保護回路7.後方保護回路8に入力し、フレ
ームパルスがm回連続して不一致となったとき、前方保
護回路7によりフレーム非同期と判定し、n回連続して
一致となったとき、後方保護回路8により、フレーム同
期と判定する。フレーム非同期と判定された場合は、前
記パルスパターン発生回路4に入力するクロック2をイ
ンヒビット回路5において1ピツトインヒピノトし、フ
レームパルスをハ/テングする構成が一般的であった。
ところが、上述した従来のフレーム同期回路では、電源
の瞬断時、受信符号列が一時的に誤り、かつ同期位置で
ない位置にフレームパルスに類似したパルス列があり、
類似同期状態に入った場合でフレームパルスがm回以上
連続しても不一致とならない場合、すなわち9m回に1
回以上、フレームパルスト同一のパターンがあられれる
場合は、前方保護回路出力が出力されず、誤同期状態か
ら抜は出すことができなくなるという欠点がある。
の瞬断時、受信符号列が一時的に誤り、かつ同期位置で
ない位置にフレームパルスに類似したパルス列があり、
類似同期状態に入った場合でフレームパルスがm回以上
連続しても不一致とならない場合、すなわち9m回に1
回以上、フレームパルスト同一のパターンがあられれる
場合は、前方保護回路出力が出力されず、誤同期状態か
ら抜は出すことができなくなるという欠点がある。
そこで1本発明の目的は上記欠点に鑑み、フレーム同期
パルスとフレーム非同期パルスとの両パルスとも出力さ
れない類似同期状態を検出し、ハンチング状態にするフ
レーム同期回路を提供することである。
パルスとフレーム非同期パルスとの両パルスとも出力さ
れない類似同期状態を検出し、ハンチング状態にするフ
レーム同期回路を提供することである。
本発明によれば、フレームパルスを含む受信符号列とパ
ルスパターン発生回路より出力されるフレームパターン
及びフレーム位置パルスとを入力するフレームパルス−
数構出回路と、該フレームパルス一致検出回路より出力
されるフレームパルス一致/不一致ノ(ルスヲ入力スル
シフトレジスタと、該シフトレジスタの出力より。
ルスパターン発生回路より出力されるフレームパターン
及びフレーム位置パルスとを入力するフレームパルス−
数構出回路と、該フレームパルス一致検出回路より出力
されるフレームパルス一致/不一致ノ(ルスヲ入力スル
シフトレジスタと、該シフトレジスタの出力より。
m回連続して前記フレームパルスが不一致となったとき
フレーム非同期パルスを出力する前方保護回路と、n回
連続して前記フレームパルスが一致したときフレーム同
期パルスを出力する後方保護回路と、前記前方保護回路
出力が出力されたとき、セット(又はリセット)され、
前記後方保護回路出力が出力されたとき、リセット(又
はセット)されるセット・リセットフリップフロップと
、該セントリセットフリップフロップがセット(又はリ
セット)されたとき。
フレーム非同期パルスを出力する前方保護回路と、n回
連続して前記フレームパルスが一致したときフレーム同
期パルスを出力する後方保護回路と、前記前方保護回路
出力が出力されたとき、セット(又はリセット)され、
前記後方保護回路出力が出力されたとき、リセット(又
はセット)されるセット・リセットフリップフロップと
、該セントリセットフリップフロップがセット(又はリ
セット)されたとき。
前記パルスパターン発生回路に入力するクロックを1ビ
ットインヒビットするインヒピット回路とを有するフレ
ーム同期回路において、前記後方保護回路出力の断を検
出し、前記セット・リセットフリッププロップをセット
(又はリセット)する信号断検出回路を設けたことを特
徴とするフレーム同期回路が得られる。
ットインヒビットするインヒピット回路とを有するフレ
ーム同期回路において、前記後方保護回路出力の断を検
出し、前記セット・リセットフリッププロップをセット
(又はリセット)する信号断検出回路を設けたことを特
徴とするフレーム同期回路が得られる。
第1図は本発明の一実施例を示す。
受信信号人力1に入力されるフレームパルスを含む受信
符号列は、パルスパターン発生回路4より送られるフレ
ームパターン及びフレーム位置パルスより、フレームパ
ルス−数構出回路3において、フレームパルスが正しい
符号であるか否かを判定される。フレームパルス−数構
出回路3は正しい七判定された場合には、フレームパル
ス一致パルスがシフトレジスタ6に出力される。一方、
誤りと判定された場合は、フレームパルス不一致パルス
がシフトレジスタ6に出力される。シフトレジスタ6の
各段の出力は、前方保護回路7及び後方保護回路8に加
えられる。
符号列は、パルスパターン発生回路4より送られるフレ
ームパターン及びフレーム位置パルスより、フレームパ
ルス−数構出回路3において、フレームパルスが正しい
符号であるか否かを判定される。フレームパルス−数構
出回路3は正しい七判定された場合には、フレームパル
ス一致パルスがシフトレジスタ6に出力される。一方、
誤りと判定された場合は、フレームパルス不一致パルス
がシフトレジスタ6に出力される。シフトレジスタ6の
各段の出力は、前方保護回路7及び後方保護回路8に加
えられる。
前方保護回路7では、同期状態においてm回連続してフ
レームパルスが不一致となった場合に、フレーム非同期
パルスをセットリセットフリップ70ツブ9に出力する
。すなわち2m回未満のフレームパルスが不一致だとし
てもフレーム同期は同期はずれとはしないように保護を
かける。
レームパルスが不一致となった場合に、フレーム非同期
パルスをセットリセットフリップ70ツブ9に出力する
。すなわち2m回未満のフレームパルスが不一致だとし
てもフレーム同期は同期はずれとはしないように保護を
かける。
一方、後方保護回路8では、同期はずれ状態において、
n回連続してフレームパルスが一致した場合に、フレー
ム同期パルスをセットリセットフリップフロップ9に出
力する。すなわち。
n回連続してフレームパルスが一致した場合に、フレー
ム同期パルスをセットリセットフリップフロップ9に出
力する。すなわち。
n回未満のフレームパルスが一致したとしても。
まだ、フレームは同期と判定しない。前方保護回路出力
されるフレーム非同期パルスにょシ。
されるフレーム非同期パルスにょシ。
セントリセットフリップフロップ9は、セット(又はリ
セット)され、ハンチング状態となる。
セット)され、ハンチング状態となる。
即ち、フリップフロップ9の出方により、入力クロック
2がインヒビノド回路5にょシ、1ピントインヒビット
されパルスパターン発生回路4のカウンタをストップさ
せる。この操作が正常なフレームパルスを検出するまで
行われる。
2がインヒビノド回路5にょシ、1ピントインヒビット
されパルスパターン発生回路4のカウンタをストップさ
せる。この操作が正常なフレームパルスを検出するまで
行われる。
この後に、後方保護が行われフレーム同期がとられる。
特別な場合として、まれではあるが一時的にフレームパ
ルスが正常に同期されず、擬似同期状態に入り、フレー
ムパルスがm回以上連続して不一致とならない場合、す
なわち9m回に1回以上フレームパルスと同一のパター
ンがあられれる場合、従来のフレーム回路では、前方保
護回路出力も後方保護回路出力とも出力されず。
ルスが正常に同期されず、擬似同期状態に入り、フレー
ムパルスがm回以上連続して不一致とならない場合、す
なわち9m回に1回以上フレームパルスと同一のパター
ンがあられれる場合、従来のフレーム回路では、前方保
護回路出力も後方保護回路出力とも出力されず。
誤同期状態から抜は出すことができなくなる。
そこで1本発明では、後方保護回路出力を、信号断検出
回路10で常時監視しており、フレーム同期パルス及び
フレーム非同期パルスの両方とも出力されない誤同期状
態に対しては、信号断検出が働き、セットリセットフリ
ップ70ツブ9をセット(又はリセット)シ、ハンチン
グ状態にして、パルスパターン発生回路4に入力される
クロック2を1ビノトインヒピツトするインヒビノド回
路5をセットし、誤同期状態から抜は出し、新たにフレ
ーム同期を行うことができる。
回路10で常時監視しており、フレーム同期パルス及び
フレーム非同期パルスの両方とも出力されない誤同期状
態に対しては、信号断検出が働き、セットリセットフリ
ップ70ツブ9をセット(又はリセット)シ、ハンチン
グ状態にして、パルスパターン発生回路4に入力される
クロック2を1ビノトインヒピツトするインヒビノド回
路5をセットし、誤同期状態から抜は出し、新たにフレ
ーム同期を行うことができる。
以上説明したように9本発明はフレーム同期回路の後方
保護回路出力のフレームパルス一致パルスの断検出を行
う断検出回路を追加し、フレームパルス一致パルスの断
が検出された場合。
保護回路出力のフレームパルス一致パルスの断検出を行
う断検出回路を追加し、フレームパルス一致パルスの断
が検出された場合。
強制的にハンチング状態にするととくより、誤同期を防
止する効果がある。
止する効果がある。
μ1憩B
第1図は本発明フレーム同期回路の構成例のブロック図
、第2図は従来のフレーム同期回路の構成例のブロック
図である。 1・・・受信信号入力、2・・・クロック入力、3・・
・フレームパルス−数構出回路、4・・・パルスパター
ン発生回路、5・・・インヒビノド回路、6・・・シフ
トレジスタ、7・・・前方保護回路、8・・・後方保護
回路、9・・・セントリセットフリップフロップ。 10・・・信号断検出回路。 第1図 声2図 ワ
、第2図は従来のフレーム同期回路の構成例のブロック
図である。 1・・・受信信号入力、2・・・クロック入力、3・・
・フレームパルス−数構出回路、4・・・パルスパター
ン発生回路、5・・・インヒビノド回路、6・・・シフ
トレジスタ、7・・・前方保護回路、8・・・後方保護
回路、9・・・セントリセットフリップフロップ。 10・・・信号断検出回路。 第1図 声2図 ワ
Claims (1)
- 1、フレームパルスを含む受信符号列とパルスパターン
発生回路より出力されるフレームパターン及びフレーム
位置パルスとを入力するフレームパルス一致検出回路と
、前記フレームパルス一致検出回路より出力されるフレ
ームパルス一致/不一致パルスを入力するシフトレジス
タと、該シフトレジスタの出力よりm回連続してフレー
ムパルスが不一致となったときフレーム非同期パルスを
出力する前方保護回路と、n回連続してフレームパルス
が一致したときフレーム同期パルスを出力する後方保護
回路と、前記前方保護回路出力が出力されたときセット
(又はリセット)され、前記後方保護回路出力が出力さ
れたときリセット(又はセット)されるセットリセット
フリップフロップと、前記セットリセットフリップフロ
ップがセット(又はリセット)されたとき、前記パルス
パターン発生回路に入力するクロックを1ビットインヒ
ビットするインヒビット回路とを有するフレーム同期回
路において、前記後方保護回路出力の断を検出し、前記
セットリセットフリップフロップをセット(又はリセッ
ト)する信号断検出回路を設けたことを特徴とするフレ
ーム同期回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61279649A JPS63133731A (ja) | 1986-11-26 | 1986-11-26 | フレ−ム同期回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61279649A JPS63133731A (ja) | 1986-11-26 | 1986-11-26 | フレ−ム同期回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63133731A true JPS63133731A (ja) | 1988-06-06 |
Family
ID=17613922
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61279649A Pending JPS63133731A (ja) | 1986-11-26 | 1986-11-26 | フレ−ム同期回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63133731A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0530099A (ja) * | 1991-07-24 | 1993-02-05 | Mitsubishi Electric Corp | フレーム同期方法 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5748842A (en) * | 1980-09-08 | 1982-03-20 | Tech Res & Dev Inst Of Japan Def Agency | Frame synchronizing circuit |
JPS59223037A (ja) * | 1983-06-02 | 1984-12-14 | Nec Home Electronics Ltd | 同期保護回路 |
-
1986
- 1986-11-26 JP JP61279649A patent/JPS63133731A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5748842A (en) * | 1980-09-08 | 1982-03-20 | Tech Res & Dev Inst Of Japan Def Agency | Frame synchronizing circuit |
JPS59223037A (ja) * | 1983-06-02 | 1984-12-14 | Nec Home Electronics Ltd | 同期保護回路 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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JPH0530099A (ja) * | 1991-07-24 | 1993-02-05 | Mitsubishi Electric Corp | フレーム同期方法 |
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