JPS6293834U - - Google Patents

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JPS6293834U
JPS6293834U JP18462685U JP18462685U JPS6293834U JP S6293834 U JPS6293834 U JP S6293834U JP 18462685 U JP18462685 U JP 18462685U JP 18462685 U JP18462685 U JP 18462685U JP S6293834 U JPS6293834 U JP S6293834U
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frequency
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JP18462685U
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  • Manipulation Of Pulses (AREA)

Description

【図面の簡単な説明】
第1図は本考案の分周器の一実施例(1/3分
周器)の構成を示す図、第2図は同、タイムチヤ
ート、第3図は同、他の実施例(1/3分周器)
の構成を示す図、第4図は従来の1/3分周器の
構成を示す図、第5図は同、タイムチヤートであ
る。 1……プリセツト型2N進カウンタ、2……プ
リセツト回路2、6……D型フリツプフロツプ回
路、7,8……インバータ回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 (イ) クロツクパルスCpをカウントして、 n2n+1またはn+12n+1(ただし、n
    は自然数) なる分周出力を出力する1/(2n+1)分周回
    路。 (ロ) 一つのデータ入力、プリセツトまたはリセ
    ツト入力およびクロツク入力をもち、上記データ
    入力DNと出力QN+1との間にクロツクの立ち
    上がりまたは立ち下がりにおいてQN+1=DN
    なる関係が成立するD型フリツプフロツプ回路。 を具備し、 (ハ) 上記1/(2n+1)分周回路の分周出力
    であつて、デユーテイサイクルが n2n+1またはn+12n+1(ただし、n
    は自然数) である分周出力を直接または位相反転して上記D
    型フリツプフロツプ回路のデータ入力に入力する
    とともに、プリセツトまたはリセツト入力に入力
    し、当該データ入力を上記クロツクパルスCpに
    同期して当該クロツクパルスCpの半周期だけ遅
    延させることを特徴とする分周器。
JP18462685U 1985-11-29 1985-11-29 Pending JPS6293834U (ja)

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JP18462685U JPS6293834U (ja) 1985-11-29 1985-11-29

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JPS6293834U true JPS6293834U (ja) 1987-06-15

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ID=31132482

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JP18462685U Pending JPS6293834U (ja) 1985-11-29 1985-11-29

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