JPS6255331B2 - - Google Patents
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- Publication number
- JPS6255331B2 JPS6255331B2 JP53164806A JP16480678A JPS6255331B2 JP S6255331 B2 JPS6255331 B2 JP S6255331B2 JP 53164806 A JP53164806 A JP 53164806A JP 16480678 A JP16480678 A JP 16480678A JP S6255331 B2 JPS6255331 B2 JP S6255331B2
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- JP
- Japan
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- diode
- signal
- control voltage
- turned
- series
- Prior art date
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- Expired
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- 239000003990 capacitor Substances 0.000 claims description 21
- 230000008054 signal transmission Effects 0.000 claims description 2
- 230000000295 complement effect Effects 0.000 claims 2
- 230000005540 biological transmission Effects 0.000 description 6
- 238000010586 diagram Methods 0.000 description 5
- 238000000034 method Methods 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
- 239000013256 coordination polymer Substances 0.000 description 1
- 238000007599 discharging Methods 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
Description
【発明の詳細な説明】
本発明は無線通信装置におけるスペースダイパ
ーシテイ方式の機器切換等に使用される信号スイ
ツチ回路に関するものである。
ーシテイ方式の機器切換等に使用される信号スイ
ツチ回路に関するものである。
一般に無線通信装置におけるスペースダイパー
シテイ方式においては第１図に示すように、アン
テナから中間周波数に変換するまでの高周波段を
２種類（RX1、RX2）設け、これら出力を監視す
ることにより通信状態の良好な高周波段の出力を
信号スイツチ回路Ｓによつて共通な中間周波段
IF以降の装置に切換えることが行なわれてい
る。
シテイ方式においては第１図に示すように、アン
テナから中間周波数に変換するまでの高周波段を
２種類（RX1、RX2）設け、これら出力を監視す
ることにより通信状態の良好な高周波段の出力を
信号スイツチ回路Ｓによつて共通な中間周波段
IF以降の装置に切換えることが行なわれてい
る。
このような方式において切換のための信号スイ
ツチ回路は従来第２図に示すように信号入力Ｓ１
からの伝送信号は直列ダイオードＤ１を介して信
号出力端子Ｓ２に伝達されるようになつており、
伝送信号を遮断する場合は直列ダイオードＤ１を
オフ状態として、ダイオードＤ１の両端にあつて
伝送路に並列に置かれた並列ダイオードＤ２，Ｄ
３をオン状態にすることにより伝送信号を短絡し
ていた。
ツチ回路は従来第２図に示すように信号入力Ｓ１
からの伝送信号は直列ダイオードＤ１を介して信
号出力端子Ｓ２に伝達されるようになつており、
伝送信号を遮断する場合は直列ダイオードＤ１を
オフ状態として、ダイオードＤ１の両端にあつて
伝送路に並列に置かれた並列ダイオードＤ２，Ｄ
３をオン状態にすることにより伝送信号を短絡し
ていた。
この直列及び並列ダイオードＤ１〜Ｄ３のオ
ン、オフは制御電圧端子Ｖ１Ｖ２に図のような電
圧を与えることにより行われる。即ち直列ダイオ
ードＤ１はオフからオンになり並列ダイオードＤ
２，Ｄ３はオンからオフになる。この場合端子Ｓ
１に与えられた伝送信号（図のＳ１）は端子Ｓ２
に図のような立上がり時間Ｔを持つて伝送され
る。この回路の場合、並列ダイオードＤ２Ｄ３は
消費電流を少なくするため縦列接続されている。
このためバイパスコンデンサＣが必要となる。信
号スイツチ回路が遮断状態から導通状態に変わる
場合このバイパスコンデンサＣの充放電時間のた
め並列ダイオードＤ２Ｄ３のオフ状態になる迄の
時間がかかり、出力端子Ｓ２の立上がり時間Ｔが
大きくなる。これは第１図のスペースダイパーシ
テイのような場合、信号が遮断され受信出来ない
時間が出来てしまうことになり、極めて伝送品質
を低下させることになる。
ン、オフは制御電圧端子Ｖ１Ｖ２に図のような電
圧を与えることにより行われる。即ち直列ダイオ
ードＤ１はオフからオンになり並列ダイオードＤ
２，Ｄ３はオンからオフになる。この場合端子Ｓ
１に与えられた伝送信号（図のＳ１）は端子Ｓ２
に図のような立上がり時間Ｔを持つて伝送され
る。この回路の場合、並列ダイオードＤ２Ｄ３は
消費電流を少なくするため縦列接続されている。
このためバイパスコンデンサＣが必要となる。信
号スイツチ回路が遮断状態から導通状態に変わる
場合このバイパスコンデンサＣの充放電時間のた
め並列ダイオードＤ２Ｄ３のオフ状態になる迄の
時間がかかり、出力端子Ｓ２の立上がり時間Ｔが
大きくなる。これは第１図のスペースダイパーシ
テイのような場合、信号が遮断され受信出来ない
時間が出来てしまうことになり、極めて伝送品質
を低下させることになる。
本発明は、斯かる従来の信号スイツチ回路が有
する欠点を改善しようとするもので、本発明によ
れば、信号伝送路に直列に挿入され、第１の制御
電圧によりオン／オフされる第１のダイオード
と、該第１のダイオードの一端とコンデンサを介
し接続され、バイパスコンデンサを用いて接地さ
れ、且つ前記第１の制御電圧と逆特性の第２の制
御電圧が印加される第２のダイオードと、一端を
前記第１のダイオードの他端にコンデンサを介し
て接続され、他端を接地されるとともに、前記第
２のダイオードと縦続に接続されることにより前
記第２の制御電圧が印加される第３のダイオード
とから成る信号スイツチ回路に於て、前記バイパ
スコンデンサと第２のダイオードとの接続点を抵
抗を介して接地することにより達成される。
する欠点を改善しようとするもので、本発明によ
れば、信号伝送路に直列に挿入され、第１の制御
電圧によりオン／オフされる第１のダイオード
と、該第１のダイオードの一端とコンデンサを介
し接続され、バイパスコンデンサを用いて接地さ
れ、且つ前記第１の制御電圧と逆特性の第２の制
御電圧が印加される第２のダイオードと、一端を
前記第１のダイオードの他端にコンデンサを介し
て接続され、他端を接地されるとともに、前記第
２のダイオードと縦続に接続されることにより前
記第２の制御電圧が印加される第３のダイオード
とから成る信号スイツチ回路に於て、前記バイパ
スコンデンサと第２のダイオードとの接続点を抵
抗を介して接地することにより達成される。
以下本発明を図面に示された実施例によつて詳
細に説明する。
細に説明する。
第３図は本発明の一実施例を示す回路図であ
り、信号入力端子Ｓ１と信号出力端子Ｓ２の間に
コンデンサＣ２，Ｃ５を介して直列ダイオードＤ
１が置かれている。この直列ダイオードＤ１にア
ース、インダクタンスＬ４、ダイオードＤ１、イ
ンダクタンスＬ１、制御電圧端子Ｖ１の電流通路
を通して順方向電流を流したり、逆バイアスを加
えることにより直列ダイオードＤ１をオンオフさ
せる。直列ダイオードＤ１の両端には、コンデン
サＣ３並列ダイオードＤ２、バイパスコンデンサ
Ｃ１及びコンデンサＣ４、並列ダイオードＤ３の
回路が信号伝送路に並列に接続されている。この
並列ダイオードＤ２Ｄ３はアース、並列ダイオー
ドＤ３、インダクタンスＬ３、並列ダイオードＤ
２、インダクタンスＬ２、制御電圧端子Ｖ２の電
流路で制御電圧源に対して直列接続されている。
並列ダイオードＤ２Ｄ３は制御電圧端子Ｖ２に与
える電圧により順方向電流を流したり、逆バイア
スすることによりオン・オフさせる。バイパスコ
ンデンサＣ１の放電路として抵抗Ｒがバイパスコ
ンデンサＣ１とアースとの間に接続されている。
り、信号入力端子Ｓ１と信号出力端子Ｓ２の間に
コンデンサＣ２，Ｃ５を介して直列ダイオードＤ
１が置かれている。この直列ダイオードＤ１にア
ース、インダクタンスＬ４、ダイオードＤ１、イ
ンダクタンスＬ１、制御電圧端子Ｖ１の電流通路
を通して順方向電流を流したり、逆バイアスを加
えることにより直列ダイオードＤ１をオンオフさ
せる。直列ダイオードＤ１の両端には、コンデン
サＣ３並列ダイオードＤ２、バイパスコンデンサ
Ｃ１及びコンデンサＣ４、並列ダイオードＤ３の
回路が信号伝送路に並列に接続されている。この
並列ダイオードＤ２Ｄ３はアース、並列ダイオー
ドＤ３、インダクタンスＬ３、並列ダイオードＤ
２、インダクタンスＬ２、制御電圧端子Ｖ２の電
流路で制御電圧源に対して直列接続されている。
並列ダイオードＤ２Ｄ３は制御電圧端子Ｖ２に与
える電圧により順方向電流を流したり、逆バイア
スすることによりオン・オフさせる。バイパスコ
ンデンサＣ１の放電路として抵抗Ｒがバイパスコ
ンデンサＣ１とアースとの間に接続されている。
今、信号スイツチ回路が遮断状態の場合、直列
ダイオードＤ１はオフ状態であり、並列ダイオー
ドＤ２，Ｄ３はオン状態になつている。この状態
では信号入力端子Ｓ１からの信号は直列ダイオー
ドＤ１で阻止されると共に、並列ダイオードＤ
２，Ｄ３で短絡されるため大きな減衰を受ける。
ダイオードＤ１はオフ状態であり、並列ダイオー
ドＤ２，Ｄ３はオン状態になつている。この状態
では信号入力端子Ｓ１からの信号は直列ダイオー
ドＤ１で阻止されると共に、並列ダイオードＤ
２，Ｄ３で短絡されるため大きな減衰を受ける。
次に信号スイツチ回路を遮断状態から導通状態
にする場合は制御電圧端子Ｖ１，Ｖ２より夫々直
列ダイオードＤ１をオン、並列ダイオードＤ２，
Ｄ３をオフとするような電圧を与える。この場合
バイパスコンデンサＣ１には前の状態の電荷が充
電されているので、この電荷を放電し、逆極性に
短時間で充電しなければならない。抵抗Ｒは、バ
イパスコンデンサＣ１の放電路となり、短時間に
並列ダイオードＤ２，Ｄ３をオフ状態に出来る。
にする場合は制御電圧端子Ｖ１，Ｖ２より夫々直
列ダイオードＤ１をオン、並列ダイオードＤ２，
Ｄ３をオフとするような電圧を与える。この場合
バイパスコンデンサＣ１には前の状態の電荷が充
電されているので、この電荷を放電し、逆極性に
短時間で充電しなければならない。抵抗Ｒは、バ
イパスコンデンサＣ１の放電路となり、短時間に
並列ダイオードＤ２，Ｄ３をオフ状態に出来る。
以下、第４図乃至第７図を参照して第３図に示
す回路が、第２図に示す回路に比べて放電時間が
短縮される理由について説明する。
す回路が、第２図に示す回路に比べて放電時間が
短縮される理由について説明する。
第４図ａは、説明のため第２図に示す回路の一
部を抜き出したもので、図中第２図と同一の参照
番号で指示される部分は第２図と同一のものを示
す。
部を抜き出したもので、図中第２図と同一の参照
番号で指示される部分は第２図と同一のものを示
す。
第４図ｂは第４図ａの等価回路で、制御電圧Ｖ
２によりスイツチSWをオン／オフするものと考
えられる。
２によりスイツチSWをオン／オフするものと考
えられる。
また、第４図ｂに於て、スイツチSWをオフに
した場合の等価回路は、第６図ａのようになる。
（ラプラス変換後） 尚、ここで、I0はｔ＝０の時の電流値（初期
値）、ダイオードＤは、等価的に抵抗ｒに置き換
えて考える。
した場合の等価回路は、第６図ａのようになる。
（ラプラス変換後） 尚、ここで、I0はｔ＝０の時の電流値（初期
値）、ダイオードＤは、等価的に抵抗ｒに置き換
えて考える。
第６図ａに於て、
ｉD（ｒ＋LP＋１／CP）＝Ｅ／Ｐ＋LI0
の関係から、これをダイオードＤに流れる電流ｉ
Dについて解くと、 ｉD＝Ｅ／ｒ｛Ｐ＋α／（Ｐ＋α）２＋β２＋α／（ｐ
＋α）２＋β２｝ α＝Ｒ／２Ｌ、β２＝１／ＬＣ−（ｒ／２Ｌ）２ となる。β２が正、負、０の３通りについて解が
存在するが、ここではβ２が正としてこれを求め
ると となる。式を図示すると第６図ｂのようになる
が、ここで抵抗ｒはダイオードであるためｉDは
一方向にのみ流れ、実際には第６図ｃに示すもの
となる。
Dについて解くと、 ｉD＝Ｅ／ｒ｛Ｐ＋α／（Ｐ＋α）２＋β２＋α／（ｐ
＋α）２＋β２｝ α＝Ｒ／２Ｌ、β２＝１／ＬＣ−（ｒ／２Ｌ）２ となる。β２が正、負、０の３通りについて解が
存在するが、ここではβ２が正としてこれを求め
ると となる。式を図示すると第６図ｂのようになる
が、ここで抵抗ｒはダイオードであるためｉDは
一方向にのみ流れ、実際には第６図ｃに示すもの
となる。
一方第５図ａは、第４図ａに対応して第３図に
示す回路の一部を抜き出したもので、図中第３図
と同一の参照番号で指示される部分は第３図と同
一のものを示す。
示す回路の一部を抜き出したもので、図中第３図
と同一の参照番号で指示される部分は第３図と同
一のものを示す。
第５図ｂは第５図ａの等価回路で、制御電圧Ｖ
２によりスイツチSWをオン／オフするものと考
えられる。
２によりスイツチSWをオン／オフするものと考
えられる。
また、第５図ｂに於て、スイツチSWをオフに
した場合の等価回路は、第７図のようになる。
（ラプラス変換後） 尚、ここでは第６図ａと同様に、I0はｔ＝０の
時の電流値（初期値）、ダイオードＤは、等価的
に抵抗ｒに置き換えて考える。
した場合の等価回路は、第７図のようになる。
（ラプラス変換後） 尚、ここでは第６図ａと同様に、I0はｔ＝０の
時の電流値（初期値）、ダイオードＤは、等価的
に抵抗ｒに置き換えて考える。
第７図に於て、
ｉD＝iR＋iC
LI0−ｉD（LP＋ｒ）＝１／ＣＰiC−Ｅ／Ｐ＝ｉR・Ｒ
からダイオードＤに流れる電流ｉDについて解く
と、 ｉD＝Ｅ／ｒ｛Ｐ＋α／（Ｐ＋α）２＋β２＋α／（Ｐ
＋α）２＋β２｝ 逆変換して、 が求まる。前記式と上記式は、β、αの値が
異なるのみで、その波形は第６図ｂ〜ｃと同じに
なる。
と、 ｉD＝Ｅ／ｒ｛Ｐ＋α／（Ｐ＋α）２＋β２＋α／（Ｐ
＋α）２＋β２｝ 逆変換して、 が求まる。前記式と上記式は、β、αの値が
異なるのみで、その波形は第６図ｂ〜ｃと同じに
なる。
即ち、式でＲ＝∞とすると、
α＝ｒ／２Ｌ＋１／２ＣＲ＝ｒ／２Ｌ
β２＝１／ＬＣ＋ｒ／ＬＣＲ−（ｒ／２Ｌ＋１／２ＣＲ
）２＝１／ＬＣ−（ｒ／２Ｌ）２ となり、式と一致することがわかる。
）２＝１／ＬＣ−（ｒ／２Ｌ）２ となり、式と一致することがわかる。
但し、ここでｉD＝０となる時間、即ちバイパ
スコンデンサの放電時間は、式の場合に比較し
て式の場合は大幅に短縮されることになる。
スコンデンサの放電時間は、式の場合に比較し
て式の場合は大幅に短縮されることになる。
ｉ＝０となるまでの時間t1＝１／β（ｎπ−tan-1
β／α）をＬ＝10μＨ、Ｃ＝10000pF、Ｒ＝500Ω、
ｒ＝100Ωの具体的数値を代入して算出すると、
式の場合（第２図に対応）
α＝５×106、β≒2.74×106
∴t1＝9.64×10-7＝0.964μSec
式の場合（第３図に対応）
α＝５×106＋１×106＝６×106、β≒８×106
∴t1＝2.77×10-7＝0.277μSec
となり、放電用抵抗Ｒにより大幅にその放電時間
が短縮されることがわかる。
が短縮されることがわかる。
本発明によれば信号スイツチ回路が遮断状態か
ら導通状態に変わる場合に立上がり時間は極めて
短かくなり、前述のスペースダイパーシテイ方式
の切換時にも一時的に信号が遮断されることがな
くなる。
ら導通状態に変わる場合に立上がり時間は極めて
短かくなり、前述のスペースダイパーシテイ方式
の切換時にも一時的に信号が遮断されることがな
くなる。
尚、抵抗Ｒを挿入することにより、信号オフの
際に分流し、並列ダイオードＤ３に流れる電流が
減少するが、これは消費電流を若干増加させるこ
とにより容易に解決され、抵抗Ｒが回路の高周波
特性に影響を与えることは無い。
際に分流し、並列ダイオードＤ３に流れる電流が
減少するが、これは消費電流を若干増加させるこ
とにより容易に解決され、抵抗Ｒが回路の高周波
特性に影響を与えることは無い。
第１図は信号スイツチ回路の一適用例を示す無
線通信装置のブロツク図、第２図は従来の信号ス
イツチ回路、第３図は本発明による信号スイツチ
回路の一実施例、第４図は第２図の一部を抜き出
した図、及びその等価回路、第５図は第３図の一
部を抜き出した図、及びその等価回路、第６図は
第４図に於ける放電特性を説明するための図、第
７図は第５図に於ける放電特性を説明するための
図である。 図中、Ｓ１は信号入力端子、Ｓ２は信号出力端
子、Ｄ１は直列ダイオード、Ｄ２，Ｄ３は並列ダ
イオード、Ｃ１はバイパスコンデンサ、Ｃ２〜Ｃ
５はコンデンサ、Ｌ１〜Ｌ４はインダクタンス、
Ｖ１，Ｖ２は制御電圧（端子）、Ｒ，ｒは抵抗を
夫々示す。
線通信装置のブロツク図、第２図は従来の信号ス
イツチ回路、第３図は本発明による信号スイツチ
回路の一実施例、第４図は第２図の一部を抜き出
した図、及びその等価回路、第５図は第３図の一
部を抜き出した図、及びその等価回路、第６図は
第４図に於ける放電特性を説明するための図、第
７図は第５図に於ける放電特性を説明するための
図である。 図中、Ｓ１は信号入力端子、Ｓ２は信号出力端
子、Ｄ１は直列ダイオード、Ｄ２，Ｄ３は並列ダ
イオード、Ｃ１はバイパスコンデンサ、Ｃ２〜Ｃ
５はコンデンサ、Ｌ１〜Ｌ４はインダクタンス、
Ｖ１，Ｖ２は制御電圧（端子）、Ｒ，ｒは抵抗を
夫々示す。
Claims (1)
- １ 信号伝送路に直列に挿入され、第１の制御電
圧によりオン／オフされる第１のダイオードと、
一端を該第１のダイオードの一端とコンデンサを
介し接続され、他端をバイパスコンデンサを用い
て接地され、且つ前記第１の制御電圧と逆特性の
第２の制御電圧が該一端に印加され、前記第１の
ダイオードと相補的にオン／オフされる第２のダ
イオードと、一端を前記第１のダイオードの他端
にコンデンサを介して接続され、他端を接地され
るとともに、前記第２の制御電圧に対して前記第
２のダイオードとインダクタンスを介して直列接
続され、前記第１のダイオードと相補的にオン／
オフする第３のダイオードとから成る信号スイツ
チ回路に於て、前記バイパスコンデンサと第２の
ダイオードとの接続点を抵抗を介して接地したこ
とを特徴とする信号スイツチ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16480678A JPS5591235A (en) | 1978-12-28 | 1978-12-28 | Signal switch circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16480678A JPS5591235A (en) | 1978-12-28 | 1978-12-28 | Signal switch circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5591235A JPS5591235A (en) | 1980-07-10 |
| JPS6255331B2 true JPS6255331B2 (ja) | 1987-11-19 |
Family
ID=15800264
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16480678A Granted JPS5591235A (en) | 1978-12-28 | 1978-12-28 | Signal switch circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5591235A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5231273A (en) * | 1991-04-09 | 1993-07-27 | Comtec Industries | Inventory management system |
-
1978
- 1978-12-28 JP JP16480678A patent/JPS5591235A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5591235A (en) | 1980-07-10 |
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