JPS62269197A - Liquid crystal display unit - Google Patents
Liquid crystal display unitInfo
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- JPS62269197A JPS62269197A JP11195786A JP11195786A JPS62269197A JP S62269197 A JPS62269197 A JP S62269197A JP 11195786 A JP11195786 A JP 11195786A JP 11195786 A JP11195786 A JP 11195786A JP S62269197 A JPS62269197 A JP S62269197A
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- JP
- Japan
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- liquid crystal
- crystal display
- display module
- signal
- image
- Prior art date
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- Pending
Links
- 239000004973 liquid crystal related substance Substances 0.000 title claims description 26
- 238000010586 diagram Methods 0.000 description 2
- 230000006866 deterioration Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Landscapes
- Liquid Crystal Display Device Control (AREA)
- Transforming Electric Information Into Light Information (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
〔産業上の利用分野〕・
本発明は液晶表示袋装置、を関し、ＣＲＴ画像表示装置
の水平同期信号を間引き、液晶表示モジュールの画、面
サイズにマフ□千′ソゲさせるようにした液晶表示装置
である。[Detailed Description of the Invention] [Industrial Application Field] The present invention relates to a liquid crystal display bag device, in which the horizontal synchronizing signal of a CRT image display device is thinned out, and a muff is applied to the screen size of a liquid crystal display module. This is a liquid crystal display device that allows the display to fade.
テレビやパソコンのＣＲＴ画像を、液晶表示モジエール
で表示させようとすると、垂直方向の分解能や画面分割
数などで、ＣＲＴ画像の全体をうまく液晶表示モジュー
ルに表示できなかった０本発明はこの欠点を除くため、
水平同期信号を間引く回路を設け、ＣＲＴ画像と液晶表
示モジュール画像との相似性を残した。When trying to display a CRT image from a television or computer on a liquid crystal display module, the entire CRT image could not be displayed properly on the liquid crystal display module due to vertical resolution, number of screen divisions, etc. The present invention solves this drawback. In order to exclude
A circuit for thinning out horizontal synchronizing signals was provided to maintain similarity between the CRT image and the liquid crystal display module image.
テレビやパソコン等のＣＲＴ画像を、液晶表示モジュー
ルに表示する時に、ＣＲＴの垂直分解能と液晶表示モジ
ュールのデユティ−が異なった場合、ＣＲＴ画像と液晶
考示モジュール画像との相似性を保った方法での液晶表
示装置は従来技術ではみられなかった。 。When displaying a CRT image from a TV or computer on a liquid crystal display module, if the vertical resolution of the CRT and the duty of the liquid crystal display module are different, a method that maintains the similarity between the CRT image and the liquid crystal display module image can be used. This liquid crystal display device has not been seen in the prior art. .
テレビやパソコン等のＣＲＴ画像を、液晶表示モジエー
ルに表示する時に、ＣＲＴの垂直分解能と液晶表示モジ
ュールのデエテイーが異なった時に発生するＣＲＴ画像
と液晶表示モジュール画像との相個性の劣化問題。When displaying a CRT image from a television, personal computer, etc. on a liquid crystal display module, there is a problem of deterioration in phase characteristics between the CRT image and the liquid crystal display module image, which occurs when the vertical resolution of the CRT and the resolution of the liquid crystal display module are different.
テレビやパソコン等のＣＲＴの水平同期信号を、液晶表
示モジュールのデユティ−に合わせる様に水平同期信号
の間引き回路を設ける。A horizontal synchronizing signal thinning circuit is provided to match the horizontal synchronizing signal of a CRT such as a television or a personal computer to the duty of a liquid crystal display module.
第１図に水平同期信号の間引き回路を利用した液晶表示
装置の全体構成図を示す。FIG. 1 shows an overall configuration diagram of a liquid crystal display device using a horizontal synchronizing signal thinning circuit.
本発明はテレビチェナーの画像を、デユティ−１／２０
０の液晶表示モジエールに表示をした実施例である。The present invention allows images of TV Cheners to be displayed at duty-1/20.
This is an example in which the display is displayed on a liquid crystal display module 0.
テレビチュナーの１フイールドは２６２．５本の垂直分
解がある。これをそのまま１ ／２００デユティーの液
晶表示モジュールに表示しようとすると６２゜５本の画
像が不足してしまいテレビチェナーからの全体像が表示
されないことになる。この欠点を除去するには、テレビ
チュナーからの水平同期信号を４回に１回、間引けば間
引き回数は２６２．５ ／４＝６５．５本となり、はぼ
液晶表示モジュールのデユティ−１／２００に近くなり
、テレビチュナーの画像の全体が表示されることになる
。One field of a TV tuner has 262.5 vertical lines. If this were to be displayed on a 1/200 duty liquid crystal display module, five 62° images would be insufficient and the entire image from the TV screen would not be displayed. To eliminate this drawback, if the horizontal synchronization signal from the TV tuner is thinned out once every four times, the number of thinning signals becomes 262.5/4 = 65.5, which means that the duty of the liquid crystal display module is -1/ The number will be close to 200, and the entire image of the TV tuner will be displayed.
第１図に基づき、本発明の詳細な説明する。The present invention will be explained in detail based on FIG.
テレビチェナーからの垂直同期信号（ＶＳＹＮＣ）、水
平同期信号（Ｈ５ＹＮＣ） 、クロック信号（ＣＬ Ｋ
）は同期回路で、有効なビデオデータ（ＶＤψ〜３）が
発生すると、水平同期信号のイネーブル信号ｌが発生し
、カウンタのリセツトを解除し、アンドゲート２１を通
して、カウンタのクロック端子ＣＬに水平同期信号が供
給される。カウンタは水平同期信号が３発入力され、カ
ウンタの１７２分周出力と、１／４分周出力が同時に“
Ｈルベルになると、アンドゲート２２を通して、Ｄタイ
プフリップフロップのデータ端子りを“Ｈルベルにする
。Ｄタイプフリップフロップは、アンドゲート１の出力
である有効な水平同期信号２の立上がりでトリガーされ
、′Ｌ”レベルの出力信号７を発生する。Ｄタイプフリ
ップフロップのｉ出カフと、有効な水平同期信号の反転
信号を、アンドゲート２３で論理積をとることにより水
平同期信号を４回に１回間引いた水平同期信号８が得ら
れる。アンドゲート２２を多入力ゲートとし、インバー
タと組合せれば、任意の間引き回数をもつた回路が簡単
に構成できる０間引きされた水平同期信号８はラインア
ドレスカウンタ３１のクロ７りとして使用され、水平ド
ントカウンタ４１とともに、メモリ回路にビデオデータ
（ＶＤφ〜３）を書き込む、１Ｆき込まれたビデオデー
タは、液晶表示モジュールコントロール回路のクロック
及びタイムシェアリング信号１５等で、メモリ回路から
液晶表示データＤφ〜３として読み出される。第２図に
タイムチャートを載せる。Vertical synchronization signal (VSYNC), horizontal synchronization signal (H5YNC), clock signal (CLK) from TV chainer
) is a synchronization circuit, and when valid video data (VDψ~3) is generated, a horizontal synchronization signal enable signal l is generated, cancels the reset of the counter, and outputs horizontal synchronization to the clock terminal CL of the counter through the AND gate 21. A signal is provided. Three horizontal synchronization signals are input to the counter, and the 172 frequency division output and 1/4 frequency division output of the counter are simultaneously “
When the H level is reached, the data terminal of the D type flip-flop is set to the "H level" through the AND gate 22. An output signal 7 of 'L' level is generated. By ANDing the i output of the D type flip-flop and the inverted signal of the effective horizontal synchronizing signal using the AND gate 23, the horizontal synchronizing signal 8 obtained by thinning out the horizontal synchronizing signal once every four times is obtained. By making the AND gate 22 a multi-input gate and combining it with an inverter, a circuit with an arbitrary number of decimations can be easily constructed. Video data (VDφ~3) is written to the memory circuit together with the don't counter 41. The video data written in 1F is transferred from the memory circuit to the liquid crystal display data Dφ by the clock and time sharing signal 15 of the liquid crystal display module control circuit. ~3. The time chart is shown in Figure 2.
ＣＲＴの垂直分解能と液晶表示モジュールのデユティ−
が異なっても、ＣＲ７画像と液晶表示モジュール画像と
の相似性を保って表示することが可能であり、かつ簡単
な回路で構成が可能である。Vertical resolution of CRT and duty of liquid crystal display module
Even if they are different, it is possible to display the CR7 image and the liquid crystal display module image while maintaining their similarity, and it is possible to configure the CR7 image and the liquid crystal display module image with a simple circuit.
第１図は液晶表示装置の全体構成図、第２図はタイムチ
ャートである。
以上FIG. 1 is an overall configuration diagram of a liquid crystal display device, and FIG. 2 is a time chart. that's all
Claims (1)
信号と水平同期信号と論理積をとる第一のアンドゲート
と、前記第一のアンドゲートの出力信号を計数するカウ
ンタと、前記カウンタの任意の出力から水平同期信号を
間引きするためのゲートから構成される液晶表示装置。a first AND gate that ANDs a signal that enables a horizontal synchronization signal of a CRT image display device and the horizontal synchronization signal; a counter that counts an output signal of the first AND gate; and an arbitrary output of the counter. A liquid crystal display device consisting of a gate for thinning horizontal synchronization signals.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11195786A JPS62269197A (en) | 1986-05-16 | 1986-05-16 | Liquid crystal display unit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11195786A JPS62269197A (en) | 1986-05-16 | 1986-05-16 | Liquid crystal display unit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62269197A true JPS62269197A (en) | 1987-11-21 |
Family
ID=14574390
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11195786A Pending JPS62269197A (en) | 1986-05-16 | 1986-05-16 | Liquid crystal display unit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62269197A (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01307388A (en) * | 1988-06-06 | 1989-12-12 | Sony Corp | X-y matrix type display device |
| JPH02244884A (en) * | 1989-03-16 | 1990-09-28 | Fujitsu Ltd | Horizontal synchronizing signal adjustment circuit for ac type plasma display device |
-
1986
- 1986-05-16 JP JP11195786A patent/JPS62269197A/en active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01307388A (en) * | 1988-06-06 | 1989-12-12 | Sony Corp | X-y matrix type display device |
| JPH02244884A (en) * | 1989-03-16 | 1990-09-28 | Fujitsu Ltd | Horizontal synchronizing signal adjustment circuit for ac type plasma display device |
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