JPS62245885A - 複合カラ−映像信号のフイ−ルドメモリ - Google Patents
複合カラ−映像信号のフイ−ルドメモリInfo
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- JPS62245885A JPS62245885A JP61089791A JP8979186A JPS62245885A JP S62245885 A JPS62245885 A JP S62245885A JP 61089791 A JP61089791 A JP 61089791A JP 8979186 A JP8979186 A JP 8979186A JP S62245885 A JPS62245885 A JP S62245885A
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- Japan
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- 239000002131 composite material Substances 0.000 title description 3
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- 102100040862 Dual specificity protein kinase CLK1 Human genes 0.000 abstract 1
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Landscapes
- Television Signal Processing For Recording (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
一産業上の利用分野一
本発明ば、複合カラー映像信号の１フイ一ルド分をデジ
タル信号で記憶するフィールドメモリに関する。
タル信号で記憶するフィールドメモリに関する。
一発明の背景−
輝度信号と色信号からなる複合カラー映像信号を記憶す
るフィールドメモリは、ビデオテープレコーダ（Ｖ Ｔ
Ｒ）における同−力レーヤのスチル画像の記録、再生
に利用され、映像信号の記憶をデジタル信号とするとき
には信号伝送や輝度信号の階調補正等の信号処理を容易
にする。
るフィールドメモリは、ビデオテープレコーダ（Ｖ Ｔ
Ｒ）における同−力レーヤのスチル画像の記録、再生
に利用され、映像信号の記憶をデジタル信号とするとき
には信号伝送や輝度信号の階調補正等の信号処理を容易
にする。
このようなフィールドメモリへの映像信号の記憶には、
フロッピーディスク等から読出した映像信号を順次Ａ／
Ｄ変換してメモリに記憶させている。
フロッピーディスク等から読出した映像信号を順次Ａ／
Ｄ変換してメモリに記憶させている。
一発明が解決しようとする問題点−
従来のフィールドメモリは、入力画像信号を順次記憶す
るようにしているため、該メモリから読出した信号から
隣り合う走査線の対応する画素信号間の処理（ライン相
関処理等）では、両方の画素データが同一のメモリ素子
に記憶されることから隣り合う画素データの同時読出し
ができなくなる。
るようにしているため、該メモリから読出した信号から
隣り合う走査線の対応する画素信号間の処理（ライン相
関処理等）では、両方の画素データが同一のメモリ素子
に記憶されることから隣り合う画素データの同時読出し
ができなくなる。
また、スチルビデオシステムでは色差信号Ｒ−ＹとＢ−
Ｙが線順次で記録され、この色差信号を読出してＮＴＳ
Ｃ方式のテレビジョン信＠Ｌｆ春濤ナスＶＬ＋画仏苫垣
芸の面曲籍出１．力く要求されるが従来方式では、それ
ができない。
Ｙが線順次で記録され、この色差信号を読出してＮＴＳ
Ｃ方式のテレビジョン信＠Ｌｆ春濤ナスＶＬ＋画仏苫垣
芸の面曲籍出１．力く要求されるが従来方式では、それ
ができない。
このため、従来はビデオフロッピーから読み出したアナ
グロ信号の段階で遅延線を設け、両色差信号を同時化し
たうえで ＮＴＳＣに合成し、それをＡＤ変換してメモリに書き込
んでいた。又、フィールドメモリを使って同時化を行な
う場合は、フィールドメモリから２回に分けて読出し、
先に読出したデータをラインメモリに蓄え又は遅延させ
ておくことで後に読出したデータとの同時取出しを得る
ようにしている。しかし、この方式では読出しに必要な
時間がメモリへのアクセス時間の２倍となるという信号
処理の遅れになるし、フィールドメモリのほかにライン
メモリやシフトレジスタとその制御回路を必要とする問
題があった。
グロ信号の段階で遅延線を設け、両色差信号を同時化し
たうえで ＮＴＳＣに合成し、それをＡＤ変換してメモリに書き込
んでいた。又、フィールドメモリを使って同時化を行な
う場合は、フィールドメモリから２回に分けて読出し、
先に読出したデータをラインメモリに蓄え又は遅延させ
ておくことで後に読出したデータとの同時取出しを得る
ようにしている。しかし、この方式では読出しに必要な
時間がメモリへのアクセス時間の２倍となるという信号
処理の遅れになるし、フィールドメモリのほかにライン
メモリやシフトレジスタとその制御回路を必要とする問
題があった。
本発明の目的は、順次入力される走査線毎の画像信号を
記憶し、記憶した複数の走査線間の画素データの同時読
出しができるようにした、フィールドメモリを提供する
ことにある。
記憶し、記憶した複数の走査線間の画素データの同時読
出しができるようにした、フィールドメモリを提供する
ことにある。
一問題点を解決するための手段−
前述した問題を解決するため、本発明は、順次入力され
る走査線毎の映像信号を該走査線が変る毎に複数の異な
るメモリ素子に記憶し、この複数のメモリ素子から隣り
合った走査線の画像情報を同時に読出す構成にしたもの
である。
る走査線毎の映像信号を該走査線が変る毎に複数の異な
るメモリ素子に記憶し、この複数のメモリ素子から隣り
合った走査線の画像情報を同時に読出す構成にしたもの
である。
一実施例−
第１図は本発明の一実施例を示す回路図であり、スチル
ビデオシステムのフロッピーディスクから再生した色差
信号Ｒ−ＹとＢ−Ｙを記憶するフィールドメモリの場合
である。スチルビデオシステムのフロッピーディスクに
は輝度信号と色信号とが分離されて記録されており、色
信号はＲ−ＹとＢ−Ｙの色差信号として線順次で記録さ
れ、トラック１周に １フイ一ルド分が記録され、フロッピーディスクの１回
転毎に各信号が１フイ一ルド分再生される、この再生信
号のうち、色差信号Ｒ−Ｙ、Ｂ−ＹはＡ／Ｄ変換変換器
上って、そのサンプリングレートがクロックＣＬＫＩ
（Φ３．５Ｍ）１２）から決められて１ライン当り２５
８バイトで順次デジタル信号に変換される。
ビデオシステムのフロッピーディスクから再生した色差
信号Ｒ−ＹとＢ−Ｙを記憶するフィールドメモリの場合
である。スチルビデオシステムのフロッピーディスクに
は輝度信号と色信号とが分離されて記録されており、色
信号はＲ−ＹとＢ−Ｙの色差信号として線順次で記録さ
れ、トラック１周に １フイ一ルド分が記録され、フロッピーディスクの１回
転毎に各信号が１フイ一ルド分再生される、この再生信
号のうち、色差信号Ｒ−Ｙ、Ｂ−ＹはＡ／Ｄ変換変換器
上って、そのサンプリングレートがクロックＣＬＫＩ
（Φ３．５Ｍ）１２）から決められて１ライン当り２５
８バイトで順次デジタル信号に変換される。
Ａ／Ｄ変換器１の変換出力は３ステートバッファ２，３
を通して夫々メモリ素子４゜５ （２５ｆｌＫ、ＳＲＡ
Ｍ ）のデータ入出力端子りに与えられる。３ステート
バッファ２，３はデータの記憶（書込み）と読出しの切
換信号ＲＥＣ／ＰＲが記憶側にあるときに能動にされる
。
を通して夫々メモリ素子４゜５ （２５ｆｌＫ、ＳＲＡ
Ｍ ）のデータ入出力端子りに与えられる。３ステート
バッファ２，３はデータの記憶（書込み）と読出しの切
換信号ＲＥＣ／ＰＲが記憶側にあるときに能動にされる
。
メモリ素子４．５の、そのアドレスには、色差信号Ｒ−
Ｙ、Ｂ−Ｙの１ライン中での各画素のアドレスを下位８
ビツトのカウンタ６によるクロックＣＬＫ、の計数で与
え、ラインの値（１〜２５６）になる上位アドレスを８
ビツトのカウンタ７による水平同期信号Ｈ５ＹＮＣの計
数で与える。このカウンタ７のうち、最下位１ビツト（
２”）出力はメモリ素子４，５のチャツプセレクト入力
端子Ｃ３に与えられ、論理インバータ８の介在によって
メモリ素子４．５が相補的に選択される。これによって
、線順次で与えられる色差信号Ｒ−ＹとＢ−Ｙは一方が
メモリ素子４に記憶され他方がメモリ素子５に記憶され
る。アンドゲート９．１０は切換信号ＲＥＣ／Ｐａが記
憶側にあるときにカウンタ７の最下位ビット出力でメモ
リ素子４．５を交互に選択させ、読出し側にあるときに
メモリ素子４．５の両方を選択させる。
Ｙ、Ｂ−Ｙの１ライン中での各画素のアドレスを下位８
ビツトのカウンタ６によるクロックＣＬＫ、の計数で与
え、ラインの値（１〜２５６）になる上位アドレスを８
ビツトのカウンタ７による水平同期信号Ｈ５ＹＮＣの計
数で与える。このカウンタ７のうち、最下位１ビツト（
２”）出力はメモリ素子４，５のチャツプセレクト入力
端子Ｃ３に与えられ、論理インバータ８の介在によって
メモリ素子４．５が相補的に選択される。これによって
、線順次で与えられる色差信号Ｒ−ＹとＢ−Ｙは一方が
メモリ素子４に記憶され他方がメモリ素子５に記憶され
る。アンドゲート９．１０は切換信号ＲＥＣ／Ｐａが記
憶側にあるときにカウンタ７の最下位ビット出力でメモ
リ素子４．５を交互に選択させ、読出し側にあるときに
メモリ素子４．５の両方を選択させる。
１１は同期信号Ｓ ＹＮＣから水平同期信号Ｈ５ＹＮＣ
と垂直同期信号Ｖ ５ＹＮＧを分離するための同期分離
回路であり、垂直同期信号 Ｖ ５ＹＮＣはカウンタ７のリセット信号とされ、また
水平同期信号Ｈ５ＹＮＣはカウンタ６のリセット信号に
される。
と垂直同期信号Ｖ ５ＹＮＧを分離するための同期分離
回路であり、垂直同期信号 Ｖ ５ＹＮＣはカウンタ７のリセット信号とされ、また
水平同期信号Ｈ５ＹＮＣはカウンタ６のリセット信号に
される。
こうした構成により、フロッピーディスクから線順次で
与えられる色差信号Ｒ−Ｙ、Ｂ−Ｙは、その一方例えば
Ｒ−Ｙがメモリ素子４に記憶され、隼方Ｂ−Ｙがメモリ
素子５に記憶される。そして、色差信号の読出し時には
メモリ素子４，５からＩ’ｌ−ＹとＢ−Ｙの同時読出し
が行われる。従って、隣り合う画素データ間の処理やＮ
ＴＳＣ方式のテレビジョン信号へノ合成にメモリ素子４
，５の両方からの色差信号の同時出力によって行うこと
ができ、このとき従来のラインメモリ等の同時読出しの
ための制御回路を不要にしながら読出し時間の遅れも無
くなる。
与えられる色差信号Ｒ−Ｙ、Ｂ−Ｙは、その一方例えば
Ｒ−Ｙがメモリ素子４に記憶され、隼方Ｂ−Ｙがメモリ
素子５に記憶される。そして、色差信号の読出し時には
メモリ素子４，５からＩ’ｌ−ＹとＢ−Ｙの同時読出し
が行われる。従って、隣り合う画素データ間の処理やＮ
ＴＳＣ方式のテレビジョン信号へノ合成にメモリ素子４
，５の両方からの色差信号の同時出力によって行うこと
ができ、このとき従来のラインメモリ等の同時読出しの
ための制御回路を不要にしながら読出し時間の遅れも無
くなる。
なお、第１図においてはライン番号の奇数番目と偶数番
目のものを組合せた同時読出しになるが、この組合せは
カウンタ６．７の各出力に少しのゲート素子を付加して
適宜変更されるものである。
目のものを組合せた同時読出しになるが、この組合せは
カウンタ６．７の各出力に少しのゲート素子を付加して
適宜変更されるものである。
また、入力信号としては色差信号の場合を示したが、こ
れは他の画像信号にも適宜対応できるものである。例え
ば、輝度信号には、その広帯域化によってＡ／Ｄ変換器
１の処理速度を上げ、メモリ素子４，５の容量を４倍（
Ｉ ＭＳＲＡＭ）にし、カウンタ６．７Ｌ７Ｊ：るアド
レスを２ビツト増設することで実現される。第２図はメ
モリ素ｆに２５６ ＫＳＲＡＭのものを８個用いて輝度
信号の記憶と隣り合った走査線の同時読出しをするため
の実施例を示す。同図中、メモリ素子２１〜２４には輝
度信号ラインの奇数番目のデータを記憶し、２５〜２８
には偶数番目のデータを記憶し、カウンタ２９，３０か
らなるラインのアドレスデータのうち下位３ビツトから
デコーダ３１によって８つのメモリ素子２１〜２８のう
ちの１つを選択し１画素のアドレスデータにはカウンタ
３２，３３．３４による ｌＯビットデータを当て、ラインデータをメモリ素子２
１〜２８に順次（２１，２５゜２２、・・・）記憶させ
、読出し時には対のメモリ素子（２１と２５．・・・）
から同時に行われる。この場合も読出しメモリ素子の組
合せは適宜設計変更できるのは勿論である。
れは他の画像信号にも適宜対応できるものである。例え
ば、輝度信号には、その広帯域化によってＡ／Ｄ変換器
１の処理速度を上げ、メモリ素子４，５の容量を４倍（
Ｉ ＭＳＲＡＭ）にし、カウンタ６．７Ｌ７Ｊ：るアド
レスを２ビツト増設することで実現される。第２図はメ
モリ素ｆに２５６ ＫＳＲＡＭのものを８個用いて輝度
信号の記憶と隣り合った走査線の同時読出しをするため
の実施例を示す。同図中、メモリ素子２１〜２４には輝
度信号ラインの奇数番目のデータを記憶し、２５〜２８
には偶数番目のデータを記憶し、カウンタ２９，３０か
らなるラインのアドレスデータのうち下位３ビツトから
デコーダ３１によって８つのメモリ素子２１〜２８のう
ちの１つを選択し１画素のアドレスデータにはカウンタ
３２，３３．３４による ｌＯビットデータを当て、ラインデータをメモリ素子２
１〜２８に順次（２１，２５゜２２、・・・）記憶させ
、読出し時には対のメモリ素子（２１と２５．・・・）
から同時に行われる。この場合も読出しメモリ素子の組
合せは適宜設計変更できるのは勿論である。
−発明の効果−
以上の説明から明らかなように、本発明は順次入力され
る走査線毎の画像信号を走査線別に異なるメモリ素子に
記憶し、複数のメモリ素子から隣り合った走査線の画像
情報を同時に読出すようにしたため、隣り合った走査線
の画素信号間の処理や合成を高速処理できるし、構成の
簡単化を図ることができる効果がある。
る走査線毎の画像信号を走査線別に異なるメモリ素子に
記憶し、複数のメモリ素子から隣り合った走査線の画像
情報を同時に読出すようにしたため、隣り合った走査線
の画素信号間の処理や合成を高速処理できるし、構成の
簡単化を図ることができる効果がある。
第１図は本発明の一実施例を示す回路図、第２図は本発
明の他の実施例を示す回路図である。 ｌ・・・Ａ／Ｄ変換器、 ４．５・・・メモリ素子、 ６．７・・・カウンタ、 １１・・・同期分離回路、 ２１．２８・・・メモリ素子、 ２９．３４・・・カウンタ、 ３１・・・デコーダ、
明の他の実施例を示す回路図である。 ｌ・・・Ａ／Ｄ変換器、 ４．５・・・メモリ素子、 ６．７・・・カウンタ、 １１・・・同期分離回路、 ２１．２８・・・メモリ素子、 ２９．３４・・・カウンタ、 ３１・・・デコーダ、
Claims (1)
- １）順次入力される走査線毎の画像信号を該走査線が変
る毎に複数の異なるメモリ素子に記憶し、この複数のメ
モリ素子から隣り合った走査線の画像情報を同時に読出
す構成にしたことを特徴とすフィールドメモリ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61089791A JPS62245885A (ja) | 1986-04-18 | 1986-04-18 | 複合カラ−映像信号のフイ−ルドメモリ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61089791A JPS62245885A (ja) | 1986-04-18 | 1986-04-18 | 複合カラ−映像信号のフイ−ルドメモリ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62245885A true JPS62245885A (ja) | 1987-10-27 |
Family
ID=13980509
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61089791A Pending JPS62245885A (ja) | 1986-04-18 | 1986-04-18 | 複合カラ−映像信号のフイ−ルドメモリ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62245885A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01274574A (ja) * | 1988-04-27 | 1989-11-02 | Canon Inc | 画像記憶装置 |
| US5470382A (en) * | 1992-02-19 | 1995-11-28 | Nissei Kabushiki Kaisha | Biodegradable molded articles |
-
1986
- 1986-04-18 JP JP61089791A patent/JPS62245885A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01274574A (ja) * | 1988-04-27 | 1989-11-02 | Canon Inc | 画像記憶装置 |
| US5470382A (en) * | 1992-02-19 | 1995-11-28 | Nissei Kabushiki Kaisha | Biodegradable molded articles |
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