JPS62186612A - トランジスタをオフ状態にするためのフイ−ドバツク制御装置 - Google Patents

トランジスタをオフ状態にするためのフイ−ドバツク制御装置

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JPS62186612A
JPS62186612A JP62022624A JP2262487A JPS62186612A JP S62186612 A JPS62186612 A JP S62186612A JP 62022624 A JP62022624 A JP 62022624A JP 2262487 A JP2262487 A JP 2262487A JP S62186612 A JPS62186612 A JP S62186612A
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transistor
collector
switch
coupled
base
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JP62022624A
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ダビデ　チエリ
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S G S Mikuroeretoronikaesu P E
S G S MIKUROERETORONIKAESU P EE
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、伝達回路の最終段の生きているトランジスタ
をオフ状態にするためのフィードバック制御ｖ装置に関
する。
本発明の制ｍ＋装置１よとくに、異なる時間にレベルの
異なる２種類の電１［をその出力端子に発生し、外部命
令により前記レベルの一方から能力へ切換わるようない
わゆる伝達回路の最終段を形成するトランジスタをオフ
状態にすることを＄す御するのに使用する。
もちろんこの切換えは、伝達回路の最終段を形成するト
ランジスタのコレクタまたはエミッタのいずれかに結合
されるそれ自身既知の負荷をまたいで行われる。
伝達操作とは、回路の初期条件に応じて伝達回路の最終
段を形成するトランジスタをオンまたはオフの状態にす
ることを含む。ざらにとくには、オフ状態にされるべき
前記トランジスタはそのベースが駆動トランジスタのコ
レクタとスイッチオフトランジスタのコレクタとに電気
結合され、一方駆動トランジスタとスイッチオフトラン
ジスタとのベースは前記伝達回路の第１段を形成するト
ランジスタに結合される。
既知のように、トランジスタを含む伝達回路を使用する
場合に伴なう主要な問題は、伝達操作中に、ある特定の
トランジスタのオフ状態のｌｌｌｊ問を正確に制御する
ことである。
従来の技術とその問題点 スイッチオフ、したがって回路のスイッチ切換えを行な
う従来方法の特徴は、回路の最終段を形成する前記トラ
ンジスタをオフ状態にするのに他のトランジスタを使用
することであり、この他のトランジスタはいわゆるスイ
ッチオフトランジスタであっては、これは前者のトラン
ジスタがオフ状態に保持される期間中飽和領１ｉ＠　（
ＳＡＴ）内に保持される。
このようにスイッチオフトランジスタは、とくに飽和ｆ
ｆｊ　ＶＡにあって、オフ状態にすべきトランジスタの
ベースから電流を引出すことによって回路が切換えられ
るときはいつでも作動させられて当該トランジスタをオ
フ状態とし、回路全体の切換えが行われる。
イタリア特許第２３６４６Ａ／８１号に開示のような従
来技術の他の方法は、１ム達回路の最終段に供給される
いわゆる駆動トランジスタの飽和電圧を検知する装置を
促供する方法である。この装置は、駆動トランジスタが
その飽和作動領域から抜は出すまでは、スイッチオフト
ランジスタを導通状態、とくにフォワード能動領域（７
△［）〉内に保持するのに有効である。
前者の例では、スイッチオフトランジスタは高飽和領域
で２１コ動するので飽和トランジスタ内では電荷が蓄積
しやすく、次にスイッチを切換えるときに、伝達回路内
の最終段が導通状態に復帰される前にこれらの電６むを
除去しなければならないという大きな不利が伴なう。こ
れにより、回路のスイッチを切換えるための外部命令に
対する回路応答にかなりの時間遅れが発生する。
後者の例では、スイッチオフトランジスタ１よフ４ワー
ド能動領域内で作動するが、この方法は、（の［１的を
実質的に達成する間、オフ状（原にされるべきトランジ
スタの実際状態に依存するよりもむしろ駆動トランジス
タの状（ｍにＩＮ　（ｒ−シ、したがって駆動トラジス
タの飽和電圧を検知する装置を回路に組込むことを必要
とするという欠点がある。
発明の要約 本発明の基本となる問題は、スイッチオフトランジスタ
を内蔵する伝達回路のための回路構成であって、伝達回
路の最終段を形成しオフ状態にされるべきトランジスタ
をオフ状態とするのに必要なら、Ｌうどその間だけスイ
ッチオフトランジスタを作Ｕノさけ“るような回路構成
を提供づることであって、これにより上記の従来技術の
欠点を回避できる。
この問題は本発明により、伝達回路の最終段を形成し、
そのベースが駆動トランジスタのコレクタと、スイッチ
オフトランジスタのコレクタとに電気結合されるトラン
ジスタをオフ状態にするためのフィードバックａｉｌり
１１装置であって、−り駆動］・ランジスタとスイッチ
オフ１−ランジスタどのベースは前記伝ｊヱ回路の第１
段を形成するトランジスタに結合されているところの装
置においで二オフ状態番こされるべき前記トランジスタ
と電源の一方の極との間に挿入される電流はン４Ｊと；
前記センリ″と電気結合される電流変換器と：および 前記変換器と前記伝達回路の前記第１段との間に挿入さ
れるスイッチと； を有することを特徴とでるトランジスタをオフ状態にす
るためのフィードバック制御ＩＩ装胃により解決される
。
本発明の特徴Ｊ３よび利点は、実施例を示１−添トＪ図
而に関する以下の説明により１ＴＩＩ解されようが、実
施例はこの好ましい実施例に限るものではない。
乱丸乳 図によると、伝達回路１は最終段にオフ状態にされるべ
きトランジスタＴ３を有し、トランジスタＴ３のベース
Ｂ３は駆動トランジスタ゛Ｆ２のコレクタＣ２とスイッ
チオフトランジスタＴ４の」レクタＣ４に結合され、一
方駆動トランシスター「２のベースＢ２どスイッチオフ
トランジスタＴ４のベースＢ４とは、前記伝達回路１の
第１段を形成する甲−トランジスタＴ１のコレクタＣ１
１と０１２とにそれぞれ結合される。
オフ状態にされるべき前記トランジスタＴ３のコレクタ
Ｃ３と電源の三極ＶＣとの間に、電流センナ２が挿入さ
れる。
３は尋５１６を介して電流レン’Ｊ−２に電気結合され
る電流変換器を示ず。
４は加算ノードを示し、これ自身は既知であるのでその
回路説明は詳細には行わないが、加Ｑノード４は、導線
７を介して前記電流変換器３に接続され、また導線８を
介して伝達回路１の前記駆動トランジスタＴ２のベース
Ｂ２に接続される。
ブロック５は、前記変換器３を伝達回路１の前記第１段
Ｔ１のベースに結合重る結線ケーブル９十に挿入される
スイッチを有する。前記スイッチ５は実際の回路ではＯ
ｒｊ記電流変換器３に内蔵されることが多い。
オフ状態にされるべきトランジスタＴ３のコレクタとエ
ミッタとにそれぞれ端子Ｃと［とが設けられ、これらは
伝達回路１の外部にあってそれ自身既知の負Ｒに結合さ
れる。
とくに第２図を参照すると、前記伝達回路１はその最終
段としてオフ状態にされるべぎ館記ｌ−ランジスタＴ３
を有し、トランジスタＴ３はｎｐｎ形で、エミッタＥ３
は通常の負ｖｉ２ｃを介して接地され、コレクタＣ３は
前記電流センリ２を形成づる抵抗器Ｒ１を介して電源電
圧のｎｆＩ記（少ＶＣに結合され、またＢ３はｎｐｎ形
のスイッチオフ１−ランジスタＴ４のコレクタＣ４とｎ
ｐｎ形の駆動トランジスタＴ２のコレクタＣ２とに結合
される。
面記スイッチＡフトランジスタＴ　４　ｉ；ｔ　Ｔ　３
の−Ｉエミッタ結合されるエミッタＥ４と、前記トラン
ジスタ１１のコレクタＣ１２に電気結合されるベースＢ
４とを有し、ｐｎｐ形であって２つのコレクタをイｊす
るトランジスタ王１は伝達回路１の前記第１段を形成す
る。
前記ベースＢ４と前記エミッタＥ１１との間に甲向要系
、とくにダイオードＤ４が挿入される。
一方ｐｎｐ型の駆動トランジスタＴ２のエミッタＥ２は
前記電源極ＶＣに結合され、そのベースＢ２ちダイオー
ドＤ２を挾んでｉ４　Ｖ　ｃと、伝達回路第１段の前記
トランジスタＴ１のコレクタＣ１１とに結合される。ト
ランジスタＴ１のエミッタＥ１は極Ｖｃに結合され、そ
のベースＢ１はダイオードＤ１を介してそれ自身のエミ
ッタＥ１に結合される。
＠記電気結合導線６の一端はオフ状態にされるべきトラ
ンジスタＴ３のコレクタｃ３に結合され、他端は前記電
流変換器３の入力側に結合される。
電流変換２Ｓ３は相Ｈに並列結合をなす一対の増幅器Ｋ
ｌ、に２を有し、増幅器Ｋｌ、に２は前記クープル導線
６を介して前記コレクタｃ３に電気結合される。
対の中の第１の増幅器に１はその出力側にトランジスタ
Ｔ５のベースＢ５を有し、トランジスタＴ５のエミッタ
Ｅ５は接地され、そのコレクタＣ５は加ε１ノード４に
結合される。
対の中の第２のｊｌり幅器に２はノードＡに通じる出力
側を有し、ノードＡからはトランジスタＴ６のベースが
出て、トランジスタＴ６のエミッタ［６は接地され、そ
のコレクタｃ６は前記クープル導線９を介して伝達回路
１の第１段Ｔ１のベースＢ１に電気結合される。
前記ノードＡにはまたトランジスタＴ７のコレクタＣ７
がＩｌ’１合され、トランジスタＴ７のエミッタＥ７ば
接地され、そのベース８７は外部端子Ｒに結合される。
前記トランジスタＴ７は前記スイッチ５を形成し、端子
Ｒはオフ状態にされるべきトランジスタＴ３のオフ状態
を制御Ｖる図示されていない外部スイッチの端子を示す
。
加篩ノード４はまた外ＦＡ端子Ｓに結合される入力を有
し、端子Ｓは逆に前記トランジスタＴ３のオン状態を制
御する図示されていない外部スイッチの端子となる。
次に加算ノード４は導線８を介して駆動トランジスタＴ
２のベースＢ２に電気結合される出力を有する。
本発明による装置の作動は、セン量す２により測定され
る電流であってオフ状態にされるべきトランジスタＴ３
のコレクタ電流１ｃの大きさが基礎になる。すなわち前
記電流の関数である電圧信号は１−ランシスター「３の
コレクタＣ３からピックアップされ、導線６を介して電
流変換器３の入力側に供給される。変換器は並列結合の
増幅器対Ｋｌ。
Ｋ２を介してこの信号を増幅し、トランジスタＴ５、Ｔ
６を介してそれぞれ前記コレクタ電流に比例する第１お
よび第２の信号を出力する。
加ｎノード４は２つの入力を有する論理ＯＲゲートに類
似し、これらの入力の一つは導線７により電流変換器３
に結合され、一方で他の入力は「オン」信号が出現する
外部端子Ｓに結合される。
したがって加ｑノード４はその入力側で、端子Ｓから「
オン」信号と、オフ状態にされるべきトランジスタＴ３
のコレクタ電流に比例り−る電流変換器３の出力信号と
を受ける。
前記加Ｃ）ノードからの出力はケーブル導線８を介して
駆動トランジスタ■２のベースＢ２にフィードバックさ
れる。
「オン」信号が存在すると「オン」信号は加締ノード４
を介して駆動トランジスタＴ２をオン状態にし、一方駆
動トランジスタＴ２のほうは［・ランシスタＴ３をオン
状態にする。このとぎに電流レンサ２と変換器３とは、
たとえ「オン」信号が存在しなくとも、コレクタ電流に
比例する加算ノード４からのフィードバック信号により
、トランジスタＴ２，３の両方をオン状態に保持する。
−力変換器３により発生されトランジスタ■３のコレク
タ電流に比例する第２のＢ号は、導線９を介してスイッ
チ５を横切って、伝達回路１の第１段のトランジスタＴ
１のベースＢ１へ送られる。
「オフ」信号が端子Ｒに供給されると、スイッチ５を形
成するトランジスタＴ７は、伝ｊ″￥回路１の第１段に
あるトランジスタＴ１に、オフ状態にされるべきトラン
ジスタＴ３のコレクタ電流１ｃに比例した信号の供給を
可能とする。４−ランシスタＴ１はスイッチトランジス
タＴ４のスイッチをオンどし、両トランジスタＴ１．Ｔ
’４は駆動１−ランジスタＴ２とオフ状態にされるべき
トランジスタＴ３どのそれぞれをオフ状態にし、かくし
て回路１の全体のスイッチの切換えが行われる。
本発明による装「１の明白な利点は、伝達回路の第１段
のトランジスタＴ１がオフ状態とされると、］ヘランジ
スタＴ１は、駆ｉ１Ｊ　＋−ランジスタＴ２を効果的に
オフ状態にすると同時にスイッチオフトランジスタＴ４
を効果的にオフ状態とづるのに十分に飽和領域の境界に
保持され、この結果最終段重３のスイッチはオフ状態に
されて伝達操作が有効に行われることである。
消費電力が少ないこと、およびとくにオフとオンとのフ
ェーズにおける伝達速度が甲いことが利点である。
【図面の簡単な説明】
第１図は本発明によるフィードバック−１１１１］装置
のブロック線図を示し、および 第２図（３１第１図の装置の詳細図と伝達回路への結線
図である。 １・・・電源、２・・・電＊Ｌンリ、３・・・宙°流変
換器、４・・・加０）−ド、５・・・スイッチ、６．７
．Ｆｌ、Ｅ−３・・・導線、Ｂ　１−７・・・エミッタ
、Ｉｃ・・・■】レクタ電流、Ｋ１．２・・・増幅器、
−ｒ　ｉ　−７・・・１ヘランジスタ、［ぐ１・・・ｉ
（抗器、ＶＣ・・・電源極、ＺＣ・・・抵抗、Ｃ８Ｆ、
Ｒ，Ｓ・・・外部端子。

Claims (5)

    【特許請求の範囲】
  1. （１）伝達回路の最終段を形成し、そのベースが駆動ト
    ランジスタのコレクタと、スイッチオフトランジスタの
    コレクタとに電気結合されるトランジスタをオフ状態に
    するためのフィードバック制御装置であって、一方駆動
    トランジスタとスイッチオフトランジスタとのベースは
    前記伝達回路の第１段を形成するトランジスタに結合さ
    れているところの装置において： オフ状態にされるべき前記トランジスタＴ３と電源の一
    方の極との間に挿入される電流センサ２と； 前記センサと電気結合される電流変換器２と；および 前記変換器と前記伝達回路の前記第１段との間に挿入さ
    れるスイッチ５と； を有することを特徴とするトランジスタをオフ状態にす
    るためのフィードバック制御装置。
  2. （２）前記電流センサ２は、オフ状態にされるべき前記
    トランジスタＴ３のコレクタＣ３と電源の一方の極との
    間に結合された抵抗器Ｒ１を有することを特徴とする特
    許請求の範囲第１項に記載の装置。
  3. （３）前記電流変換器３は並列結合された一対の増幅器
    Ｋ１、Ｋ２を有し、増幅器Ｋ１、Ｋ２において、それら
    の入力は前記コレクタＣ３に電気結合され、それらの各
    出力はそのエミッタガ接地されているトランジスタのベ
    ースに結合されることを特徴とする特許請求の範囲第１
    項記載の装置。
  4. （４）前記スイッチ５はトランジスタＴ７を有し、トラ
    ンジスタＴ７は、接地されたエミッタＥ７と、外部端子
    Ｒに結合されるベースＢ７と、および前記電流変換器３
    の増幅器Ｋ１の出力側に配置されるトランジスタＴ６の
    ベースＢ６に結合されるコレクタとを有することを特徴
    とする特許請求の範囲第１項に記載の装置。
  5. （５）伝達回路の最終段を形成し、そのベースが駆動ト
    ランジスタのコレクタと、スイッチオフトランジスタの
    コレクタとに電気結合されるトランジスタをオフ状態に
    するためたのフィードバック制御装置であって、一方駆
    動トランジスタとスイッチオフトランジスタとのベース
    は前記伝達回路の第１段を形成するトランジスタに結合
    されているところの装置において： オフ状態にされるべき前記トランジスタＴ３と電源の一
    方の極との間に挿入される電流センサ２と； 前記センサと電気結合される電流変換器２と；前記変換
    器に電気結合される第１の入力と、「オン」制御外部端
    子に電気結合される第２の入力とを有する加算ノード４
    と； 前記変換器と前記伝達回路の前記第１段との間に挿入さ
    れるスイッチ５と；および 前記加算ノード４と前記駆動トランジスタＴ２のベース
    Ｂ２との間の電気結線と； を有することを特徴とするトランジスタをオフ状態にす
    るためのフィードバック制御装置。
JP62022624A 1986-02-06 1987-02-04 トランジスタをオフ状態にするためのフイ−ドバツク制御装置 Pending JPS62186612A (ja)

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IT19309/86A IT1188335B (it) 1986-02-06 1986-02-06 Dispositivo di controllo in retroazione per lo spegnimento di un transistore
IT19309A/86 1986-02-06

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JPS62186612A true JPS62186612A (ja) 1987-08-15

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ID=11156609

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Application Number Title Priority Date Filing Date
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US (1) US4763016A (ja)
JP (1) JPS62186612A (ja)
DE (1) DE3703661C2 (ja)
FR (1) FR2593980B1 (ja)
GB (1) GB2186454B (ja)
IT (1) IT1188335B (ja)
NL (1) NL8700009A (ja)

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Also Published As

Publication number Publication date
IT1188335B (it) 1988-01-07
IT8619309A1 (it) 1987-08-06
NL8700009A (nl) 1987-09-01
GB8629637D0 (en) 1987-01-21
FR2593980B1 (fr) 1991-03-22
GB2186454A (en) 1987-08-12
DE3703661C2 (de) 1995-09-14
IT8619309A0 (it) 1986-02-06
FR2593980A1 (fr) 1987-08-07
GB2186454B (en) 1989-11-01
US4763016A (en) 1988-08-09
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