JPS6140085U - ダイヤルパルス受信回路 - Google Patents

ダイヤルパルス受信回路

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Publication number
JPS6140085U
JPS6140085U JP12599984U JP12599984U JPS6140085U JP S6140085 U JPS6140085 U JP S6140085U JP 12599984 U JP12599984 U JP 12599984U JP 12599984 U JP12599984 U JP 12599984U JP S6140085 U JPS6140085 U JP S6140085U
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JP
Japan
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dial pulse
terminal
signal
pulse signal
receiver circuit
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Pending
Application number
JP12599984U
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English (en)
Inventor
公雄 池森
Original Assignee
株式会社東芝
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】 第1図は本考案の一実施例の回路図、第2図および第3
図はそれぞれ第1図に示した実施例回路の具体動作例を
説明するためのタイムチャート、第4図および第5図は
それぞれ従来のダイヤパルス受信回路を示す回路図、第
6図および第7図はそれぞれ第5図に示した従来回路の
具体的動作を説明するためのタイムチャートである。 1・・・’K話機、2, 2 0・・・ダ′イヤルパ
ルス受信部、3・・・抵抗、4・・・コンデンサ、5・
・・積分回路、6・・・シュミットトリガ回路、7.2
1・・・インバータ、8,9,22.23・・・シフト
レジスタ、自0,11・・・アンド、ゲート、12,2
4・・・R−S形フリツプフロツプ回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電子交換機におけるダイヤパルス受信回路において、受
    信したダイヤルパルス信号がクリア端子に加えられかつ
    データ入力端子がプルアップされた第1のシフトレジス
    タと、前記ダイヤルパルス信号の論理反転信号がクリア
    端子に加えられかつデータ入力端子がプルアップされた
    第2のシフトレジスタと、該第1および第2のシフトレ
    ジスタの所定段の出力がそれぞれセット端子およびリセ
    ット端子に加えられるフリツプフロツプ回路とを具え、
    該フリツプフロツプ回路の出力信号をダイヤルパルス信
    号として処理するようにしたダイヤルパルス受信回路。
JP12599984U 1984-08-20 1984-08-20 ダイヤルパルス受信回路 Pending JPS6140085U (ja)

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JPS6140085U true JPS6140085U (ja) 1986-03-13

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