JPS6132404Y2 - - Google Patents

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JPS6132404Y2
JPS6132404Y2 JP1818180U JP1818180U JPS6132404Y2 JP S6132404 Y2 JPS6132404 Y2 JP S6132404Y2 JP 1818180 U JP1818180 U JP 1818180U JP 1818180 U JP1818180 U JP 1818180U JP S6132404 Y2 JPS6132404 Y2 JP S6132404Y2
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JP
Japan
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circuit
output
differential
amplifier
proportional
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JP1818180U
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JPS56122154U (ja
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Description

【考案の詳細な説明】 本考案は、測定値微分形調節計に用いて好適な
比例+微分演算を行うアナログ演算回路の改良に
関する。
測定値微分形調節計の演算式は、測定値をF
M、設定値をES、出力値をEo、微分時間をTD
微分ゲインをn、積分時間をTI、比例帯をPBと
すると、 で表わされる。そして(1+STD)/(1+1/n STD)なる比例+微分演算は、従来第1図に示す
ようなアナログ演算回路で行われている。第1図
において、演算増幅器OP1と演算抵抗R1,R2およ
び分圧比が1/αなる分圧抵抗器RVは増幅回路A を、演算増幅器OP2と演算抵抗RDおよびコンデ
ンサCDは積分回路Iを、また演算増幅器OP3
演算抵抗r1〜r4は加算回路ADをそれぞれ構成し
ている。増幅回路Aはその帰還回路に接続された
積分回路Iとで入力信号Eiの微分演算を行い、
次式に示す如き出力Edを生ずる。
この微分演算出力EDと入力信号Eiとを加算回
路ADで加算して、 なる比例+微分演算出力Eoを得ている。なお増
幅回路Aとしては第2図に示すように反転形も用
いられている。この場合微分時間TD=R/R+R
DD、微分ゲインn=α、抵抗比R/R=n−1/
nとな る。このように従来は(1+STD)/(1+1/n STD)なる演算を、微分項と定値項に分けて演算
し、その後加算するようにしているため、加算回
路ADが必要となり回路構成が複雑となる欠点が
あつた。
本考案の目的は、比例+微分演算を簡単な回路
構成で実現できるアナログ演算回路を提供するに
ある。
第3図は本考案演算回路の一実施例を示す接続
図である。第3図において第1図の従来例と異る
ところは、積分回路Iで入力信号EIと出力信号
Eoとの差を積分し、その積分出力Efと入力信号
Eiとを増幅回路Aで加算増幅して出力信号Eoを
発生させることによつて加算回路ADを不用とし
た点である。このように構成した本考案において
は、積分回路Iの出力Efは、 Ef=(1+1/SC)Ei−1/SCEo(4) となる。よつて、増幅回路Aの出力には、 なる比例+微分演算出力Eoが得られる。(5)式に
おいて、微分時間TDおよび微分ゲインnはそれ
ぞれ、TD=R+R/RDD,n=αである。
なお、増幅回路Aとして反転形を用いる場合に
は第4図に示すように、入力信号Eiと出力信号
Eoとを各々抵抗R3,R4を介して積分回路Iに加
えるように構成すればよい。この場合の入出力関
係は となり、微分時間TDは2R/R+RD(RD
/2) で、微分ゲインnはαR/Rである。
以上説明したように本考案においては、比例+
微分演算を加算回路を必要としない簡単な回路構
成で行うことのできるアナログ演算回路が得られ
る。
【図面の簡単な説明】
第1図および第2図は従来の演算回路の一例を
示す接続図、第3図は本考案演算回路の一実施例
を示す接続図、第4図は本考案演算回路の他の実
施例を示す接続図である。 A……増幅回路、I……積分回路、AD……加
算回路、OP1〜OP3……演算増幅器。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力信号と出力信号の差を積分する積分回路
    と、演算増幅器とこの演算増幅器の出力を分圧し
    て入力側に負帰還するための分圧抵抗器からな
    り、前記積分回路の出力と前記入力信号とを前記
    分圧抵抗器の分圧比で決まるゲインで加算増幅し
    て前記出力信号を発生する増幅回路とを有し、比
    例+微分演算を行うことを特徴とするアナログ演
    算回路。
JP1818180U 1980-02-15 1980-02-15 Expired JPS6132404Y2 (ja)

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JPS56122154U JPS56122154U (ja) 1981-09-17
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